JPS628616A - 半導体集積回路 - Google Patents
半導体集積回路Info
- Publication number
- JPS628616A JPS628616A JP60147701A JP14770185A JPS628616A JP S628616 A JPS628616 A JP S628616A JP 60147701 A JP60147701 A JP 60147701A JP 14770185 A JP14770185 A JP 14770185A JP S628616 A JPS628616 A JP S628616A
- Authority
- JP
- Japan
- Prior art keywords
- control terminal
- row control
- type region
- conduction type
- mosfets
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、キーボード・インタフェースを有するコン
トローラを、キーボードを接続する代わりにマイクロ・
コンピュータなどで自動制御させる場合に必要となるア
ナログ・スイッチを有する半導体集積回路に関する。
トローラを、キーボードを接続する代わりにマイクロ・
コンピュータなどで自動制御させる場合に必要となるア
ナログ・スイッチを有する半導体集積回路に関する。
この発明は、キーボード・インターフェースを有するコ
ントローラを、マイクロ・コンビニル夕などで自動制御
させる場合に必要となるアナログ・スイッチを有する半
導体集積回路において、第二導電型の領域に形成された
複数個のMOSFETのソースが共通であってかつ、前
記第二導電型の領域及び行制御用端子に電気的に接続す
ることにより、MOSFETのソースと前記第二導電型
の領域とで形成されるPN接合ダイオードに流れる電流
を防止したり、バックゲートバイアス効果を防止するこ
とができるようにしたものである。
ントローラを、マイクロ・コンビニル夕などで自動制御
させる場合に必要となるアナログ・スイッチを有する半
導体集積回路において、第二導電型の領域に形成された
複数個のMOSFETのソースが共通であってかつ、前
記第二導電型の領域及び行制御用端子に電気的に接続す
ることにより、MOSFETのソースと前記第二導電型
の領域とで形成されるPN接合ダイオードに流れる電流
を防止したり、バックゲートバイアス効果を防止するこ
とができるようにしたものである。
従来、第2図(a)に示すようにキーボードの各キーの
代わりに、マトリックス状にアナログ・スイッチとして
動作するMOSFETを並べて、横1列のMOSFET
のドレインを全て共通として、列制御用端子3に接続し
、縦1列のMOSFETのソースを全て共通として、行
制御用端子2に接続し、これらのMOSFETをNチャ
ネル型とする場合には、全ての問5FETを共通のP型
領域5上に形成し、P壁領域5を接地電位としていた。
代わりに、マトリックス状にアナログ・スイッチとして
動作するMOSFETを並べて、横1列のMOSFET
のドレインを全て共通として、列制御用端子3に接続し
、縦1列のMOSFETのソースを全て共通として、行
制御用端子2に接続し、これらのMOSFETをNチャ
ネル型とする場合には、全ての問5FETを共通のP型
領域5上に形成し、P壁領域5を接地電位としていた。
第2図(b)は第2図(a)の断面図を示したものであ
る。
る。
〔発明が解決しようとする問題点]
しかし、従来技術においては、MOSFETのゲートの
ON、 OFFの制御を行う回路と、行制御用端子2、
列制御用端子3が接続されるべき、キーボード・インタ
フェースを有するコントローラとの間で電源電圧が異な
る場合に、たとえば、行制御用端子2の電位が接地電位
よりも低下して、MOSFETのソース7とP壁領域5
とで形成されるPN接合ダイオードが順方向となワて、
電流が流れたり、遂に行制御用端子2の電位が、接地電
位よりも高くなって、)’IO3FETにバックゲート
バイアス効果を生じ、アナログ・スイッチとしてのON
抵抗が増大するなどの問題点があった。
ON、 OFFの制御を行う回路と、行制御用端子2、
列制御用端子3が接続されるべき、キーボード・インタ
フェースを有するコントローラとの間で電源電圧が異な
る場合に、たとえば、行制御用端子2の電位が接地電位
よりも低下して、MOSFETのソース7とP壁領域5
とで形成されるPN接合ダイオードが順方向となワて、
電流が流れたり、遂に行制御用端子2の電位が、接地電
位よりも高くなって、)’IO3FETにバックゲート
バイアス効果を生じ、アナログ・スイッチとしてのON
抵抗が増大するなどの問題点があった。
上記問題点を解決するため、第二導電型領域5を行制御
用端子2ごとに設けるとともに、領域5と行制御用端子
2とを同電位とするようにした。
用端子2ごとに設けるとともに、領域5と行制御用端子
2とを同電位とするようにした。
上記のように接続された回路においては、行制御用端子
に加わる電圧が変化しても、第二導電型の領域表面に設
けられたP″領域通して、前記、第二導電型の領域とM
OSFETのソースの電位は常に等しく保たれる。これ
によって、前記、第二導電型の領域と、前記、MOSF
ETのソースとの間の寄生ダイオードに加わる電圧はO
vとなり、電流が流れることを防止することができる。
に加わる電圧が変化しても、第二導電型の領域表面に設
けられたP″領域通して、前記、第二導電型の領域とM
OSFETのソースの電位は常に等しく保たれる。これ
によって、前記、第二導電型の領域と、前記、MOSF
ETのソースとの間の寄生ダイオードに加わる電圧はO
vとなり、電流が流れることを防止することができる。
以下にこの発明の実施例を図面に基づいて詳細に説明す
る。第1図(a)は、この発明のキーボード・インター
フェース回路の概要を表したもので、マトリックス状に
配置されたMOSFET 1のソースとドレインがそれ
ぞれ、行制御用端子2及び列制御用端子3に接続されて
いる。第1図(b)は第1図(a)のMOSFET 1
の断面を見たものであり、第一導電型半導体基板4の上
に第二導電型の領域5を設け、MOSFET 1のソー
スと第二導電型の領域5がP″領域6を通して行制御用
端子2に共通に接続されている。
る。第1図(a)は、この発明のキーボード・インター
フェース回路の概要を表したもので、マトリックス状に
配置されたMOSFET 1のソースとドレインがそれ
ぞれ、行制御用端子2及び列制御用端子3に接続されて
いる。第1図(b)は第1図(a)のMOSFET 1
の断面を見たものであり、第一導電型半導体基板4の上
に第二導電型の領域5を設け、MOSFET 1のソー
スと第二導電型の領域5がP″領域6を通して行制御用
端子2に共通に接続されている。
このような接続とした場合、前記あように、第二導電型
の領域5とMO5F+!↑7のソースとの間の電位差は
常に0となり、前記、寄生ダイオードは発生せず、無駄
な電流の流れを防止することができる。
の領域5とMO5F+!↑7のソースとの間の電位差は
常に0となり、前記、寄生ダイオードは発生せず、無駄
な電流の流れを防止することができる。
この発明は以上説明したように、第二導電型の領域上に
形成されたMOSFETのソースを行制御用端子及び第
二導電型の領域に電気的に接続することkよって、二系
統の電源電圧が存在しても、効率よく制御することがで
きるという効果がある。
形成されたMOSFETのソースを行制御用端子及び第
二導電型の領域に電気的に接続することkよって、二系
統の電源電圧が存在しても、効率よく制御することがで
きるという効果がある。
第1図(a)はこの発明のキーボード・インターフェー
スの回路図、第1図(b)は第1図(a)の断面図、第
2図(a)は従来のキーボード・インターフェースの回
路図、第2図(b)は第2図(a)の断面図である。 1・・・MOSFET 2・・・行制御用端子 3・・・列制御用端子 4・・・第一導電型半導体基板 5・・・第二導電型領域 6・・・P″領 域・・・MOSFET ソース 以上
スの回路図、第1図(b)は第1図(a)の断面図、第
2図(a)は従来のキーボード・インターフェースの回
路図、第2図(b)は第2図(a)の断面図である。 1・・・MOSFET 2・・・行制御用端子 3・・・列制御用端子 4・・・第一導電型半導体基板 5・・・第二導電型領域 6・・・P″領 域・・・MOSFET ソース 以上
Claims (2)
- (1)基板上に複数個の行制御用端子と複数個の列制御
用端子を有し、任意の行制御用端子と任意の列制御用端
子の間にMOSFETが介在し、該MOSFETのソー
スは行制御用端子のいずれか1つに接続され、該MOS
FETのドレインは列制御用端子のいずれか1つに接続
され、前記MOSFETを含む領域が、前記基板と電気
的に分離されていることを特徴とする半導体集積回路。 - (2)第一導電型半導体基板上に複数個の第二導電型の
領域があって、該第二導電型領域上に形成された複数個
のMOSFETのソースが共通であってかつ、前記第二
導電型の領域及び前記行制御用端子に電気的に接続され
る手段を具備していることを特徴とする特許請求の範囲
第1項記載の半導体集積回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60147701A JPS628616A (ja) | 1985-07-05 | 1985-07-05 | 半導体集積回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60147701A JPS628616A (ja) | 1985-07-05 | 1985-07-05 | 半導体集積回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS628616A true JPS628616A (ja) | 1987-01-16 |
Family
ID=15436294
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60147701A Pending JPS628616A (ja) | 1985-07-05 | 1985-07-05 | 半導体集積回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS628616A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6183210B1 (en) | 1997-09-29 | 2001-02-06 | Hitachi Construction Machinery Co. Ltd. | Torque control device for hydraulic pump in hydraulic construction equipment |
-
1985
- 1985-07-05 JP JP60147701A patent/JPS628616A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6183210B1 (en) | 1997-09-29 | 2001-02-06 | Hitachi Construction Machinery Co. Ltd. | Torque control device for hydraulic pump in hydraulic construction equipment |
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