JPS6273634U - - Google Patents

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JPS6273634U
JPS6273634U JP16586685U JP16586685U JPS6273634U JP S6273634 U JPS6273634 U JP S6273634U JP 16586685 U JP16586685 U JP 16586685U JP 16586685 U JP16586685 U JP 16586685U JP S6273634 U JPS6273634 U JP S6273634U
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JP
Japan
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charging
discharging
mos transistor
circuit
discharging circuit
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JP16586685U
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【図面の簡単な説明】
第１図は本考案の一実施例を示す回路図、第２
図ａ，ｂは第１図に示された回路の動作を説明す
る波形図、第３図および第４図は本考案の他の実
施例を示す回路図、第５図は従来例を示す回路図
、第６図ａ，ｂは第５図に示された回路の動作を
説明する波形図である。 主な図番の説明、１は第１の充放電回路、３は
第１のＭＯＳトランジスタ、４は定電圧素子、５
は第２の充放電回路、６は第２のＭＯＳトランジ
スタ、８はインバータ回路である。

Claims (1)

    【実用新案登録請求の範囲】
  1. 電源間に直列に接続された第１のコンデンサ、
    第１のＭＯＳトランジスタおよび定電圧素子より
    成る第１の充放電回路と、電源間に直列に接続さ
    れ且つ前記第１の充放電回路の出力に従つて充放
    電を行う第２のＭＯＳトランジスタおよび第２の
    コンデンサより成る第２の充放電回路と、該第２
    の充放電回路の出力により反転するインバータ回
    路とを具備し、前記第１の充放電回路の第１のコ
    ンデンサへの充電あるいは放電を電源電圧が前記
    第１のＭＯＳトランジスタのスレツシヨルド電位
    と前記定電圧素子の導通電圧との和以上に達した
    とき始めることを特徴とする初期設定回路。
JP16586685U 1985-10-29 1985-10-29 Pending JPS6273634U (ja)

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JP16586685U JPS6273634U (ja) 1985-10-29 1985-10-29

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JPS6273634U true JPS6273634U (ja) 1987-05-12

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JP16586685U Pending JPS6273634U (ja) 1985-10-29 1985-10-29

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0272023U (ja) * 1988-11-18 1990-06-01
JP4646434B2 (ja) * 2001-05-10 2011-03-09 三洋電機株式会社 パワーオンリセット回路

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5870334A (ja) * 1981-10-21 1983-04-26 Toshiba Corp オ−トクリア回路

Patent Citations (1)

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Publication number Priority date Publication date Assignee Title
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