JPS6240064A - 低電力で高効率のスイツチング電源 - Google Patents
低電力で高効率のスイツチング電源Info
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- JPS6240064A JPS6240064A JP61187926A JP18792686A JPS6240064A JP S6240064 A JPS6240064 A JP S6240064A JP 61187926 A JP61187926 A JP 61187926A JP 18792686 A JP18792686 A JP 18792686A JP S6240064 A JPS6240064 A JP S6240064A
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- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
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- H02M3/325—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
- H02M3/337—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only in push-pull configuration
- H02M3/3372—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only in push-pull configuration of the parallel type
- H02M3/3374—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only in push-pull configuration of the parallel type with preregulator, e.g. current injected push-pull
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［発明の分野］
本発明は一般的には精密な電源に関し、特に４〜２０ｍ
Ａの電流ループを付勢するのに特に有用な新規かつ有効
な低電力で高効率のスイッチング電源に関する。
Ａの電流ループを付勢するのに特に有用な新規かつ有効
な低電力で高効率のスイッチング電源に関する。
［従来技術］
一般に、分割電圧源（正電圧）を用いる５０ｆＱＷより
も小さい低電源は、（高い）浮動共通電位を設定するこ
とによりまたは低効率のスイッチング電源により実現さ
れる。しかし、４〜２０ｍＡの電流ループから動作する
電源は、回路機能をできるだけ大ぎくするために高効率
であることが絶対必要である。
も小さい低電源は、（高い）浮動共通電位を設定するこ
とによりまたは低効率のスイッチング電源により実現さ
れる。しかし、４〜２０ｍＡの電流ループから動作する
電源は、回路機能をできるだけ大ぎくするために高効率
であることが絶対必要である。
２線式のアナログ伝送系は周知である。この種の系は、
電流ループを形成する２つの線によって電源に接続され
るトランスミッタを備える。このトランスミッタは、少
なくともその特徴の一つとして圧力または温度などの状
態を検出するトランスジューサを備えている。この状態
はプロセス変数（ＰＶ、 Ｐｒｏｃｅｓｓ Ｖａｒｉ
ａｂｌｅ ）として知られる。
電流ループを形成する２つの線によって電源に接続され
るトランスミッタを備える。このトランスミッタは、少
なくともその特徴の一つとして圧力または温度などの状
態を検出するトランスジューサを備えている。この状態
はプロセス変数（ＰＶ、 Ｐｒｏｃｅｓｓ Ｖａｒｉ
ａｂｌｅ ）として知られる。
電源が、電流ループを閉じるよう２本の線に接続される
。この電流ループに抵抗を設けることも一般に行われて
いる。トランスミッタはそのトランスジューサからの信
号を増幅しこの増幅された信号は、プロセス変数に比例
するかまたはこれと関係したある一定の電流を電源から
引き出すのに使用される。最低の４ｍＡから最大の２０
ｍＡまで引き出すことは普通である。４ｎ＋Ａないし２
０ｍＡの電流は抵抗を通り、この抵抗を横切っである電
圧降下が発生する。この電圧降下は測定されてプロセス
変数に関するある値を与える。
。この電流ループに抵抗を設けることも一般に行われて
いる。トランスミッタはそのトランスジューサからの信
号を増幅しこの増幅された信号は、プロセス変数に比例
するかまたはこれと関係したある一定の電流を電源から
引き出すのに使用される。最低の４ｍＡから最大の２０
ｍＡまで引き出すことは普通である。４ｎ＋Ａないし２
０ｍＡの電流は抵抗を通り、この抵抗を横切っである電
圧降下が発生する。この電圧降下は測定されてプロセス
変数に関するある値を与える。
トランスミッタの回路を付勢するのに叢低４ｍＡの電流
が必要とされることに注意されたい。
が必要とされることに注意されたい。
この４ｍＡのレベルよりも大きいいずれの過度の電流も
プロセス変数を決めるのに用いられる値となる。
プロセス変数を決めるのに用いられる値となる。
この種の４ｍＡないし２０ｍＡの２線式の系は正確さが
高々０．１％近傍に限られてしまう。この種の系はトラ
ンスミッタを含めて実質的に一方向性であり、トランス
ミッタは実質的に制御されずまた絶えず送信している。
高々０．１％近傍に限られてしまう。この種の系はトラ
ンスミッタを含めて実質的に一方向性であり、トランス
ミッタは実質的に制御されずまた絶えず送信している。
［発明の概要］
本発明は、４〜２０ｆｆｉＡの電流ループのためのマイ
クロプロセッサベースの“スマート″なトランスミッタ
に利用することのできる電源に向けられるものである。
クロプロセッサベースの“スマート″なトランスミッタ
に利用することのできる電源に向けられるものである。
本発明によれば、電源は、４〜２０ｍＡの電流ループの
ための従来の電源よりも向上した効率を有する。
ための従来の電源よりも向上した効率を有する。
本発明の目的はこのようにして、
少なくとも２つの離間された接続点をもつ１次巻線と少
なくとも１つの２次巻線とを有する低損失のスイッチン
グ変成器と、 １次電圧を１次巻線に印加するための正および負の入力
線と、 入力線を横切って接続される定電流源と、入力線を横切
ってこの定電流源と直列に接続されるツェナーダイオー
ドと、 １次巻線の接続点の一方は定電流源に接続されたツェナ
ーダイオードの一側に接続されると共に、１次巻線の接
続点の他方と前記正および負の入力線の一方との間に接
続されるドレインおよびソースを備えるＦＥＴと、 １次巻線に与えられる１次電圧を断続するために、ＦＥ
Ｔのベースに接続される出力を有する低電力の発据器と
、 ２次巻線からの電圧を直流整流するために、２次巻線に
接続される整流器とを備える低電力で高効率のスイッチ
ング電源を提供することである。
なくとも１つの２次巻線とを有する低損失のスイッチン
グ変成器と、 １次電圧を１次巻線に印加するための正および負の入力
線と、 入力線を横切って接続される定電流源と、入力線を横切
ってこの定電流源と直列に接続されるツェナーダイオー
ドと、 １次巻線の接続点の一方は定電流源に接続されたツェナ
ーダイオードの一側に接続されると共に、１次巻線の接
続点の他方と前記正および負の入力線の一方との間に接
続されるドレインおよびソースを備えるＦＥＴと、 １次巻線に与えられる１次電圧を断続するために、ＦＥ
Ｔのベースに接続される出力を有する低電力の発据器と
、 ２次巻線からの電圧を直流整流するために、２次巻線に
接続される整流器とを備える低電力で高効率のスイッチ
ング電源を提供することである。
本発明のさらに他の目的は、整流器が、２次巻線を横切
って接続される一対の枝と２次巻線からの電圧をさらに
ろ波するためのろ波回路に接続される別の一対の枝とを
有する全波整流器であるこの種の電源を提供することで
ある。
って接続される一対の枝と２次巻線からの電圧をさらに
ろ波するためのろ波回路に接続される別の一対の枝とを
有する全波整流器であるこの種の電源を提供することで
ある。
本発明のさらに他の目的は、一方の２次巻線は、グラウ
ンドに接続された中間の端子を有し、他方の２次巻線は
、共通浮動基準電位として動作するために正の入力線お
よび負の入力線の別の一つに接続された中間の端子を有
する２つの２次巻線と１次巻線の対向端部に接続された
２つのＦＥＴとを提供することである。
ンドに接続された中間の端子を有し、他方の２次巻線は
、共通浮動基準電位として動作するために正の入力線お
よび負の入力線の別の一つに接続された中間の端子を有
する２つの２次巻線と１次巻線の対向端部に接続された
２つのＦＥＴとを提供することである。
本発明のさらに他の目的は、構成が簡易で構造が堅牢で
製造費用の廉価な低電力で高効率のスイッチング電源を
提供することである。
製造費用の廉価な低電力で高効率のスイッチング電源を
提供することである。
［好ましい実施例の詳ＩＩｌな説明１
図面を参照すると、本発明は、８７％〜９２％の効率を
有することが見出された低電力で高効率のスイッチング
電源用の回路から構成されるものとして具体化されてい
る。これは、４〜２０１ＩＩＡの電流ループ系と一緒に
使用されるマイクロプロセッサベースのスマートなくト
ランスミッタはラインにある間は、マイクロプロセッサ
によって監視される）トランスミッタのために、追加の
機能と増大した動作速度（応答時間）をもたらす。
有することが見出された低電力で高効率のスイッチング
電源用の回路から構成されるものとして具体化されてい
る。これは、４〜２０１ＩＩＡの電流ループ系と一緒に
使用されるマイクロプロセッサベースのスマートなくト
ランスミッタはラインにある間は、マイクロプロセッサ
によって監視される）トランスミッタのために、追加の
機能と増大した動作速度（応答時間）をもたらす。
図の回路は、直流の１２Ｖ〜４２Ｖの１次電圧を受容す
る入力回路アッセンブリ１０を備える。
る入力回路アッセンブリ１０を備える。
入力回路アッセンブリ１０は、周知の４〜２０ｍＡプロ
セス制御系の電流ループに接続することができる。入力
回路アッセンブリ１０の機能は、アイソレート回路アッ
センブリ１２に一定の電流および電圧を与えることであ
る。
セス制御系の電流ループに接続することができる。入力
回路アッセンブリ１０の機能は、アイソレート回路アッ
センブリ１２に一定の電流および電圧を与えることであ
る。
アイソレート回路アッセンブリ１２は、一定の電圧およ
び電流信号を入力回路アッセンブリ１０から受容し、こ
の信号を電磁的に出力回路アッセンブリ１４に結合する
。これは、入力回路アッセンブリ１０と出力回路アッセ
ンブリ１４との間に電気的なアイソレーション（隔離）
を与える。
び電流信号を入力回路アッセンブリ１０から受容し、こ
の信号を電磁的に出力回路アッセンブリ１４に結合する
。これは、入力回路アッセンブリ１０と出力回路アッセ
ンブリ１４との間に電気的なアイソレーション（隔離）
を与える。
出力回路アッセンブリ１４は、入力回路アッセンブリ１
０からアイソレートされまたろ波される出力信号を設定
するために、±５Ｖの直流電力の出力をろ波する２つの
周知のＲＣろ波回路に接続される２つの±５Ｖの直流電
源から構成されている。
０からアイソレートされまたろ波される出力信号を設定
するために、±５Ｖの直流電力の出力をろ波する２つの
周知のＲＣろ波回路に接続される２つの±５Ｖの直流電
源から構成されている。
入力回路１０は、比例４〜２０ｍＡプロセス制御ループ
から線１６．１８に１２〜４２Ｖの直流信号を受容する
。抵抗２０が線１６およびフィードバック線２２に並列
に接続される。トランジスタ２６のエミッタ２４がフィ
ードバック線２２に並列にまた抵抗２０に直列に接続さ
れる。トランジスタ２６のコレクタ２８が線１８および
同じトランジスタ２６のベース３０に並列に接続される
。
から線１６．１８に１２〜４２Ｖの直流信号を受容する
。抵抗２０が線１６およびフィードバック線２２に並列
に接続される。トランジスタ２６のエミッタ２４がフィ
ードバック線２２に並列にまた抵抗２０に直列に接続さ
れる。トランジスタ２６のコレクタ２８が線１８および
同じトランジスタ２６のベース３０に並列に接続される
。
ベース３０はマイクロプロセッサ（図示せず）などのド
ライブ回路に接続される。定電流源３２が抵抗２０およ
びエミッタ２４に並列にまた線３４を通じてツェナーダ
イオード３６に直列に接続される。ツェナーダイオード
３６は次に入力線１日に並列に接続される。
ライブ回路に接続される。定電流源３２が抵抗２０およ
びエミッタ２４に並列にまた線３４を通じてツェナーダ
イオード３６に直列に接続される。ツェナーダイオード
３６は次に入力線１日に並列に接続される。
アイソレート回路１２は、線３４から低損失スイッチン
グ変成器４２の１次巻線４１の中点タップ４０に接続さ
れる線３８を通って入力回路１０に接続される。１次巻
線４１の各対向端部は一対のＭＯ８ＦＥＴ４８．５０の
ソース４４．４６に各々接続される。ＭＯ８ＦＥ丁４８
．５０の各ドレイン５２．５４は、入力線１８へと接続
される。
グ変成器４２の１次巻線４１の中点タップ４０に接続さ
れる線３８を通って入力回路１０に接続される。１次巻
線４１の各対向端部は一対のＭＯ８ＦＥＴ４８．５０の
ソース４４．４６に各々接続される。ＭＯ８ＦＥ丁４８
．５０の各ドレイン５２．５４は、入力線１８へと接続
される。
ＭＯ８ＦＥＴ４８．５０の各ゲート５６．５８は低電力
発振器６０に接続される。
発振器６０に接続される。
一対の２次巻線６２．６４が変成器４２のコア６６を通
って設けられる。一対の中点タップ６８．７０は使用者
が選択する基準電位点７２に接続される。２次巻線６２
．６４の各側部は一対の周知のショットキーダイオード
整流回路７４．７６に各々接続される。周知の一対の各
ＲＣ回路網１０６．１０８が、線７８．８０および線８
２．８４によって整流回路７４．７６に各々接続される
。一対の抵抗８６．８８が、各々キャパシタ９０．９２
および９４．９６と一緒に周知の抵抗−キャパシタろ波
回路網１０６．１０８を各々形成する。出力回路１４は
、そのろ波回路網１０６．１０８に並列に接続される２
対の出力線９８．１００および出力線１０２．１０４を
各々与える。
って設けられる。一対の中点タップ６８．７０は使用者
が選択する基準電位点７２に接続される。２次巻線６２
．６４の各側部は一対の周知のショットキーダイオード
整流回路７４．７６に各々接続される。周知の一対の各
ＲＣ回路網１０６．１０８が、線７８．８０および線８
２．８４によって整流回路７４．７６に各々接続される
。一対の抵抗８６．８８が、各々キャパシタ９０．９２
および９４．９６と一緒に周知の抵抗−キャパシタろ波
回路網１０６．１０８を各々形成する。出力回路１４は
、そのろ波回路網１０６．１０８に並列に接続される２
対の出力線９８．１００および出力線１０２．１０４を
各々与える。
動作を説明すると、入力回路１０の入力線１６．１８は
、プロセス変数に比例する４〜２０ｍＡの信号を与える
プロセス制御ループに接続される。
、プロセス変数に比例する４〜２０ｍＡの信号を与える
プロセス制御ループに接続される。
入力の４〜２０ｍＡの電流は、抵抗２０を横切っである
電圧を生成する。この電流はプロセス変数に比例してい
るので、抵抗２０に生成された電圧もプロセス変数に比
例し、プロセス変数の読みを得るのに使用することがで
きる。マイクロプロセッサなどの周知のドライブ回路（
図示せず）が、トランジスタ２６のベース３０をドライ
ブする信号を発生する。これは、トランジスタ２６のエ
ミッタ２４を通ってコレクタ２８へ電流が流れるように
させる。このドライブ信号もプロセス変数に比例する。
電圧を生成する。この電流はプロセス変数に比例してい
るので、抵抗２０に生成された電圧もプロセス変数に比
例し、プロセス変数の読みを得るのに使用することがで
きる。マイクロプロセッサなどの周知のドライブ回路（
図示せず）が、トランジスタ２６のベース３０をドライ
ブする信号を発生する。これは、トランジスタ２６のエ
ミッタ２４を通ってコレクタ２８へ電流が流れるように
させる。このドライブ信号もプロセス変数に比例する。
トランジスタ２６のベース３０はドライブ回路によって
ドライブされるので、これもまたプロセス変数に比例す
る信号が、フィードバック線２２を通って後方へ流れる
。
ドライブされるので、これもまたプロセス変数に比例す
る信号が、フィードバック線２２を通って後方へ流れる
。
周知の方法で負荷にかかわらず一定の大きさの電流を与
えるトランジスタおよび抵抗の群である周知の定電流源
３２が、線３４および線３８に沿って変化しない電流を
アイソレート回路１２に与える。ツェナーダイオード３
６は、アイソレート回路１２を横切る電圧を調整し、い
ずれの交流電力もアイソレート回路から線３８および線
３４を通って線１８へそれゆえ４〜２０ｍＡの電流ルー
プへ戻されることを阻止する。
えるトランジスタおよび抵抗の群である周知の定電流源
３２が、線３４および線３８に沿って変化しない電流を
アイソレート回路１２に与える。ツェナーダイオード３
６は、アイソレート回路１２を横切る電圧を調整し、い
ずれの交流電力もアイソレート回路から線３８および線
３４を通って線１８へそれゆえ４〜２０ｍＡの電流ルー
プへ戻されることを阻止する。
アイソレート回路１２は、入力回路１０の定電流源３２
から線３４および線３８を通じて一定の電流をスイッチ
ング変成器４２の中点タップ４０で受容する。スイッチ
ング変成器４２は、巻線分布を改善することにより１次
側から２次側への漏水損失を減するために、好ましくは
環状コイルであるコア６６を有する。スイッチング変成
器４２は低い磁束密度（１００〜５００ガウス）で動作
するようまたコア損失を減するよう特別に構成されてい
る。
から線３４および線３８を通じて一定の電流をスイッチ
ング変成器４２の中点タップ４０で受容する。スイッチ
ング変成器４２は、巻線分布を改善することにより１次
側から２次側への漏水損失を減するために、好ましくは
環状コイルであるコア６６を有する。スイッチング変成
器４２は低い磁束密度（１００〜５００ガウス）で動作
するようまたコア損失を減するよう特別に構成されてい
る。
低電力発振器６０は、信号をＭＯ８ＦＥＴ４８．５０の
各ゲート５６．５８に交互に投入する。信号はゲート５
６．５８を交互にターンオンし、電流が中点タップ４０
から１次コイル４１およびソース４４．４６を通って各
ＭＯ８ＦＥＴ４８．５０の各ドレイン５２．５４へ交互
に流れるようにする。従来設計されたこの種の電源の大
抵のものにおいて、低電力発振器６０はＭ ＯＳ Ｆ
Ｅ Ｔ４８．５０の代りに一対の普通のトランジスタを
交互にドライブするのが普通であった。普通のトランジ
スタの代りに、低電力ゲートドライブ特性および迅速な
スイッチング特性をもつＭＯＳＦＥＴを利用することに
より、スイッチング檜失は大いに減ぜられる。発振器は
、ＭＯＳＦＥＴや変成器などにおける全体のスイッチン
グ損失をさらに減するために、ｌ０ＫＨ２以下の周波数
をもつものとすべきである。
各ゲート５６．５８に交互に投入する。信号はゲート５
６．５８を交互にターンオンし、電流が中点タップ４０
から１次コイル４１およびソース４４．４６を通って各
ＭＯ８ＦＥＴ４８．５０の各ドレイン５２．５４へ交互
に流れるようにする。従来設計されたこの種の電源の大
抵のものにおいて、低電力発振器６０はＭ ＯＳ Ｆ
Ｅ Ｔ４８．５０の代りに一対の普通のトランジスタを
交互にドライブするのが普通であった。普通のトランジ
スタの代りに、低電力ゲートドライブ特性および迅速な
スイッチング特性をもつＭＯＳＦＥＴを利用することに
より、スイッチング檜失は大いに減ぜられる。発振器は
、ＭＯＳＦＥＴや変成器などにおける全体のスイッチン
グ損失をさらに減するために、ｌ０ＫＨ２以下の周波数
をもつものとすべきである。
１次コイル４１を通って流れるこの交互の電流は、変成
器４２の２つの２次巻線６２．６４へと降圧される。各
２次巻線６２．６４は中点タップ６８．７０を各々有す
る。これらの中点タップは、出力回路１４の２つの＋５
ｖの電源出力のための共通電位点である。
器４２の２つの２次巻線６２．６４へと降圧される。各
２次巻線６２．６４は中点タップ６８．７０を各々有す
る。これらの中点タップは、出力回路１４の２つの＋５
ｖの電源出力のための共通電位点である。
両方の２次巻線６２．６４のどちらの端部も、周知のブ
リッジ整流回路７４．７６の入力側に各々与えられる。
リッジ整流回路７４．７６の入力側に各々与えられる。
ショットキーダイオードが、スイッチング損失をできる
だけ最小にするために、ブリッジ７４．７６で使用され
る。これらの周知のブリッジ整流回路７４．７６は、２
次巻線６２．６４からの交流電圧＜ＡＣＶ）を周知の方
法で直流電圧（ＤＣＶＩに変える。これらのブリッジ整
流回路７４．７６の出力は、ろ波されない直流電圧を出
力回路１４に与える。
だけ最小にするために、ブリッジ７４．７６で使用され
る。これらの周知のブリッジ整流回路７４．７６は、２
次巻線６２．６４からの交流電圧＜ＡＣＶ）を周知の方
法で直流電圧（ＤＣＶＩに変える。これらのブリッジ整
流回路７４．７６の出力は、ろ波されない直流電圧を出
力回路１４に与える。
出力回路１４は、アイソレート回路１２からのｆＩＩＮ
な直流電圧（ＯＣＶ）を一定の＋５ｖの直流電源へとろ
波する周知の２つのＲＣろ波回路網１０６．１０８を右
する。出力線９８．１０２は、選択される各基準電位点
７２．７３よりも低い５Ｖの直流信号を各々与え、線１
００．１０４は、選択される各基準電位点７２．７３よ
りも高い５■の直流信号を各々与える。
な直流電圧（ＯＣＶ）を一定の＋５ｖの直流電源へとろ
波する周知の２つのＲＣろ波回路網１０６．１０８を右
する。出力線９８．１０２は、選択される各基準電位点
７２．７３よりも低い５Ｖの直流信号を各々与え、線１
００．１０４は、選択される各基準電位点７２．７３よ
りも高い５■の直流信号を各々与える。
かくして、本発明の電源は、線９８．１００および８１
０２．１０４を通じて出力電源信号を与え、８７〜９２
％の効率をもつ低電力かつ高効率電源であることが理解
されよう。これは、４〜２０ｍＡの電流ループで使用さ
れるトランスミッタのために、改善された応答時間をも
たらす。
０２．１０４を通じて出力電源信号を与え、８７〜９２
％の効率をもつ低電力かつ高効率電源であることが理解
されよう。これは、４〜２０ｍＡの電流ループで使用さ
れるトランスミッタのために、改善された応答時間をも
たらす。
図は、本発明による電源用の回路を示す模式図である。
図中の各参照番号が示す主な名称を以下に挙げる。
１０：入力回路（アッセンブリ）
１２ニアイソレ一ト回路（アッセンブリ）１４：出力回
路（アッセンブリ） １６．１８二人力線 ２０：抵抗 ２２：フィードバック線 ２４：エミッタ ２６：トランジスタ ２８：コレクタ ３０：ベース ３２：定電流源 ３４．３８．７８．８０．８２．８４：線３６：ツエナ
ーダイオード ４０：中点タップ ４１：１次巻線 ４２：変成器 ４４．４６：ソース ４８．５０ ：ＭＯＳＦＥＴ ５２．５４ニドレイン ５６．５８ニゲ−ト ロ０：発振器 ６２．６４：２次巻線 ６６：コア ６８．７０：中点タップ ７２．７３：基準電位点 ７４．７６：整流回路 ８６．８８：抵抗 ９０．９２．９４．９６：キャパシタ ９８．１００，１０２．１０４：出力線１０６．１０８
：ＲＣ回路網
路（アッセンブリ） １６．１８二人力線 ２０：抵抗 ２２：フィードバック線 ２４：エミッタ ２６：トランジスタ ２８：コレクタ ３０：ベース ３２：定電流源 ３４．３８．７８．８０．８２．８４：線３６：ツエナ
ーダイオード ４０：中点タップ ４１：１次巻線 ４２：変成器 ４４．４６：ソース ４８．５０ ：ＭＯＳＦＥＴ ５２．５４ニドレイン ５６．５８ニゲ−ト ロ０：発振器 ６２．６４：２次巻線 ６６：コア ６８．７０：中点タップ ７２．７３：基準電位点 ７４．７６：整流回路 ８６．８８：抵抗 ９０．９２．９４．９６：キャパシタ ９８．１００，１０２．１０４：出力線１０６．１０８
：ＲＣ回路網
Claims (7)
- （１）少くとも２つの離間された接続点をもつ１次巻線
と少くとも１つの２次巻線とを有する低損失のスイッチ
ング変成器と、 １次電圧を１次巻線に印加するための正および負の入力
線と、 入力線を横切つて接続される定電流源と、 入力線を横切ってこの定電流源と直列に接続され、一定
の電圧源を提供するツェナーダイオードと、 １次巻線の前記少くとも２つの接続点の一方はこのツェ
ナーダイオードの一側に接続され、１次巻線の前記接続
点の他方と前記入力線の一方との間に接続されるドレイ
ンおよびソースを備えるＦＥＴと、 １次巻線に与えられる１次電圧を断続するために、前記
ＦＥＴの制御ゲートに接続される出力を有する低損失の
発振器と、 ２次巻線からの交流電圧を直流電圧に整流するために、
２次巻線を横切つて接続される全波整流器とを備える低
電力で高効率のスイッチング電源。 - （２）１次巻線の前記一方の接続点は、定電流源に接続
されたツェナーダイオードの一側に接続される特許請求
の範囲第１項記載の低電力で高効率のスイッチング電源
。 - （３）全波整流器は２次巻線を横切って接続される第１
の一対の枝と第２の一対の枝とこの第２の一対の枝を横
切つて接続される容量性のろ波回路とを備える特許請求
の範囲第２項記載の低電力で高効率のスイッチング電源
。 - （４）前記１次巻線は、 前記一方の接続点の側に前記他方の接続点と向かい合う
さらに別の接続点と、 この別の接続点と前記入力線の一方との間に接続される
ドレインおよびソースを有する別のＦＥＴと、 この別のＦＥＴのゲートに接続される前記発振器と、 前記一方の接続点と別の接続点との間の前記１次巻線の
部分に関連される別の２次巻線と、前記一方の接続点と
他方の接続点との間の前記１次巻線の部分に関連される
最初に述べた前記２次巻線と、前記別の２次巻線を横切
つて接続される別の全波整流器とを有する前記変成器と
を備えてなる特許請求の範囲第３項記載の低電力で高効
率のスイッチング電源。 - （５）前記別の全波整流器は、前記別の２次巻線を横切
つて接続される第一の一対の枝と第二の一対の枝とこの
別の全波整流器の第二の一対の枝を横切って接続される
容量性のろ波回路とを有する特許請求の範囲第４項記載
の低電力で高効率のスイッチング電源。 - （６）前記２次巻線はグランドに接続される中点タップ
を有し、最初に述べた前記容量性のろ波回路は、各々最
初に述べた全波整流器の第２の一対の枝の一方に接続さ
れる一端部と前記グランドに接続される対向端部とを有
する一対の各キャパシタとを有する特許請求の範囲第５
項記載の低電力で高効率のスイッチング電源。 - （７）前記別の２次巻線は前記入力線の他方に接続され
る中点タップを有し、前記別の容量性のろ波回路は、各
々前記別の全波整流器の第二の一対の枝の一方に接続さ
れる一端部と前記入力線の他方に接続される対向端部と
を有する一対の各キャパシタとを有する特許請求の範囲
第６項記載の低電力で高効率のスイッチング電源。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US06/765,404 US4669038A (en) | 1985-08-13 | 1985-08-13 | Low power high efficiency switching power supply |
| US765404 | 1985-08-13 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6240064A true JPS6240064A (ja) | 1987-02-21 |
Family
ID=25073475
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61187926A Pending JPS6240064A (ja) | 1985-08-13 | 1986-08-12 | 低電力で高効率のスイツチング電源 |
| JP055964U Pending JPH0660295U (ja) | 1985-08-13 | 1991-06-24 | 低電力で高効率のスイッチング電源 |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP055964U Pending JPH0660295U (ja) | 1985-08-13 | 1991-06-24 | 低電力で高効率のスイッチング電源 |
Country Status (13)
| Country | Link |
|---|---|
| US (1) | US4669038A (ja) |
| EP (1) | EP0211635B1 (ja) |
| JP (2) | JPS6240064A (ja) |
| KR (1) | KR950012749B1 (ja) |
| AU (1) | AU579481B2 (ja) |
| BR (1) | BR8603296A (ja) |
| CA (1) | CA1273397A (ja) |
| DE (1) | DE3687327T2 (ja) |
| ES (1) | ES8800524A1 (ja) |
| HK (1) | HK70593A (ja) |
| IN (1) | IN164863B (ja) |
| MX (1) | MX165857B (ja) |
| SG (1) | SG54693G (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003025990A (ja) * | 2001-07-13 | 2003-01-29 | Hitachi Ltd | 鉄道車両用空調装置の電気品冷却方式 |
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| US5841467A (en) * | 1996-02-01 | 1998-11-24 | The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration | Ground isolation circuit for isolating a transmission line from ground interference |
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| FR2969428B1 (fr) * | 2010-12-21 | 2013-01-04 | St Microelectronics Sa | Commutateur electronique et appareil de communication incluant un tel commutateur |
| ITBO20130199A1 (it) * | 2013-05-03 | 2014-11-04 | Fioretti En S R L | Dispositivo per la generazione di energia ad alta efficienza |
Family Cites Families (10)
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|---|---|---|---|---|
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| DE2162711A1 (de) * | 1971-12-17 | 1973-06-20 | Ver Flugtechnische Werke | Schaltungsanordnung zur erzeugung einer konstanten gleichspannung |
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| US4456950A (en) * | 1982-06-10 | 1984-06-26 | Hewlett-Packard Company | Current spike protection circuit for switch-mode power supplies |
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| US4502104A (en) * | 1982-12-23 | 1985-02-26 | Rockwell International Corporation | Bootstrapped AC-DC power converter |
-
1985
- 1985-08-13 US US06/765,404 patent/US4669038A/en not_active Expired - Fee Related
-
1986
- 1986-05-06 IN IN352/CAL/86A patent/IN164863B/en unknown
- 1986-05-26 KR KR1019860004116A patent/KR950012749B1/ko not_active IP Right Cessation
- 1986-05-30 CA CA000510383A patent/CA1273397A/en not_active Expired - Fee Related
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- 1986-07-21 MX MX003211A patent/MX165857B/es unknown
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- 1986-08-01 DE DE8686305964T patent/DE3687327T2/de not_active Revoked
- 1986-08-12 JP JP61187926A patent/JPS6240064A/ja active Pending
-
1991
- 1991-06-24 JP JP055964U patent/JPH0660295U/ja active Pending
-
1993
- 1993-04-28 SG SG546/93A patent/SG54693G/en unknown
- 1993-07-22 HK HK705/93A patent/HK70593A/xx unknown
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| JP2003025990A (ja) * | 2001-07-13 | 2003-01-29 | Hitachi Ltd | 鉄道車両用空調装置の電気品冷却方式 |
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| SG54693G (en) | 1993-07-09 |
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| DE3687327T2 (de) | 1993-04-29 |
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