JPS62203066A - Apparatus for measuring waveform level - Google Patents
Apparatus for measuring waveform levelInfo
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Abstract
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は、主として、電子デバイスの出方波形が正常か
異常かを判定することによってその電子デバイスが良品
であるか不良品であるかの検査に使用するものであって
、例えば、VTRのモーフサーボ信号や同期信号などの
波形を測定してその制御回路の良否を判定したりするこ
と等に使用する波形レベル測定装置に関する。[Detailed Description of the Invention] <Industrial Application Field> The present invention is mainly concerned with determining whether an electronic device is a good product or a defective product by determining whether the output waveform of the electronic device is normal or abnormal. The present invention relates to a waveform level measuring device used for inspection, for example, measuring waveforms of VTR morph servo signals, synchronization signals, etc. to determine the quality of its control circuit.
〈従来技術〉 従来のこの種の波形レベル測定装置を第4図に示す。<Conventional technology> A conventional waveform level measuring device of this type is shown in FIG.
第4図において、I!、tii子デバイス、2はサンプ
ルホールド回路、3はタイミング回路、4はサンフリン
グパルス発生回路、5はサンプリング時間設定回路であ
る。In Figure 4, I! , tii child device, 2 is a sample hold circuit, 3 is a timing circuit, 4 is a sunfling pulse generation circuit, and 5 is a sampling time setting circuit.
次に、第5図に基づいて動作を説明する。Next, the operation will be explained based on FIG.
電子デバイスlがら例えば図示のような波形の信号Sl
が出力されているとし、この信号S、の時間T0におけ
るレベルv8を測定し、コルレベルVにが規定のレベル
vRの許容範囲(±α)内にあるかどうか(■、−α≦
VX≦VR十α)を判定する場合について説明する。For example, an electronic device l generates a signal Sl having a waveform as shown in the figure.
is output, measure the level v8 of this signal S at time T0, and check whether the cor level V is within the permissible range (±α) of the specified level vR (■, −α≦
A case of determining VX≦VR+α) will be described.
サンプリング時間設定回路5では、予めサンプリングす
る時間T0を設定しておく。In the sampling time setting circuit 5, a sampling time T0 is set in advance.
電子デバイス1から出力される信号S、は、サンプルホ
ールド回路2とタイミング回路3とに入力される。タイ
ミング回路3は、入力信号S+ の立ち上がりおよび立
ち下がりのタイミングでタイミングパルス3つを発生す
る。このタイミングパルスS2がサンプリングパルス発
生回路4に出力される。A signal S output from the electronic device 1 is input to a sample hold circuit 2 and a timing circuit 3. The timing circuit 3 generates three timing pulses at the rising and falling timings of the input signal S+. This timing pulse S2 is output to the sampling pulse generation circuit 4.
サンプリングパルス発生回路4は、入力したタイミング
パルスS2およびサンプリング時間設定回路5で設定さ
れているサンプリング時間T0に基づいて、サンプリン
グパルスS、をサンプルホールド回路2に出力する。The sampling pulse generation circuit 4 outputs the sampling pulse S to the sample hold circuit 2 based on the input timing pulse S2 and the sampling time T0 set by the sampling time setting circuit 5.
サンプルホールド回路2は、このサンプリングパルスS
3の入力時間T0内において、電子デバイス1から入力
した信号SIをサンプリングする。The sample hold circuit 2 receives this sampling pulse S.
The signal SI input from the electronic device 1 is sampled within the input time T0 of No. 3.
このサンプリングされた信号S、のレベルは■8となる
。The level of this sampled signal S is 8.
そして、このようにして測定されたレベルvXの信号を
図示しない判定回路に出力し、前記の■7−α≦■8≦
V、l+α
の判定を行う。Then, the signal of the level vX measured in this way is output to a judgment circuit (not shown), and the above-mentioned ■7-α≦■8≦
Determine V, l+α.
〈発明が解決しようとする問題点〉
しかしながら、このような構成を有する従来例には、次
のような問題点がある。<Problems to be Solved by the Invention> However, the conventional example having such a configuration has the following problems.
(イ)波形レベル測定装置の回路構成として、測定デバ
イス個々の出力波形専用のサンプルホールド回路2.タ
イミング回路3.サンプリングパルス発生回路4.サン
プリング時間設定回路5を必要とし、回路全体が複雑で
高価なものとなっている。(a) As a circuit configuration of the waveform level measuring device, a sample hold circuit dedicated to the output waveform of each measurement device 2. Timing circuit 3. Sampling pulse generation circuit 4. A sampling time setting circuit 5 is required, making the entire circuit complicated and expensive.
(ロ)タイミングパルスS2とサンプリングパルスS、
との同期ならびにサンプリングパルスs3と入力信号S
Iとの同期がむずかしく、同期ミスによって誤ったレベ
ルの信号S4を出力するおそれがある。ことに、信号s
1における測定すべき時間T0が短いときや信号S1の
波形が複雑なときには、測定しようとする期間T0にず
れが生じ、測定不能になる。(b) Timing pulse S2 and sampling pulse S,
synchronization with sampling pulse s3 and input signal S
It is difficult to synchronize with I, and there is a risk that a synchronization error may result in outputting the signal S4 at an incorrect level. In particular, the signal s
When the time T0 to be measured in 1 is short or the waveform of the signal S1 is complex, a shift occurs in the period T0 to be measured, making measurement impossible.
〈発明の目的〉
本発明は、従来例のこのような問題点を解消し、回路構
成の簡略化と測定精度の向上とを図ることを目的とする
。<Objective of the Invention> An object of the present invention is to solve these problems of the conventional example, simplify the circuit configuration, and improve measurement accuracy.
〈問題点を解決するための手段〉
本発明は、上記の目的を達成するために、次のような構
成をとる。<Means for Solving the Problems> In order to achieve the above object, the present invention has the following configuration.
即ち、本発明の波形レベル測定装置は、入力波形の測定
対象レベルを含む所定時間の設定手段と、
入力波形に対するトリガレベルの設定手段と、前記トリ
ガレベルにおいて入力波形の立下り・立上り間または立
上り・立下り間の時間の測定手段と、
この時間測定手段による測定時間と前記所定時間設定手
段によって設定された所定時間との比較手段と、
これら両時間が一致するまで前記トリガレベルを段階的
に微小変更するトリガレベル微変手段と、前記時間比較
手段によって前記両時間が一致したときに、そのときの
トリガレベルを測定レベルとして出力する測定レベル出
力手段
とを備えたものである。That is, the waveform level measuring device of the present invention includes: a means for setting a predetermined time including the level to be measured of the input waveform; a means for setting a trigger level for the input waveform; - means for measuring the time between falling edges; means for comparing the time measured by the time measuring means with a predetermined time set by the predetermined time setting means; and stepwise adjusting the trigger level until these two times match. The apparatus includes a trigger level slight change means for making a slight change, and a measurement level output means for outputting the trigger level at that time as a measurement level when the two times coincide with each other by the time comparison means.
この構成において、「入力波形の測定対象レベルを含む
所定時間」とは、測定対象レベルに関して初期のトリガ
レベルとは反対側に測定対象レベルから微小変位したレ
ベルにおける正規の入力波形の立下り・立上り間または
立上り・立下り間の時間のことである。In this configuration, the "predetermined time period including the measurement target level of the input waveform" refers to the falling and rising edges of the regular input waveform at a level slightly displaced from the measurement target level on the opposite side of the initial trigger level with respect to the measurement target level. It is the time between the rise and fall.
〈作用〉 この構成による作用は、次の通りである。<Effect> The effects of this configuration are as follows.
(i)予め、所定時間設定手段において、入力波形の測
定対象レベルを含む所定時間を設定し、かつ、トリガレ
ベル設定手段において、初期のトリガレベルを設定して
おく。(i) In advance, the predetermined time setting means sets a predetermined time including the level to be measured of the input waveform, and the trigger level setting means sets an initial trigger level.
時間測定手段は、その初期のトリガレベルにおいて入力
波形の立下り・立上り間または立上り・立下り間の時間
を測定する。時間比較手段は、時量測定手段によって測
定された初期トリガレベルにおける測定時間と所定時間
設定手段によって設定された所定時間とを比較する。The time measuring means measures the time between falling and rising edges or between rising and falling edges of the input waveform at the initial trigger level. The time comparing means compares the measurement time at the initial trigger level measured by the time measuring means and the predetermined time set by the predetermined time setting means.
この比較の結果、両時間が不一致のときは、トリガレベ
ル微変手段がトリガレベルを1段階微小変更して、第1
微小変更トリガレベルとする。As a result of this comparison, if the two times do not match, the trigger level slight change means minutely changes the trigger level by one step.
Set it as a small change trigger level.
時間測定手段は、その第1微小変更トリガレベルにおい
て再度、入力波形の立下り・立上り間または立上り・立
下り間の時間を測定する。時間比較手段は、時間測定手
段によって測定された第1微小変更トリガレベルにおけ
る測定時間と所定時間設定手段によって設定された所定
時間とを比較する。The time measuring means measures the time between falling and rising edges or between rising and falling edges of the input waveform again at the first minute change trigger level. The time comparing means compares the measurement time at the first minute change trigger level measured by the time measuring means and the predetermined time set by the predetermined time setting means.
この比較の結果、両時間が不一致のときは、トリガレベ
ル微変手段がトリガレベルをさらに1段階微小変更して
、第2微小変更トリガレベルとする。As a result of this comparison, if the two times do not match, the trigger level fine change means further finely changes the trigger level by one step to obtain a second finely changed trigger level.
このように、トリガレベル微変手段は、所定時間と測定
時間とが一致するまでトリガレベルを段階的に微小変更
していく。In this way, the trigger level slight change means minutely changes the trigger level step by step until the predetermined time and the measurement time match.
測定レベル出力手段は、時間比較手段が所定時間と測定
時間との一致を判定したときに、そのときのトリガレベ
ルを測定レベルとして出力する。The measurement level output means outputs the trigger level at that time as the measurement level when the time comparison means determines that the predetermined time and the measurement time match.
所定時間と測定時間とが一致するトリガレベルは、初期
トリガレベルである場合もあるし、1段階だけあるいは
複数段階にわたって微小変更されたトリガレベルである
場合もある。The trigger level at which the predetermined time and the measurement time match may be the initial trigger level, or may be a trigger level that has been slightly changed in one step or over multiple steps.
Ni)従来例では、シビアなタイミングでサンプリング
パルスの出力、停止を決定しなければならないために、
高精度で高価なタイミング回路、サンプルホールド回路
およびそれらの周辺回路を必要としたが、本発明の場合
には、トリガレベルの変更に基づいて測定対象レベルを
測定しており、タイミング処理を必要としないため、全
体として回路構成の簡略化が図られる。Ni) In the conventional example, it is necessary to decide whether to output or stop the sampling pulse at strict timing.
However, in the case of the present invention, the level to be measured is measured based on changes in the trigger level, and timing processing is not required. Therefore, the overall circuit configuration can be simplified.
(iii )前記(ii)と同様の理由により、従来例
で生じていた同期ミスに起因する誤測定がなくなる。(iii) For the same reason as (ii) above, erroneous measurements caused by synchronization errors that occur in the conventional example are eliminated.
また、測定対象レベルを測定すべき時間が短いことや入
力波形が複雑なことに起因して測定精度が影響を受ける
といったことを免れる。Furthermore, the measurement accuracy is not affected by the short time required to measure the level of the measurement target or by the complexity of the input waveform.
〈実施例〉
以下、本発明の実施例を図面に基づいて詳細に説明する
。<Example> Hereinafter, an example of the present invention will be described in detail based on the drawings.
第1図は本発明の一実施例に係る波形レベル測定装置の
ブロック回路図である。FIG. 1 is a block circuit diagram of a waveform level measuring device according to an embodiment of the present invention.
第1図において、6は電子デバイス、7は電子デバイス
6からの入力信号S1をカウントするカウンタ回路、8
は全体の制御、演算を司るam・演算回路、9は制御・
演算回路8から出力されたトリガレベル信号S、をD/
A変喚してそのアナログ信号S、をカウンタ回路7に出
力するD/A変換回路、10はカウンタ回路7でアナロ
グ信号S。In FIG. 1, 6 is an electronic device, 7 is a counter circuit that counts the input signal S1 from the electronic device 6, and 8
9 is the am/arithmetic circuit that controls the overall control and calculations, and 9 is the control/arithmetic circuit.
The trigger level signal S outputted from the arithmetic circuit 8 is connected to D/
10 is a D/A conversion circuit which converts A and outputs the analog signal S to a counter circuit 7;
(トリガレベル信号Ss)に対応して測定した測定時間
tを示すアナログ信号S、をA/D変換してそのデジタ
ル信号Ssを制御・演工γ回路8に出力するA/D変換
回路である。This is an A/D conversion circuit that A/D converts an analog signal S indicating a measurement time t measured in response to a trigger level signal Ss and outputs the digital signal Ss to a control/operation γ circuit 8. .
11は入力信号S1の波形における測定対象レベル■。11 is the measurement target level ■ in the waveform of the input signal S1.
を含む所定時間Tの設定回路であり、制御・演算回路8
に接続されている。ここで、「測定対象レベル■。を含
む所定時間T」とは、測定対象レベル■。に関して初期
のトリガレベル■。とは反対側に測定対象レベルV、か
ら微小レベルだけ変位したレベルにおいて、既知の正規
の入力波形の立下り・立上り間の時間(第3図(A)の
波形の場合)または立上り・立下り間の時間(第3図(
B)の波形の場合)のことである。It is a setting circuit for a predetermined time T including
It is connected to the. Here, the "predetermined time T including the measurement target level ■." refers to the measurement target level ■. ■ Regarding the initial trigger level. The time between the falling and rising edges of a known regular input waveform (in the case of the waveform in Figure 3 (A)) or the rising and falling times at a level displaced by a minute level from the measurement target level V on the opposite side. The time between (Figure 3 (
In the case of waveform B).
この所定時間設定回路11が発明の構成にいう「入力波
形の測定対象レベルを含む所定時間の設定手段」に相当
する。This predetermined time setting circuit 11 corresponds to "setting means for a predetermined time including the measurement target level of the input waveform" in the configuration of the invention.
12は入力信号Slの波形に対する初期のトリガレベル
v0の設定回路であり、制御・演算回路8に接続されて
いる。この初期トリガレベル設定回路12が発明の構成
にいう「入力波形に対するトリガレベルの設定手段」に
相当する。12 is a circuit for setting an initial trigger level v0 for the waveform of the input signal Sl, and is connected to the control/arithmetic circuit 8. This initial trigger level setting circuit 12 corresponds to "trigger level setting means for input waveform" in the configuration of the invention.
次に、この実施例の動作を第2図のフローチャートおよ
び第3図(A)の波形図に基づいて説明する。Next, the operation of this embodiment will be explained based on the flowchart of FIG. 2 and the waveform diagram of FIG. 3(A).
ステップ#lでは、所定時間設定回路11において、既
知の正規の入力信号SIの波形についての所定時間Tを
設定し、これを制御・演算回路8におけるレジスタRT
にストアする(RT−T)。In step #l, the predetermined time setting circuit 11 sets a predetermined time T for the waveform of the known regular input signal SI, and sets this to the register RT in the control/arithmetic circuit 8.
(RT-T).
ステップ#2では、初期トリガレベル設定回路12にお
いて、初期のトリガレベルV。を設定し、これを制御・
演算回路8におけるレジスタRTLにストアする (R
TL−■。)。In step #2, the initial trigger level setting circuit 12 sets the initial trigger level V. and control this.
Store in register RTL in arithmetic circuit 8 (R
TL-■. ).
ステ・ノブ#3では、初期のトリガレベル■。において
、入力信号S1の立下り・立上り間の時間t1を測定す
る。即ち、制御・演算回路8から初期のトリガレベル信
号S、をD/A変換回路9に出力する。D/A変換回路
9は、この初期のトリガレベル信号S、をアナログ信号
Shに変換してカウンタ回路7に出力する。カウンタ回
路7は、アナログ信号S、によって指定された初期のト
リガレベル■。において、入力信号S1の立下り・立上
り間の時間t1を測定する。第3図(A)の場合は、t
+”0である。この測定された時間t1(−〇)を示す
アナログ信号S7はA/D変換回路10によってデジタ
ル信号S6に変換され、制御・演算回路8に入力される
。For Ste Knob #3, the initial trigger level ■. , the time t1 between the falling and rising edges of the input signal S1 is measured. That is, the initial trigger level signal S is output from the control/arithmetic circuit 8 to the D/A conversion circuit 9. The D/A conversion circuit 9 converts this initial trigger level signal S into an analog signal Sh and outputs it to the counter circuit 7. The counter circuit 7 receives an initial trigger level (2) specified by the analog signal S. , the time t1 between the falling and rising edges of the input signal S1 is measured. In the case of FIG. 3(A), t
+"0. The analog signal S7 indicating the measured time t1 (-0) is converted into a digital signal S6 by the A/D conversion circuit 10 and input to the control/arithmetic circuit 8.
このステップ#3が、発明の構成にいう[トリガレベル
において入力波形の立下り・立上り間(または立上り・
立下り間)の時間の測定手段」に相当する。This step #3 is between the falling and rising edges of the input waveform at the trigger level (or between the rising and rising edges) in the configuration of the invention.
This corresponds to "Measurement means for measuring the time (between falling edges)".
ステップ#4では、初期のトリガレベル■。における測
定時間t、とレジスタR7にストアされている所定時間
Tとを比較し、t、=Tかどうかを判断する。In step #4, the initial trigger level ■. The measured time t in , and the predetermined time T stored in the register R7 are compared to determine whether t,=T.
このステップ#4が、発明の構成にいう「時間測定手段
による測定時間と所定時間設定手段によって設定された
所定時間との比較手段」に相当する。This step #4 corresponds to "comparison means for comparing the time measured by the time measuring means and the predetermined time set by the predetermined time setting means" in the configuration of the invention.
初期のトリガレベルV0の場合は、ステ7プ#4でNO
と判断するのでステップ#5に移行し、 ゛トリガレ
ベルを桁上げする。即ち、レジスタRTLにストアされ
ている初期のトリガレベル■。に微小レベルΔVを加算
して、その合計値を第1微小変更トリガレベル(■。+
Δ■)としてレジスタRTLにストアする( Ry L
= V o +ΔV)。If the initial trigger level is V0, select NO at step #4.
Therefore, move to step #5 and increase the trigger level. That is, the initial trigger level ■ stored in register RTL. Add the minute level ΔV to and set the total value as the first minute change trigger level (■.+
Δ■) in the register RTL (Ry L
= V o +ΔV).
このステップ#5が、発明の構成にいう「測定時間と所
定時間とが一致するまでトリガレへルを段階的に微小変
更するトリガレベル微変手段」に相当する。This step #5 corresponds to the "trigger level fine change means for changing the trigger level minutely step by step until the measurement time and the predetermined time match" as referred to in the configuration of the invention.
次いでステップ#6では、レジスタRTLにストアした
第1微小変更トリガレベル(■。十Δ■)が予怨される
入力信号SIの波形の最大値V may以下かどうかを
判断する。第3図(A)の場合はYESと判断し、ステ
ップ#3にリターンする。Next, in step #6, it is determined whether the first slight change trigger level (■.10Δ■) stored in the register RTL is less than or equal to the maximum value V may of the waveform of the input signal SI to be rejected. In the case of FIG. 3(A), the determination is YES and the process returns to step #3.
このステップ#3では、第1微小変更トリガレベル(■
。+ΔV)に基づいて、前述と同様に入力信号Slの立
下り・立上り間の時間t2を測定する。第3図(A)の
場合は、Q<t2<Tであるから、次のステップ#4で
再びNoと判断し、ステップ#5に移行する。In this step #3, the first minute change trigger level (■
. +ΔV), the time t2 between the falling and rising edges of the input signal Sl is measured in the same manner as described above. In the case of FIG. 3(A), since Q<t2<T, the next step #4 is again determined as No, and the process moves to step #5.
このステップ#5では、再度、トリガレベルを桁上げす
る。即ち、レジスタRTLにストアされている第1微小
変更トリガレベル(V O+Δ■)に微小レベルΔVを
加算して、その合計値を第2微小変更トリガレベル(V
o+2・Δ■)としてレジスタRTLにストアする(R
rt=Vo ” 2 ’Δ■)。In this step #5, the trigger level is carried up again. That is, the minute level ΔV is added to the first minute change trigger level (V O + Δ■) stored in the register RTL, and the total value is set as the second minute change trigger level (V
o+2・Δ■) in register RTL (R
rt=Vo"2'Δ■).
次いでステップ#6を経て、ステップ#3で、第2微小
変更トリガレベル(vo+2・ΔV)に基づいて、前述
と同様に入力信号S、の立下り・立上り間の時間t、を
測定する。第3図(Δ)の場合は、1.=t2<”1”
であるから、次のステップ#4で再びNoと判断し、ス
テップ#5に移行する。Next, through step #6, in step #3, the time t between the falling and rising edges of the input signal S is measured based on the second minute change trigger level (vo+2·ΔV) in the same way as described above. In the case of FIG. 3 (Δ), 1. =t2<"1"
Therefore, in the next step #4, the determination is No again, and the process moves to step #5.
このステップ#5では、再度、トリガレベルを桁上げす
る。即ち、レジスタRTLにストアされている第2微小
変更トリガレベル(V、+2・Δ■)に微小レベルΔV
を加算して、その合計値を第3微小変更トリガレベル(
V6+3・Δ■)としてレジスタR?Lにストアする(
RTL−■。+3・Δ■)。In this step #5, the trigger level is carried up again. That is, the minute level ΔV is changed to the second minute change trigger level (V, +2・Δ■) stored in the register RTL.
, and the total value is set as the third minute change trigger level (
V6+3・Δ■) as register R? Store in L (
RTL-■. +3・Δ■).
次いでステップ#6を経て、ステップ#3で、第3微小
変更トリガレベル(V、+3・ΔV)に基づいて、前述
と同様に入力信号S、の立下り・立上り間の時間L4を
測定する。第3図(A)の場合は、t、=’rであるか
ら、次のステップ#4ではYESと判断し、ステップ#
7に移行する。Next, through step #6, in step #3, the time L4 between the fall and rise of the input signal S is measured based on the third minute change trigger level (V, +3·ΔV) in the same manner as described above. In the case of FIG. 3(A), since t,='r, it is judged as YES in the next step #4, and step #4 is determined as YES.
Move to 7.
ステップ#7では、レジスタRttにストアされている
第3微小変更トリガレベル(■。+3・Δ■)を実測定
レベル■。とみなしてメモリに書き込むとともに、この
実測定レベル■。のデータを外部に出力した後、フロー
を終了する。In step #7, the third minute change trigger level (■.+3·Δ■) stored in the register Rtt is set to the actual measurement level ■. ■This actual measurement level is assumed and written to memory. After outputting the data to the outside, the flow ends.
このステップ#7が、発明の構成にいう[時間比較手段
によって測定時間と所定時間が一致したときに、そのと
きのトリガレベルを測定レベルとして出力する測定レベ
ル出力手段」にそとする6なお、場合によっては、ステ
ップ#6の判断でレジスタRTLの内容が最大値V r
aaxを超えることがある。その場合は、直ちにフロー
を終了する。This step #7 is based on the "measurement level output means for outputting the trigger level at that time as the measurement level when the measurement time and the predetermined time match by the time comparison means" in the constitution of the invention. In some cases, the content of the register RTL may be the maximum value V r as determined in step #6.
It may exceed aax. In that case, immediately end the flow.
なお、電子デバイス6からの入力信号S、の波形が第3
図(B)のような場合には、初期のトリガレベルv0が
高く、1段階ごとの微小レベルΔ■の変更は、マイナス
側になる。即ち、■。−Δ■のようになる。Note that the waveform of the input signal S from the electronic device 6 is the third waveform.
In the case as shown in FIG. 3B, the initial trigger level v0 is high, and the change in the minute level Δ■ for each step is on the negative side. That is, ■. −Δ■.
ところで、ステップ#4での判断において、レジスタR
オにストアしたトリガレベルが測定対象レベルV、と一
致せず、測定対象レベル■oよりも大きくなる場合があ
る。By the way, in the judgment at step #4, register R
The trigger level stored in O does not match the measurement target level V, and may be higher than the measurement target level V.
しかし、微小レベルΔ■を電子デバイス6の良否判断の
許容範囲α以下(Δ■≦α)としておけば、不一致であ
っても電子デバイス6の良否の判断を誤ることがない。However, if the minute level Δ■ is set to be less than or equal to the allowable range α for determining the quality of the electronic device 6 (Δ■≦α), the determination of the quality of the electronic device 6 will not be mistaken even if there is a discrepancy.
また、ステップ#4の判断が最初にYESとなったとき
に、レジスタRTLにストアしたトリガレベルが測定対
象レベル■。よりも大きい場合には、変更する微小レベ
ルを最初の微小レベルΔVよりもさらに小さい微小レベ
ルΔV、とし、かつ、レジスタR?Lの内容からその微
小レベルΔ■、を今度は順次段階的に減算しながら、同
様のサイクルを繰り返し、次にステップ#4の判断がN
oとなったときに、変更する微小レベルを先の微小レベ
ルΔv1よりもさらに小さい微小レベルΔ■2にして、
再度順次段階的に加算しながら、同様のサイクルを繰り
返すように構成すれば、最終的にはレジスタR?Lスト
了したトリガレベルと測定対象レベルVIlとが一致す
ることになる。従って、電子デバイス6の良否の判定を
高精度化することができる。Further, when the determination in step #4 is YES for the first time, the trigger level stored in the register RTL is the measurement target level ■. , the minute level to be changed is set to a minute level ΔV that is even smaller than the first minute level ΔV, and the register R? This time, the same cycle is repeated while subtracting the minute level Δ■, from the contents of L, step by step, and then the judgment in step #4 is N.
o, the minute level to be changed is set to minute level Δ■2, which is even smaller than the previous minute level Δv1,
If the configuration is configured to repeat the same cycle while adding in steps again, the final result will be register R? The trigger level at which the L-strike has been completed and the measurement target level VII will match. Therefore, it is possible to highly accurately determine whether the electronic device 6 is good or bad.
〈発明の効果さ 本発明によれば、次の効果が発揮される。<Efficacy of invention According to the present invention, the following effects are achieved.
(a)トリガレベルの変更に基づいて測定対象レベルを
測定しているため、従来例のようにシビアなタイミング
処理を必要とせず、全体として回路構成を簡略化するこ
とができる。(a) Since the level to be measured is measured based on a change in the trigger level, there is no need for severe timing processing as in the conventional example, and the overall circuit configuration can be simplified.
(b)前記(a)と同様の理由により、従来例で生じて
いた同期ミスに起因する誤測定をなくすことができると
ともに、測定対象レベルを測定すべき時間が短いことや
入力波形が複雑であっても、そのことには影響されるこ
となく高精度な測定を行うことができる。(b) For the same reasons as in (a) above, it is possible to eliminate erroneous measurements caused by synchronization errors that occurred in the conventional example, and the time to measure the level of the measurement target is short and the input waveform is complex. Even if there is a problem, highly accurate measurements can be performed without being affected by it.
第1図ないし第3図は本発明の実施例に係り、第1図は
波形レベル測定装置のブロック回路図、第2図はフロー
チャート、第3図は波形図である。
第4図および第5図は従来例に係り、第4図は波形レベ
ル測定装置のブロック回路図、第5図は波形図である。
8・・・制御・演算回路1 to 3 relate to embodiments of the present invention, in which FIG. 1 is a block circuit diagram of a waveform level measuring device, FIG. 2 is a flowchart, and FIG. 3 is a waveform diagram. 4 and 5 relate to a conventional example, in which FIG. 4 is a block circuit diagram of a waveform level measuring device, and FIG. 5 is a waveform diagram. 8...Control/arithmetic circuit
Claims (1)
手段と、 入力波形に対するトリガレベルの設定手段と、前記トリ
ガレベルにおいて入力波形の立下り・立上り間または立
上り・立下り間の時間の測定手段と、 この時間測定手段による測定時間と前記所定時間設定手
段によって設定された所定時間との比較手段と、 これら両時間が一致するまで前記トリガレベルを段階的
に微小変更するトリガレベル微変手段と、前記時間比較
手段によって前記両時間が一致したときに、そのときの
トリガレベルを測定レベルとして出力する測定レベル出
力手段 とを備えた波形レベル測定装置。(1) means for setting a predetermined time including the level to be measured of the input waveform; means for setting a trigger level for the input waveform; and measuring the time between falling and rising edges or between rising and falling edges of the input waveform at the trigger level. means for comparing the time measured by the time measuring means with the predetermined time set by the predetermined time setting means; and trigger level fine changing means for slightly changing the trigger level step by step until these two times match. and measurement level output means for outputting a trigger level at that time as a measurement level when the two times match by the time comparison means.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61044399A JPH0727014B2 (en) | 1986-03-01 | 1986-03-01 | Waveform level measuring device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61044399A JPH0727014B2 (en) | 1986-03-01 | 1986-03-01 | Waveform level measuring device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS62203066A true JPS62203066A (en) | 1987-09-07 |
JPH0727014B2 JPH0727014B2 (en) | 1995-03-29 |
Family
ID=12690431
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61044399A Expired - Fee Related JPH0727014B2 (en) | 1986-03-01 | 1986-03-01 | Waveform level measuring device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0727014B2 (en) |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56106419A (en) * | 1980-01-25 | 1981-08-24 | Casio Comput Co Ltd | Voltage level detector |
-
1986
- 1986-03-01 JP JP61044399A patent/JPH0727014B2/en not_active Expired - Fee Related
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS56106419A (en) * | 1980-01-25 | 1981-08-24 | Casio Comput Co Ltd | Voltage level detector |
Also Published As
Publication number | Publication date |
---|---|
JPH0727014B2 (en) | 1995-03-29 |
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