JPS62201834U - - Google Patents
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- Publication number
- JPS62201834U JPS62201834U JP9083786U JP9083786U JPS62201834U JP S62201834 U JPS62201834 U JP S62201834U JP 9083786 U JP9083786 U JP 9083786U JP 9083786 U JP9083786 U JP 9083786U JP S62201834 U JPS62201834 U JP S62201834U
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- power supply
- switching transistor
- turned
- reverse current
- Prior art date
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- Pending
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- Power Sources (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Description
第１図は本考案一実施例の回路図、第２図は従
来例の回路図、第３図は従来例および本考案の動
作説明図である。 ＤＣは電源回路、Ｄ１，Ｄ２はダイオード、Ｃ
ＰＵはマイクロコンピユータ、Ｂはバツテリ、Ｑ
はスイツチングトランジスタ、Ｒは抵抗、ＶＤＤ
，ＶＳＳは電源端子である。
来例の回路図、第３図は従来例および本考案の動
作説明図である。 ＤＣは電源回路、Ｄ１，Ｄ２はダイオード、Ｃ
ＰＵはマイクロコンピユータ、Ｂはバツテリ、Ｑ
はスイツチングトランジスタ、Ｒは抵抗、ＶＤＤ
，ＶＳＳは電源端子である。
Claims (1)
- 電源回路から出力される直流電圧を第１の逆流
阻止用ダイオードを介してメモリー回路の電源端
子に印加するとともに、バツクアツプ用バツテリ
から出力される上記直流電圧よりも低い電池電圧
をスイツチングトランジスタを介して上記電源端
子に印加し、第２の逆流阻止用ダイオードを介し
て上記直流電圧が印加された抵抗の両端電圧に基
いてスイツチングトランジスタをオン、オフ制御
せしめ、直流電圧が所定電圧より高い場合にスイ
ツチングトランジスタをオフさせ、直流電圧が所
定電圧よりも低くなつた場合にオンさせるように
したことを特徴とするメモリーバツクアツプ回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9083786U JPS62201834U (ja) | 1986-06-14 | 1986-06-14 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9083786U JPS62201834U (ja) | 1986-06-14 | 1986-06-14 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62201834U true JPS62201834U (ja) | 1987-12-23 |
Family
ID=30951071
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9083786U Pending JPS62201834U (ja) | 1986-06-14 | 1986-06-14 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62201834U (ja) |
-
1986
- 1986-06-14 JP JP9083786U patent/JPS62201834U/ja active Pending
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