JPS62166528U - - Google Patents
Info
- Publication number
- JPS62166528U JPS62166528U JP5344086U JP5344086U JPS62166528U JP S62166528 U JPS62166528 U JP S62166528U JP 5344086 U JP5344086 U JP 5344086U JP 5344086 U JP5344086 U JP 5344086U JP S62166528 U JPS62166528 U JP S62166528U
- Authority
- JP
- Japan
- Prior art keywords
- resistor
- terminal device
- interface circuit
- circuit
- switch
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 5
Landscapes
- Logic Circuits (AREA)
Description
第１図は本考案の第１の実施例を示す回路図、
第２図は本考案の第２の実施例を示す回路図、第
３図は端末装置の接続図、第４図ａ，ｂは従来の
ＴＴＬインターフエースによるインターフエース
回路を示す回路図、第５図ａ，ｂは従来のＣＭＯ
Ｓインターフエースによるインターフエース回路
を示す回路図である。 ２ａ，２ｂ，…；入力端子、３ａ，３ｂ，…；
ラインレシーバ、４ａ，４ｂ，…；第２の抵抗器
、５ａ，５ｂ，…；ダイオード、６，９ａ，９ｂ
…；スイツチ。
第２図は本考案の第２の実施例を示す回路図、第
３図は端末装置の接続図、第４図ａ，ｂは従来の
ＴＴＬインターフエースによるインターフエース
回路を示す回路図、第５図ａ，ｂは従来のＣＭＯ
Ｓインターフエースによるインターフエース回路
を示す回路図である。 ２ａ，２ｂ，…；入力端子、３ａ，３ｂ，…；
ラインレシーバ、４ａ，４ｂ，…；第２の抵抗器
、５ａ，５ｂ，…；ダイオード、６，９ａ，９ｂ
…；スイツチ。
Claims (1)
- 端末装置における受信用のインターフエース回
路において、外部信号の入力端子と電源の間に、
第１の抵抗器と、これより小さな抵抗値を持つ第
２の抵抗器及びスイツチの直列回路とを並列に接
続したことを特徴とする端末装置のインターフエ
ース回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5344086U JPS62166528U (ja) | 1986-04-11 | 1986-04-11 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5344086U JPS62166528U (ja) | 1986-04-11 | 1986-04-11 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62166528U true JPS62166528U (ja) | 1987-10-22 |
Family
ID=30879502
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5344086U Pending JPS62166528U (ja) | 1986-04-11 | 1986-04-11 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62166528U (ja) |
-
1986
- 1986-04-11 JP JP5344086U patent/JPS62166528U/ja active Pending