JPS643221U - - Google Patents
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- Publication number
- JPS643221U JPS643221U JP9502087U JP9502087U JPS643221U JP S643221 U JPS643221 U JP S643221U JP 9502087 U JP9502087 U JP 9502087U JP 9502087 U JP9502087 U JP 9502087U JP S643221 U JPS643221 U JP S643221U
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- resistor
- side output
- generation circuit
- utility
- Prior art date
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- Pending
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- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
Landscapes
- Logic Circuits (AREA)
- Synchronizing For Television (AREA)
Description
第１図は本考案の一実施例の３値信号生成回路
の回路図、第２図ａ〜ｃは信号波形図である。 １……リセツト信号入力端子、２……水平同期
信号入力端子、３……出力端子。
の回路図、第２図ａ〜ｃは信号波形図である。 １……リセツト信号入力端子、２……水平同期
信号入力端子、３……出力端子。
Claims (1)
- 【実用新案登録請求の範囲】 (1) リセツト信号印加により抵抗プルアツプ側
出力が「Ｌ」レベルとなる第一のトランジスタと
、水平同期信号印加によりオン、オフ動作を行う
第２のトランジスタとを具備し、該第２のトラン
ジスタの非接地側を抵抗を介して上記第１のトラ
ンジスタの抵抗プルアツプ側出力に接続し、該抵
抗プルアツプ側出力を出力端子に接続してなるこ
とを特徴とする３値信号生成回路。 (2) 上記第１及第２のトランジスタがエミツタ
接地のＮＰＮトランジスタでなり、上記リセツト
信号がインバータを介して上記第１のトランジス
タのベースに印加されるようにしたことを特徴と
する実用新案登録請求の範囲第１項記載の３値信
号生成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9502087U JPS643221U (ja) | 1987-06-20 | 1987-06-20 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9502087U JPS643221U (ja) | 1987-06-20 | 1987-06-20 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS643221U true JPS643221U (ja) | 1989-01-10 |
Family
ID=31319630
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9502087U Pending JPS643221U (ja) | 1987-06-20 | 1987-06-20 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS643221U (ja) |
-
1987
- 1987-06-20 JP JP9502087U patent/JPS643221U/ja active Pending
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