JPS62157442A - Ｉｓｄｎ用複合端末装置 - Google Patents
Ｉｓｄｎ用複合端末装置Info
- Publication number
- JPS62157442A JPS62157442A JP60297494A JP29749485A JPS62157442A JP S62157442 A JPS62157442 A JP S62157442A JP 60297494 A JP60297494 A JP 60297494A JP 29749485 A JP29749485 A JP 29749485A JP S62157442 A JPS62157442 A JP S62157442A
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- channel
- speed
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、ディジタル通信のＩＳＤＮ用複合端末装置に
関するものである。
関するものである。
従来の技術
現在、電話機や各種のディジタル端末装置を統合するデ
ィジタル通信網の構築が進展しつつある。
ィジタル通信網の構築が進展しつつある。
このようなディジタル通信網に関するＣＣＩＴＴの勧告
に基づ＜ ｒ Ｓ Ｄ Ｎ （Ｉｎｔｅｇｒａｔｅｄ
５ｅｒｖｉ −ｃｅｓ Ｄｉｇｉｔａｌ Ｎｅｔｉ
ｙｏｒｋ ）規格によれば、信号速度６４ ｋｂｉｔｓ
／ｓ のＢチャネル二つを通信用チャネルとして持ち
、通話路設定のための制御用信号及びバケット用のチャ
ネルを信号速度１６ ｋｂｉｔｓ／ｓのＤチャネルとし
て持つ信号速度１４４ ｋｂｉｔｓ／ｓの（、２Ｂ ＋
Ｄ ）チャネルを、それぞれ上り用、下り用として端
末装置に二つ割当てる構成となっている。
に基づ＜ ｒ Ｓ Ｄ Ｎ （Ｉｎｔｅｇｒａｔｅｄ
５ｅｒｖｉ −ｃｅｓ Ｄｉｇｉｔａｌ Ｎｅｔｉ
ｙｏｒｋ ）規格によれば、信号速度６４ ｋｂｉｔｓ
／ｓ のＢチャネル二つを通信用チャネルとして持ち
、通話路設定のための制御用信号及びバケット用のチャ
ネルを信号速度１６ ｋｂｉｔｓ／ｓのＤチャネルとし
て持つ信号速度１４４ ｋｂｉｔｓ／ｓの（、２Ｂ ＋
Ｄ ）チャネルを、それぞれ上り用、下り用として端
末装置に二つ割当てる構成となっている。
また、ＩＳＤＮの端末装置としては、一つの加入者番号
を有しつつ機能的には独立した複数の端末装置から構成
される複合端末装置の混在が予定されている。
を有しつつ機能的には独立した複数の端末装置から構成
される複合端末装置の混在が予定されている。
発明が解決しようとする問題点
上述のＩＳＤＮ規格は、電話機の現在の信号速度６．４
ｋ ｂｉ ｔｓ／ｓ を有するＢチャネルを割当て
単位として、一端末装置に一時に電話機２台分の通信容
量を割当てようとするものである。従って、複合端末装
置において、信号速度６４ ｋｂｉｔｓ／ｓ以下の端末
装置にＢチャネルを割当てる場合には、種々の方法によ
って６４ ｋｂｉｔｓ／ｓ まで速度変換をすること
が必要になる。
ｋ ｂｉ ｔｓ／ｓ を有するＢチャネルを割当て
単位として、一端末装置に一時に電話機２台分の通信容
量を割当てようとするものである。従って、複合端末装
置において、信号速度６４ ｋｂｉｔｓ／ｓ以下の端末
装置にＢチャネルを割当てる場合には、種々の方法によ
って６４ ｋｂｉｔｓ／ｓ まで速度変換をすること
が必要になる。
この結果、多数の低速端末装置から成る複合端末装置間
で通信を行う場合には、Ｂチャネルの通信容量が実際に
は余っていても、各複合端末装置内の二つの端末装置間
の通信しかできず、通信容量が無駄になるという問題が
ある。
で通信を行う場合には、Ｂチャネルの通信容量が実際に
は余っていても、各複合端末装置内の二つの端末装置間
の通信しかできず、通信容量が無駄になるという問題が
ある。
発明の構成
問題点を解決するための手段
上記従来技術の問題点を解決する本発明のＩＳＤＮ用複
合端末装置は、自複合端末装置内の各端末装置の信号速
度を６４ Ｘ （Ｎ／ ８ ） ｋｂｉｔｓ／ｓ。
合端末装置は、自複合端末装置内の各端末装置の信号速
度を６４ Ｘ （Ｎ／ ８ ） ｋｂｉｔｓ／ｓ。
ただしＮ＝１〜８、に速度変調してＢチャネル内の未使
用ビット位置に挿入して送出し、挿入したＢチャネル内
ビット位置情報、発信端末装置の信号速度情報及び宛先
端末装置情報をＤチャネルを使用して交換機に送出する
送信制御手段と、受信したＢチャネル内の各ビット位置
から同一宛先を有するビットを抽出して受信した信号速
度情報に基づいて速度復調を行い自複合端末装置内の対
応の宛先端末装置に転送する受信制御手段とを備え、１
つのＢチャネルを複数の端末装置に分割使用させること
により、二つのＢチャネルをそれらの通信容量の上限ま
で有効利用するように構成されている。
用ビット位置に挿入して送出し、挿入したＢチャネル内
ビット位置情報、発信端末装置の信号速度情報及び宛先
端末装置情報をＤチャネルを使用して交換機に送出する
送信制御手段と、受信したＢチャネル内の各ビット位置
から同一宛先を有するビットを抽出して受信した信号速
度情報に基づいて速度復調を行い自複合端末装置内の対
応の宛先端末装置に転送する受信制御手段とを備え、１
つのＢチャネルを複数の端末装置に分割使用させること
により、二つのＢチャネルをそれらの通信容量の上限ま
で有効利用するように構成されている。
以下、本発明の作用を実施例と共に詳細に説明する。
第１図は、本発明の一実施例の複合端末装置の構成をＩ
ＳＤＮシステムの′他の部分と共に示す構成ブロック図
である。
ＳＤＮシステムの′他の部分と共に示す構成ブロック図
である。
図中、ＴＥ、 、ＴＥ、は複合端末装置、ＥＴは交換機
、Ｎ Ｔ ｏとＮＴ、は網終端装置、■。、Ｉｆｌは（
２Ｂ＋Ｄ）構成のＣＣＩＴＴ １インタフエースを満
たす上り、下りの宅用系バスである。
、Ｎ Ｔ ｏとＮＴ、は網終端装置、■。、Ｉｆｌは（
２Ｂ＋Ｄ）構成のＣＣＩＴＴ １インタフエースを満
たす上り、下りの宅用系バスである。
各複合端末装置は、Ｔ Ｅ ａで代表して示すように、
インタフェース回路ＳとＬＡＰＤ、プロセッサＰ、多重
化／多重分離回路ＭＵＸ、複数の速度変復調回路Ｇｏ、
ＣＩ ・・・ＣＲ１複数の端末袋？２Ｔ、、Ｔ、 ・
・・Ｔ、、を備えている。
インタフェース回路ＳとＬＡＰＤ、プロセッサＰ、多重
化／多重分離回路ＭＵＸ、複数の速度変復調回路Ｇｏ、
ＣＩ ・・・ＣＲ１複数の端末袋？２Ｔ、、Ｔ、 ・
・・Ｔ、、を備えている。
インタフェース回路Ｓは、ＣＣＩＴＴ Ｉインタフェ
ースＳ点の機能を備えている。インタフェース回路ＬＡ
ＰＤは、ＣＣＩＴＴ Ｄチャネルプロトコル・レイア
２の機能を備え、入出力バス■１０゜ を介して上位レ
イアを満足するプロセッサＰへ接続される。プロセッサ
Ｐはレイ７３以上の機能を備える処理装置であり、Ｄチ
ャネルを介して相手方複合端末装置のプロセッサＰと通
信制御部情報を授受する。また、 プロセッサＰは、入
出力バス１１０．を介して多重化／多重分離回路ＭＵＸ
、速度変復調送信００〜Ｃ７、端末装置Ｔ０〜Ｔ７を制
御する。
ースＳ点の機能を備えている。インタフェース回路ＬＡ
ＰＤは、ＣＣＩＴＴ Ｄチャネルプロトコル・レイア
２の機能を備え、入出力バス■１０゜ を介して上位レ
イアを満足するプロセッサＰへ接続される。プロセッサ
Ｐはレイ７３以上の機能を備える処理装置であり、Ｄチ
ャネルを介して相手方複合端末装置のプロセッサＰと通
信制御部情報を授受する。また、 プロセッサＰは、入
出力バス１１０．を介して多重化／多重分離回路ＭＵＸ
、速度変復調送信００〜Ｃ７、端末装置Ｔ０〜Ｔ７を制
御する。
速度変復調装置００〜Ｃ１は、対応の端末装置Ｔ、−Ｔ
、入出力データの信号速度を６４Ｘ（Ｎ／ ８ ） ｋ
ｂｉｔｓ／ｓ −、ただしＮ＝１〜８、に速度変調し
、これと逆の速度復調を行う。
、入出力データの信号速度を６４Ｘ（Ｎ／ ８ ） ｋ
ｂｉｔｓ／ｓ −、ただしＮ＝１〜８、に速度変調し
、これと逆の速度復調を行う。
複合端末装置Ｔ Ｅ ＯのプロセッサＰは、端末装置の
一つ（端末装置Ｔ０とする）から複合端末装置Ｔ Ｅ
ｔの端末装置の一つ（端末装置Ｔ＋ とする）に対する
情報送出要求を受付けると、端末装置Ｔ０の信号速度を
調査する。端末装置Ｔ０の信号速度が２４ ｋｂｉｔｓ
／ｓ よりも高くかつ３２ ｋｂｉｔｓ／ｓ以下の範
囲であるとする。次に、プロセッサＰは、チャネルＢの
使用状況を調査する。この場合、両Ｂチャネルの全ての
ビット位置が未使用状態であるため、端末装置Ｔ０の情
報送出用にＢ、チャネルのビット位置２４〜２７を予約
する。
一つ（端末装置Ｔ０とする）から複合端末装置Ｔ Ｅ
ｔの端末装置の一つ（端末装置Ｔ＋ とする）に対する
情報送出要求を受付けると、端末装置Ｔ０の信号速度を
調査する。端末装置Ｔ０の信号速度が２４ ｋｂｉｔｓ
／ｓ よりも高くかつ３２ ｋｂｉｔｓ／ｓ以下の範
囲であるとする。次に、プロセッサＰは、チャネルＢの
使用状況を調査する。この場合、両Ｂチャネルの全ての
ビット位置が未使用状態であるため、端末装置Ｔ０の情
報送出用にＢ、チャネルのビット位置２４〜２７を予約
する。
引き続き、プロセッサＰは、複合端末装置ＴＥ。
の宛先端末装置Ｔ、に自複合端末装置ＴＥ、の発信端末
装置Ｔ０からの送信信号をＢ１チャネルのビット位置２
４〜２７に送出したい旨を発信端末装置Ｔ０信号速度と
共に、Ｄチャネルによって交換機ＥＴに通知する。
装置Ｔ０からの送信信号をＢ１チャネルのビット位置２
４〜２７に送出したい旨を発信端末装置Ｔ０信号速度と
共に、Ｄチャネルによって交換機ＥＴに通知する。
相手方複合端末装置ＴＥ、のプロセッサＰは、上記複合
端末装置ＴＥ、からの発信要求と信号速度情報を交換機
ＥＴからＤチャネルを介して受信すると、受信の可否を
調査し可であれば、受信に使用できるＢチャネル番号“
とその４個のビット位置情報と共に受信可の応答をＤチ
ャネルによって交換機ＥＴに返す。
端末装置ＴＥ、からの発信要求と信号速度情報を交換機
ＥＴからＤチャネルを介して受信すると、受信の可否を
調査し可であれば、受信に使用できるＢチャネル番号“
とその４個のビット位置情報と共に受信可の応答をＤチ
ャネルによって交換機ＥＴに返す。
複合端末装置ＴＥＯのプロセッサＰは、上記受信可の応
答を交換機から受けると、送信要求を発した端末装置Ｔ
。に送信の開始を指令すると共に、速度変復調装置Ｃ０
と多重化／多重分離回路ＭＵＸを起動する。速度変復調
装置Ｃ０は、端末装置Ｔ０から受けた２ ４ ｋｂｉｔ
ｓ／ｓ よりも高く３２ｋｂｉｔｓ／ｓ 以下の速
度の信号を、速度変換用のバッファメモリに書込むと共
に、６２．５μｓの読出し中断時間を設けながら、書込
み順に４ビツトずつ６４ ｋｂｉｔｓ／ｓ の速度で
読出して多重化／多重分離回路ＭＵＸに転送するという
速度変換操作を繰り返す。多重化／多重分離回路ＭＵＸ
は、速度変復調装置Ｃ０から受けた６２．５μｓの中断
時間を伴う６４ ｋｂｉｔｓ／ｓ のビット列から成
る信号速度３２ ｋｂｉｔｓへの送信信号をＢ１チャネ
ルのビット位置２４〜２７に挿入する。
答を交換機から受けると、送信要求を発した端末装置Ｔ
。に送信の開始を指令すると共に、速度変復調装置Ｃ０
と多重化／多重分離回路ＭＵＸを起動する。速度変復調
装置Ｃ０は、端末装置Ｔ０から受けた２ ４ ｋｂｉｔ
ｓ／ｓ よりも高く３２ｋｂｉｔｓ／ｓ 以下の速
度の信号を、速度変換用のバッファメモリに書込むと共
に、６２．５μｓの読出し中断時間を設けながら、書込
み順に４ビツトずつ６４ ｋｂｉｔｓ／ｓ の速度で
読出して多重化／多重分離回路ＭＵＸに転送するという
速度変換操作を繰り返す。多重化／多重分離回路ＭＵＸ
は、速度変復調装置Ｃ０から受けた６２．５μｓの中断
時間を伴う６４ ｋｂｉｔｓ／ｓ のビット列から成
る信号速度３２ ｋｂｉｔｓへの送信信号をＢ１チャネ
ルのビット位置２４〜２７に挿入する。
この結果、第２図に示すように、端末装置Ｔ０から送出
された２ ４ ｋｂｉｔｓ／ｓ よりも高くかつ３２
ｋｂｉｔｓ／ｓ 以下の速度を有する端末装置Ｔ０の
送信信号が３２ ｋｂｉｔｓ／ｓ に速度変調されて
上り宅用系バスＩＬＩ上のＢ、チャネルのピント位置２
４〜２７に送出される。
された２ ４ ｋｂｉｔｓ／ｓ よりも高くかつ３２
ｋｂｉｔｓ／ｓ 以下の速度を有する端末装置Ｔ０の
送信信号が３２ ｋｂｉｔｓ／ｓ に速度変調されて
上り宅用系バスＩＬＩ上のＢ、チャネルのピント位置２
４〜２７に送出される。
複合端末装置ＴＥ、のプロセッサは、交換機ＥＴから受
けたＤチャネル情報に基づいて交換機に通知したＢチャ
ネル内の所定の４個のビット位置の信号を抽出して宛先
端末装置Ｔ１に接続される速度変復調装置へ転送すべき
旨を自装置内の多重化／多重分離回路に指令し、速度変
復調装置には、多重化／多重分離回路から受けた３ ２
ｋｂｉｔｓ／ｓの信号を信号速度情報に基づく信号速
度に復調して端末装置Ｔ、に転送すべき旨を指令する。
けたＤチャネル情報に基づいて交換機に通知したＢチャ
ネル内の所定の４個のビット位置の信号を抽出して宛先
端末装置Ｔ１に接続される速度変復調装置へ転送すべき
旨を自装置内の多重化／多重分離回路に指令し、速度変
復調装置には、多重化／多重分離回路から受けた３ ２
ｋｂｉｔｓ／ｓの信号を信号速度情報に基づく信号速
度に復調して端末装置Ｔ、に転送すべき旨を指令する。
このようにして、複合端末装置ＴＥ、と交換機ＥＴ間で
は、Ｂ、チャネル内のビット位置２４〜２７を使用し、
また、交換機ＥＴと複合端末装置ＴＥ、間では複合端末
装置ＴＥ、が交換機に通知したＢ、又はＢ２チャネル内
の４個のビット位置を使用して通信が開始される。
は、Ｂ、チャネル内のビット位置２４〜２７を使用し、
また、交換機ＥＴと複合端末装置ＴＥ、間では複合端末
装置ＴＥ、が交換機に通知したＢ、又はＢ２チャネル内
の４個のビット位置を使用して通信が開始される。
上記通信の続行中に、複合端末装置ＴＥ６の他の端末装
置の一つ（端末装置Ｔ２とする）から複合端末装置ＴＥ
、の端末装置の一つ（端末装置Ｔ３とする）に新たな送
信要求が発せられたものとする。
置の一つ（端末装置Ｔ２とする）から複合端末装置ＴＥ
、の端末装置の一つ（端末装置Ｔ３とする）に新たな送
信要求が発せられたものとする。
複合端末装置ＴＥ、のプロセッサＰは、この送信要求を
受付けると、端末装置Ｔ２の信号速度と、Ｂ１、Ｂｚチ
ャネルの使用状況を調査する。端末装置Ｔ２の信号速度
もまた２ ４ ｋｂｉｔｓ／ｓ よりも高くかつ３２
ｋｂｉｔｓ／ｓ以下であるとすれば、プロセッサＰは
、Ｂ１チャネルのビット位置２４〜２７が端末装置Ｔ０
によって使用されているが、このチャネルの未使用の４
個のビット位置２°〜２３を使用して３２ ｋｂｉｔｓ
／ｓ の情報を送信できることを検出する。
受付けると、端末装置Ｔ２の信号速度と、Ｂ１、Ｂｚチ
ャネルの使用状況を調査する。端末装置Ｔ２の信号速度
もまた２ ４ ｋｂｉｔｓ／ｓ よりも高くかつ３２
ｋｂｉｔｓ／ｓ以下であるとすれば、プロセッサＰは
、Ｂ１チャネルのビット位置２４〜２７が端末装置Ｔ０
によって使用されているが、このチャネルの未使用の４
個のビット位置２°〜２３を使用して３２ ｋｂｉｔｓ
／ｓ の情報を送信できることを検出する。
複合端末装置ＴＥ、のプロセッサＰは、複合端末装置Ｔ
Ｅ、の端末装置Ｔ２から複合端末装置ＴＥ１の宛先端末
装置Ｔ、への送信データがＢ、チャネルのビット位置２
０〜２３を使用して送出される旨を、再びＤチャネルを
使用して交換機ＥＴに通知する。以後は端末装置Ｔ０か
らの送信処理と同様の処理が繰り返され、複合端末装置
ＴＥ。
Ｅ、の端末装置Ｔ２から複合端末装置ＴＥ１の宛先端末
装置Ｔ、への送信データがＢ、チャネルのビット位置２
０〜２３を使用して送出される旨を、再びＤチャネルを
使用して交換機ＥＴに通知する。以後は端末装置Ｔ０か
らの送信処理と同様の処理が繰り返され、複合端末装置
ＴＥ。
の端末装置Ｔ２と交換機ＥＴ間ではＢ１チャネルのビッ
ト位置２°〜２３を使用して、また、交換機ＥＴと複合
端末装置ＴＥ、間では、複合端末装置ＴＥ、のプロセッ
サが指定したＢ１又はＢ２チャネルの４個のビット位置
を使用して、通信が開始される。
ト位置２°〜２３を使用して、また、交換機ＥＴと複合
端末装置ＴＥ、間では、複合端末装置ＴＥ、のプロセッ
サが指定したＢ１又はＢ２チャネルの４個のビット位置
を使用して、通信が開始される。
すなわち、第３図に示すように、複合端末装置ＴＢＧ内
の端末装置Ｔ０からの送信信号と、端末送信Ｔ２からの
送信信号のそれぞれがＢ、チャネル内のビット位置２４
〜２７と、ビット位置２゜〜２３に送出される。
の端末装置Ｔ０からの送信信号と、端末送信Ｔ２からの
送信信号のそれぞれがＢ、チャネル内のビット位置２４
〜２７と、ビット位置２゜〜２３に送出される。
上記二つの通信の続行中に、複合端末装置Ｔ Ｅ 。
内の更に他の端末装置が複合端末装置ＴＥ、内の更に他
の端末装置に対して送信を行いたい旨の新たな送信要求
を発すると、複合端末装置ＴＥ、のプロセッサＰは、そ
の端末装置に未使用状態にあるＢ２チャネル内の一部又
は全部のビット位置を割当てる。
の端末装置に対して送信を行いたい旨の新たな送信要求
を発すると、複合端末装置ＴＥ、のプロセッサＰは、そ
の端末装置に未使用状態にあるＢ２チャネル内の一部又
は全部のビット位置を割当てる。
以上、信号速度が２４ ｋｂｉｔｓ／ｓ よりも高く
がつ３２ ｋｂｉｔｓ／ｓ 以下の場合には、Ｂ、又
はＢ２チャネル内の連続した４個の未使用ビット位置を
割当てる構成を例示したが、いずれかのチャネル内の偶
数又は奇数の４個のビット位置を割当てる構成としても
よい。
がつ３２ ｋｂｉｔｓ／ｓ 以下の場合には、Ｂ、又
はＢ２チャネル内の連続した４個の未使用ビット位置を
割当てる構成を例示したが、いずれかのチャネル内の偶
数又は奇数の４個のビット位置を割当てる構成としても
よい。
また、信号速度が２４ ｋｂｉｔｓ／ｓ よりも高く
かつ３２ ｋｂｉｔｓ／ｓ 以下範囲にある場合を例
示したが、その他の範囲の信号速度については、それぞ
れ８．１６．２４．４０．５６．６４ ｋｂｉｔｓ／ｓ
に速度変調して同順に８１又はＢ２チャネル内の１．２
．３．５．６．７及び８個の未使用ビット位置を割当て
ればよい。
かつ３２ ｋｂｉｔｓ／ｓ 以下範囲にある場合を例
示したが、その他の範囲の信号速度については、それぞ
れ８．１６．２４．４０．５６．６４ ｋｂｉｔｓ／ｓ
に速度変調して同順に８１又はＢ２チャネル内の１．２
．３．５．６．７及び８個の未使用ビット位置を割当て
ればよい。
発明の効果
以上詳細に説明したように、本発明のＩＳＤＮ用複合端
末装置は、入出力データ速度を６４（Ｎ／ ８ ） ｋ
ｂｉｔｓ／ｓ （Ｎ ＝ １〜８ ）に変復調し、Ｂチ
ャネルを複数の端末装置で分割利用する構成であるから
、、Ｂチャネルをその通信容量の上限まで有効利用でき
、ＩＳＤＮの一層高度なサービスを提供できるという効
果が奏される。
末装置は、入出力データ速度を６４（Ｎ／ ８ ） ｋ
ｂｉｔｓ／ｓ （Ｎ ＝ １〜８ ）に変復調し、Ｂチ
ャネルを複数の端末装置で分割利用する構成であるから
、、Ｂチャネルをその通信容量の上限まで有効利用でき
、ＩＳＤＮの一層高度なサービスを提供できるという効
果が奏される。
第１図は本発明の一実施例のＩＳＤＮ用複合端末装置の
構成をＩＳＤＮ通信システムの関連部分と共に示すブロ
ック図、第２図、第３図は上記実施例の動作を説明する
ためのタイミングチャートである。 ＴＥｏ、ＴＥＩ ・・ＩＳＤＮ用複合端末装置、ＥＴ・
・・交換機、ＮＴＯ、ＮＴ、 ・・・網終端装置、Ｉ
ｕ、Ｉゎ ・・上り、下りのＩＳＤＮ宅用系バス、Ｓ、
ＬＡＰＤ・・インタフェース回路、ＭＵＸ・・多重化／
多重分離回路、００〜Ｃ７・、速度変復調装置、Ｔ０〜
Ｔ７ ・・端末装置、Ｐ・・プロセッサ。
構成をＩＳＤＮ通信システムの関連部分と共に示すブロ
ック図、第２図、第３図は上記実施例の動作を説明する
ためのタイミングチャートである。 ＴＥｏ、ＴＥＩ ・・ＩＳＤＮ用複合端末装置、ＥＴ・
・・交換機、ＮＴＯ、ＮＴ、 ・・・網終端装置、Ｉ
ｕ、Ｉゎ ・・上り、下りのＩＳＤＮ宅用系バス、Ｓ、
ＬＡＰＤ・・インタフェース回路、ＭＵＸ・・多重化／
多重分離回路、００〜Ｃ７・、速度変復調装置、Ｔ０〜
Ｔ７ ・・端末装置、Ｐ・・プロセッサ。
Claims (1)
- 【特許請求の範囲】 ＩＳＤＮ規格の宅用系に接続されるＩＳＤＮ用複合端末
装置において、 自複合端末内の各端末装置の信号速度を６４×（Ｎ／８
）ｋｂｉｔｓ／ｓ、ただしＮ＝１〜８、に速度変調して
Ｂチャネル内の未使用ビット位置に挿入して送出し、挿
入したＢチャネル内ビット位置情報、発信端末装置の信
号速度情報及び宛先端末装置情報をＤチャネルを使用し
て交換機に通知する送信制御手段と、 受信したＢチャネル内の各ビット位置から同一宛先を有
するビットを抽出して受信した信号速度情報に基づく速
度復調を行い自複合端末装置内の対応の宛先端末装置に
転送する受信制御手段とを備えたことを特徴とするＩＳ
ＤＮ用複合端末装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60297494A JPS62157442A (ja) | 1985-12-30 | 1985-12-30 | Ｉｓｄｎ用複合端末装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60297494A JPS62157442A (ja) | 1985-12-30 | 1985-12-30 | Ｉｓｄｎ用複合端末装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62157442A true JPS62157442A (ja) | 1987-07-13 |
Family
ID=17847231
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60297494A Pending JPS62157442A (ja) | 1985-12-30 | 1985-12-30 | Ｉｓｄｎ用複合端末装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62157442A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63232697A (ja) * | 1987-03-20 | 1988-09-28 | Hitachi Ltd | 多元情報交換方法及びそのための装置 |
| JPH0290840A (ja) * | 1988-09-28 | 1990-03-30 | Hitachi Ltd | データ通信方式 |
| JPH02296427A (ja) * | 1989-05-11 | 1990-12-07 | Fujitsu Ltd | 時分割多重化装置のバスインタフェース回路 |
-
1985
- 1985-12-30 JP JP60297494A patent/JPS62157442A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63232697A (ja) * | 1987-03-20 | 1988-09-28 | Hitachi Ltd | 多元情報交換方法及びそのための装置 |
| JPH0290840A (ja) * | 1988-09-28 | 1990-03-30 | Hitachi Ltd | データ通信方式 |
| JPH02296427A (ja) * | 1989-05-11 | 1990-12-07 | Fujitsu Ltd | 時分割多重化装置のバスインタフェース回路 |
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