JPS62119526A - アクテイブマトリクス液晶駆動装置 - Google Patents
アクテイブマトリクス液晶駆動装置Info
- Publication number
- JPS62119526A JPS62119526A JP26031885A JP26031885A JPS62119526A JP S62119526 A JPS62119526 A JP S62119526A JP 26031885 A JP26031885 A JP 26031885A JP 26031885 A JP26031885 A JP 26031885A JP S62119526 A JPS62119526 A JP S62119526A
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- Japan
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- liquid crystal
- voltage
- pixel
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
本発明は、アクティブマトリクス液晶パネルの各液晶素
子にデータ線から所定の電圧を印加する際に、液晶素子
の駆動用として用いる画素トランジスタのゲート容量に
蓄積される電荷が液晶素子に放電することによって生じ
る液晶素子の電位変動を防止するために、画素トランジ
スタがオフすると同時にデータ線に正の電圧を重畳する
ことにより、画素１−ランジスタのドレイン電圧がソー
ス電圧よりも高くなる様に保持し、これによって蓄積電
荷をドレイン側に放電させることで、液晶素子の電位変
ＩＪ＋を防止したアクティブマトリクス液晶駆動装置で
ある。
子にデータ線から所定の電圧を印加する際に、液晶素子
の駆動用として用いる画素トランジスタのゲート容量に
蓄積される電荷が液晶素子に放電することによって生じ
る液晶素子の電位変動を防止するために、画素トランジ
スタがオフすると同時にデータ線に正の電圧を重畳する
ことにより、画素１−ランジスタのドレイン電圧がソー
ス電圧よりも高くなる様に保持し、これによって蓄積電
荷をドレイン側に放電させることで、液晶素子の電位変
ＩＪ＋を防止したアクティブマトリクス液晶駆動装置で
ある。
本発明は、液晶を使用して画像表示を行うアクティブマ
トリクス表示装置において、各液晶素子の駆動用として
用いられる画素１−ランジスタの駆動装置の改良に関す
る。
トリクス表示装置において、各液晶素子の駆動用として
用いられる画素１−ランジスタの駆動装置の改良に関す
る。
従来、この種の装置としては、液晶素子の駆動用として
用いられる画素トランジスタがゲート容量を有するため
に、そのゲート容量に蓄積された電荷が液晶素子に放電
することにより、液晶素子の電位変動が生じるという問
題があった。
用いられる画素トランジスタがゲート容量を有するため
に、そのゲート容量に蓄積された電荷が液晶素子に放電
することにより、液晶素子の電位変動が生じるという問
題があった。
そこで、この問題を解決する手段として、例えば画素ト
ランジスタに印加する画素データ電圧として予め変動分
を加えて補正した電圧を印加する方式のものや、あるい
は液晶素子の対向電極側で変動分に応じた補正電圧を印
加する方式のものが擢案されている。
ランジスタに印加する画素データ電圧として予め変動分
を加えて補正した電圧を印加する方式のものや、あるい
は液晶素子の対向電極側で変動分に応じた補正電圧を印
加する方式のものが擢案されている。
しかし、前者の方式のものにあっては、中間調を表示す
る場合に、各階調に電圧補正のための回路を必要とする
ために、装置が複雑になる。また、後者方式のものでは
、表示面積が大きい場合に液晶素子の対向電極内で電圧
勾配が生じるために、表示ムラが発生するという問題が
あった。
る場合に、各階調に電圧補正のための回路を必要とする
ために、装置が複雑になる。また、後者方式のものでは
、表示面積が大きい場合に液晶素子の対向電極内で電圧
勾配が生じるために、表示ムラが発生するという問題が
あった。
本発明は、上記問題点を解消するためになされたもので
、ムラのない良好な表示を行うことができる改良液晶駆
動装置を提供することを目的としたものである。そして
、この目的を達成するために、液晶素子を駆動する画素
トランジスタがオフしたときにドレインに正電圧を重畳
する装置を設けたことを特徴とするものである。
、ムラのない良好な表示を行うことができる改良液晶駆
動装置を提供することを目的としたものである。そして
、この目的を達成するために、液晶素子を駆動する画素
トランジスタがオフしたときにドレインに正電圧を重畳
する装置を設けたことを特徴とするものである。
本発明は、画素トランジスタのオフ時に画素データ線に
正電圧を重畳するごとによって、画素）・ランジスタの
ドレイン電圧をソース電圧よりも高く保持し、それによ
って画素１−ランジスタのゲート容量に蓄積された電荷
をトレイン側に放電することで、液晶素子の電位変動を
防止する様にしたものである。
正電圧を重畳するごとによって、画素）・ランジスタの
ドレイン電圧をソース電圧よりも高く保持し、それによ
って画素１−ランジスタのゲート容量に蓄積された電荷
をトレイン側に放電することで、液晶素子の電位変動を
防止する様にしたものである。
以下、本発明の実施例を図面を参照して詳細に説明する
。第１図は本発明の一実施例を示す回路図である。
。第１図は本発明の一実施例を示す回路図である。
第１図において、１は図示しないパネル上に格子状に多
数配列した液晶素子であり、文字９図形等の画像を表示
するための表示画素として機能する。この液晶素子１は
、各素子１にそれぞれ対応した駆動用の画素トランジス
タ２のソース側と共通線３の間に接続し、また同トラン
ジスタ２のドレイン側に画素データを入力する画素デー
タ線４に、ゲート側を液晶素子１への書き込みを制御す
るスキャン線５に接続することによって、マトリクス構
成の液晶表示装置を構成している。そして、後述するよ
うに、画素トランジスタ２のドレイン及びゲートにデー
タ線とスキャン線から信号を入力することにより、画素
トランジスタ１のスイッチ動作を制御することで、液晶
素子１による画像表示を行うようになっている。
数配列した液晶素子であり、文字９図形等の画像を表示
するための表示画素として機能する。この液晶素子１は
、各素子１にそれぞれ対応した駆動用の画素トランジス
タ２のソース側と共通線３の間に接続し、また同トラン
ジスタ２のドレイン側に画素データを入力する画素デー
タ線４に、ゲート側を液晶素子１への書き込みを制御す
るスキャン線５に接続することによって、マトリクス構
成の液晶表示装置を構成している。そして、後述するよ
うに、画素トランジスタ２のドレイン及びゲートにデー
タ線とスキャン線から信号を入力することにより、画素
トランジスタ１のスイッチ動作を制御することで、液晶
素子１による画像表示を行うようになっている。
第２図は上記実施例の動作を示すタイムチャートである
。以下、同図を参照して作用を説明する。
。以下、同図を参照して作用を説明する。
第２図（ａｌは画素データ線４から画素トランジスタ２
のドレインに印加する画素データ信号、同図（ｂｌは画
素トランジスタ２のゲートに入力する制御信号を示す。
のドレインに印加する画素データ信号、同図（ｂｌは画
素トランジスタ２のゲートに入力する制御信号を示す。
図示のように、画素！・ランジスタ２のドレインに負の
電圧（本実施例では一１５■）を印加し、且つゲートに
正の電圧（＋１５Ｖ）を入力すると、画素トランジスタ
２がオンして同図（Ｃ１に示すように、液晶素子２に負
の電圧が印加される。
電圧（本実施例では一１５■）を印加し、且つゲートに
正の電圧（＋１５Ｖ）を入力すると、画素トランジスタ
２がオンして同図（Ｃ１に示すように、液晶素子２に負
の電圧が印加される。
次いでデータ信号をＯとし、またゲート電圧を負電圧（
−１５Ｖ ”）にして逆バイアスすると、画素トランジ
スタ２はオフとなって液晶素子１には上記ドレイン電圧
（−１０Ｖ ）が保持され、この電圧の絶対値に応じた
明るさの色表示がなされる。更に画素データ線４がら正
の電圧（→−１０■）を印加し、スキャン線５からゲー
トに正の電圧（＋ １５ Ｖ ）を入力すると、画素ト
ランジスタ２はオンし画素データ線４の電圧（−１０Ｖ
）が液晶素子１に印加される。この後再び画素トラン
ジスタ２を逆バイアスしてゲートに負電圧＜ −１５Ｖ
＞を入力して画素トランジスタ２をオフし、画素デー
タ線４の電圧を０にすると、液晶素子Ｉには画素データ
線イの＝６− 電圧（＋１０Ｖ）が保持され、この電圧の絶対値に応じ
た明るさの色表示がなされる。このように一定周期毎に
画素データ線４の電圧を交流的に変化させ、且つ画素ト
ランジスタ２のゲート電圧を制御することによって、そ
の周期毎に液晶素子１の残留電荷がリフレッシュされて
良好な色表示を行うようになっている。
−１５Ｖ ”）にして逆バイアスすると、画素トランジ
スタ２はオフとなって液晶素子１には上記ドレイン電圧
（−１０Ｖ ）が保持され、この電圧の絶対値に応じた
明るさの色表示がなされる。更に画素データ線４がら正
の電圧（→−１０■）を印加し、スキャン線５からゲー
トに正の電圧（＋ １５ Ｖ ）を入力すると、画素ト
ランジスタ２はオンし画素データ線４の電圧（−１０Ｖ
）が液晶素子１に印加される。この後再び画素トラン
ジスタ２を逆バイアスしてゲートに負電圧＜ −１５Ｖ
＞を入力して画素トランジスタ２をオフし、画素デー
タ線４の電圧を０にすると、液晶素子Ｉには画素データ
線イの＝６− 電圧（＋１０Ｖ）が保持され、この電圧の絶対値に応じ
た明るさの色表示がなされる。このように一定周期毎に
画素データ線４の電圧を交流的に変化させ、且つ画素ト
ランジスタ２のゲート電圧を制御することによって、そ
の周期毎に液晶素子１の残留電荷がリフレッシュされて
良好な色表示を行うようになっている。
ここで、第２図ｆ８＋において、Ａ、Ｂとして示すよう
に図示しない電圧印加装置によって、画素トランジスタ
２のゲートに負の電圧を入力してオフするときに、周期
的に画素データ線４から画素トランジスタ２のドレイン
に正の電圧を重畳している。（本実施例では±５Ｖ）こ
の結果、画素トランジスタ２のドレイン電圧は、画素デ
ータ線４の電圧が正の場合は＋１５■、負の場合は一５
■となる。そして、液晶素子１には画素データ線４の電
圧が保持されているために、画素トランジスタ２がオフ
したときのドレイン電圧はソース電圧よりも高電位とな
る。これにより、第１図においてＯＣＴとして示すゲー
ト容量に画素トランジスタ２がオンしたときに蓄積され
た電荷を電位の高いドレイン側に放電することができる
。
に図示しない電圧印加装置によって、画素トランジスタ
２のゲートに負の電圧を入力してオフするときに、周期
的に画素データ線４から画素トランジスタ２のドレイン
に正の電圧を重畳している。（本実施例では±５Ｖ）こ
の結果、画素トランジスタ２のドレイン電圧は、画素デ
ータ線４の電圧が正の場合は＋１５■、負の場合は一５
■となる。そして、液晶素子１には画素データ線４の電
圧が保持されているために、画素トランジスタ２がオフ
したときのドレイン電圧はソース電圧よりも高電位とな
る。これにより、第１図においてＯＣＴとして示すゲー
ト容量に画素トランジスタ２がオンしたときに蓄積され
た電荷を電位の高いドレイン側に放電することができる
。
詳述すると、第３図（ａ）に示すように、画素トランジ
スタ２がオンすると、同トランジスタ２のドレイン・ソ
ース間のチャンネルと、ゲート電極との間でゲート容■
ＣＧが形成されるために、その容量Ｃ％に電荷が蓄積さ
れる。この蓄積電荷が画素トランジスタ２がオフしとき
に、ドレインとソース側に放電しようとするが、第３図
ｆｂ）に示すようにドレイン電圧がソース電圧よりも高
電位なために、ドレイン側だけに放電する。これにより
ソース側に接続した液晶素子１には放電されなくなるた
めに、電位変動が生ぜずＪ７うのない表示が可能となる
。
スタ２がオンすると、同トランジスタ２のドレイン・ソ
ース間のチャンネルと、ゲート電極との間でゲート容■
ＣＧが形成されるために、その容量Ｃ％に電荷が蓄積さ
れる。この蓄積電荷が画素トランジスタ２がオフしとき
に、ドレインとソース側に放電しようとするが、第３図
ｆｂ）に示すようにドレイン電圧がソース電圧よりも高
電位なために、ドレイン側だけに放電する。これにより
ソース側に接続した液晶素子１には放電されなくなるた
めに、電位変動が生ぜずＪ７うのない表示が可能となる
。
以上説明したように本発明によれば、液晶素子を駆動す
る画素１−ランジスタがオフすると同時に、ドレイン電
圧をソース電圧よりも高く保持するようにしたので、画
素トランジスタが有するゲート容量の蓄積電荷をドレイ
ン側に放電することができ、それによって液晶素子の電
位変動を有効に防止し、ムラのない良好な画像表示を行
うことができるという効果がある。
る画素１−ランジスタがオフすると同時に、ドレイン電
圧をソース電圧よりも高く保持するようにしたので、画
素トランジスタが有するゲート容量の蓄積電荷をドレイ
ン側に放電することができ、それによって液晶素子の電
位変動を有効に防止し、ムラのない良好な画像表示を行
うことができるという効果がある。
第１図は本発明の一実施例の回路図。
第２図は上記実施例の動作を示すタイムチャート。
第３図は本発明の動作原理を示す説明図である。
１・・・液晶素子
２・・・画素トランジスタ
３・・・共通線
４・・・画素データ線
５・・・スキャン線
４４債１Ｙ−夕透豹
第１図
第２図
第３図
Claims (2)
- （１）格子状に配列した液晶素子をそれぞれ駆動用の画
素トランジスタに接続すると共に、各画素トランジスタ
に画素データ線から画素データ信号を入力し、スキャン
線から書込み制御信号を入力するアクティブマトリクス
液晶駆動装置において、前記画素データ線に、画素デー
タ書込み終了と同時に、前記画素データ線に正の電圧を
重畳しかつ保持することを特徴とするアクティブマトリ
クス液晶駆動装置。 - （２）各画素トランジスタのドレインを画素データ線に
、ソースをスキャン線にそれぞれ接続し、画素トランジ
スタがオフすると同時にドレイン電圧をソース電圧より
高く保持するようにしたことを特徴とする特許請求の範
囲第１項記載のアクティブマトリクス液晶駆動装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26031885A JPS62119526A (ja) | 1985-11-20 | 1985-11-20 | アクテイブマトリクス液晶駆動装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP26031885A JPS62119526A (ja) | 1985-11-20 | 1985-11-20 | アクテイブマトリクス液晶駆動装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62119526A true JPS62119526A (ja) | 1987-05-30 |
Family
ID=17346351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP26031885A Pending JPS62119526A (ja) | 1985-11-20 | 1985-11-20 | アクテイブマトリクス液晶駆動装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62119526A (ja) |
-
1985
- 1985-11-20 JP JP26031885A patent/JPS62119526A/ja active Pending
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