JPS6159571A - バ−コ−ドリ−ダ - Google Patents
バ−コ−ドリ−ダInfo
- Publication number
- JPS6159571A JPS6159571A JP18168784A JP18168784A JPS6159571A JP S6159571 A JPS6159571 A JP S6159571A JP 18168784 A JP18168784 A JP 18168784A JP 18168784 A JP18168784 A JP 18168784A JP S6159571 A JPS6159571 A JP S6159571A
- Authority
- JP
- Japan
- Prior art keywords
- barcode
- signal
- analog signal
- detection circuit
- bar code
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K7/00—Methods or arrangements for sensing record carriers, e.g. for reading patterns
- G06K7/01—Details
- G06K7/016—Synchronisation of sensing process
- G06K7/0166—Synchronisation of sensing process by means of clock-signals derived from the code marks, e.g. self-clocking code
Landscapes
- Engineering & Computer Science (AREA)
- Artificial Intelligence (AREA)
- Computer Vision & Pattern Recognition (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はバーコードリーダに関するもので、さらに詳し
くは読取ヘッド部で読取ったバーコードアナログ信号を
入力しバーコードデータの解読を行なうデコーダ部の構
成を簡略化したバーコードリーダに関するものである。
くは読取ヘッド部で読取ったバーコードアナログ信号を
入力しバーコードデータの解読を行なうデコーダ部の構
成を簡略化したバーコードリーダに関するものである。
Ｃ従来の技術〕
近年自Ｕ自庫、配送センターあるいは工場等において商
品情報の自動収集、自ａ住分け、作業指示等を行なうた
めにバーコードリーダが広く用いられるようになった。
品情報の自動収集、自ａ住分け、作業指示等を行なうた
めにバーコードリーダが広く用いられるようになった。
バーコードリーダはバーコードラベル面からの反射光（
又は）Ｂ通光）を受けてデータを認識する！置であり、
読取ヘッド部と、マイクロプロセッサ（ＣＰＵ）を組込
んだバーコードの内容を解読するデコーダ部を備えてい
る。
又は）Ｂ通光）を受けてデータを認識する！置であり、
読取ヘッド部と、マイクロプロセッサ（ＣＰＵ）を組込
んだバーコードの内容を解読するデコーダ部を備えてい
る。
上記バーコードリーダの主要部構成につき図面を参照し
て説明する。
て説明する。
第４図は従来のバーコードリーダの一構成例を示すブロ
ック図である。図に見られるように、読取ヘッド部１０
で取入れたバーコードのアナログ信号がデコーダ部２０
へ送られてくる。デコーダ部２０は、上記アナログ信号
を波形整形してディジタル信号に変換するＡ／Ｄ変換器
２１と、該Ａ、／Ｄ変換器２１の出力を量子化（波形を
カウントしてパターンを調べる）するカウンタ２２と、
該カウンタ２２の出力からバーコードの内容を解読する
判断回路（ＣＰＵ）２３を備えており、解読されたバー
コードのデータがインタフェース２４を介して外部装２
！（ホストコンピュータ＞３０へ出力されるようになっ
ている。なお、説明が後になったが、デコーダ部２０に
はｍ子化用のクロックを発生するクロック発振器２５と
、Ａ 、／ Ｄ変換器２１からのディジタル信号波形を
入力しその立上り、立下りを検出してカウンタ２２にク
リヤをかける制御信号（クリヤパルス）を発生するコン
トローラ２６も備えている。
ック図である。図に見られるように、読取ヘッド部１０
で取入れたバーコードのアナログ信号がデコーダ部２０
へ送られてくる。デコーダ部２０は、上記アナログ信号
を波形整形してディジタル信号に変換するＡ／Ｄ変換器
２１と、該Ａ、／Ｄ変換器２１の出力を量子化（波形を
カウントしてパターンを調べる）するカウンタ２２と、
該カウンタ２２の出力からバーコードの内容を解読する
判断回路（ＣＰＵ）２３を備えており、解読されたバー
コードのデータがインタフェース２４を介して外部装２
！（ホストコンピュータ＞３０へ出力されるようになっ
ている。なお、説明が後になったが、デコーダ部２０に
はｍ子化用のクロックを発生するクロック発振器２５と
、Ａ 、／ Ｄ変換器２１からのディジタル信号波形を
入力しその立上り、立下りを検出してカウンタ２２にク
リヤをかける制御信号（クリヤパルス）を発生するコン
トローラ２６も備えている。
ところで、上記バーコードアナログ信号をバーコードデ
ィジタル信号に変換処理するＡ／Ｄ変換器２１は従来例
えば第５図のような回路構成になっていた。
ィジタル信号に変換処理するＡ／Ｄ変換器２１は従来例
えば第５図のような回路構成になっていた。
すなわち、入力されるバーコードアナログ信号の白部分
のピークをホールドする白ピークホールド回路２１１と
、黒部分のピークをホールドする黒ピークホールド回路
２１２と、上記両ピークホールド回路２１１と２１２の
出力から上記入力されたアナログ信号が白であるか黒で
あるかを判定すると同時に白及び黒のホールド値の中Ｉ
ＩＪｆｆ点における信号幅を決定するスレッシュ検出回
路２１３と、該スレッシュ検出回路２１３の出力をバー
コードディジタル信号に変換して出力するコンパレーク
２１４を備えて構成されている。
のピークをホールドする白ピークホールド回路２１１と
、黒部分のピークをホールドする黒ピークホールド回路
２１２と、上記両ピークホールド回路２１１と２１２の
出力から上記入力されたアナログ信号が白であるか黒で
あるかを判定すると同時に白及び黒のホールド値の中Ｉ
ＩＪｆｆ点における信号幅を決定するスレッシュ検出回
路２１３と、該スレッシュ検出回路２１３の出力をバー
コードディジタル信号に変換して出力するコンパレーク
２１４を備えて構成されている。
上述したように従来のバーコードリーダのデコーダ部２
０はＡ 、／’ Ｄ変換器２１を備え、バーコードアナ
ログ信号を波形整形してディジタル信号に変換した後デ
コードを行っている。そのため回路構成が複雑なＡ 、
／ Ｄ変ｊ！Ａ器２１やコントローラ２６を必要とし、
デコーダ部２０の構成はかなり複雑なものとなっていた
。しかもＡ 、、／ Ｄ変換には次のような問題点もあ
る。
０はＡ 、／’ Ｄ変換器２１を備え、バーコードアナ
ログ信号を波形整形してディジタル信号に変換した後デ
コードを行っている。そのため回路構成が複雑なＡ 、
／ Ｄ変ｊ！Ａ器２１やコントローラ２６を必要とし、
デコーダ部２０の構成はかなり複雑なものとなっていた
。しかもＡ 、、／ Ｄ変換には次のような問題点もあ
る。
上記従来の７へ、／Ｄ変換器では、第６図に示すような
変換操作が行なわれている。すなわち、第６図（ａ ）
に示すようなバーコードを読取り、第６図（１））に実
線で示すバーコードアナログ信号がＡ 、、／ Ｄ ！
換器）こ入力されると、白及び黒のピークホールド回路
２１１及び２１２が、第６図（ｂ）に点線及び破線で示
すように白ピーク及び黒ピークをホールドする。各ピー
クホールド回路は入力されるバーコードアナログ信号の
ピークを順次ホールドするために固定された所定の時定
数で放電を行なっている。この白及び黒のピーク値の中
間値をスレッシュ検出回路２１３で見出して、その中間
値における信号幅を取り出し、コンパレータ２１４によ
って第６図（Ｃ）に示すようなバーコードディジタル信
号に変換している。
変換操作が行なわれている。すなわち、第６図（ａ ）
に示すようなバーコードを読取り、第６図（１））に実
線で示すバーコードアナログ信号がＡ 、、／ Ｄ ！
換器）こ入力されると、白及び黒のピークホールド回路
２１１及び２１２が、第６図（ｂ）に点線及び破線で示
すように白ピーク及び黒ピークをホールドする。各ピー
クホールド回路は入力されるバーコードアナログ信号の
ピークを順次ホールドするために固定された所定の時定
数で放電を行なっている。この白及び黒のピーク値の中
間値をスレッシュ検出回路２１３で見出して、その中間
値における信号幅を取り出し、コンパレータ２１４によ
って第６図（Ｃ）に示すようなバーコードディジタル信
号に変換している。
ところで、入力されるバーコードアナログ信号は、読取
ヘッド部１０がバーコードラベル面を走有する時の位置
や角度の影響（走査する光ビームの焦点ボケ等による影
響）を受け、またノイズ（バーコードの印刷むらや外来
光線等による）等の影響を受けて、第６図（ｄ ）に示
すように波形が歪んでいる場合がある。この時は入力信
号のうちピーク値の検出ができなくなるところが発生し
、正確なスレッシュ検出（中間値を取り出すことンが不
可能になり（この原因はピークホールド回路の放電の時
定数が固定されることにある）第６図（ｅ）に示すよう
な誤ったディジタル信号が出力される。すなわち、読取
ったバーコードラベル面からのデータが正しく解読され
ないという問題点がある。
ヘッド部１０がバーコードラベル面を走有する時の位置
や角度の影響（走査する光ビームの焦点ボケ等による影
響）を受け、またノイズ（バーコードの印刷むらや外来
光線等による）等の影響を受けて、第６図（ｄ ）に示
すように波形が歪んでいる場合がある。この時は入力信
号のうちピーク値の検出ができなくなるところが発生し
、正確なスレッシュ検出（中間値を取り出すことンが不
可能になり（この原因はピークホールド回路の放電の時
定数が固定されることにある）第６図（ｅ）に示すよう
な誤ったディジタル信号が出力される。すなわち、読取
ったバーコードラベル面からのデータが正しく解読され
ないという問題点がある。
本発明はこのような問題点を解消するためになされたも
ので、デコーダ部の回路構成を簡略化し、かつバーコー
ドアナログ信号が歪んでいた場合でも正確にデータの解
読ができるようにしたバーコードリーダを提供すること
を目的とするものである。
ので、デコーダ部の回路構成を簡略化し、かつバーコー
ドアナログ信号が歪んでいた場合でも正確にデータの解
読ができるようにしたバーコードリーダを提供すること
を目的とするものである。
上記の目的を達成するために、本発明のバーコードリー
ダのデコーダ部においては、バーコードアナログ信号の
白及び黒のピーク値の中１Ｓｆｌ値における信号幅を取
り出す手段としてｄＶ、／ｄｔ検出回路を設け、該ｄＶ
、、／ｄｔ検出回路が取り出した信号幅の出力と、クロ
ック発振器からのクロックをカウンタに入力し、バーコ
ードディジタル信号に変換することなく直接バーコード
幅をカウントさせ、該カウンタの出力から判断回路（Ｃ
ＰＵ）がバーコードの内容を解読するようにした。
ダのデコーダ部においては、バーコードアナログ信号の
白及び黒のピーク値の中１Ｓｆｌ値における信号幅を取
り出す手段としてｄＶ、／ｄｔ検出回路を設け、該ｄＶ
、、／ｄｔ検出回路が取り出した信号幅の出力と、クロ
ック発振器からのクロックをカウンタに入力し、バーコ
ードディジタル信号に変換することなく直接バーコード
幅をカウントさせ、該カウンタの出力から判断回路（Ｃ
ＰＵ）がバーコードの内容を解読するようにした。
なお、上記ｄ■、／ｄｔ検出回路は、バーコードアナロ
グ信号を所定の周波数のクロック（時１ｉ！ｌｄｔ＞で
サンプリングし、そのサンプル値の前後の電圧差（ｄＶ
）を検出することによりバーコードの幅を求めるもので
ある。
グ信号を所定の周波数のクロック（時１ｉ！ｌｄｔ＞で
サンプリングし、そのサンプル値の前後の電圧差（ｄＶ
）を検出することによりバーコードの幅を求めるもので
ある。
（作用）
上述したように本発明のバーコードリーダのデコーダ部
はＡ 、／ Ｄ変換器やコントローラを必要とせず、回
路構成が簡略化されるばかりでなく、バ。
はＡ 、／ Ｄ変換器やコントローラを必要とせず、回
路構成が簡略化されるばかりでなく、バ。
−コードアナログ信号のピーク値には、ｗｒＩＡ係にバ
ーコード幅を求めているので、入力されるバーコードア
ナログ信号が歪んだりレベルが下っていても正確にバー
コードが解読できるようになる。
ーコード幅を求めているので、入力されるバーコードア
ナログ信号が歪んだりレベルが下っていても正確にバー
コードが解読できるようになる。
次に本発明の実施例につき図面を参照して説明する。
第１図は本発明のバーコードリーダの一構成例を示すブ
ック図である。図において前出のものと同一符号のもの
は同−又は均等部分を示すものとし、その部分について
の構成と動作の説明は適宜省略する。２００はバーコー
ドアナログ信号を入力しバーコード幅を求めるｄ Ｖ／
ｄｔ検出回路である。該ｄＶ／ｄｔ検出回路２００はバ
ーコードアナログ信号の立上り、立下りを検出してバー
コード幅に応じたパルス信号（カウンタ２２をクリヤす
るクリヤパルス）を発生する。
ック図である。図において前出のものと同一符号のもの
は同−又は均等部分を示すものとし、その部分について
の構成と動作の説明は適宜省略する。２００はバーコー
ドアナログ信号を入力しバーコード幅を求めるｄ Ｖ／
ｄｔ検出回路である。該ｄＶ／ｄｔ検出回路２００はバ
ーコードアナログ信号の立上り、立下りを検出してバー
コード幅に応じたパルス信号（カウンタ２２をクリヤす
るクリヤパルス）を発生する。
第２図はｄＶ、、／ｄｔ検出回路の一溝成例を示すブロ
ック図、第３図はその動作を説明するための波形図であ
る。
ック図、第３図はその動作を説明するための波形図であ
る。
第２図において、１は信号が入力される入力端子、２は
サンプリング用のクロック信号を発生するクロック発振
器（第１図の２５に相当する）、３は第１のホールド回
路でクロック発振器２からのりＯツク信号でザンプルさ
れた新しいサンプル値Ｖｎ （Ｖｌ 、Ｖ＝ 、Ｖ３
・＝−）（第３図（ａ ）参照〕を順次ホールドする回
路、４は第２のホールド回路で同じく一つ前のサンプル
値Ｖｘ−＋（ＶＯ。
サンプリング用のクロック信号を発生するクロック発振
器（第１図の２５に相当する）、３は第１のホールド回
路でクロック発振器２からのりＯツク信号でザンプルさ
れた新しいサンプル値Ｖｎ （Ｖｌ 、Ｖ＝ 、Ｖ３
・＝−）（第３図（ａ ）参照〕を順次ホールドする回
路、４は第２のホールド回路で同じく一つ前のサンプル
値Ｖｘ−＋（ＶＯ。
Ｖｌ、Ｖ２・・・・・・）（第３図（ａ）参照）を順次
ホールドする回路である。
ホールドする回路である。
５は立上り立下り検出回路で、第１及び第２の゛ホール
ド回路３及び４のホールド値ＶｎとＶ、−１を入力し、
その両者を比較してＶ ｌ−１＞ Ｖ ｎならばバーコ
ードアナログ信号が立下り状態にあると判断し、Ｖ ｔ
−＋ ＜ Ｖ ｎならばバーコードアナログ信号が立上
り状態にあると判断してそのデータ信号〔第３図（ｂ）
参照〕を発生すると同時に、その時の電圧差の絶対１’
Ｉ Ｉ Ｖ＠−＋ Ｖ ｎ ｌを出力すル〔第３図（
Ｃ）参照〕。
ド回路３及び４のホールド値ＶｎとＶ、−１を入力し、
その両者を比較してＶ ｌ−１＞ Ｖ ｎならばバーコ
ードアナログ信号が立下り状態にあると判断し、Ｖ ｔ
−＋ ＜ Ｖ ｎならばバーコードアナログ信号が立上
り状態にあると判断してそのデータ信号〔第３図（ｂ）
参照〕を発生すると同時に、その時の電圧差の絶対１’
Ｉ Ｉ Ｖ＠−＋ Ｖ ｎ ｌを出力すル〔第３図（
Ｃ）参照〕。
６は（１■、／ｄｔ比較器で、上記絶対値電圧ＩＶ、−
。
。
−Ｖｎ ｌと基準電圧発生器７からの基準電圧ＶＣ〔第
３図（Ｃ）参照）とを比較し、絶対値電圧が所定の基準
電圧Ｖｃを越えた時にパルス信号（カウンタをクリヤす
るクリヤパルス）〔第３図（ｄ ）参照〕を出力端子８
に出力する。
３図（Ｃ）参照）とを比較し、絶対値電圧が所定の基準
電圧Ｖｃを越えた時にパルス信号（カウンタをクリヤす
るクリヤパルス）〔第３図（ｄ ）参照〕を出力端子８
に出力する。
このパルス信号とクロック信号がカウンタ２２に入力さ
れバーコード信号のｍ子化が行なわれ、ＣＰｔＪ （第
１図の２３）でバーコードが解読される。
れバーコード信号のｍ子化が行なわれ、ＣＰｔＪ （第
１図の２３）でバーコードが解読される。
■上説明したように本発明のバーコードリーダのデコー
ダ部では、入力されたバーコードアナログ信号をサンプ
リングし、各サンプル値を順次比較してその前後の値か
ら波形の立上り、立下りを判断すると同時にｄ Ｖ／ｄ
ｔの値が基準電圧値ＶＣを越えたところを検出して、バ
ーコードの幅を決めているので、従来のようにバーコー
ドの検出漏れが発生することはなく、正確なディジタル
信号の変換が行なわれる。
ダ部では、入力されたバーコードアナログ信号をサンプ
リングし、各サンプル値を順次比較してその前後の値か
ら波形の立上り、立下りを判断すると同時にｄ Ｖ／ｄ
ｔの値が基準電圧値ＶＣを越えたところを検出して、バ
ーコードの幅を決めているので、従来のようにバーコー
ドの検出漏れが発生することはなく、正確なディジタル
信号の変換が行なわれる。
また、バーコードアナログ信号をディジタル信号に変換
することなく、（ＩＶ、／ｄｔ検出回路の出力から直接
カウンタでバーコード幅をカウントできるようにしたの
で回路偶成が簡略化される。
することなく、（ＩＶ、／ｄｔ検出回路の出力から直接
カウンタでバーコード幅をカウントできるようにしたの
で回路偶成が簡略化される。
第１図は本発明のバーコードリーダのブロック図、第２
図は本発明のｄＶ／ｄｔ検出回路のブロック図、第３図
（ａ） 〜（ｄ）はｄ Ｖ／ｄｔ検出回路の動作を説明
するための波形図、第４図は従来のバーコードリーダの
ブロック図、第５図はＡ 、／ Ｄ変換器の一構成例を
示すブロック図、第６図（ａ）はバーコードの一例を示
す平面図、第６図（ｂ）〜（ｅ）は従来のＡ 、／ Ｄ
変換器の動作を説明するための波形図である。 ２．２５・・・・・・クロック発振器、３．４・・・・
・・ホールド回路、 ５・・・・・・立上り立下り検出回路、６・・・・・・
ｄＶ、／ｄｔ比校器、 ７・・・・・・基準電圧発生器、 １０・・・・・・読取ヘッド部、 ２０・・・・・・デコーダ部、 ２１・・・・・・Ａ 、、／ Ｄ変換器、２２・・・・
・・カウンタ、 ２３・・・・・・判断回路ＣＣＰＵ’）、２６・・・・
・・コントローラ、 ２００・・・・・・ｄＶ／ｄｔ検出回路。
図は本発明のｄＶ／ｄｔ検出回路のブロック図、第３図
（ａ） 〜（ｄ）はｄ Ｖ／ｄｔ検出回路の動作を説明
するための波形図、第４図は従来のバーコードリーダの
ブロック図、第５図はＡ 、／ Ｄ変換器の一構成例を
示すブロック図、第６図（ａ）はバーコードの一例を示
す平面図、第６図（ｂ）〜（ｅ）は従来のＡ 、／ Ｄ
変換器の動作を説明するための波形図である。 ２．２５・・・・・・クロック発振器、３．４・・・・
・・ホールド回路、 ５・・・・・・立上り立下り検出回路、６・・・・・・
ｄＶ、／ｄｔ比校器、 ７・・・・・・基準電圧発生器、 １０・・・・・・読取ヘッド部、 ２０・・・・・・デコーダ部、 ２１・・・・・・Ａ 、、／ Ｄ変換器、２２・・・・
・・カウンタ、 ２３・・・・・・判断回路ＣＣＰＵ’）、２６・・・・
・・コントローラ、 ２００・・・・・・ｄＶ／ｄｔ検出回路。
Claims (1)
- 【特許請求の範囲】 １、バーコードラベル面からバーコードを読取る読取ヘ
ッド部と、該読取ヘッド部が出力したバーコードアナロ
グ信号を入力しバーコードデータを解読するためのデコ
ーダ部とを備えてなるバーコードリーダであって、 上記デコーダ部は、順次入力されるバーコードアナログ
信号の波形が白であるか黒であるかを判定すると同時に
その信号の幅を決定するｄＶ／ｄｔ検出回路と、該当ｄ
Ｖ／ｄｔ検出回路の出力に基づきバーコード幅をカウン
トするカウンタと、該カウンタの出力からバーコードの
内容を解読する判断回路とを備え、バーコードアナログ
信号をバーコードディジタル信号に変換することなく、
直接デコードするものであることを特徴とするバーコー
ドリダ。 ２、上記ｄＶ／ｄｔ検出回路は、入力されるバーコード
アナログ信号波形をサンプリングしそのサンプル値を順
次ホールドする２つのホールド手段と、該２つのホール
ド手段にホールドされた前後のサンプル値を順次比較し
上記バーコードアナログ信号波形が立上り又は立下りの
いずれの状態にあるかを検出してそのデータ信号を発生
すると同時に前後のサンプル値の差の絶対値電圧を出力
する立上り立下り検出回路と、該立上り立下り検出回路
からの絶対値電圧が所定の基準電圧を越えた時にパルス
信号を出力するｄＶ／ｄｔ比較器と、を備えて構成した
ものである特許請求の範囲第１項に記載のバーコードリ
ーダ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18168784A JPS6159571A (ja) | 1984-08-31 | 1984-08-31 | バ−コ−ドリ−ダ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18168784A JPS6159571A (ja) | 1984-08-31 | 1984-08-31 | バ−コ−ドリ−ダ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6159571A true JPS6159571A (ja) | 1986-03-27 |
Family
ID=16105110
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18168784A Pending JPS6159571A (ja) | 1984-08-31 | 1984-08-31 | バ−コ−ドリ−ダ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6159571A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007197073A (ja) * | 2006-01-30 | 2007-08-09 | Daio Paper Corp | 薄葉紙の収納箱 |
| US11489434B2 (en) | 2019-12-13 | 2022-11-01 | Kabushiki Kaisha Toshiba | Power transducer including a rate of voltage change detection circuit |
Citations (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50120724A (ja) * | 1974-03-08 | 1975-09-22 | ||
| JPS51135430A (en) * | 1975-05-20 | 1976-11-24 | Matsushita Electric Ind Co Ltd | Signal processing unit |
| JPS5565101A (en) * | 1978-11-09 | 1980-05-16 | Fujitsu Ltd | Measuring system for width |
| JPS55143682A (en) * | 1979-04-24 | 1980-11-10 | Fujitsu Ltd | Read system for bar code information |
-
1984
- 1984-08-31 JP JP18168784A patent/JPS6159571A/ja active Pending
Patent Citations (4)
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