JPS6155982B2 - - Google Patents

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Publication number
JPS6155982B2
JPS6155982B2 JP8910079A JP8910079A JPS6155982B2 JP S6155982 B2 JPS6155982 B2 JP S6155982B2 JP 8910079 A JP8910079 A JP 8910079A JP 8910079 A JP8910079 A JP 8910079A JP S6155982 B2 JPS6155982 B2 JP S6155982B2
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JP
Japan
Prior art keywords
output
score
service
service right
counting
Prior art date
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Expired
Application number
JP8910079A
Other languages
Japanese (ja)
Other versions
JPS5613965A (en
Inventor
Tetsuya Kondo
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kawai Musical Instrument Manufacturing Co Ltd
Original Assignee
Kawai Musical Instrument Manufacturing Co Ltd
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Filing date
Publication date
Application filed by Kawai Musical Instrument Manufacturing Co Ltd filed Critical Kawai Musical Instrument Manufacturing Co Ltd
Priority to JP8910079A priority Critical patent/JPS5613965A/en
Publication of JPS5613965A publication Critical patent/JPS5613965A/en
Publication of JPS6155982B2 publication Critical patent/JPS6155982B2/ja
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  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)

Description

【発明の詳細な説明】 本発明はコートの中央にネツトを有するルール
の類似した競技の得点と勝敗判定、とくにサービ
ス権のカウント表示を行なう得点表示器に関する
ものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a score display device for displaying scores and winning/losing decisions in games with similar rules having a net in the center of the court, and in particular for displaying a count of service rights.

一般にコートの中央にネツトを有する球技、た
とえば卓球、テニス、バレーボール、バトミント
ン等はその競技のルールにおいて類似性を有して
いる。すなわち、 (1) 所定の奇数ゲーム(セツト)マツチを設定
し、その過半数のゲーム(セツト)を先取した
方が勝である。
In general, ball games that have a net in the center of the court, such as table tennis, tennis, volleyball, and badminton, have similar rules. That is, (1) A predetermined odd numbered game (set) is set, and the winner is the one who wins the majority of games (set) first.

(2) サーブ権に拘らず得点できる場合と、サーブ
権を有する方が得点できる場合がある。
(2) There are cases in which a player can score regardless of the right to serve, and cases in which the player with the right to serve can score.

(3) どちらか一方が所定の得点に達した時ゲーム
(セツト)が終了する。
(3) The game (set) ends when one of the players reaches a predetermined score.

(4) ジユウスの場合には2点差でゲーム(セツ
ト)が終了する。
(4) In the case of Juusu, the game (set) ends with a difference of 2 points.

従つて、この範囲の競技に共通の得点表示器を
作り、競技に応じ適応した設定を行なうことによ
り、審判や得点表示者の労力を減少するばかりで
なく、これらの不在の私的競技の場合にも競技者
同士の操作により得点表示が可能となる。
Therefore, by creating a common score display for this range of competitions and making settings appropriate to the competition, it is possible to not only reduce the labor of referees and score display, but also to reduce the burden on private competitions where these are not present. It is also possible to display scores through operations between competitors.

本出願人は上記ルールのうちサーブ権の規定を
除いた得点表示器を特願昭54―3739及び特願昭54
―3740により提案している。これ等の得点表示器
は、複数個のスイツチと、該複数個のスイツチに
対応して設けられ、該複数個のスイツチの入力操
作によつて競技の得点をそれぞれカウントする得
点カウント手段と、該得点カウント手段の内容を
それぞれ表示する得点表示手段と、前記得点表示
手段の内容から規定の得点をそれぞれ検索する得
点検索手段と、前記得点カウント手段の内容から
ジユウスの条件を検索するジユウス検索手段と、
該ジユウス検索手段と前記得点検索手段との検索
結果に基づいて競技の勝敗をそれぞれ判定する勝
敗判定手段と、該判定手段による勝敗判定結果を
それぞれ表示する勝敗判定表示手段とを有し、基
本発明に機能を追加する形で順次提案されてい
る。本発明の得点表示器は、前記既提案の得点表
示器のうち所要の構成の外、さらに前記複数個の
スイツチの論理積出力によつて最初のサービス権
を持つ側とその本数(以下初期値という)を決定
する初期サービス権決定手段と、前記複数個のス
イツチの論理和出力を入力として前記初期サービ
ス権決定手段によつて決定された初期値に基づい
てサービス権数をカウントするサービス権カウン
ト手段と、該サービス権カウント手段を前記論理
積出力によて初期値に設定するプリセツト手段
と、前記サービス権カウント手段の内容によりサ
ービス権の位置と残数とを表示するサービス権表
示手段と、前記初期サービス権決定手段の初期値
によつて規定され前記論理和出力を入力としてジ
ユウス時のサービス権を表示するジユウス時サー
ビス権表示手段と、前記ジユウス検索手段の出力
によつて前記ジユウス時サービス権表示手段と前
記サービス権表示手段とを選択する選択手段とを
具えたことを特徴とするものである。
The present applicant has proposed a score indicator excluding the provision of the right to serve among the above rules in Japanese Patent Application No. 3739 and No. 1983.
- Suggested by 3740. These score display devices include a plurality of switches, a score counting means that is provided corresponding to the plurality of switches and counts the score of the competition according to the input operation of the plurality of switches, and a score display means for respectively displaying the contents of the score count means; a score search means for respectively searching for prescribed scores from the contents of the score display means; and a normal search means for searching for a condition from the contents of the score count means. ,
The basic invention comprises win/lose judgment means for respectively judging the win/lose of the competition based on the search results of the user search means and the score search means, and a win/lose judgment display means for respectively displaying the win/lose judgment results by the judgment means. Additional features are being proposed one after another. The score display of the present invention has the required configuration of the previously proposed score display, and also determines the side having the first service right and the number thereof (hereinafter referred to as initial value) based on the AND output of the plurality of switches. and a service right count that counts the number of service rights based on the initial value determined by the initial service right determining means using the logical sum output of the plurality of switches as input. means, presetting means for setting the service right counting means to an initial value by the logical AND output, and service right display means for displaying the position and remaining number of service rights based on the contents of the service right counting means; an improper service right display means that is defined by the initial value of the initial service right determining means and receives the logical OR output as an input and displays a service right in an unusual situation; The present invention is characterized by comprising a selection means for selecting the right display means and the service right display means.

以下本発明を実施例につき詳述する。 The present invention will be described in detail below with reference to examples.

いま実施例として卓球用の得点表示器を取り上
げ、卓球のルールのうちのサービス権に係わる部
分を抜萃列挙する。
Now, we will take a score display for table tennis as an example and enumerate the parts of the rules of table tennis that relate to service rights.

(1) 1ゲーム中5本ずつ交替して行なわれる。た
だし20オール(20対20のジユウスのとき)にな
つたときは以後1本ずつ交替で行なう。
(1) Five games are alternated during each game. However, if the score reaches 20 all (20-20), the players will take turns playing one run at a time.

(2) そのゲームの最初のサーバは次のゲームでは
レシーバとなりこれを1マツチ(通常5ゲー
ム)終了まで交互に行なう。
(2) The first server in that game becomes the receiver in the next game, and this continues alternately until one match (usually 5 games) is completed.

ここでは、まず第1図において前記提案の得点
表示器の概略を述べた上、第2図によりこれに付
加する上述のルールに従う本発明の実施例につき
説明する。
First, an outline of the proposed score display device will be described with reference to FIG. 1, and an embodiment of the present invention according to the above-mentioned rules added thereto will be described with reference to FIG.

第1図において、10進カウンタ(CT)1
で得点を計数し、7セグメントデコーダ
(SD)2〜2で7セグメント表示素子
(SG)3〜3の表示に必要な信号にデコード
し表示するとともに、第1の検索回路AND4
,4でゲームポイント(たとえば卓球では21
点、6人制バレーボールではセツトポイント15
点)を検索し、該検索出力でOR回路21,2
を介してシフトレジスタ(SR)5,5
を1ビツト右方にシフトさせ、ゲームカウントを
表示するとともに、他方で得点表示を明滅させ、
競技者にゲームまたはマツチの終了を告知し、10
進カウンタ(CT)1〜1をリセツトする。
またジユウス(卓球では20対20、6人制バレーボ
ールでは14対14)を第2の検索回路(AND)1
7で検索し、第1の検索出力を阻止するととも
に、アツプダウンカウンタ(CT)15で2点差
を判別し、該判別出力でOR回路21,21
を介してシフトレジスタ(SR)5,5を1
ビツト右方へシフトさせ、ゲームカウントを表示
し、以下前述と同様の告知およびリセツトを行な
う。得点計数、得点表示部分については前記特願
昭54―3740号で詳細に説明されているのでここで
は概略を紹介するにとどめる。
In Figure 1, decimal counter (CT) 1 1 ~
14 , and the 7 segment decoders (SD) 21 to 24 decode and display the signals necessary for display on the 7 segment display elements (SG) 31 to 34 . AND4
Game points for 1 , 4, 2 (for example, 21 in table tennis)
Points, 15 set points in 6-a-side volleyball
point), and use the search output to perform an OR circuit 21 1 , 2
Shift register (SR) through 1 2 5 1 , 5 2
is shifted one bit to the right, the game count is displayed, and the score display is made to blink on the other hand.
Announce the end of the game or match to the contestants, and
Reset the advance counters (CT) 11 to 14 .
In addition, the second search circuit (AND)1
7, the first search output is blocked, and the up-down counter (CT) 15 determines the difference between the two points, and the determined output is used as the OR circuit 21 1 , 21 2
Shift register (SR) 5 1 , 5 2 to 1 through
The bit is shifted to the right, the game count is displayed, and the same notification and reset as described above is performed. The score counting and score display section are explained in detail in the aforementioned Japanese Patent Application No. 54-3740, so we will only give an overview here.

第2図は本発明の要部の実施例の構成を示す説
明図であり、第3図〜、第4図〜はその
動作波形図である。
FIG. 2 is an explanatory diagram showing the configuration of an embodiment of the main part of the present invention, and FIGS. 3 to 4 are operational waveform diagrams thereof.

まず、第2図に従い第3図を参照しつつ説明す
る。第2図において、点線内は前述の第1図の構
成に含まれるものを表わしている。
First, explanation will be given in accordance with FIG. 2 and with reference to FIG. 3. In FIG. 2, the dotted lines indicate what is included in the configuration of FIG. 1 described above.

図中22〜2212は発光ダイオード、23
〜23,27,28はOR回路、24は2進―
10進変換デコーダ(たとえばRCA社商品名
CD4028)、29,30,32,33はAND回
路、25は10進カウンタ(プリセツト(PE)端
子入力が高レベル“H”のときJAM IN端子(J1
〜J4)の入力状態がプリセツトされ出力端Q1〜Q4
に出力される。)、26,31はフリツプフロツ
プ、34,38は抵抗、35,39はコンデン
サ、36はダイオード、37,37は電流増
幅を兼ねるNOT回路である。
In the figure, 22 1 to 22 12 are light emitting diodes, 23 1
~23 8 , 27, 28 are OR circuits, 24 is binary-
Decimal conversion decoder (for example, RCA product name)
CD4028), 29, 30, 32, and 33 are AND circuits, and 25 is a decimal counter (when the preset (PE) terminal input is high level “H”, the JAM IN terminal (J 1
~ J4 ) input state is preset and the output terminal Q1 ~ Q4
is output to. ), 26 and 31 are flip-flops, 34 and 38 are resistors, 35 and 39 are capacitors, 36 is a diode, and 37 1 and 37 2 are NOT circuits that also serve as current amplification.

いま、押ボタンスイツチ11,11が同時
にオンされると(第3図における時刻t1の時)、
AND回路33の出力は低レベル“L”が高レベ
ル“H”となり(同図)、該出力はダイオード
36を介し抵抗34を並列に設けたコンデンサ3
5を充電する(同図)。該充電電圧はAND回路
32の一方の入力に与えられ、他方の入力に与え
られるクロツク発生器9の出力とによつてフリツ
プフロツプ(FF)31をトリガする(同図〜
)。他方で前記充電電圧は抵抗38を通してコ
ンデンサ39を充電する(同図)。該充電電圧
は第1図のシフトレジスタ5,5をリセツト
すると同時にOR回路27を介して10進カウンタ
(CT)25をプリセツトする。ただし、この時プ
リセツト(PE)端子に“H”が与えられている
間はプリセツトが継続して行なわれ、JAM IN端
子の入力状態がそのまま出力端Q1〜Q4に出力し
続ける(同図,)。
Now, when the pushbutton switches 11 1 and 11 2 are turned on at the same time (at time t 1 in FIG. 3),
The output of the AND circuit 33 changes from a low level "L" to a high level "H" (see the same diagram), and the output is connected to a capacitor 3 with a resistor 34 connected in parallel through a diode 36.
5 (same figure). The charging voltage is applied to one input of an AND circuit 32, and the flip-flop (FF) 31 is triggered by the output of the clock generator 9 applied to the other input (see FIG.
). On the other hand, the charging voltage charges a capacitor 39 through a resistor 38 (see the same figure). The charging voltage resets the shift registers 51 and 52 in FIG. However, as long as "H" is applied to the preset (PE) terminal at this time, presetting continues, and the input state of the JAM IN terminal continues to be output to the output terminals Q1 to Q4 (the same figure). ,).

いま、クロツク発生器9のある周期においてフ
リツプフロツプ(FF)31のQ出力が“H”で
あつたとすると、10進カウンタ(CT)25の
JAM IN端子のJ1およびJ3には“H”レベルが与
えられ、10進カウンタ(CT)25の出力はQ1
“H”,Q2;“L”,Q3;“H”,Q4;“L”(以下
単に0101とする)となり、2進―10進変換デコー
ダ24の出力端子5に“H”レベルが出力され
る。この結果発光ダイオード22のアノード側
に“H”レベルが与えられる。またデコーダ24
の出力端子5の“H”はOR回路23を介して
発光ダイオード22のアノード側へ“H”を与
える。以下同様にして発光ダイオード22〜2
10のアノード側へはすべて“H”が与えられ
る。この時ジユウスを記憶するフリツプフロツプ
(FF)16はOR回路7を介して与えられるコン
デンサ39の充電電圧によつてリセツトがかけら
れ、その出力は“H”レベルにQ出力は“L”
レベルに保たれており、出力の“H”レベルは
NOT回路37で反転増幅され、発光ダイオー
ド22〜2210のカソード側へ“L”レベルを
与え発光ダイオード22〜2210を点灯させ
る。
Now, if the Q output of the flip-flop (FF) 31 is "H" in a certain period of the clock generator 9, then the output of the decimal counter (CT) 25 is
“H” level is given to JAM IN terminals J1 and J3 , and the output of the decimal counter (CT) 25 is Q1 ;
“H”, Q 2 ; “L”, Q 3 ; “H”, Q 4 ; “L” (hereinafter referred to simply as 0101), and the “H” level is output to the output terminal 5 of the binary-decimal conversion decoder 24. is output. As a result, "H" level is applied to the anode side of the light emitting diode 226 . Also, the decoder 24
"H" at the output terminal 5 of is applied to the anode side of the light emitting diode 227 via the OR circuit 235 . Similarly, the light emitting diodes 22 8 to 2 are
“H” is given to all the anode sides of 210 . At this time, the flip-flop (FF) 16 that stores the status is reset by the charging voltage of the capacitor 39 applied via the OR circuit 7, and its output is at the "H" level and the Q output is at the "L" level.
level, and the output “H” level is
It is inverted and amplified by the NOT circuit 371 , and an "L" level is applied to the cathode sides of the light emitting diodes 221 to 2210 , causing the light emitting diodes 226 to 2210 to light up.

また、クロツク発生器9の次の周期でフリツプ
フロツプ(FF)31のQ出力が“H”レベルか
ら“L”レベルになつた場合は10進カウンタ25
のJAM IN端子のJ1〜J4がすべて“L”レベルと
なり、10進カウンタ(CT)25の出力は
“0000”となつて、デコーダ24の出力端子0に
“H”を出力し、前述と同様にして発光ダイオー
ド22〜22を点灯させる。ここで、前述の
コンデンサ39に充電された電圧は、シフトレジ
スタ(SR)5,5をリセツトすると同時に
OR回路7の一方の入力端子に与えられ、OR回路
7の出力は“L”レベルから“H”となり、
AND回路29,30の一方の入力端子を付勢し
(同図〜)、フリツプフロツプ(FF)31の
Q,出力端子とフリツプフロツプ(FF)26
のS,R端子をそれぞれ接続する。この時、フリ
ツプフロツプ(FF)31のQ,出力につれて
フリツプフロツプ(FF)26のQ,出力が変
化し(同図)、発光ダイオード2211または2
12のアノード側に“H”レベルを与えるが、フ
リツプフロツプ(FF)16のQ端子は“L”レ
ベルであり(同図)、NOT回路37で反転増
幅されて“H”レベルとなり発光ダイオード22
11,2212は点灯しない。
In addition, when the Q output of the flip-flop (FF) 31 changes from the "H" level to the "L" level in the next cycle of the clock generator 9, the decimal counter 25
All of the JAM IN terminals J1 to J4 of the JAM IN terminal become "L" level, the output of the decimal counter (CT) 25 becomes "0000", and "H" is output to the output terminal 0 of the decoder 24, and the above-mentioned Similarly, the light emitting diodes 22 1 to 22 5 are turned on. Here, the voltage charged in the capacitor 39 mentioned above is reset at the same time as the shift registers (SR) 5 1 and 5 2 are reset.
It is applied to one input terminal of the OR circuit 7, and the output of the OR circuit 7 changes from "L" level to "H".
One of the input terminals of the AND circuits 29 and 30 is energized (from the same figure), and the Q and output terminals of the flip-flop (FF) 31 and the flip-flop (FF) 26 are energized.
Connect the S and R terminals of each. At this time, the Q and output of the flip-flop (FF) 26 changes as the Q and output of the flip-flop (FF) 31 changes (as shown in the figure), and the light emitting diode 22 11 or 2 changes.
The "H" level is applied to the anode side of the flip-flop ( FF ) 16, but the Q terminal of the flip-flop (FF) 16 is at the "L" level (see the same figure), and it is inverted and amplified by the NOT circuit 372 to become the "H" level and the light emitting diode 22
11 , 22 12 does not light up.

次に押ボタンスイツチ11または11の少
くとも一方が離されると(第3図における時刻
t2)、AND回路33の出力は“H”レベルから
“L”レベルとなり、コンデンサ35は抵抗34
を通して放電を開始し、電圧が“L”レベルにな
つた時点(第3図における時刻t3)でフリツプフ
ロツプ(FF)31のクロツク入力はAND回路3
2によつて断たれ、その時の状態を保持し続け
る。
Next, when at least one of the pushbutton switches 11 1 or 11 2 is released (the time in FIG.
t2 ), the output of the AND circuit 33 changes from "H" level to "L" level, and the capacitor 35 is connected to the resistor 34.
When the voltage reaches the "L" level (time t3 in FIG. 3), the clock input of the flip-flop (FF) 31 is connected to the AND circuit 3.
2, and continues to maintain its current state.

さらに、コンデンサ39も抵抗38,34を経
て放電しその電圧が“L”レベルとなつた時点
(第3図における時刻t4)でシフトレジスタ
(SR)5,5のリセツトを解除し能動とする
と同時に、OR回路7およびOR回路27の一方の
入力端子を“H”レベルから“L”レベルとし、
それぞれの出力“H”レベルを“L”レベルに反
転する。この結果、AND回路29,30は閉じ
られ、フリツプフロツプ(FF)31のQ,出
力の状態とフリツプフロツプ(FF)26′のQ,
出力は同一の状態のまま停止する。10進カウン
タ(CT)25はプリセツトが解除されJAM IN
端子の入力状態に応じて“0000”または“0101”
の状態で停止する。
Furthermore, the capacitor 39 is also discharged through the resistors 38 and 34, and at the time when its voltage reaches the "L" level (time t4 in FIG. 3), the reset of the shift registers (SR) 51 and 52 is released and the shift registers 51 and 52 become active. At the same time, one input terminal of the OR circuit 7 and the OR circuit 27 is changed from the "H" level to the "L" level,
Each output "H" level is inverted to "L" level. As a result, the AND circuits 29 and 30 are closed, and the Q and output states of the flip-flop (FF) 31 and the Q, output state of the flip-flop (FF) 26' are
Output remains in the same state and stops. The preset of decimal counter (CT) 25 is canceled and JAM IN occurs.
“0000” or “0101” depending on the input state of the terminal
Stops in this state.

以上で卓球の競技開始の際、サービス権の設定
のために行なわれるトスまたはケンと同等の電子
回路によるジヤンケンおよびサービス権の設定表
示を行なうことができる。
As described above, at the start of a table tennis match, it is possible to display the setting of the game and the service right using an electronic circuit equivalent to the toss or check performed to set the service right.

第4図〜は通常のサービスからジユウス時
のサービスに至るサービス権の状態の1例を示す
各動作波形説明図である。ジヤンケンの結果を次
のように仮定する。すなわち、フリツプフロツプ
(FF)31,26は共にQ;“L”,;“H”
の状態でかつ10進カウンタ(CT)25は
“0000”で停止し、デコーダ24の出力端0に
“H”レベルが出力されているものとする。従つ
て、この場合発光ダイオード22〜22の5
個が点灯し最初のサービス権5本を一方の競技者
側に設定したことになる。次に競技が行なわれ最
初のサービスで競技者の一方が得点し加点するた
めに押ボタンスイツチ11または11を押圧
すると(同図,)、OR回路28の出力端は
“L”レベルから“H”レベルに反転し、その立
上りで10進カウンタ(CT)25を1進だけ進め
(同図〜)、デコーダ24の出力端1に“H”
レベルを出力する。この結果、発光ダイオード2
〜22が点灯し、サービス権を1本費し、
残数4本であることを表示する。このように、
次々と加点に従つて10進カウンタ(CT)25の
計数が進み、発光ダイオード22だけが点灯し
ている状態、すなわち10進カウンタ(CT)25
は最初の状態から4進しデコーダ24の出力端4
に“H”レベルを出力している状態から、前述と
同様に加点されると10進カウンタ(CT)25は
さらに1進だけ進み、その結果、デコーダ24の
出力端5に“H”レベルを出力し、発光ダイオー
ド22〜2210の5個が点灯する。このよう
に、一方の競技者は最初設定された5本のサービ
ス権をすべて費したとき、他方の競技者に5本の
サービス権が設定され、競技が終了するまで交互
に5本のサービス権を表示する。
FIGS. 4A and 4B are explanatory diagrams of each operation waveform showing an example of the state of service rights ranging from normal service to abnormal service. Assume the result of Jiyanken as follows. That is, the flip-flops (FF) 31 and 26 are both Q; "L", ; "H".
It is assumed that the decimal counter (CT) 25 stops at "0000" and the "H" level is output to the output terminal 0 of the decoder 24. Therefore, in this case, 5 of the light emitting diodes 22 1 to 22 5
The symbol lights up, indicating that one player has the first five service rights. Next, when a competition is held and one of the competitors presses the pushbutton switch 111 or 112 in order to score and add points at the first service (see the same figure), the output terminal of the OR circuit 28 changes from the "L" level. It is inverted to "H" level, and at the rising edge, the decimal counter (CT) 25 is incremented by one digit (from the same figure), and the output terminal 1 of the decoder 24 is set to "H".
Output the level. As a result, light emitting diode 2
2 2 ~ 22 5 lights up, one service right is spent,
It is displayed that there are 4 pieces left. in this way,
The decimal counter (CT) 25 counts as the points are added one after another, and only the light emitting diode 225 is lit, that is, the decimal counter (CT) 25
is converted to 4 from the initial state and output to the output terminal 4 of the decoder 24.
When a point is added in the same way as described above, the decimal counter (CT) 25 advances by one digit, and as a result, the output terminal 5 of the decoder 24 outputs an "H" level. The light is output and five light emitting diodes 22 6 to 22 10 light up. In this way, when one contestant has used all of the five service rights initially set, the other contestant is given five service rights, and they continue to serve five service rights alternately until the end of the competition. Display.

競技者の一方が20点未満のとき他の一方の競技
者が21点を得点できないとき、20オールとなり以
後のサービスは1本ずつ交替で行なうことがルー
ルに規定されている。
The rules stipulate that if one of the players scores less than 20 points and the other player fails to score 21 points, the score is 20 all and subsequent serves must be served one at a time.

いま、一方の競技者が20点を得点し、他方の競
技者が19点であつたと仮定する。この場合双方で
39点が得点され、サービス権も39本が費され、こ
の時点では発光ダイオード2210が1個だけ点灯
し、40本目のサービス権であることを表示する。
競技の進行に伴つて他方の競技者が得点すると20
オールとなり、40本目のサービス権も費されたこ
ととなる。
Now suppose that one contestant scores 20 points and the other contestant scores 19 points. In this case both
39 points have been scored and 39 service rights have been used, and at this point only one light emitting diode 2210 is lit, indicating that it is the 40th service right.
20 if the other contestant scores as the competition progresses
It was all, and the 40th service right was also spent.

次に第4図の右半部はジユウスの段階に入つた
場合を示す。得点の加点に併なうOR回路28の
出力によつてトリガされるフリツプフロツプ
(FF)26は最初のサービス権設定時にQ;
“L”,;“H”であつたものが、39本のサービ
ス権を費した時点、すなわち40本目ではQ;
“H”,;“L”となり、他方の競技者が得点し
20点目を加点したとき20オールとなつてフリツプ
フロツプ(FF)26の出力は“L”レベルか
ら“H”レベルとなると同時にAND回路17が
“H”レベルを出力し、フリツプフロツプ(FF)
16のQ出力は“L”レベルから“H”レベルに
反転し(同図,)、NOT回路37の出力
“L”レベルとフリツプフロツプ(FF)26の
出力“H”レベルとによつて発光ダイオード22
11が点灯する。さらに競技者のいずれかが得点し
加点するとフリツプフロツプ(FF)26は反転
し、Q出力は“L”レベルから“H”レベルとな
り前述と同様にして発光ダイオード2212が点灯
する。このようにして20オール以後は発光ダイオ
ード2211と2212とが交互に点灯しルールに沿
つたサービス権の表示を行なう。
Next, the right half of FIG. 4 shows the case where the state has entered the normal stage. A flip-flop (FF) 26, which is triggered by the output of the OR circuit 28 in conjunction with the addition of points, sets Q;
“L”,; “H” is Q;
“H”; “L” and the other contestant scores.
When the 20th point is added, the total becomes 20, and the output of the flip-flop (FF) 26 changes from the "L" level to the "H" level.At the same time, the AND circuit 17 outputs the "H" level, and the flip-flop (FF)
The Q output of 16 is inverted from "L" level to "H" level (see the same figure), and light is emitted by the "L" level output of NOT circuit 372 and the "H" level output of flip-flop (FF) 26. diode 22
11 lights up. Further, when one of the contestants scores and adds points, the flip-flop (FF) 26 is inverted, and the Q output changes from the "L" level to the "H" level, and the light emitting diode 2212 lights up in the same manner as described above. In this manner, after 20 all, the light emitting diodes 22 11 and 22 12 are lit alternately to display the service right in accordance with the rules.

このようにして、競技が進行し勝敗判定回路
AND回路4または4、20オール後のジユウ
スにあつては2点差判別回路のAND回路20
または20の判別出力によつてOR回路6を経
てシフトレジスタ(SR)10を働かせ、該シフ
トレジスタ(SR)10のQ8出力から得られる正
パルスによつてOR回路7を経て10進カウンタ
(CT)1〜1およびフリツプフロツプ
(FF)16をリセツトするとともに(同図,
)、OR回路27を経て10進カウンタ(CT)2
5をプリセツトし、さらにAND回路29,30
を経てフリツプフロツプ(FF)26の初期値を
設定する(同図,,〜)。
In this way, the competition progresses and the circuit for determining the winner and loser
AND circuit 4 1 or 4 2 , AND circuit 20 1 of 2-point difference discrimination circuit in the case of 20 cases later
Alternatively, the shift register (SR) 10 is operated via the OR circuit 6 by the discrimination output of 202 , and the positive pulse obtained from the Q8 output of the shift register (SR) 10 is operated via the OR circuit 7 to operate the decimal counter. (CT) 11 to 14 and the flip-flop (FF) 16 (in the same figure,
), decimal counter (CT) 2 via OR circuit 27
5 and then AND circuits 29 and 30.
The initial value of the flip-flop (FF) 26 is set through the steps shown in FIG.

以上のように複数個のスイツチの入力操作によ
つて競技の得点をカウント、表示し、規定の得点
を検索する得点検索部と、ジユウスの条件を検索
するジユウス検索部と、上記両検索部の検索結果
に基づき競技の勝敗を判定し、結果を表示する勝
敗判定部とを有する得点表示器において、複数個
のスイツチの論理積出力によつて初期値を決定す
る初期サービス権決定手段と、該初期値に基づき
サービス権をカウントするサービス権カウント手
段と、前記初期値をサービス権カウント手段へ設
定するプリセツト手段と、前記サービス権カウン
ト手段の内容を表示するサービス権表示手段と、
ジユウス時のサービス権を表示するジユウス時サ
ービス権表示手段と、前記ジユウス時サービス権
表示手段と前記サービス権表示手段とを選択する
選択手段を具えたものであり、最初に競技者の一
方に所定数(例えば5本)のサービス権を表示
し、競技の進行に伴い双方の競技者のいずれかが
加点する毎に1本のサービス権を減じサービス権
の残数が無くなつたとき他方の競技者へ所定数の
サービス権を表示し、ジユウス時にあつてはジユ
ウス時サービス権表示手段によつて交互に1本ず
つのサービス権が表示されるものである。
As described above, there is a score search section that counts and displays competition scores through input operations on multiple switches, and searches for a specified score, a match search section that searches for conditions for the match, and both of the above search sections. A score display having a win/lose judgment unit that judges the win/lose of a competition based on the search result and displays the result, an initial service right determining means that determines an initial value based on a logical AND output of a plurality of switches; a service right counting means for counting service rights based on an initial value; a presetting means for setting the initial value in the service right counting means; a service right display means for displaying the contents of the service right counting means;
The apparatus is equipped with an improper service right display means for displaying a service right at an improper time, and a selection means for selecting between the improper service right display means and the service right display means. The number of service rights (for example, 5) is displayed, and as the competition progresses, each time one of the competitors adds points, one service right is subtracted, and when there are no more service rights left, the other competition A predetermined number of service rights are displayed to the user, and when an abnormality occurs, the service rights are alternately displayed one by one by the abnormality service rights display means.

従来、この種の競技において審判不在の私的競
技の機会が多く競技者は競技に集中するあまり、
残りのサービス権数を往々にして忘れ、双方の得
点合計から判断する外に方法がなく競技の円滑な
運営に支障をきたすことがあつた。本発明による
表示器は競技者に余分な神経を使わせないばかり
か、ルールに沿つた的確な表示を行ない競技者は
純粋に集中することができる。また審判のいる公
的競技の場合に使用しても審判の補助的手段とし
て極めて有効である。
Traditionally, in this type of competition, there were many opportunities for private competitions without referees, and competitors were too focused on the competition.
Players often forgot how many servings they had remaining, and there was no other way to judge it than based on the total points scored by both players, which hindered the smooth running of the competition. The display device according to the present invention not only does not make the players use unnecessary nerves, but also provides accurate display in accordance with the rules, allowing the players to concentrate purely. It is also extremely effective as an auxiliary tool for referees when used in public competitions with referees.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来提案例の説明図、第2図は本発明
の実施例の構成を示す説明図、第3図〜,第
4図〜は第3図の実施例の動作波形図であ
り、図中、5,5はシフトレジスタ、7,2
7,28,23〜23はOR回路、9はクロ
ツク発生器、11,11は押ボタンスイツ
チ、16,26,31はフリツプフロツプ、22
〜2212は発光ダイオード、24は2進―10進
変換デコーダ、25は10進カウンタ、29,3
0,32,33はAND回路、34,38は抵
抗、35,39はコンデンサ、37,37
NOT回路を示す。
FIG. 1 is an explanatory diagram of a conventional proposed example, FIG. 2 is an explanatory diagram showing the configuration of an embodiment of the present invention, and FIGS. 3 to 4 are operational waveform diagrams of the embodiment of FIG. In the figure, 5 1 , 5 2 are shift registers, 7, 2
7, 28, 23 1 to 23 8 are OR circuits, 9 is a clock generator, 11 1 , 11 2 are push button switches, 16, 26, 31 are flip-flops, 22
1 to 22 12 is a light emitting diode, 24 is a binary-decimal conversion decoder, 25 is a decimal counter, 29, 3
0, 32, 33 are AND circuits, 34, 38 are resistors, 35, 39 are capacitors, 37 1 , 37 2 are
A NOT circuit is shown.

Claims (1)

【特許請求の範囲】 1 複数個のスイツチと、該複数個のスイツチに
対応して設けられ、該複数個のスイツチの入力操
作によつて競技の得点をそれぞれカウントする得
点カウント手段と、該得点カウント手段の内容を
それぞれ表示する得点表示手段と、前記得点カウ
ント手段の内容から規定の得点をそれぞれ検索す
る得点検索手段と、前記得点カウント手段の内容
からジユウスの条件を検索するジユウス検索手段
と、該ジユウス検索手段と前記得点検索手段との
検索結果に基づいて競技の勝敗をそれぞれ判定す
る勝敗判定手段と、該勝敗判定手段による勝敗判
定結果をそれぞれ表示する勝敗判定表示手段と、
を有する得点表示器において、 前記複数個のスイツチの論理積出力によつてサ
ービス権の初期値を決定する初期サービス権決定
手段と、前記複数個のスイツチの論理和出力を入
力として、前記初期サービス権決定手段によつて
決定された初期値に基づいてサービス権数をカウ
ントするサービス権カウント手段と、該サービス
権カウント手段を前記論理積出力によつて初期値
に設定するプリセツト手段と、前記サービス権カ
ウント手段の内容により、サービス権の位置と残
数とを表示するサービス権表示手段と、前記初期
サービス権決定手段の初期値によつて規定され、
前記論理和出力を入力としてジユウス時のサービ
ス権を表示するジユウス時サービス権表示手段
と、前記ジユウス検索手段の出力によつて、前記
ジユウス時サービス権表示手段と前記サービス権
表示手段とを選択する選択手段と、を具えたこと
を特徴とする得点表示器。
[Scope of Claims] 1. A plurality of switches, a score counting means provided corresponding to the plurality of switches, and counting the scores of the competition by input operations of the plurality of switches, score display means for respectively displaying the contents of the score counting means; score search means for searching for predetermined scores from the contents of the score counting means; and normal search means for searching for the conditions from the contents of the score counting means; win/loss determining means for determining the winner or loser of the competition based on the search results of the general search means and the score retrieving means; win/loss determining display means for respectively displaying the results of the winning/losing determination by the win/loss determining means;
an initial service right determining means that determines the initial value of the service right based on the AND output of the plurality of switches; a service right counting means for counting the number of service rights based on the initial value determined by the right determining means; a presetting means for setting the service right counting means to an initial value by the logical AND output; defined by the contents of the right counting means, a service right display means for displaying the position and remaining number of service rights, and an initial value of the initial service right determining means;
Selecting the improper service right display means and the service right display means based on the output of the improper service right display means that inputs the logical sum output and displays the service right in the improper state, and the output of the improper search means. A score display comprising a selection means.
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