JPS6147516U - 利得可変差動増幅器 - Google Patents

利得可変差動増幅器

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Publication number
JPS6147516U
JPS6147516U JP13229284U JP13229284U JPS6147516U JP S6147516 U JPS6147516 U JP S6147516U JP 13229284 U JP13229284 U JP 13229284U JP 13229284 U JP13229284 U JP 13229284U JP S6147516 U JPS6147516 U JP S6147516U
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JP
Japan
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differential amplifier
variable gain
gate
emitter
stage transistor
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JP13229284U
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JPH0247625Y2 (ja
Inventor
克彰 田仲
実 仲秋
Original Assignee
岩崎通信機株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例、第２図および第３図は本考
案の特性を示す図、第４区は手動により利得を可変し得
る直流広帯域差動増幅器、第５図，〜第１６図は制御信
号により利得を可変し得る直流広帯域増幅器の従来技術
またはその改良技術を示す図、第１７図および第１８図
は要求される特性を説明するための図、第１９図は、第
１図および第４図の特性の比較図である。 １〜４・・・トランジスタ、５，６・・・入力端子、７
，８・・・出力端子、１０，４０．５０番台・・・抵抗
、２０番台・・・ＦＥＴまたはトランジスタ、３０番台
・・・ダイオード、６０・・・Ｄ／Ａ変換器、６１，６
２・・・定電流源、７ ｊ， ７ ２・・・オペレー
ショナルアンプ、８０番台・・・コンデンサ。

Claims (3)

    【実用新案登録請求の範囲】
  1. （１）入力信号の印加される２個１組の差動入力端子と
    、前記各差動入力端子１こ各ベースを接続し各エミツタ
    は抵抗を介して接続されている２個１組の第１段トラン
    ジスタと、２個１組の差動出力′端子と、前記差動出力
    端子に各コレクタを接続し、各エミツタはそれぞれエミ
    ツタ直列抵抗を介して前記第１段トランジスタの各コレ
    クタに接続されてベース接地増幅をなす第２段トランジ
    スタとを含む差動増幅器において、前記第１段トランジ
    スタの各コレクタと前記エミツタ直列抵抗との各接続点
    にソースとドレインを接続したデュアルゲー｝ Ｇａ
    Ａｓ ＭＥＳ−ＦＥＴを接続し、前記デュアルゲートＧ
    ａＡＳ ＭＥＳ−ＦＥＴ のゲート電圧により利得を可変する
    ことを特徴とする利得可変差動増幅器。
  2. （２）前記テュアルゲート ＧａＡｓ ＭＥＳ −ＦＥ
    Ｔのゲート電圧が、デイジタルデータによってアナログ
    信号を発生するＤ／Ａ変換器から印加される実用新案登
    録請求の範囲第１項記載の利得可変差動増幅器。
  3. （３）前記７’ ：ｌ− ７ ／Ｌ／ゲートＧａＡｓ
    ＭＥＳ −ＦＥＴの第１ゲートおよび第２ゲートが並列
    に接続されてなる実用新案登録請求の範囲第１項記載の
    利得可変差動増幅器。 ｛４｝ 前記第１段トランジスタの各エミツタ間を接
    続する抵抗を切換える実用新案登録請求の範囲第１項記
    載の利得可変差動増幅器。
JP13229284U 1984-08-31 1984-08-31 利得可変差動増幅器 Granted JPS6147516U (ja)

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JP13229284U JPS6147516U (ja) 1984-08-31 1984-08-31 利得可変差動増幅器

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JPS6147516U true JPS6147516U (ja) 1986-03-29
JPH0247625Y2 JPH0247625Y2 (ja) 1990-12-14

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JP13229284U Granted JPS6147516U (ja) 1984-08-31 1984-08-31 利得可変差動増幅器

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JPH0247625Y2 (ja) 1990-12-14

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