JPS6135743B2 - - Google Patents

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JPS6135743B2
JPS6135743B2 JP53070440A JP7044078A JPS6135743B2 JP S6135743 B2 JPS6135743 B2 JP S6135743B2 JP 53070440 A JP53070440 A JP 53070440A JP 7044078 A JP7044078 A JP 7044078A JP S6135743 B2 JPS6135743 B2 JP S6135743B2
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JP
Japan
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bits
input
bit
modulator
phase
Prior art date
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JP53070440A
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English (en)
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JPS545647A (en
Inventor
Jiin Pieru Hoitebin Reimondo
Piere Burosaado Kuraude
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Individual
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Publication date
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Publication of JPS545647A publication Critical patent/JPS545647A/ja
Publication of JPS6135743B2 publication Critical patent/JPS6135743B2/ja
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L27/00Modulated-carrier systems
    • H04L27/18Phase-modulated carrier systems, i.e. using phase-shift keying
    • H04L27/20Modulator circuits; Transmitter circuits
    • H04L27/2032Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner
    • H04L27/2053Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases
    • H04L27/206Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases using a pair of orthogonal carriers, e.g. quadrature carriers
    • H04L27/2067Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases using a pair of orthogonal carriers, e.g. quadrature carriers with more than two phase states
    • H04L27/2078Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases using a pair of orthogonal carriers, e.g. quadrature carriers with more than two phase states in which the phase change per symbol period is constrained

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  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Description

【発明の詳細な説明】
本発明は特に高周波搬送波、例えばマイクロ波
周波搬送波で用いるのに適する4相スタガ位相偏
移キーイング変調方式に関するものである。 スタガ位相偏移を用いる4相状態における変調
は、4PSK方式という変調方式として公知であ
る。さらに本願の出願人のうちの最初に名前をあ
げた者によつて1977年4月6日に提出されたフラ
ンス特許願77第11008号(スタガ位相偏移多重レ
ベル変調によるデジタル情報の伝送方式」におい
て一連のビツトが搬送波を次のように変調するこ
とが記載されている。すなわち各ビツトが、その
ビツトに先行する数ビツトよつて定められた搬送
波の位相状態をそのビツト1であるか0であるか
によつて決まる位相偏移からビツトが1であれば
変更し、ビツトが0であれば変更しない(または
その逆)というようにしが変調する。この場合、
ビツトの値と位相偏移の関係を決めるには、
NRZIコーデイングによつてもよいし、または直
接でもよい。 前記フランス特許願の第5図を参照すると、ス
タガ位相偏移とNRZIコーデイングとを用いた4
相変調器が記載されている。この変調器は本願の
第1図に示してある。それには搬送波周波発生装
置1、3dB電力分割器または結合器2、90゜移相
器3、リング変調器4と5、2出力を有する多重
分離器6、トランジシヨン・コーテイングのため
の2つの回路7と8及び3dB混合または結合回路
9がある。この変調器の動作は、前記特許願の説
明に述べられており、ここでは多重分離器6が線
路11の上に与えられた一連のビツトをそのビツ
ト周波数になつている線路10の上のクロツク信
号の指令によつて多重分離するという残りの部分
を述べる。奇数番目の一連のビツトは、回路7に
加えられ、その出力信号は、変調器4において搬
送波を変調し、偶数番目の一連のビツトは、回路
8に加えられ、その出力信号は、90゜位相偏移し
た搬送波を変調器5において変調する。結合器9
は、変調器4と5から出てくる直角位相に変調さ
れた2つの周波数を加え合せる。最後に多重分離
器6の出力は、それが出す2つのビツトの出力の
状態を維持する。 この種の変調器が非常に高い搬送波周波数、例
えばマイクロ波周波数領域における周波数で用い
られなければならないとき、この種の変調器に固
有の若干の欠点がある。これらの非常に高い周波
数で動作できる結合器、変調器及び移相器は非常
に高価である。一方、これらの基本回路は変調周
波数の電力を搬送波周波発生装置の電力に対して
かなり小さくする著しい挿入損失を生ずる。 本発明の目的は前述の欠点をさける、さらに特
定すれば非常に高い搬送波周波数で動作できるス
タガ位相偏移をもつた4相変調器を提供すること
にある。 本発明の1特徴によれば、NRZI・コーデイン
グを用いたそのような変調器が提供され、それに
は搬送波周波発生装置として用いられる電圧制御
発振器があり、その発振器の周波数は1ビツトの
時間巾以下の時間巾の正または負のパルスによつ
て変調できるようにしており各パルスごとにパル
スの符号次第で発振器が発する搬送波の位相を+
90゜または−90゜だけ偏移させることができる。
ここで前記の正または負のパルスは変調器に加え
られる一連のパルスの個別コーデイングによつて
作られる。 本発明の前記特徴はほかの特徴と一緒に、以下
の実施例の説明によつてより明瞭に理解できる。
NRZI・コーデイングを用いた4相状態スタガ位
相偏移キーイング変調の定義についてを、例えば
前記フランス特許願77第11008号に記載されたも
のを参照すれば、次のことが分かる: ―位相状態の変化はビツトの伝送速度で行なわれ
る。 ―0ビツトは位相状態にいかなる変更をも生じさ
せない、 ―1のビツトは搬送波に+90゜または−90゜の位
相変化を生じさせ、2つの引続く位相変化はそ
れらを生じさせる1のビツトが偶数個の0ビツ
トによつて分離されれば同じ符号をもち、0ビ
ツトの数が奇数であれば反対符号をもつてい
る。 第2図の変調器には線路11に加えられた一連
のビツトを受ける論理制御回路12とビツトの周
波数で線路10に加えられたクロツク信号とがあ
る。制御回路12の出力は搬送周波数で出力信号
を発する電圧制御発振器13の制御入力に接続さ
れている。 回路12はその入力に0ビツトがあるときは0
信号を発する。そのとき発振器13の出力信号に
は変化がない。回路12にはその入力に加えられ
た1のビツトの直前の0ビツトの数のパリテイを
決定する装置が組込んであり、1を受けると前記
数が偶数であれば、回路12は正のパルス+V
(t)を送り出し、前記数が奇数であれば負のパ
ルス−V(t)を出す。大きさの如何にかかわら
ず出されたパルスはせいぜいビツトの時間巾に等
しい時間巾をもつている。第3図に例が示されて
いる関数V(t)の形は次の関係を満たすように
なつている。 ∫ S×V(t)dt=1/4 ここでSは周波数/電圧の比によつて表わされる
発振器の変調感度であり、Tは1ビツトの時間巾
である。実際には、発振器に加えられる制御電圧
は、その出力信号の周波数に作用する。上の関係
が確められるとき、各パルスのあとで電圧制御発
振器13によつて出される信号の位相が90゜だけ
変り、符号はパルスの符号によつて正になつたり
負になつたりする。 パルスV(t)の形を前記の関係式に合わせな
がら、位相偏移を多少急にするように選ぶことが
でき、その位相トランジシヨンによつて発振器1
3によつて出された位相変調された搬送波の波形
を整形することができる。 電圧制御発振器13によつて出された信号は前
記定義によく一致すること、すなわち発生される
変調は4つの位相状態をもつている段階つき偏移
変調であつてNRZI・コーデイングを用いている
ということが明らかである。 第4図は第2図の論理制御回路12の実例を示
す。線路11の上の信号入力は一方では論理イン
バータ14の入力に接続され、他方ではそれぞれ
3つの入力を有する2つのANDゲート15と1
6の第1の入力に並列に接続されている。インバ
ータ14の出力は、2つの入力を有するANDゲ
ート17の第1の入力に接続され、ANDゲート
17の第2の入力はクロツクの入力10に接続さ
れ、ゲート17の出力は、制御入力に信号が加え
られ3たびごとに状態を変えるフリツプフロツプ
18の制御入力に接続されている。フリツプフロ
ツプ18にはゲート15の第3の入力に接続され
た出力Qと、一方でゲート16の第3の入力に接
続され、他方でフリツプフロツプ18の信号入力
に接続されている出力がついている。次にクロ
ツク入力10はゲート15と16の第2の入力に
並列に接続されている。ゲート15と16の出力
はそれぞれ接地されている中央タツプを有する変
成器の一次巻線19の端子に接続されている。変
成器の二次巻線20は持地された一方の端子と波
形整形回路21の入力に接続された他方の端子と
をもち、回路21の出力は、発振器13の電圧制
御入力に接続されている。 波形整形回路21は、二次巻線20からのパル
スへ最も適当な形を、第3図に関して前述したよ
うに、与えるのに用いることのできる増幅器また
は減衰器に接続されたフイルタであつてもよい。 実際には、フリツプフロツプ18はその制御入
力に加えられた信号の1/2割算回路と同じに動作
する。一連のビツトの各1において、ゲート15
または16のどちらかが1を出し、その1が一次
巻線19の電流の方向を決め、従つて二次巻線2
0の電流の方向を決める。次の表は例として、構
成要素の状態と一連のビツトを加えることによつ
て第4図の制御回路の入力11に生ずる位相偏移
を示す。第5図は、第4図の各部の出力を表の値
の場合について示したパルス波形図である。
【表】
【表】 第2図の構成において、搬送周波数で動作する
唯一の装置は発振器13であつて、それは調整の
困難、挿入損失及び従来技術の装置において高い
周波数で用いられた補助装置の費用をなくすもの
である。
【図面の簡単な説明】
第1図は従来技術によるトランジシヨン・コー
デイングをもつたスタガ位相偏移キー4相変調器
のブロツク線図、第2図は本発明によるトランジ
シヨン・コーデイングをもつたスタガ位相偏移キ
ー4相変調器のブロツク線図、第3図は第2図の
変調器に用いられるパルスの形を示す電圧―時間
のグラフ、第4図は第2図の変調器に用いられる
制御回路の線図、第5図は第4図の各部の出力パ
ルスの関係を示す波形図である。 1…搬送波周波発生装置、2…3dB電力分割器
または結合器、3…90゜位相器、4,5…リング
変調器、6…多重分離器、7,8…トランジシヨ
ン・コーデイング用回路、9…3dB混合または結
合回路、12…論理制御回路、13…電圧制御発
振器、14,16,17…ANDゲート、18…
フリツプフロツプ、19…変成器の一次巻線、2
0…変成器の二次巻線、21…波形整形回路。

Claims (1)

  1. 【特許請求の範囲】 1 一連の2進数字をNRZIコーデイングを用い
    て変調するもので各ビツトが搬送波の位相状態
    を、そのビツトに先行する2ビツトによつて定ま
    る状態へNRZIコーデイングに従つてそのビツト
    によつて生じた位相偏移から、ビツトの値が1の
    ときは変更し、ビツトの値が0のときは変更しな
    い4相スタガ位相偏移キーイング変調器であつ
    て、 搬送波を発生する電圧制御発振器と、 前記一連のビツトに応じて、前記一連のビツト
    の中の1ビツトの持続時間より短い持続時間また
    は前記1ビツトの持続時間に等しい持続時間を有
    する正・負のパルスを発生する制御回路と、を備
    え、 前記パルスが前記電圧制御発振器の制御入力に
    印加され、前記印加パルスの各々がその符号次第
    で前記電圧制御発振器の出力搬送波の位相を+90
    ゜または−90゜だけ偏移し、この場合0のビツト
    はパルスを生ぜず、1のビツトは、正または負の
    パルスを発生し、二つの相次ぐパルスの付号が中
    間の0のビツトの数が奇数であれば変更され偶数
    であれば変更されないことを特徴とする4相スタ
    ガ位相偏移キーイング変調器。 2 前記制御回路が 前記一連のビツトを受ける入力とフリツプフロ
    ツプの相補信号入力に接続された出力とを有する
    否定回路と、 一つ一つがそれぞれ前記フリツプフロツプの各
    出力に接続された第1の入力、前記一連のビツト
    を受ける第2の入力、およびビツトの周波数のク
    ロツク信号を受ける第3の入力を有する1対の
    ANDゲートとを備え、 前記1対のANDゲートのそれぞれの出力が中
    央タツプが接地された変成器の一次巻線および一
    方の端子が接地され、他方の端子が前記電圧制御
    発振器の制御入力に接続された二次巻線のそれぞ
    れの端子に接続されていることを特徴とする特許
    請求の範囲第1項に記載の変調器。 3 前記フリツプフロツプがD型回路である特許
    請求の範囲第2項に記載の変調器。 4 変成器の二次巻線の前記他方の端子がパルス
    整形回路を介して前記電圧制御発振器の制御入力
    に接続されていることを特徴とする特許請求の範
    囲第2項または第3項に記載の変調器。
JP7044078A 1977-06-13 1978-06-13 44phase statter phase shift keying modulator Granted JPS545647A (en)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
FR7718770A FR2394921A1 (fr) 1977-06-13 1977-06-13 Modulateur a quatre phases a sauts decales

Publications (2)

Publication Number Publication Date
JPS545647A JPS545647A (en) 1979-01-17
JPS6135743B2 true JPS6135743B2 (ja) 1986-08-14

Family

ID=9192270

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7044078A Granted JPS545647A (en) 1977-06-13 1978-06-13 44phase statter phase shift keying modulator

Country Status (6)

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US (1) US4210879A (ja)
JP (1) JPS545647A (ja)
DE (1) DE2822637A1 (ja)
FR (1) FR2394921A1 (ja)
GB (1) GB1603938A (ja)
IT (1) IT1104953B (ja)

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IT7883380A0 (it) 1978-05-11

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