JPS61290897A - ユニツト間デイジタルトランク - Google Patents
ユニツト間デイジタルトランクInfo
- Publication number
- JPS61290897A JPS61290897A JP13178885A JP13178885A JPS61290897A JP S61290897 A JPS61290897 A JP S61290897A JP 13178885 A JP13178885 A JP 13178885A JP 13178885 A JP13178885 A JP 13178885A JP S61290897 A JPS61290897 A JP S61290897A
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- JP
- Japan
- Prior art keywords
- unit
- time slot
- signal
- channel
- inter
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はディジタル形電子交換機のユニ、ト間ディジタ
ルトランク、更処詳しく言えばユニット間！ディジタル
方式により接続するインタフェース回路に構成に関する
ものである。
ルトランク、更処詳しく言えばユニット間！ディジタル
方式により接続するインタフェース回路に構成に関する
ものである。
交換システムのトラと、り容量を拡大する一手法として
、電磁交換機の時代から、同−局舎内忙複数ユニ、トを
設置し、ユニ、ト間を複式に組む方式、謂るマルチユニ
、ト方式が知られている。この複数ユニット間の通話を
中継するトランクはユニット間トランクと呼ばれる。デ
ィジタル形電子交換機の場合は、ＰＣＭ伝送装置とのイ
ンタフェースに用いるディジタルトランク（以後ＤＩＣ
と称す）ｋ流用するのが一般的である。
、電磁交換機の時代から、同−局舎内忙複数ユニ、トを
設置し、ユニ、ト間を複式に組む方式、謂るマルチユニ
、ト方式が知られている。この複数ユニット間の通話を
中継するトランクはユニット間トランクと呼ばれる。デ
ィジタル形電子交換機の場合は、ＰＣＭ伝送装置とのイ
ンタフェースに用いるディジタルトランク（以後ＤＩＣ
と称す）ｋ流用するのが一般的である。
即ちＤＩＣを用いることで、特別な呼処理や管理プログ
ラムを追加することなく、容易にマルチユニットを組む
ことが出来る。
ラムを追加することなく、容易にマルチユニットを組む
ことが出来る。
しかしながらＤＩＣは、文献ＩＳ８”７９．パリ、１９
７９年５月、セツション３１Ａ：ディジタル スイッチ
ングシステムズ（Ｗ）、 ６８８〜６９５頁［パーサト
ル、ディジタル、スイッチング、システム、フォー、セ
ントラル、オフィス、ＮＲＡＸ ６１ ＪＩＳＳ’ ７
９． Ｐａｒｉｓ、 Ｍａｙ １９７９．５ＥＳＳＩＯ
Ｎ ３１Ａ：ＤＩＧＩＴＡＬ ＳＷＩ’Ｉ”ＣＩ（ＩＮ
Ｇ ８ＹＳＴＥＭＳ（ｙ ） ６ｓｓ 〜（５９５。
７９年５月、セツション３１Ａ：ディジタル スイッチ
ングシステムズ（Ｗ）、 ６８８〜６９５頁［パーサト
ル、ディジタル、スイッチング、システム、フォー、セ
ントラル、オフィス、ＮＲＡＸ ６１ ＪＩＳＳ’ ７
９． Ｐａｒｉｓ、 Ｍａｙ １９７９．５ＥＳＳＩＯ
Ｎ ３１Ａ：ＤＩＧＩＴＡＬ ＳＷＩ’Ｉ”ＣＩ（ＩＮ
Ｇ ８ＹＳＴＥＭＳ（ｙ ） ６ｓｓ 〜（５９５。
［Ａ Ｖ４ａ、ａａ、ｔＡｊ４ ＤＬｙＬｉａｉ
Ｓｗｊ、ｔＧＪＬＬｘｇ Ｂ＞ｉｔ＜ｍｆｅａ、Ｃ４
？Ｌｌａ、ａＪＬ ０ｆｆｅｒ、４ＮＲＡＸ ６１
Ｊの２．２ｃ）で述べられているように、伝送上必要
な（１） 極性変換、ＨＤＢｓ信号変換（２） ジ
、り吸収 （５） フレーム同期、シグナリング挿入、抽出 （４） アラームの検出、送出 （５）連続零信号抑圧 （６）送出信号等価 等の機能を有してお秒、複雑高価な装置である。また、
ＰＣＭ１次群３０チヤンネルと多重度が低いため、大容
量のユニットではユニット間のトラヒ、りが大キく、こ
のためユニ、ト間ＤＩＣおよびユニ、ト簡グープル本数
が多くな夛、スペースおよびコストの点で改良の余地が
ある。
Ｓｗｊ、ｔＧＪＬＬｘｇ Ｂ＞ｉｔ＜ｍｆｅａ、Ｃ４
？Ｌｌａ、ａＪＬ ０ｆｆｅｒ、４ＮＲＡＸ ６１
Ｊの２．２ｃ）で述べられているように、伝送上必要
な（１） 極性変換、ＨＤＢｓ信号変換（２） ジ
、り吸収 （５） フレーム同期、シグナリング挿入、抽出 （４） アラームの検出、送出 （５）連続零信号抑圧 （６）送出信号等価 等の機能を有してお秒、複雑高価な装置である。また、
ＰＣＭ１次群３０チヤンネルと多重度が低いため、大容
量のユニットではユニット間のトラヒ、りが大キく、こ
のためユニ、ト間ＤＩＣおよびユニ、ト簡グープル本数
が多くな夛、スペースおよびコストの点で改良の余地が
ある。
本発明の目的は、ソフトフェアインタフェースは従来の
ＤＩＣと同一で、ハードフェア的にはユニット間の接続
に必要な機能に限定した経済的なユニ、ト間ＤＩＣの構
成を提供することにある。
ＤＩＣと同一で、ハードフェア的にはユニット間の接続
に必要な機能に限定した経済的なユニ、ト間ＤＩＣの構
成を提供することにある。
本発明は上記目標を達成するため、音声用チャンネル用
とは別に、タイムスロｙ ） ０ （Ｔ ＳＯ）タイム
スロ、 ）１６（Ｔ８１ｄ ）用の信号線を設け、かつ
各ユニットに共通のクロ、りを分配することで回路構成
を簡略化し、更にマルチプレフナで多重度を上げること
によりハードフェア量を減し、総合的に経済化を図った
ものである。
とは別に、タイムスロｙ ） ０ （Ｔ ＳＯ）タイム
スロ、 ）１６（Ｔ８１ｄ ）用の信号線を設け、かつ
各ユニットに共通のクロ、りを分配することで回路構成
を簡略化し、更にマルチプレフナで多重度を上げること
によりハードフェア量を減し、総合的に経済化を図った
ものである。
以下本発明の実施例について詳細に説明する。
図は本発明によるユニット間ＤＩＣ’に実施したディジ
タル形電子交換機のユニット間接続の一部を示す図であ
る。
タル形電子交換機のユニット間接続の一部を示す図であ
る。
図において、１ａ、１４はディジタルスイッテングネ、
トワーク（ＮＷ）、 ２ａ、２４は中央処理装置（Ｃ
Ｐ）、 ３ａ、５４は本発明の実施例を示すユニット間
Ｄ Ｉ Ｃ，４ａ、４４は２．０４８Ｍｂ／ｓ ３２
タイムスロ。
トワーク（ＮＷ）、 ２ａ、２４は中央処理装置（Ｃ
Ｐ）、 ３ａ、５４は本発明の実施例を示すユニット間
Ｄ Ｉ Ｃ，４ａ、４４は２．０４８Ｍｂ／ｓ ３２
タイムスロ。
ト３０チャンネルの出ハイウェイ、５ａ、５４は２．０
４８Ｍｂ／ｓ ５２タイムスロ、トのＰＣＭ信号を８．
１９２Ｍｂ／ｓ １２８タイムスロツトのＰＣＭ信号に
４多重化するマルチプレフナ（ＭＰＸ）、６ａ、６４は
パリティ信号発生器（ＧＰ）、 ７ｃＬ、７４は送信シ
グナリングビット用バ、ファメモリ（ＳＳＭ）であって
、１２０チヤンネル、１６マルチフレ一ム分の容量を持
ツ。ａａ、ａ４はユニ、ト間ＤＩＣ内を制御するコント
ローラ（ＣＴＬ ）、９ａ、９４には８．１９２Ｍｂ１
８１２８タイムスロ、トのタイムスロット２．０４８Ｍ
ｂ／ｓ３２タイムスロ、トのＰＣＭ信号に落すデマルチ
プレフナ（ＤＭＰＸ）、１０ａ、１０４ハハリテイチエ
ツク回路（ＰＣＫ ）、１１４，１１４は受信シグナリ
ングビット用バッファメモリ（ＳＲ，Ｍ） １２ａ、１
２４は２．０４８ Ｍｂ／ｓ３２タイムスロット３０チ
ャンネルの入ハイクエイ、ｉ３ａ、１３Ｊ、１４−４，
１４Ｊはゲープルドライバ、１５ａ、１５４訛６ａ、１
６４はクープルレジパー、１７は２、０４８ Ｍｂ／ｓ
、 ８．１９２ Ｍｂ／ｓおよびフレームバｙｘ ｖ
各ユニットに分配するクロ、り分配装置である。
４８Ｍｂ／ｓ ５２タイムスロ、トのＰＣＭ信号を８．
１９２Ｍｂ／ｓ １２８タイムスロツトのＰＣＭ信号に
４多重化するマルチプレフナ（ＭＰＸ）、６ａ、６４は
パリティ信号発生器（ＧＰ）、 ７ｃＬ、７４は送信シ
グナリングビット用バ、ファメモリ（ＳＳＭ）であって
、１２０チヤンネル、１６マルチフレ一ム分の容量を持
ツ。ａａ、ａ４はユニ、ト間ＤＩＣ内を制御するコント
ローラ（ＣＴＬ ）、９ａ、９４には８．１９２Ｍｂ１
８１２８タイムスロ、トのタイムスロット２．０４８Ｍ
ｂ／ｓ３２タイムスロ、トのＰＣＭ信号に落すデマルチ
プレフナ（ＤＭＰＸ）、１０ａ、１０４ハハリテイチエ
ツク回路（ＰＣＫ ）、１１４，１１４は受信シグナリ
ングビット用バッファメモリ（ＳＲ，Ｍ） １２ａ、１
２４は２．０４８ Ｍｂ／ｓ３２タイムスロット３０チ
ャンネルの入ハイクエイ、ｉ３ａ、１３Ｊ、１４−４，
１４Ｊはゲープルドライバ、１５ａ、１５４訛６ａ、１
６４はクープルレジパー、１７は２、０４８ Ｍｂ／ｓ
、 ８．１９２ Ｍｂ／ｓおよびフレームバｙｘ ｖ
各ユニットに分配するクロ、り分配装置である。
次に本図を用いて動作を説明する。まずＮＷｌａ（１４
）からユニ、、ト間ＤＩＣＫ送られて来るＰＣＭ信号の
構成について説明する。出ハイウェイ４ａ（４Ｊ）のＰ
ＣＭ信号はＣＥＰＴ方式の１次群ＰＣＭ信号ニ相当ｆ
ル２．０４８ Ｍｂ／ｓ 、 ８ ｂｉ ｔ ｉ／リア
ル、３２タイムスロ、ト、音声３０チヤンネル、フレー
ム同期用１チヤンネル（タイムスロット０）、シグナリ
ング１チヤンネル（タイムスロット１６）から成る。シ
グナリング用チャンネルは１６フレームで１マルチフレ
ームが構成されている。
）からユニ、、ト間ＤＩＣＫ送られて来るＰＣＭ信号の
構成について説明する。出ハイウェイ４ａ（４Ｊ）のＰ
ＣＭ信号はＣＥＰＴ方式の１次群ＰＣＭ信号ニ相当ｆ
ル２．０４８ Ｍｂ／ｓ 、 ８ ｂｉ ｔ ｉ／リア
ル、３２タイムスロ、ト、音声３０チヤンネル、フレー
ム同期用１チヤンネル（タイムスロット０）、シグナリ
ング１チヤンネル（タイムスロット１６）から成る。シ
グナリング用チャンネルは１６フレームで１マルチフレ
ームが構成されている。
出ハイウｚ ４ａ （４４）からのＰＣＭ信号は、タイ
ムスロット０．タイムスロット１６は空チャンネルであ
り、挿入すべきシグナリングピットは別途ＣＰ２α（２
４）から受信し、従来のＤＩＣではＤＩＣ内でマルチフ
レームに組立て、タイムスロ、 ） ０．１６に挿入し
ていた。また従来ＤＩＣは相手側から受信したＰＣＭ信
号からタイムスロ、 ） ０．１＋５を分離抽出し、Ｃ
Ｐ２４（２旬に送出し、相互の接続動作を行なっていた
。
ムスロット０．タイムスロット１６は空チャンネルであ
り、挿入すべきシグナリングピットは別途ＣＰ２α（２
４）から受信し、従来のＤＩＣではＤＩＣ内でマルチフ
レームに組立て、タイムスロ、 ） ０．１６に挿入し
ていた。また従来ＤＩＣは相手側から受信したＰＣＭ信
号からタイムスロ、 ） ０．１＋５を分離抽出し、Ｃ
Ｐ２４（２旬に送出し、相互の接続動作を行なっていた
。
本発明においては、出ハイウェイ４ａ （４４）からの
２．０４８ Ｍｂ／ｓのＰＣＭ信号はＭ Ｐ Ｘ ５ｃ
Ｌ（５Ｊ ）で４ハイウェイ分多重化し、８．１９２Ｍ
ｂ１５．１２Ｂタイムスロツト、１２０チヤンネルに変
換後、ケーブルドライバ１３ａ経由相手側ユニットに送
出される。ここで同期チャンネル（タイムスロット０）
、シグナリングチャンネル（タイムクロ。
２．０４８ Ｍｂ／ｓのＰＣＭ信号はＭ Ｐ Ｘ ５ｃ
Ｌ（５Ｊ ）で４ハイウェイ分多重化し、８．１９２Ｍ
ｂ１５．１２Ｂタイムスロツト、１２０チヤンネルに変
換後、ケーブルドライバ１３ａ経由相手側ユニットに送
出される。ここで同期チャンネル（タイムスロット０）
、シグナリングチャンネル（タイムクロ。
ト１６）は送出されない。Ｐ Ｇ ６ａ （６４）は通
過する信号ビットのｇ ｏ Ｍ 、 ｔ１＆ｊ ｙ、：
計数し、パリティ信号を空タイムスロットであるタイム
ス口、ト０（あるいはタイムクロｙｌ’１６）に挿入す
る。
過する信号ビットのｇ ｏ Ｍ 、 ｔ１＆ｊ ｙ、：
計数し、パリティ信号を空タイムスロットであるタイム
ス口、ト０（あるいはタイムクロｙｌ’１６）に挿入す
る。
一方、ＣＰ２ａ（２４）から送られて来るシグナリング
ピットは、ＣＴＬ８ａ（８Ｊ）経由Ｓ Ｓ Ｍ ７ａ（
７４）のバッファメモリに一時蓄積され、音声チャンネ
ルと同−多Ｍ度に組上げ、ｃ’ｒ：ｃ、ａａ（ａ善）の
タイミングによりクープルドライバ１５ｔＬ（１５４）
経由相手側ユニットに送出される。
ピットは、ＣＴＬ８ａ（８Ｊ）経由Ｓ Ｓ Ｍ ７ａ（
７４）のバッファメモリに一時蓄積され、音声チャンネ
ルと同−多Ｍ度に組上げ、ｃ’ｒ：ｃ、ａａ（ａ善）の
タイミングによりクープルドライバ１５ｔＬ（１５４）
経由相手側ユニットに送出される。
次に受信側ユニットについて説明する。グープルレシー
バ−１５−１４（１５ａ）で受信したシグナリングビッ
トはＳ ＲＭ ＩＬ＃（Ｐｉｍ）バッファメモリに一時
蓄積した上％ ＣＰ ２Ｊ （２ａ）の信号フォーマッ
トに配列し、ソフトインタフェース上従来ＤＩＣと同一
パターンとしてＣＴ Ｌ ａ４（ｓａ）経由ｃｐ２４（
２ａ）に送出する。ＣＰ ２４（２６）はシグナリング
情報を判断し、次に必要な動作を行なう。即ちグープル
レシーバ１６４ （１６ａ）経由送られて来るＰＣＭ音
声チャンネルは、ＤＭＰＸ ９ｋ（ｒｐａ ）で２．０
４８ Ｍｂ／ｓのＰＣＭ信号に分解され、ＮＷｌＪ（１
ａ）に送出される。この音声チャンネルは前述シグナリ
ングビットの情報に応じて、パスの設定または解除され
るところは従来のＤＩＣと同様である。
バ−１５−１４（１５ａ）で受信したシグナリングビッ
トはＳ ＲＭ ＩＬ＃（Ｐｉｍ）バッファメモリに一時
蓄積した上％ ＣＰ ２Ｊ （２ａ）の信号フォーマッ
トに配列し、ソフトインタフェース上従来ＤＩＣと同一
パターンとしてＣＴ Ｌ ａ４（ｓａ）経由ｃｐ２４（
２ａ）に送出する。ＣＰ ２４（２６）はシグナリング
情報を判断し、次に必要な動作を行なう。即ちグープル
レシーバ１６４ （１６ａ）経由送られて来るＰＣＭ音
声チャンネルは、ＤＭＰＸ ９ｋ（ｒｐａ ）で２．０
４８ Ｍｂ／ｓのＰＣＭ信号に分解され、ＮＷｌＪ（１
ａ）に送出される。この音声チャンネルは前述シグナリ
ングビットの情報に応じて、パスの設定または解除され
るところは従来のＤＩＣと同様である。
なお、Ｐ ＣＫ １０Ｊ（１０ａ） Ｋ受信信号のパジ
テイをチェ、りし、パリティエラーを検出した場合、Ｃ
Ｔ Ｌ ８４ （８’）経由Ｃｐ ２４（２ｅＬ） Ｋ
通知し、ユニ。
テイをチェ、りし、パリティエラーを検出した場合、Ｃ
Ｔ Ｌ ８４ （８’）経由Ｃｐ ２４（２ｅＬ） Ｋ
通知し、ユニ。
ト間ＤＩＣの閉塞や切替時の処理を行なう。
本発明によれば、ソフトウェアな変更することなく、次
の効果ｔ％ることか出来る。
の効果ｔ％ることか出来る。
シグナリング用線な設けることにより、前述した従来Ｄ
ＩＣの必ｌ！機能である（５）Ｍ号挿入・抽出回路が不
要になる。
ＩＣの必ｌ！機能である（５）Ｍ号挿入・抽出回路が不
要になる。
また各ユニットは共通り口、りで同期動作していること
から、（３）フレーム同期、（２）ジッタ吸収回路が不
要になる。
から、（３）フレーム同期、（２）ジッタ吸収回路が不
要になる。
更に同一局舎内のユニ、ト間用に限定することで、（１
）極性変換、ＨＤＢ３信号変換、（５）連続零信号抑圧
、（６）送出信号等価、等の機能も削除可能であり、非
常に簡単な回路構成となる。
）極性変換、ＨＤＢ３信号変換、（５）連続零信号抑圧
、（６）送出信号等価、等の機能も削除可能であり、非
常に簡単な回路構成となる。
また音声信号とシグナリング信号を分離したことで、単
純に多重化することが可能となり、ケーブル数の削減と
併せて、大幅な小形化、経済化に効果がある。
純に多重化することが可能となり、ケーブル数の削減と
併せて、大幅な小形化、経済化に効果がある。
図は本発明によるユニ、ト間ＤＩＣの一実施例を示す構
成図である。 ２ａ、２ｋ・・・中央処理装置（ＣＰ）、４ａ、ａ＋・
・・出ハイワエイ、 ５ａ 、５４＝−マＡ／テプレク？（ＭＰＸ）、６ｃＬ
、 ６４・・・パリティ信号発生器（ＰＧ）、ａｎ、ａ
＋・・・コントローラ（ＣＴＬ）、１２α、１２ｋ・・
・入ハイウェイ、 １７・・・クロ、り分配装置。
成図である。 ２ａ、２ｋ・・・中央処理装置（ＣＰ）、４ａ、ａ＋・
・・出ハイワエイ、 ５ａ 、５４＝−マＡ／テプレク？（ＭＰＸ）、６ｃＬ
、 ６４・・・パリティ信号発生器（ＰＧ）、ａｎ、ａ
＋・・・コントローラ（ＣＴＬ）、１２α、１２ｋ・・
・入ハイウェイ、 １７・・・クロ、り分配装置。
Claims (1)
- １、複数のディジタル形電子交換機間を複式に組む謂る
マルチユニット方式におけるユニット間ディジタルトラ
ンクにおいて、音声チャンネル用と別にシグナリングチ
ャンネル線と、該シグナリングチャンネル線の受信側に
バッファメモリと変換回路を設け、送信側から送られて
来るシグナリング信号を該バッファメモリに蓄積して変
換し、受信側で該音声チャンネルを対応させることを特
徴とするユニット間ディジタルトランク。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13178885A JPS61290897A (ja) | 1985-06-19 | 1985-06-19 | ユニツト間デイジタルトランク |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13178885A JPS61290897A (ja) | 1985-06-19 | 1985-06-19 | ユニツト間デイジタルトランク |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61290897A true JPS61290897A (ja) | 1986-12-20 |
Family
ID=15066148
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13178885A Pending JPS61290897A (ja) | 1985-06-19 | 1985-06-19 | ユニツト間デイジタルトランク |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61290897A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03136444A (ja) * | 1988-12-24 | 1991-06-11 | Electron & Telecommun Res Inst | 異種信号変換方法及び装置 |
-
1985
- 1985-06-19 JP JP13178885A patent/JPS61290897A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03136444A (ja) * | 1988-12-24 | 1991-06-11 | Electron & Telecommun Res Inst | 異種信号変換方法及び装置 |
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