JPS61259273A - Electronic counter controlling system for copying machine - Google Patents

Electronic counter controlling system for copying machine

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Publication number
JPS61259273A
JPS61259273A JP60100455A JP10045585A JPS61259273A JP S61259273 A JPS61259273 A JP S61259273A JP 60100455 A JP60100455 A JP 60100455A JP 10045585 A JP10045585 A JP 10045585A JP S61259273 A JPS61259273 A JP S61259273A
Authority
JP
Japan
Prior art keywords
signal
counter
copying machine
switch
copying
Prior art date
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Pending
Application number
JP60100455A
Other languages
Japanese (ja)
Inventor
Nachio Seko
世古 名知夫
Yoshiaki Haniyu
羽生 嘉昭
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
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Filing date
Publication date
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Priority to JP60100455A priority Critical patent/JPS61259273A/en
Publication of JPS61259273A publication Critical patent/JPS61259273A/en
Pending legal-status Critical Current

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    • GPHYSICS
    • G03PHOTOGRAPHY; CINEMATOGRAPHY; ANALOGOUS TECHNIQUES USING WAVES OTHER THAN OPTICAL WAVES; ELECTROGRAPHY; HOLOGRAPHY
    • G03GELECTROGRAPHY; ELECTROPHOTOGRAPHY; MAGNETOGRAPHY
    • G03G21/00Arrangements not provided for by groups G03G13/00 - G03G19/00, e.g. cleaning, elimination of residual charge
    • G03G21/02Counting the number of copies; Billing

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  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Counters In Electrophotography And Two-Sided Copying (AREA)
  • Control Or Security For Electrophotography (AREA)

Abstract

PURPOSE:To prevent stepping due to the malfunction of a counter not accompanied with copying by processing an answer signal corresponding to a stepping signal at every copying machine and returning to the copying machine side and starting the control of copying basing on the answer signal. CONSTITUTION:The mu CPU 152 of a copying machine outputs a count up signal CO from a connector and inputs the answer signal AK and the values of the two signals at specified timing t0, t1, t2, t3 are judged by the mu CPU 152. When the signals CO, AK are correlated as shown in the figure, it is judges as normal as the specified number of answer signals are outputted at the delay of fixed time to the counter signal and a main relay RA is held in the state of on and a counter stepping signal CO is held for a fixed time. On the other hand, when the two signals are not outputted, it is judged as abnormal and the relay RA is made off and a relay switch SR is made off to make copying impossible and at the same time, the signal CO is dropped. Then, the signal CO is checked and 1 is added to the counter and it is judged that the initial set value becomes from negative to zero.

Description

【発明の詳細な説明】 (技術分野) 本発明は複写機の電子カウンタ制御方式に関する。[Detailed description of the invention] (Technical field) The present invention relates to an electronic counter control system for a copying machine.

(従来技術) 複写機をレンタル又はリースで使用する場合はもとより
、買い取って使用する場合でも、保守サービス料金を支
払う方式が取られている。したがって、課金の対象にな
るので、カウンタの動作が重要な要素であり、不正使用
を防止する必要がある。
(Prior Art) Maintenance service fees are paid not only when copying machines are rented or leased, but also when purchased. Therefore, since it is subject to billing, the operation of the counter is an important factor, and it is necessary to prevent unauthorized use.

従来は、電磁カウンタのコイルにリードスイッチを巻き
込んだり、接近して設置して、通電でコイルが励磁され
るとスイッチが作動するようにしていた。そして、その
スイッチ信号を複写機の制御μcpuに導いて、カウン
タを駆動する直前にスイッチがoffになっているタイ
ミングと駆動後の電源を切る直前にスイッチがonのタ
イミングをチェックすることでカウンタが接続され、正
常に動作している事を判定している。
Conventionally, a reed switch was wound around the coil of an electromagnetic counter or placed close to it, so that when the coil was energized by electricity, the switch was activated. Then, the switch signal is guided to the control μCPU of the copying machine, and the counter is activated by checking the timing at which the switch is turned off immediately before driving the counter, and the timing at which the switch is turned on immediately before turning off the power after driving. It has been determined that it is connected and operating normally.

その接続図を第10図に示す。カウンタ1はcpUのl
10(例えばI10用LS I 8255 )の出力を
受けたトランジスタ2で動作させる。そして、前記スイ
ッチ3はカウンタ1のコイルで励磁され、cpullo
の入力4に接続されており、このスイッチ3の動作状態
を前記タイミングでチェックして複写機の動作又は停止
を制御している。
The connection diagram is shown in FIG. Counter 1 is l of cpU
10 (for example, LSI 8255 for I10). Then, the switch 3 is excited by the coil of the counter 1, and the cpullo
The operating state of this switch 3 is checked at the timing mentioned above to control the operation or stop of the copying machine.

しかしながらこの様な従来例においては図でカウンタ1
.スイッチ3を取り除き、トランジスタ2の負荷抵抗R
1、スイッチ3の信号の代わりに抵抗R2およびR3で
カウンタの駆動電圧24Vをスイッチ信号レベル5vに
分圧して人力4に与えると、カウンタ1はなくても複写
機は動作でき、カウンタは歩進させなくて不正使用がで
きる。
However, in such a conventional example, counter 1 in the figure
.. Remove switch 3 and reduce the load resistance R of transistor 2
1. If, instead of the signal from switch 3, the counter drive voltage 24V is divided to a switch signal level of 5V using resistors R2 and R3 and applied to human power 4, the copying machine can operate even without counter 1, and the counter will continue to step. Unauthorized use is possible without permission.

また、この方式はプリントボタンを押すことによってカ
ウンタに電圧を印加すれば、何らかの故障によりカウン
タからのアンサ−信号が本体側に戻って来なくてもカウ
ンタが歩進してしまうという不具合があった。
Another problem with this method was that if voltage was applied to the counter by pressing the print button, the counter would increment even if the answer signal from the counter did not return to the main unit due to some kind of malfunction. .

さらにこの種のカウンタでゼロに戻るエンドレスカウン
タであると、カウンタだけをカウントさせゼロにもどせ
るため正確なカウントができない。
Furthermore, if this type of counter is an endless counter that returns to zero, accurate counting cannot be performed because only the counter counts and returns to zero.

又、不正使用もできる。It can also be used illegally.

一方、カウントする時間は複写機のコピー動作時のみで
あるため、電池バックアップの電子式カウンタでは非動
作時でも動作させていると電池の消耗が大きく電池の寿
命が短かくなるという欠点があった。
On the other hand, since the time is counted only when the copier is copying, electronic counters with battery backup have the disadvantage that if they are kept running even when the copier is not in operation, the battery will be consumed significantly and the battery life will be shortened. .

(目 的) 本発明は、この様な従来例の欠点を解消し、電子式カウ
ンタの複写機本体への接続及び動作チェックの確認を行
なうことが出来る複写機の電子式カウンタ制御方式を提
供することを目的とする。
(Objective) The present invention eliminates the drawbacks of the conventional example and provides an electronic counter control method for a copying machine that can connect the electronic counter to the copying machine main body and check its operation. The purpose is to

(構 成) そのために本発明は歩進信号と対応したアンサ−信号を
そのまま対応した形でなく、複写機毎に加工して複写機
側に戻し、このアンサ−信号に基づいて複写制御を開始
するようにしたことを特徴とするものである。
(Structure) For this purpose, the present invention processes the answer signal corresponding to the step signal and returns it to the copying machine for each copying machine, rather than in a form that corresponds to it as is, and starts copying control based on this answer signal. It is characterized by the fact that it is made to do so.

以下本発明の一実施例を図面に基づき説明する。An embodiment of the present invention will be described below based on the drawings.

第1図は、この発明の電子式コピーカウンタの斜視略図
であり、第2図は、そのブロック図である。
FIG. 1 is a schematic perspective view of an electronic copy counter of the present invention, and FIG. 2 is a block diagram thereof.

記号12はこのカウンタの制御・カウントデータなどを
保持するワンチップのμcpuである。例えば、NEC
のμPD7501Gが適している。μCpui2は、液
晶数字表示器13(以下LCD)を直接ドライブできる
セグメント出力24本、コモン出力4本、及び24人出
力ライン、第4図のフローの制御プログラムを格納した
ROM、カウンタや動作フラグなどのRAMから構成さ
れている、周知のCMOSワンチップμcpuである。
Symbol 12 is a one-chip μCPU that controls this counter and holds count data. For example, NEC
μPD7501G is suitable. The μCpui2 has 24 segment outputs that can directly drive the liquid crystal numeric display 13 (hereinafter referred to as LCD), 4 common outputs, 24 individual output lines, a ROM that stores the control program for the flow shown in Figure 4, counters, operation flags, etc. This is a well-known CMOS one-chip μCPU consisting of RAM.

LCD13は、μcpu12のセグメント出力SO〜S
23、コモン出力C0M0〜2に接続されており、周知
のダイナミック点灯方式で、そのタイミングパルスは発
振回路14で発生している。μcpu12の出力端子P
60からの制御線15はLCD13が消えているとき、
発振回路14を停止させる様制御され、電池16の消費
を軽減している。
The LCD 13 has segment outputs SO to S of the μcpu 12.
23, is connected to the common outputs C0M0 to C0M2, and the timing pulse is generated by the oscillation circuit 14 using a well-known dynamic lighting method. Output terminal P of μcpu12
When the LCD 13 is off, the control line 15 from 60
The oscillation circuit 14 is controlled to be stopped, reducing the consumption of the battery 16.

電池16は、このカウンタ10のデータを保持するため
と全回路を駆動するための電源であって、リチューム電
池が適している。実験によると後述する#cpu12の
スタンバイモードで3V150mAhで約5年間機能を
維持できる。
The battery 16 is a power source for holding the data of the counter 10 and driving all the circuits, and a lithium battery is suitable. According to experiments, it can maintain functionality for about 5 years with 3V 150mAh in standby mode of #cpu12, which will be described later.

スイッチ17は、カウンタのアンサ−信号の条件を設定
するスイッチであり、μcpu12の入力端子P40〜
P43に接続されており、各スイッチはプルアップ抵抗
でLowレベルがアクティブになっており、複写機の機
種ごとにスイッチの組み合ゎせでチェック用のアンサ−
信号の数、長さなどの条件を設定する。複写機に実装時
にはカバーで封印されている構造になっている。
The switch 17 is a switch for setting the conditions of the answer signal of the counter, and is a switch for setting the conditions of the answer signal of the counter.
Each switch is connected to P43, and each switch has a pull-up resistor that is active at the low level, and depending on the copier model, you can check the answer by combining the switches.
Set conditions such as number of signals and length. The structure is such that it is sealed with a cover when installed in a copying machine.

スイッチ18は、LCD13を必要な時のみ表示させる
ための表示スイッチであり、このスイッチが作動すると
LCD13は30秒間表示されている。このスイッチは
μcpu12の入力端子pHに接続されており、プルア
ップ抵抗でLowレベルがアクティブになっている。
The switch 18 is a display switch for displaying the LCD 13 only when necessary, and when this switch is activated, the LCD 13 is displayed for 30 seconds. This switch is connected to the input terminal pH of the μCPU 12, and a pull-up resistor makes the Low level active.

スイッチ19は、単一リセット用のスイッチであって、
通常複写機のコピーカウンタは納入時ゼロ、マイナス3
000〜5000の値に設定にセットされている。レン
タル契約や保守サービス契約が有効になるのはカウンタ
の指示値がゼロからで、契約成立時にゼロにするために
単一リセット機能が必要になる。すなわち、最上位桁が
9から0に代わったとき、μcpu12のRAMにスイ
ッチを無効にするフラグを格納し、そのフラグをチェッ
クしてスイッチ19の機能を有効又は無効にしである。
The switch 19 is a single reset switch,
Normally, the copy counter of a copier is zero at the time of delivery, minus 3.
It is set to a value between 000 and 5000. A rental contract or maintenance service contract becomes valid when the indicated value of the counter starts from zero, and a single reset function is required to set it to zero when the contract is established. That is, when the most significant digit changes from 9 to 0, a flag for disabling the switch is stored in the RAM of the μcpu 12, and the function of the switch 19 is enabled or disabled by checking the flag.

スイッチ19はμCpu12の入力端子P12に接続さ
れており、プルアップ抵抗でLowレベルがアクティブ
になっている。
The switch 19 is connected to the input terminal P12 of the μCpu 12, and has a pull-up resistor whose low level is active.

フォトカプラー20は、PPC(普通紙複写機)からの
カウントアツプ信号を受は取るインタフェース回路でP
PCとは電気的に絶縁されている。
The photocoupler 20 is an interface circuit that receives and takes count-up signals from a PPC (plain paper copying machine).
It is electrically isolated from the PC.

PPCからの信号でLED2OAを点灯させ、その光で
フォトトランジスタ20Bをスイッチングさせこの出力
をμcpu12の入力端子P50にとり込み、カウント
アツプ信号としている。
The LED 2OA is turned on by a signal from the PPC, the phototransistor 20B is switched by the light, and this output is taken into the input terminal P50 of the μCPU 12, and is used as a count-up signal.

フォトカブラ21は、前記カウントアツプ信号を検出し
てPPCへ送り返えすアンサーバック信号のインタフェ
ースであり、μcpu12の出力端子P30からの出力
信号でトランジスタ22をドライブしてLED21Aを
点灯し、フォトトランジスタ21Bを介してPPCへ供
給している。このインタフェース回路もPPCとは電気
的に絶縁されている。
The photocoupler 21 is an interface for an answerback signal that detects the count-up signal and sends it back to the PPC, and drives the transistor 22 with the output signal from the output terminal P30 of the μCPU 12 to light up the LED 21A, and the phototransistor 21B. It is supplied to PPC via. This interface circuit is also electrically isolated from the PPC.

これらの信号はコネクター23とでPPCと接続されて
いる。
These signals are connected to the PPC via a connector 23.

スタンバイモードは、μcpu12の内部の機能を停止
して電力の消費を節約している0例えば、NECのμP
D7501Gでは5TOP命令を実行するとスタンバイ
モードになり、割り込み端子に信号を印加することでス
タンバイモードが解除し、μcpu12は活性化する。
Standby mode stops the internal functions of the μCPU 12 to save power consumption. For example, NEC's μP
In the D7501G, when the 5TOP instruction is executed, the standby mode is entered, and by applying a signal to the interrupt terminal, the standby mode is canceled and the μCPU 12 is activated.

スタンバイモードの解除には第2図の回路に接続されて
いるカウント信号A9表示5W18の作動信号B、単一
リセット5W19の作動信号Cのいずれかが作動してN
ANDゲート26の入力がり、owレベルになると、N
ANDゲートの出力がH1ghレベルになり、μCpu
12のスタンバイモード解除用の割り込み端子INTO
がアクティブになって解除している。
To cancel the standby mode, either the count signal A9 display 5W18 activation signal B or the single reset 5W19 activation signal C connected to the circuit shown in Figure 2 is activated.
When the input of the AND gate 26 becomes OW level, N
The output of the AND gate becomes H1gh level, and the μCpu
12 interrupt pin INTO for canceling standby mode
is activated and released.

次にこのカウンタ10の動作を第3図〜第6図のフロー
で説明する。
Next, the operation of this counter 10 will be explained using the flows shown in FIGS. 3 to 6.

ステップ100: このカウンタに電池16の電源を印加したときだけ実行
する初期設定ルーチンである。
Step 100: This is an initial setting routine that is executed only when power from the battery 16 is applied to this counter.

このルーチンは一回だけ実行するルーチンであり、その
内容は ■ μcpu12のRAMの内容カウンタ、フラグ類を
リセットする。
This routine is executed only once, and its contents are as follows: (1) Resets the RAM contents counter and flags of the μCPU 12;

■ 表示を消したり、I10ボートの入出力設定等の各
入出力設定条件を初期条件に設定する。
■ Turn off the display and set each input/output setting condition, such as the input/output setting of the I10 boat, to the initial condition.

ステップ101: 電池16の消耗を最小限にするためにμcpu12を各
動作の実行後にスタンバイモードに設定するルーチンで
ある。
Step 101: This is a routine for setting the μCPU 12 to standby mode after each operation in order to minimize consumption of the battery 16.

その実行は5TOP命令などのスタンバイモードの命令
による。
Its execution is based on standby mode instructions such as the 5TOP instruction.

実施例の、crcpu12のtt P D7501Gは
5TOP命令を実行するとスタンバイモードになる。
In the embodiment, the ttPD7501G of crcpu12 enters standby mode when the 5TOP instruction is executed.

その解除は次の各外部信号がアクティブのときである。It is released when each of the following external signals is active.

■ 表示スイッチ18が押された時、 ステップ102 ■ 単一リセットスイッチ19か押された時、ステップ
103 ■ 複写機からカウンタアップ信号(CO)200がき
た時          ステップ104ステップ10
2: 表示スイッチ18が押されると第2図の回路図に示すよ
うに、接続されているNANDゲート26の入力C点の
電位がLowレベルになり、出力がH1ghレベルにな
って接続されているμcpu12のスタンバイモード解
除用の割り込み入力がアクティブになるため、スタンバ
イモードが解除される。
■ When the display switch 18 is pressed, Step 102 ■ When the single reset switch 19 is pressed, Step 103 ■ When the counter up signal (CO) 200 is received from the copying machine Step 104 Step 10
2: When the display switch 18 is pressed, the potential at the input point C of the connected NAND gate 26 becomes Low level, and the output becomes H1gh level, as shown in the circuit diagram of FIG. Since the interrupt input for canceling the standby mode of μCPU 12 becomes active, the standby mode is canceled.

そして表示処理ルーチンのステップ105に進む。The process then proceeds to step 105 of the display processing routine.

ステップ103: 単一リセットスイッチ19が押されると第2図の回路図
に示すように、接続されているNANDゲート26の入
力B点の電位がLowレベルになり、出力がH4ghレ
ベルになって接続されているμcpu12のスタンバイ
モード解除用の割り込み入力がアクティブになるため、
スタンバイモードが解除される。
Step 103: When the single reset switch 19 is pressed, as shown in the circuit diagram of FIG. 2, the potential at the input point B of the connected NAND gate 26 becomes Low level, the output becomes H4gh level, and the connection is established. The interrupt input for canceling the standby mode of μCPU12 becomes active.
Standby mode is canceled.

そして単一リセット処理ルーチンのステップ106に進
む。
The process then proceeds to step 106 of the single reset processing routine.

ステップ104: 複写機からカウント信号(CO)200が第2図の回路
図に示すように、コネクタ23を介してフオトカプラ−
20Aを点灯するように印加され、フォトトランジスタ
20BがOnし、接続されているNANDゲート26の
入力A点の電位がLowレベルになり、出力がHigh
レベルになると接続されているμC1)u12のスタン
バイモード解除用の割り込み入力がアクティブになって
、スタンバイモードが解除される。
Step 104: The count signal (CO) 200 from the copying machine is sent to the photocoupler via the connector 23 as shown in the circuit diagram of FIG.
20A is applied to turn on the phototransistor 20B, the potential at the input point A of the connected NAND gate 26 becomes Low level, and the output becomes High.
When the level is reached, the interrupt input for canceling the standby mode of the connected μC1)u12 becomes active, and the standby mode is canceled.

そしてアンサーバック・カウントアツプ処理ルーチンの
ステップ107に進む。
The process then proceeds to step 107 of the answerback countup processing routine.

ステップ105: 表示処理ルーチンであり、その動作フローは第4図に示
す。
Step 105: Display processing routine, the operation flow of which is shown in FIG.

表示スイッチ1日が押されるとステップ102でスタン
バイモードが解除され、μcpu12の内蔵タイマーで
表示時間30秒をセット・スタートさせる(ステップ1
05A) 。
When the display switch 1 day is pressed, the standby mode is canceled in step 102, and a display time of 30 seconds is set and started using the built-in timer of the μCPU 12 (step 1).
05A).

制御線15をHighレベルに出力して表示タイミング
パルスの発振回路14の発振を開始する(ステップ10
5B)。
The control line 15 is output to High level to start the oscillation of the display timing pulse oscillation circuit 14 (step 10).
5B).

μcpu12のRAMに格納しであるカウンタのデータ
をLCD13に出力し、表示する(ステップ105C)
 。
The counter data stored in the RAM of the μcpu 12 is output to the LCD 13 and displayed (step 105C).
.

表示中にカウントアツプ信号が到来するとカウントでき
ないのでそれをチェックする(ステップ105D) 。
If a count-up signal arrives during display, it will not be possible to count, so this is checked (step 105D).

つぎに、30秒タイマーのオバータイムをチェックして
(ステップ105E) 、タイムオバーでなければ表示
を続けるが、タイムオバーであればLCD13(7)表
示ヲ消シ(ステップ105F)、制?IIvA15をL
owレベルに出力して表示タイミングパルスの発振回路
14を停止させる(ステップ105G) 。
Next, the overtime of the 30 second timer is checked (step 105E), and if the timer is not over, the display continues, but if the timer is over, the display on the LCD 13 (7) is erased (step 105F). IIvA15 to L
It outputs to OW level and stops the display timing pulse oscillation circuit 14 (step 105G).

スタンバイモード(ステップ102)に戻り待機モード
になる。
The process returns to standby mode (step 102) and enters standby mode.

ステップ106: 単一リセット処理ルーチンであり、その動作フローは第
5図に示す。
Step 106: Single reset processing routine, the operation flow of which is shown in FIG.

単一リセットスイッチ19が押されるとステップ102
でスタンバイモードが解除され、ステップ10フルーチ
ンでカウントアツプ毎にカウンタの内容がゼロかを判定
して(ステップ107G) 、ゼロになったら単一リセ
ットの機能を無効にするフラグをμcpu12のRAM
にセットする(ステップ107H)ので、まずこのフラ
グのセットの有無をチェックする(ステップ106A)
 。
When the single reset switch 19 is pressed, step 102
The standby mode is released, and in the step 10 full routine, it is determined whether the counter contents are zero at each count up (step 107G), and when it becomes zero, a flag to disable the single reset function is stored in the RAM of the μcpu 12.
(Step 107H), so first check whether this flag is set (Step 106A).
.

そしてセットされてなければセットしてカウンタをリセ
ットする(ステップ106B)、当然セットされていれ
ばこの単一リセットの機能は無効であるからステップ1
02に進む。
If it is not set, set it and reset the counter (step 106B).Of course, if it is set, this single reset function is invalid, so step 1
Proceed to 02.

ステップ107: アンサーバック・カウントアツプ処理ルーチンであり、
その動作フローは第6図に示す。
Step 107: Answer back count up processing routine,
The operation flow is shown in FIG.

第7図の複写機からのカウントアツプ信号(CO)20
0がコネクタ23に来ると、第2図のインタフェース回
路20を介してμcpu12はカウント信号を検知する
Count-up signal (CO) 20 from the copying machine in Figure 7
When 0 comes to the connector 23, the μCPU 12 detects the count signal via the interface circuit 20 of FIG.

μcpu12はまずカウンタがオーバーフロー(7桁の
カウンタでは9,999,999を意味する。)してな
いかをチェックする(ステップ107A)、カウンタが
オーバーフローしていれば9,999,999の表示を
一定時間点滅させアンサ−信号を出力しないで終了する
(ステップ107B、 107C)。
The μcpu 12 first checks to see if the counter has overflowed (meaning 9,999,999 for a 7-digit counter) (step 107A). If the counter has overflowed, it keeps the display constant at 9,999,999. The process ends without outputting an answer signal by blinking the time (steps 107B and 107C).

カウンタがオーバーフローしてなければ、ステップ10
7Dへ進み第7図のアンサ−信号(A K)201をμ
cpu12は複写機へ、第2図のインタフェース回路2
1を介して出力する。
If the counter does not overflow, step 10
Proceed to 7D and send the answer signal (AK) 201 in Figure 7 to μ.
The CPU 12 connects to the copying machine, interface circuit 2 in Figure 2.
Output via 1.

実施例では、第7図(a)、 (b)に示すように複写
機からのカウントアツプ信号(Go)200は100m
5で、アンサ−信号(AK)201はlQmsのパルス
を2個あるいは4個出力する。尚、Tはカウントアツプ
タイミングを示す。
In the embodiment, as shown in FIGS. 7(a) and 7(b), the count-up signal (Go) 200 from the copying machine is 100 m.
At step 5, the answer signal (AK) 201 outputs two or four pulses of lQms. Note that T indicates the count-up timing.

即ちカウントアツプ信号(カウンタ歩進信号)に対して
アンサ−信号を機械毎に加工して出力する。
That is, an answer signal is processed and outputted for each machine in response to a count-up signal (counter step signal).

第8図は複写機の動作、不動作を制御する電源回路の実
施例である。
FIG. 8 shows an embodiment of a power supply circuit for controlling operation and non-operation of a copying machine.

AClooVの商用電源から電源スィッチを介して制御
用電源回路150に、さらにリレースイッチ(接点)S
Rを介して駆動用電源回路151に給電される。
The commercial power supply of AClooV is connected to the control power supply circuit 150 via the power switch, and then the relay switch (contact) S
Power is supplied to the driving power supply circuit 151 via R.

制御用電源回路150はμcpu152や各種センサ等
にDCt61を供給し、一方駆動用電源回路151は感
光体ドラム等の駆動モータ153.露光用ハロゲンラン
プ154.定着装置155のヒータ等々にAC電源を供
給する。
The control power supply circuit 150 supplies DCt61 to the μCPU 152, various sensors, etc., while the drive power supply circuit 151 supplies the drive motor 153 . Exposure halogen lamp 154. AC power is supplied to the heater of the fixing device 155, etc.

メインリレーRAはμcpu152によって制御される
。その通電が解除されるとリレースイッチSRをoff
にして駆動電源回路151への通電を断ち、複写機をコ
ピー不能状態にする。
Main relay RA is controlled by μcpu152. When the energization is released, turn off the relay switch SR.
Then, the power to the drive power supply circuit 151 is cut off, and the copying machine becomes in a state in which copying is disabled.

複写機の/jc p u152は第2図のコネクタ23
よりカウントアツプ信号COを出力し、アンサ−信号A
Kを入力させ、μcpu152により第7図(a)。
The /jc p u152 of the copying machine is connected to the connector 23 in Figure 2.
outputs the count-up signal CO, and outputs the answer signal A.
7(a) by inputting K and using the μcpu 152.

伽)におけるi+1 r  tI +jl +j3のタ
イミングにおける両信号の値を判定させ、両信号Co、
AKが第9図に示す対応図に示すように出ていれば、カ
ウンタ信号に対してアンサ−信号が30m5の遅れで所
定の個数出ているということで正常であると判定しメイ
ンリレーRAをOnのまま保持する、と共にカウンタ歩
進信号200を第7図の実線の時間維持する。
The values of both signals at the timing of i+1 r tI +jl +j3 in (G) are determined, and both signals Co,
If AK is output as shown in the correspondence diagram shown in Fig. 9, the answer signal is output in a predetermined number with a delay of 30m5 with respect to the counter signal, so it is determined to be normal and main relay RA is activated. It remains on, and the counter step signal 200 is maintained for the time indicated by the solid line in FIG.

両信号Co、AKが第9図(a)、 (b)に示すよう
に出ていない場合には、異常であると判定しメインリレ
ーRAをoffにしてリレースイッチSRをoffL、
コピー不能状態にすると共にカウントアツプ信号(Co
)200を第7図の点線のようにすぐおとす。
If both signals Co and AK are not output as shown in Fig. 9(a) and (b), it is determined that there is an abnormality, and the main relay RA is turned off and the relay switch SR is turned offL,
Make copy impossible and set count up signal (Co
) 200 immediately as shown by the dotted line in Figure 7.

ステップ107Dでカウントアツプ信号をチェックして
カウンタを1つ加算しくステップ107 E )、初期
設定値のマイナスからゼロになったかをステップ107
Gで判定して単一リセットフラグをセットする。
In step 107D, check the count up signal and increment the counter by one (step 107E), and check in step 107 whether the initial set value has gone from minus to zero.
Make a determination with G and set the single reset flag.

そしてステップ102にもどって待機する。Then, the process returns to step 102 and waits.

このチェックプログラムは複写機の制御μcpu152
に格納されている。
This check program is the control μCPU 152 of the copying machine.
is stored in.

(効 果) 本発明は以上述べた通りのものであり、本発明によれば
カウンタの不正使用を防止出来、またユーザ側から見て
不利益をこうむる、複写をともなわないカウンタの誤動
作による歩進を防止することが出来る。
(Effects) The present invention is as described above, and according to the present invention, it is possible to prevent unauthorized use of the counter, and to prevent the counter from malfunctioning without copying, which would be disadvantageous from the user's point of view. can be prevented.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明に係る電子式カウンタの外観斜視図、第
2図は同、ブロック図、第3図、第4図。 第5図、第6図はその制御動作を示すフローチャート、
第7図(a)、 (b)はカウントアツプ信号とアンサ
−信号のタイミングチャート、第8図は複写機の電源回
路図、第9図(δl、(b)は第7図(a)、 (b)
の各信号と所定タイミング時の信号の対応状態を示す図
、第10図は従来例に係るカウンタの回路図である。 10・・・電子式カウンタ、12・・・カウンタ用μC
pu。 152・・・複写機用μcpu。 第1図 究7図 (b) jo  11   Z2L3T 第8図 第9図 (Q) (b)
FIG. 1 is an external perspective view of an electronic counter according to the present invention, FIG. 2 is a block diagram thereof, and FIGS. 3 and 4. 5 and 6 are flowcharts showing the control operation,
Figures 7(a) and (b) are timing charts of the count-up signal and answer signal, Figure 8 is the copying machine power supply circuit diagram, Figure 9 (δl, (b) is Figure 7(a), (b)
FIG. 10 is a circuit diagram of a conventional counter. 10...Electronic counter, 12...μC for counter
pu. 152...μcpu for copying machine. Figure 1 Study Figure 7 (b) jo 11 Z2L3T Figure 8 Figure 9 (Q) (b)

Claims (1)

【特許請求の範囲】[Claims] μcpuで制御され、総コピー枚数を表示するための電
子式カウンタを備えた複写機において、本体側からのカ
ウンタ歩進信号を受けてカウンタ側からこのカウンタ歩
進信号を加工したアンサー信号を複写機毎に異ならせて
出力するようにしたことを特徴とする複写機の電子式カ
ウンタ制御方式。
In a copying machine controlled by a μCPU and equipped with an electronic counter for displaying the total number of copies, the copying machine receives a counter increment signal from the main unit and processes an answer signal from the counter side. An electronic counter control system for a copying machine, characterized in that the output is different for each copying machine.
JP60100455A 1985-05-14 1985-05-14 Electronic counter controlling system for copying machine Pending JPS61259273A (en)

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