JPS6125655U - 関数発生回路 - Google Patents

関数発生回路

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Publication number
JPS6125655U
JPS6125655U JP10637684U JP10637684U JPS6125655U JP S6125655 U JPS6125655 U JP S6125655U JP 10637684 U JP10637684 U JP 10637684U JP 10637684 U JP10637684 U JP 10637684U JP S6125655 U JPS6125655 U JP S6125655U
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JP
Japan
Prior art keywords
resistor
input terminal
inverting input
series
operational amplifier
Prior art date
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Pending
Application number
JP10637684U
Other languages
English (en)
Inventor
靖博 荒井
伸次 萩原
Original Assignee
富士電機株式会社
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Publication date
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Publication of JPS6125655U publication Critical patent/JPS6125655U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例を示す回路図、第２図イ，口
，ハはそれそれ第１図に示した実施例の動作状態を示す
説明図、第３図イ，口，ハは増幅度を少し低下させたと
きの第２図イ，口，八に対応する説明図、第４図は本考
案に係る関数発生回路を上下限警報回路に応用した応用
例を示す回路図、第５図は第４図の回路の動作説明図、
第６図は従来の関数発生回路を示す回路図、第７図は第
６図の回路の動作状態を示す説明区、である。 符号説明、ＯＰ１，ＯＰ２・・・・・・コンバレータ（
演算増幅器）、Ｄ１．Ｄ２・・・・・・タイオード、Ｖ
１，■２・・・・・・出力設定電圧、Ｖ１・・・・・・
入力電圧、ＶＯ・・・・・・出力電圧、■ＯＰ・・・・
・・コンバレータＯＰ１の飽和出力電圧、■ＯＮ・曲・
コンパレータＯＰ２の飽和出力電圧、ＶＤＩ，ＶＤ２・
・・・・・クィオートＤ１．Ｄ２の順方向電、王、ＲＹ
１，ＲＹ２・・・・・・リレー、〜′Ｐ・・・・・・リ
レーＲＹ１用の電源、＼７Ｎ・・・・・・リレーＲＹ２
用の電源、ＲＬｌ・・・川リレーＲＹｌの内部抵抗、Ｒ
Ｌ２・・・・・・リレーＲＹ２の内部抵抗。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力信号に対して、それと関数関係にある出力信号を出
    力する関数発生回路であって、入力信号の入力端子を第
    １の抵抗と第２の抵抗の直列接続を介してアースに導く
    と共に、前記入力端子を第３の抵抗を介して演算増幅器
    の反転入力端子に接続し、前記第１の抵抗と第２の抵抗
    の接続点を前記演算増幅器の非反転入力端子に接続し、
    かつ前記反転入力端子を、第４の抵抗を介して前記演算
    増幅器の出力側に接続すると共に、前記反転入力端子と
    アースの間に、第１のダイオードと第１の設定電源の直
    列接続から成る第１の直列回路と、第２のタイオードと
    第２の設定重源の直列接続から成る第２の直列回路と、
    を相互に逆極性になるように並列接続したことを特徴と
    する関数発生回路。
JP10637684U 1984-07-16 1984-07-16 関数発生回路 Pending JPS6125655U (ja)

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JPS6125655U true JPS6125655U (ja) 1986-02-15

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