JPS61205884A - 雑音内のパルス列を検出する装置 - Google Patents
雑音内のパルス列を検出する装置Info
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- JPS61205884A JPS61205884A JP61048172A JP4817286A JPS61205884A JP S61205884 A JPS61205884 A JP S61205884A JP 61048172 A JP61048172 A JP 61048172A JP 4817286 A JP4817286 A JP 4817286A JP S61205884 A JPS61205884 A JP S61205884A
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- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
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- H03K5/1532—Peak detectors
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- G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
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- G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
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- G01S13/74—Systems using reradiation of radio waves, e.g. secondary radar systems; Analogous systems
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- Radar Systems Or Details Thereof (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、雑音の間のパルス列の各パルスを検出するた
めの装置に係るものである。
めの装置に係るものである。
従来の技術
ＤＭＥ （距離測定装置）の無線航法援助システムのよ
うな応用においては、パルス列（ＤＭＥの場合のように
、パルス列は多分２つのパルスだけからなる）を検出す
る、より正確に言えば、データを構成しているパルス間
隔を検出するためにパルスを識別することが必要である
。
うな応用においては、パルス列（ＤＭＥの場合のように
、パルス列は多分２つのパルスだけからなる）を検出す
る、より正確に言えば、データを構成しているパルス間
隔を検出するためにパルスを識別することが必要である
。
この目的に対して、特にこのような検出が特に重大なり
ＭＥにおいて、種々の装置が知られている。ＤＭＥにお
いてはパルスが対で送信され、受信時にそれらの間隔が
決定される。各パルスの到達時刻はその立上り縁の半値
高で決定されるようになっている。
ＭＥにおいて、種々の装置が知られている。ＤＭＥにお
いてはパルスが対で送信され、受信時にそれらの間隔が
決定される。各パルスの到達時刻はその立上り縁の半値
高で決定されるようになっている。
このような検出を遂行する公知の装置を第１図に示す。
第１図において、入力信号であるパルス対Ｅは、一方で
はパルスの半分の高さ、即ち■。
はパルスの半分の高さ、即ち■。
をピーク値として■。／２を決定するピーク検出器りに
、他方では遅延ラインＲｏに印加される。ピーク検出器
り及び遅延ラインＲ８からの信号ＶＣ／２及びＥＲはコ
ンパレータＣ８に印加される。遅延ラインＲ，の目的は
、入力パルスＥを時間τ。
、他方では遅延ラインＲｏに印加される。ピーク検出器
り及び遅延ラインＲ８からの信号ＶＣ／２及びＥＲはコ
ンパレータＣ８に印加される。遅延ラインＲ，の目的は
、入力パルスＥを時間τ。
だけ遅らせてそれらを検出された値ＶＣ／２と同時に（
或はそれよりも後に）コンパレータＣ８に到達させるた
めである。
或はそれよりも後に）コンパレータＣ８に到達させるた
めである。
入力信号Ｅは第２ａ図に時間の関数として示しである。
２つのパルスは実質的に同一のピーク値Ｖｃを有してお
り、それらの間隔Ｔは各パルスの立上り縁の半値布（Ｖ
Ｃ／２）を分離している時間間隔として求められる。第
２ｂ図も、信号Ｅと同一ではあるが信号Ｅに対して時間
τ０だけ遅延されている信号Ｅ１１を時間の関数として
示すものである。第１の遅延されたパルス（ＥＲ）がコ
ンパレータＣｏに到達すると、コンパレータＣ８は信号
ＥＲの立上り栂と■。／２とを比較し、この立上り縁が
値■。／２に到達する時刻に信号（矩形波パルス）を発
生する。コンパレータＣ６から供給される信号Ｓを時間
の関数として第２Ｃ図に示してあり、信号Ｅ、の第１の
パルスに対応する信号Ｓの部分には参照番号１が附しで
ある。遅延された信号Ｅ、を形成している第２のパルス
がコンパレータＣ６に到達すると、コンパレータＣｏは
同じように作動して第２Ｃ図に参照番号２で示す第２の
矩形波パルスを発生する。出力信号Ｓのパルス１及び２
の立上り縁の間隔Ｔが２つの入力パルスＥの間隔である
。
り、それらの間隔Ｔは各パルスの立上り縁の半値布（Ｖ
Ｃ／２）を分離している時間間隔として求められる。第
２ｂ図も、信号Ｅと同一ではあるが信号Ｅに対して時間
τ０だけ遅延されている信号Ｅ１１を時間の関数として
示すものである。第１の遅延されたパルス（ＥＲ）がコ
ンパレータＣｏに到達すると、コンパレータＣ８は信号
ＥＲの立上り栂と■。／２とを比較し、この立上り縁が
値■。／２に到達する時刻に信号（矩形波パルス）を発
生する。コンパレータＣ６から供給される信号Ｓを時間
の関数として第２Ｃ図に示してあり、信号Ｅ、の第１の
パルスに対応する信号Ｓの部分には参照番号１が附しで
ある。遅延された信号Ｅ、を形成している第２のパルス
がコンパレータＣ６に到達すると、コンパレータＣｏは
同じように作動して第２Ｃ図に参照番号２で示す第２の
矩形波パルスを発生する。出力信号Ｓのパルス１及び２
の立上り縁の間隔Ｔが２つの入力パルスＥの間隔である
。
発明が解決しようとする問題点
明らかに、上述の装置が動作するためには２つのパルス
間の入力信号Ｅの振巾が値ｖｃ／２以下に低下する必要
がある。そうでない場合には、コンパレータＣｏは第２
のパルスを識別することができない。しかし、パルス列
に雑音が重畳されている場合には、信号Ｅの振幅に係る
この条件を満たすことはできないかも知れない。例えば
、ＤＭＥが電波を反射する障害物を含む環境内で作動し
ている場合には、これらの障害物は若干の遅延を与えて
これらのＤＭＥパルスを反射する。これらの遅延された
パルスが直接伝播信号に重畳されると、２つのパルス間
の振巾がＶｃ／２よりも大きい複合入力信号を形成する
可能性がある。従ってＤＭＥ全体の効率及び精度が損わ
れ、有効測定数が減少するか、成る場合には０になって
しまう。
間の入力信号Ｅの振巾が値ｖｃ／２以下に低下する必要
がある。そうでない場合には、コンパレータＣｏは第２
のパルスを識別することができない。しかし、パルス列
に雑音が重畳されている場合には、信号Ｅの振幅に係る
この条件を満たすことはできないかも知れない。例えば
、ＤＭＥが電波を反射する障害物を含む環境内で作動し
ている場合には、これらの障害物は若干の遅延を与えて
これらのＤＭＥパルスを反射する。これらの遅延された
パルスが直接伝播信号に重畳されると、２つのパルス間
の振巾がＶｃ／２よりも大きい複合入力信号を形成する
可能性がある。従ってＤＭＥ全体の効率及び精度が損わ
れ、有効測定数が減少するか、成る場合には０になって
しまう。
本発明の目的は、２つのパルス間の振巾が値ＶＣ／２以
下に低下することを必要としないようにして上述の欠陥
を打破する検出装置を提供することである。
下に低下することを必要としないようにして上述の欠陥
を打破する検出装置を提供することである。
問題点を解決するための手段
すなわち、本発明によれば、第１のパルスは前述のよう
にして検出されるが、第２のパルス（並びに、もし存在
すればパルス列内のそれ以後のパルス）は自己交叉によ
って検出される。また、信号はそれ自身の交叉が検出さ
れ、適当に遅延されるのである。
にして検出されるが、第２のパルス（並びに、もし存在
すればパルス列内のそれ以後のパルス）は自己交叉によ
って検出される。また、信号はそれ自身の交叉が検出さ
れ、適当に遅延されるのである。
より精密に言えば、本発明の装置は、
受信した列の第１のパルスのピーク値Ｖｃを検出する手
段と、 受信した列に第１の遅延を与える第１のアナログ手段と
、 受信し、遅延させた第１のパルスのレベルとレベルＶＣ
／２とを比較するコンパレータと、受信した列に第１の
遅延とは異る第２の遅延を与える第２のアナログ手段と
、 第２の遅延手段から供給される信号と、第１の遅延手段
から供給される信号及び値Ｖｃ／２とを比較する第２の
コンパレータと、 ２つのコンパレータからの出力信号が一致すると出力信
号を発生する（ＡＮＤ型の〉論理回路とを具備している
。
段と、 受信した列に第１の遅延を与える第１のアナログ手段と
、 受信し、遅延させた第１のパルスのレベルとレベルＶＣ
／２とを比較するコンパレータと、受信した列に第１の
遅延とは異る第２の遅延を与える第２のアナログ手段と
、 第２の遅延手段から供給される信号と、第１の遅延手段
から供給される信号及び値Ｖｃ／２とを比較する第２の
コンパレータと、 ２つのコンパレータからの出力信号が一致すると出力信
号を発生する（ＡＮＤ型の〉論理回路とを具備している
。
本発明の他の目的、特色及び結果は、添付図面を参照し
ての以下の説明から明白になるであろう。
ての以下の説明から明白になるであろう。
実施例
第３図は、本発明の装置の一実施例のブロックダイアダ
ラムである。第３図の説明は、第３図の装置のことなる
点の信号の時間的変化を示している第４ａ図乃至第４ｅ
図を参照しながら進めることにする。
ラムである。第３図の説明は、第３図の装置のことなる
点の信号の時間的変化を示している第４ａ図乃至第４ｅ
図を参照しながら進めることにする。
検出装置への入力信号Ｅは、ピーク検出器Ｄ１第１のア
ナログ遅延回路Ｒ８、及び第２のアナログ遅延回路Ｒ１
に並列に印加される。
ナログ遅延回路Ｒ８、及び第２のアナログ遅延回路Ｒ１
に並列に印加される。
説明を簡易にするために、信号Ｅは２つのパルスだけか
ら形成され、それらの間１１Ｔが予め選定されているも
のとする。しかし本発明の装置の動作を明白に示すため
に、第４ａ図に破線で示す信号Ｅは、これら２つのパル
ス間の値が半ピーク値■、／２よりも大きくなる程極め
て妨害されているものとする。
ら形成され、それらの間１１Ｔが予め選定されているも
のとする。しかし本発明の装置の動作を明白に示すため
に、第４ａ図に破線で示す信号Ｅは、これら２つのパル
ス間の値が半ピーク値■、／２よりも大きくなる程極め
て妨害されているものとする。
第４ａ図には：
ピーク検出器りからの信号Ａ（ある立上り時間の後に■
。／２に等しくなる一定信号。）、遅延回路Ｒ８からの
信号Ｂ（入力信号Ｅと同一形状であるが、時間τ。たけ
遅延されており、実線で示しである）、 遅延回路Ｒ１からの信号Ｃ（これも入力信号Ｅと同一形
状であるがτ。とは異る時間τ１だけ遅延されている。
。／２に等しくなる一定信号。）、遅延回路Ｒ８からの
信号Ｂ（入力信号Ｅと同一形状であるが、時間τ。たけ
遅延されており、実線で示しである）、 遅延回路Ｒ１からの信号Ｃ（これも入力信号Ｅと同一形
状であるがτ。とは異る時間τ１だけ遅延されている。
ＤＭＥへの応用の特定の場合にはτ１くτ。）、
も図示しである。
信号Ａ及びＢは、第１図において説明した公知装置のよ
うに、第１のコンパレータＣ６に印加される。コンパレ
ータＣ８の出力信号を第４図にＢで示す。このコンパレ
ータＣ８は遅延された信号Ｂが■。／２（信号Ａ）に等
しくなる時刻を検出することができる。この時刻をｔ３
で示す。したがって信号Ｇは時刻ｔ３から一定のレベル
となり、信号Ｂが再びｖｃ／２以下になるまで（第４図
には示されていない）このレベルを保つ。
うに、第１のコンパレータＣ６に印加される。コンパレ
ータＣ８の出力信号を第４図にＢで示す。このコンパレ
ータＣ８は遅延された信号Ｂが■。／２（信号Ａ）に等
しくなる時刻を検出することができる。この時刻をｔ３
で示す。したがって信号Ｇは時刻ｔ３から一定のレベル
となり、信号Ｂが再びｖｃ／２以下になるまで（第４図
には示されていない）このレベルを保つ。
本発明によれば、装置は第２のコンパレータＣ３を含ん
でおり、コンパレータＣ１は信号Ｃ（τ。
でおり、コンパレータＣ１は信号Ｃ（τ。
だけ遅延させた入力信号）を受けてそれと信号Ｂ及び信
号Ａ（Ｖ、／２）の両方とを比較する。コンパレータＣ
１から供給される信号Ｊを第４Ｃ図に示す。信号Ｊは遅
延された信号ＣがＶｃ／２に等しくなる時刻ｔ、に高レ
ベルに立上る。信号Ｊは信号Ｃの振巾が減少して信号Ｂ
（前述のように同じ信号ではあるがτ０だけ遅延された
もの）と交叉できるようになるまで高レベルを保つ。こ
の交叉は時刻ｔ、に発生する。もし遅延された信号Ｃが
ｖｃ／２以下に低下しなければ、即ちもし再び信号Ａと
交叉することがなければ、信号Ｊは遅延した信号Ｃの振
巾が再び増加し、遅延した信号ＢとＣとが互いに交叉す
る時刻ｔｓに高レベルに立上る。
号Ａ（Ｖ、／２）の両方とを比較する。コンパレータＣ
１から供給される信号Ｊを第４Ｃ図に示す。信号Ｊは遅
延された信号ＣがＶｃ／２に等しくなる時刻ｔ、に高レ
ベルに立上る。信号Ｊは信号Ｃの振巾が減少して信号Ｂ
（前述のように同じ信号ではあるがτ０だけ遅延された
もの）と交叉できるようになるまで高レベルを保つ。こ
の交叉は時刻ｔ、に発生する。もし遅延された信号Ｃが
ｖｃ／２以下に低下しなければ、即ちもし再び信号Ａと
交叉することがなければ、信号Ｊは遅延した信号Ｃの振
巾が再び増加し、遅延した信号ＢとＣとが互いに交叉す
る時刻ｔｓに高レベルに立上る。
信号Ｊは、遅延した信号Ｃ（７）振巾が再び減少して信
号Ｂと再び交叉する時刻ｔ７までこのレベルを保つ。も
し信号Ｃの振巾が値ＶＣ／２（信号Ａ）以下に低下すれ
ば、信号Ｃは信号Ａと交差するので信号Ｊを低レベルに
立下らせる。
号Ｂと再び交叉する時刻ｔ７までこのレベルを保つ。も
し信号Ｃの振巾が値ＶＣ／２（信号Ａ）以下に低下すれ
ば、信号Ｃは信号Ａと交差するので信号Ｊを低レベルに
立下らせる。
以上のようにして、コンパレータＣ３の出力に２つの矩
形波パルス３及び４からなる信号Ｊが得られ、これらの
パルスの立上り縁間の間隔は所望の間隔Ｔに実質的に一
致している。即ち第１の矩形波パルス３の立上り縁は信
号（遅延された信号Ｃ）の半ピーク値を検出することに
よって得られ、その後の立下り縁及び立ち上り縁は信号
自身（実際には遅延された信号Ｂ及びＣ）の自己交叉に
よって得られる。従って、時刻ｔ４、ｔｓ及びｔ７にお
いて信号Ｊに変化を生じさせるためには、信号Ｅがその
ピーク値に達した後はその振巾に関する状態には拘りな
く、信号Ｅの勾配の符号の変化（上昇／下降）のみが必
要である。
形波パルス３及び４からなる信号Ｊが得られ、これらの
パルスの立上り縁間の間隔は所望の間隔Ｔに実質的に一
致している。即ち第１の矩形波パルス３の立上り縁は信
号（遅延された信号Ｃ）の半ピーク値を検出することに
よって得られ、その後の立下り縁及び立ち上り縁は信号
自身（実際には遅延された信号Ｂ及びＣ）の自己交叉に
よって得られる。従って、時刻ｔ４、ｔｓ及びｔ７にお
いて信号Ｊに変化を生じさせるためには、信号Ｅがその
ピーク値に達した後はその振巾に関する状態には拘りな
く、信号Ｅの勾配の符号の変化（上昇／下降）のみが必
要である。
しかし、より特定的にＤＭＥにおいては、遅延された信
号Ｂが半ピーク値■。／２と交叉する時刻は別の関係に
用いられる時間基準になっている。
号Ｂが半ピーク値■。／２と交叉する時刻は別の関係に
用いられる時間基準になっている。
従って装置はその出力にＡＮＤゲート型の論理的−飲手
段りを備えている。この手段りの目的は第４ｅ図に示す
ようにパルス３（信号Ｊ）の立上り縁を時刻ｔ、に一致
させることである。第４ｅ図は装置の出力信号Ｓを表わ
している。
段りを備えている。この手段りの目的は第４ｅ図に示す
ようにパルス３（信号Ｊ）の立上り縁を時刻ｔ、に一致
させることである。第４ｅ図は装置の出力信号Ｓを表わ
している。
しかし、上述の自己交叉を生じさせるためにτ０よりも
小さい遅延τ１が信号Ｃに与えられているので、期間Ｔ
の開始時刻ｔ１は時刻ｔ３よりも進んでいる。第３図及
び第４図に示す実施例では、このずれを補償するために
コンパレータＣＩの出力に遅延回路Ｒ２が付加されてい
る。信号Ｊは時間τ２だけ遅延され、第４ｄ図に示す信
号Ｆになる。τ２くτＯｒ、であるがこの値に接近して
いる。従って、信号Ｆはその立上り縁がτ２だけ遅延さ
れて時刻ｔ２及びｔ６に発生することを除けば、信号Ｊ
と同一である。遅延τ２は、時刻ｔ３に対する時刻ｔ、
の前進を可能な限り補償するように選択される。このよ
うにして出力信号Ｓとして２つの矩形波パルスが得られ
る。即ち信号Ｇ（ＤＭＥの時間基準）で示す時刻ｔ３と
、信号Ｆで示す時刻ｔ６とにそれぞれ立上り縁を有し、
ｔ６−ｔ３＝Ｔ（Ｔはパルス間の所望間隔）となるよう
なパルスである。これらの時刻の間に、信号Ｓは遅延さ
れた信号ｊから得られた信号Ｆの出現に追随することに
なる。
小さい遅延τ１が信号Ｃに与えられているので、期間Ｔ
の開始時刻ｔ１は時刻ｔ３よりも進んでいる。第３図及
び第４図に示す実施例では、このずれを補償するために
コンパレータＣＩの出力に遅延回路Ｒ２が付加されてい
る。信号Ｊは時間τ２だけ遅延され、第４ｄ図に示す信
号Ｆになる。τ２くτＯｒ、であるがこの値に接近して
いる。従って、信号Ｆはその立上り縁がτ２だけ遅延さ
れて時刻ｔ２及びｔ６に発生することを除けば、信号Ｊ
と同一である。遅延τ２は、時刻ｔ３に対する時刻ｔ、
の前進を可能な限り補償するように選択される。このよ
うにして出力信号Ｓとして２つの矩形波パルスが得られ
る。即ち信号Ｇ（ＤＭＥの時間基準）で示す時刻ｔ３と
、信号Ｆで示す時刻ｔ６とにそれぞれ立上り縁を有し、
ｔ６−ｔ３＝Ｔ（Ｔはパルス間の所望間隔）となるよう
なパルスである。これらの時刻の間に、信号Ｓは遅延さ
れた信号ｊから得られた信号Ｆの出現に追随することに
なる。
第５図は本発明の検出装置の実際的な実施例を示すもの
である。
である。
第５図において、信号Ｅはボルテージホロアに接続され
ている演算増巾器６に印加される。増巾器６の機能は、
本発明の装置の動作を先行回路チェーンから減結合する
ことである。
ている演算増巾器６に印加される。増巾器６の機能は、
本発明の装置の動作を先行回路チェーンから減結合する
ことである。
増巾器６の出力に現われた信号Ｅはピーク検出器Ｄ、遅
延回路Ｒ８及びＲ１（これらの構成に関しては後述する
）に並列に印加される。これら３つのブロックＤ、Ｒ，
及びＲ１の出力信号Ａ、Ｂ及びＣは、それぞれが差動増
巾器によって形成されているコンパレータＣｏ及びＣＩ
に印加される。
延回路Ｒ８及びＲ１（これらの構成に関しては後述する
）に並列に印加される。これら３つのブロックＤ、Ｒ，
及びＲ１の出力信号Ａ、Ｂ及びＣは、それぞれが差動増
巾器によって形成されているコンパレータＣｏ及びＣＩ
に印加される。
検出器りの出力とコンパレータＣ１の入力（−）との間
の接続は、コンパレータＣＩが■ｃ／２（信号Ａ１時刻
１＋）でトリガされるように形成されている。この接続
の中にダイオード７が挿入されている。信号Ｂが値ＶＣ
／２（信号Ａ）に干渉するのを防ぐために、ダイオード
７のアノードは検出器り側に、カソードはコンパレータ
Ｃ３側に接続されている。コンパレータＣ１からの出力
信号Ｊは遅延回路Ｒ２によって時間τ２だけ遅延される
。
の接続は、コンパレータＣＩが■ｃ／２（信号Ａ１時刻
１＋）でトリガされるように形成されている。この接続
の中にダイオード７が挿入されている。信号Ｂが値ＶＣ
／２（信号Ａ）に干渉するのを防ぐために、ダイオード
７のアノードは検出器り側に、カソードはコンパレータ
Ｃ３側に接続されている。コンパレータＣ１からの出力
信号Ｊは遅延回路Ｒ２によって時間τ２だけ遅延される
。
回路Ｒ２は単安定論理回路であってよい。単安定回路は
遅延時間をアナログ遅延ラインよりも正確に調整できる
論理回路である。信号Ｆを形成している矩形波パルスの
巾は使用される単安定回路に依存することに注目された
い。この巾は時刻ｔ３をカバーするのに充分であれば、
即ち少なくとも（ｔ３−ｔ＋）−τ２よりも僅かに長い
ものであれば大して重要ではない。回路Ｃ８及びＲ２の
出力信号Ｇ及びＦはＡＮＤゲートＬに印加され、出力信
号Ｓが出力される。
遅延時間をアナログ遅延ラインよりも正確に調整できる
論理回路である。信号Ｆを形成している矩形波パルスの
巾は使用される単安定回路に依存することに注目された
い。この巾は時刻ｔ３をカバーするのに充分であれば、
即ち少なくとも（ｔ３−ｔ＋）−τ２よりも僅かに長い
ものであれば大して重要ではない。回路Ｃ８及びＲ２の
出力信号Ｇ及びＦはＡＮＤゲートＬに印加され、出力信
号Ｓが出力される。
ピーク検出器りは差動増巾器１１を含み、信号Ｅはその
正入力に印加され、出力はダイオード１２のアノードに
供給される。ダイオード１２のカソードは例えばＮＰＮ
型のトランジスタ１４のベースに接続されている。トラ
ンジスタ１４のコレクタは電源に、またエミッタは２つ
の抵抗１５及び１６を通して接地されている。トランジ
スタ１４のエミッタは増巾器１１の負入力にも接続され
ている。このトランジスタ１４のベースはコンデンサ１
３を通して接地されている。以上から、トランジスタ１
４のエミッタに得られる信号が入力信号Ｅと共にピーク
値Ｖｃまで増加することは明白であろう。トランジスタ
１４のエミッタが増巾器１１の負入力、ダイオード１２
及びコンデンサ１３を通してループを形成しているので
、エミッタの信号のレベルは入力信号が低下しても降下
することはない。従ってトランジスタ１４のエミッタに
は値Ｖｃが恒久的に存在する。抵抗１５及び１６はピー
ク電圧をＸに分圧するために用いられており、両抵抗の
接続点１７には電圧Ｖｃ／４が得られる。以下に説明す
るように遅延回路Ｒ。
正入力に印加され、出力はダイオード１２のアノードに
供給される。ダイオード１２のカソードは例えばＮＰＮ
型のトランジスタ１４のベースに接続されている。トラ
ンジスタ１４のコレクタは電源に、またエミッタは２つ
の抵抗１５及び１６を通して接地されている。トランジ
スタ１４のエミッタは増巾器１１の負入力にも接続され
ている。このトランジスタ１４のベースはコンデンサ１
３を通して接地されている。以上から、トランジスタ１
４のエミッタに得られる信号が入力信号Ｅと共にピーク
値Ｖｃまで増加することは明白であろう。トランジスタ
１４のエミッタが増巾器１１の負入力、ダイオード１２
及びコンデンサ１３を通してループを形成しているので
、エミッタの信号のレベルは入力信号が低下しても降下
することはない。従ってトランジスタ１４のエミッタに
は値Ｖｃが恒久的に存在する。抵抗１５及び１６はピー
ク電圧をＸに分圧するために用いられており、両抵抗の
接続点１７には電圧Ｖｃ／４が得られる。以下に説明す
るように遅延回路Ｒ。
及びＲ１の出力に現われるのは入力信号Ｅではなく、振
巾が２になっている信号であることを考慮して、接続点
１７には第３図に示すようにｖｃ／２ではなく、■。／
４に等しい電圧を発生させることが望ましいのである。
巾が２になっている信号であることを考慮して、接続点
１７には第３図に示すようにｖｃ／２ではなく、■。／
４に等しい電圧を発生させることが望ましいのである。
遅延回路Ｒ６は、本実施例では、例えば分布定数を有す
るＬＣ型のアナログ遅延ライン２２からなっている。遅
延ライン２２の入力は、遅延ライン２２の特性インピー
ダンスに等しい値を有する抵抗２１を通して入力信号を
受ける。同様に、遅延ライン２２の出力はこれもライン
の特性インピーダンスに等しい抵抗２３を通して接地さ
れている。従って、遅延ライン２２の出力に得られる信
号Ｂの振巾は、入力信号の各になることは明白である。
るＬＣ型のアナログ遅延ライン２２からなっている。遅
延ライン２２の入力は、遅延ライン２２の特性インピー
ダンスに等しい値を有する抵抗２１を通して入力信号を
受ける。同様に、遅延ライン２２の出力はこれもライン
の特性インピーダンスに等しい抵抗２３を通して接地さ
れている。従って、遅延ライン２２の出力に得られる信
号Ｂの振巾は、入力信号の各になることは明白である。
遅延回路Ｒ１も例えば遅延ライン２２と同じ型のアナロ
グ遅延ライン２５からなっており、その両端はそれぞれ
抵抗２４を通して入力信号Ｅ及び抵抗２６を通して接地
に接続されている。各抵抗はラインの特性インピーダン
スに等しい。信号Ｅの振巾の２の振巾の信号Ｃが遅延ラ
イン２５の出力から取出される。
グ遅延ライン２５からなっており、その両端はそれぞれ
抵抗２４を通して入力信号Ｅ及び抵抗２６を通して接地
に接続されている。各抵抗はラインの特性インピーダン
スに等しい。信号Ｅの振巾の２の振巾の信号Ｃが遅延ラ
イン２５の出力から取出される。
第１図は先行技術の検出装置のブロックダイアダラムで
あり、 第２ａ図、第２ｂ図及び第２ｃ図は第１図の装置の各部
波形図であり、 第３図は本発明の検出装置の一実施例のブロックダイア
ダラムであり、 第４ａ図乃至第４ｅ図は第３図の装置の各部波形図であ
り、そして 第５図は本発明の装置の実際的な実施例の回路図である
。 （主な参照番号） １．２・・コンパレータＣ８からの出力、３．４・・コ
ンパレータＣ１からの出力、６．１１・・演算増巾器、 ７．１２・・ダイオード、 １３・・コンデンサ、１４
・・トランジスタ、 １５、１６．２１．２３．２４．２６・・抵抗、２２、
２５・・アナログ遅延ライン、 Ａ・・ピーク検出器りの出力、 Ｂ・・遅延回路Ｒ８の出力、□ Ｃ・・遅延回路Ｒ３の出力、 Ｃ，、Ｃ，・・コンパレータ、 Ｄ・・ピーク検出器、 Ｅ・・入力信号、Ｅ□ ・・遅
延信号、 Ｆ・・遅延回路Ｒ２の出力、 Ｇ・・コンパレータＣ８の出力、 Ｊ・・コンパレータＣ１の出力、 Ｌ・・論理的一致手段（ＡＮＤゲート）、Ｒ，、Ｒ，、
Ｒ，・・遅延回路、 Ｓ・・装置の出力、 Ｔ・・パルス間隔、Ｖｃ ・・
ピーク値。
あり、 第２ａ図、第２ｂ図及び第２ｃ図は第１図の装置の各部
波形図であり、 第３図は本発明の検出装置の一実施例のブロックダイア
ダラムであり、 第４ａ図乃至第４ｅ図は第３図の装置の各部波形図であ
り、そして 第５図は本発明の装置の実際的な実施例の回路図である
。 （主な参照番号） １．２・・コンパレータＣ８からの出力、３．４・・コ
ンパレータＣ１からの出力、６．１１・・演算増巾器、 ７．１２・・ダイオード、 １３・・コンデンサ、１４
・・トランジスタ、 １５、１６．２１．２３．２４．２６・・抵抗、２２、
２５・・アナログ遅延ライン、 Ａ・・ピーク検出器りの出力、 Ｂ・・遅延回路Ｒ８の出力、□ Ｃ・・遅延回路Ｒ３の出力、 Ｃ，、Ｃ，・・コンパレータ、 Ｄ・・ピーク検出器、 Ｅ・・入力信号、Ｅ□ ・・遅
延信号、 Ｆ・・遅延回路Ｒ２の出力、 Ｇ・・コンパレータＣ８の出力、 Ｊ・・コンパレータＣ１の出力、 Ｌ・・論理的一致手段（ＡＮＤゲート）、Ｒ，、Ｒ，、
Ｒ，・・遅延回路、 Ｓ・・装置の出力、 Ｔ・・パルス間隔、Ｖｃ ・・
ピーク値。
Claims (9)
- （１）複数のパルスからなるパルス列を検出するための
装置であって； 前記列の第１のパルスのピーク値を検出する手段と、 前記パルス列を受けてそれに第１の遅延を与えて第１の
出力信号を形成する第１のアナログ遅延手段と、 前記第１の出力信号のレベルと前記ピーク値の半分とを
比較し、前記第１の出力信号が前記半ピーク値に等しく
なった時及び前記第１の出力信号が前記半ピーク値より
も大きい限り第１の信号を発生する第１のコンパレータ
と、 前記パルス列を受けてそれに第１の遅延とは異る第２の
遅延を与えて第２の出力信号を形成する第２のアナログ
遅延手段と、 前記第２の出力信号のレベルと前記半ピーク値とを、及
び前記第２の出力信号のレベルと前記第１の出力信号と
を比較し、前記第２の出力信号が前記半ピーク値或いは
記第１の出力信号の何れかに等しくなった時及び前記第
２の出力信号が前記半ピーク値及び前記第１の出力信号
の最大値よりも大きい限り第２の信号を発生する第２の
コンパレータと、 前記第１及び第２のコンパレータからそれぞれ前記第１
及び第２の信号を受け、前記第１及び第２の信号間に一
致が存在する場合に信号を発生する論理手段と を具備することを特徴とする装置。 - （２）前記第２の遅延が前記第１の遅延よりも小さいこ
とを特徴とする特許請求の範囲第（１）項に記載の装置
。 - （３）前記第２のコンパレータと前記論理手段との間に
置かれていて前記第２のコンパレータからの前記第２の
信号に第３の遅延を与える第３の遅延手段をも具備し、
前記第３の遅延が前記第１の遅延と第２の遅延との間の
差よりは小さいがこの差に接近していることを特徴とす
る特許請求の範囲第（２）項に記載の装置。 - （４）前記論理手段がＡＮＤゲートからなっていること
を特徴とする特許請求の範囲第（１）項に記載の装置。 - （５）前記第３の遅延手段が単安定論理回路であること
を特徴とする特許請求の範囲第（３）項に記載の装置。 - （６）前記検出手段が； ２つの入力を有し、その第１の入力にパルス列を受ける
差動増巾器と、 アノードが前記増巾器の出力に接続されているダイオー
ドと、 前記ダイオードのカソードと接地との間に接続されてい
るコンデンサと、 ベースが前記ダイオードのカソードに、コレクタが電源
に、そしてエミッタが前記増巾器の第２の入力に接続さ
れていて、前記パルス列のピーク値を前記エミッタから
取出し得るようになっているトランジスタと を具備することを特徴とする特許請求の範囲第（１）項
に記載の装置。 - （７）前記第１の遅延手段がＬＣ型の遅延ラインからな
っており、前記ラインの各端がそれぞれ前記ラインの特
性インピーダンスに等しいインピーダンスを有する抵抗
に接続されていることを特徴とする特許請求の範囲第（
１）項に記載の装置。 - （８）前記第２の遅延手段がＬＣ型の遅延ラインからな
っており、前記ラインの各端がそれぞれ前記ラインの特
性インピーダンスに等しいインピーダンスを有する抵抗
に接続されていることを特徴とする特許請求の範囲第（
１）項に記載の装置。 - （９）前記パルス列を受けそれを前記検出手段と前記第
１及び第２の遅延手段とに伝送する減結合手段をも具備
していることを特徴とする特許請求の範囲第（１）項に
記載の装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| FR8503228 | 1985-03-05 | ||
| FR8503228A FR2578701A1 (fr) | 1985-03-05 | 1985-03-05 | Dispositif de detection d'un train d'impulsions dans du bruit et application a un systeme dme |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61205884A true JPS61205884A (ja) | 1986-09-12 |
Family
ID=9316880
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61048172A Pending JPS61205884A (ja) | 1985-03-05 | 1986-03-05 | 雑音内のパルス列を検出する装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4694200A (ja) |
| EP (1) | EP0194924A1 (ja) |
| JP (1) | JPS61205884A (ja) |
| CA (1) | CA1245750A (ja) |
| FR (1) | FR2578701A1 (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03130580U (ja) * | 1990-04-12 | 1991-12-27 | ||
| JPH05164850A (ja) * | 1991-12-13 | 1993-06-29 | Nec Corp | 時間検出装置 |
| JP2010164381A (ja) * | 2009-01-14 | 2010-07-29 | Toshiba Corp | パルス検出装置及びパルス検出方法 |
| JP2010286335A (ja) * | 2009-06-11 | 2010-12-24 | Toshiba Corp | パルス検出装置 |
Families Citing this family (14)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB2177804A (en) * | 1985-05-31 | 1987-01-28 | Coulter Electronics | Analysing and editing electrical pulses |
| US4769597A (en) * | 1985-06-28 | 1988-09-06 | Kabushiki Kaisha Toshiba | Apparatus for generating index signals, for use in magnetic recording/reproducing apparatuses |
| JPS6386152A (ja) * | 1986-09-30 | 1988-04-16 | Toshiba Corp | インデツクス調整装置 |
| US4857760A (en) * | 1988-02-10 | 1989-08-15 | Tektronix, Inc. | Bipolar glitch detector circuit |
| US5289060A (en) * | 1992-09-16 | 1994-02-22 | Texas Instruments Incorporated | Programmable glitch filter |
| GB2288089B (en) * | 1994-03-31 | 1998-06-24 | Plessey Telecomm | Adaptive threshold line receiver |
| JPH0877503A (ja) * | 1994-08-31 | 1996-03-22 | Aiwa Co Ltd | ピーク検出回路およびそれを使用した記録媒体再生装置 |
| JP3254159B2 (ja) * | 1997-02-04 | 2002-02-04 | セイコーインスツルメンツ株式会社 | 充放電制御回路 |
| US6606511B1 (en) | 1999-01-07 | 2003-08-12 | Masimo Corporation | Pulse oximetry pulse indicator |
| US6684090B2 (en) * | 1999-01-07 | 2004-01-27 | Masimo Corporation | Pulse oximetry data confidence indicator |
| US6252433B1 (en) | 1999-05-12 | 2001-06-26 | Southwest Research Institute | Single event upset immune comparator |
| US7187721B1 (en) * | 2000-02-09 | 2007-03-06 | Rambus Inc. | Transition-time control in a high-speed data transmitter |
| JP2011014963A (ja) * | 2009-06-30 | 2011-01-20 | Renesas Electronics Corp | 半導体装置、半導体装置のノイズ除去方法 |
| US20120119789A1 (en) * | 2010-11-16 | 2012-05-17 | Lsi Corporation | Peak Detector Extension System |
Family Cites Families (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| NL140682B (nl) * | 1967-02-28 | 1973-12-17 | Ibm Nederland | Detectieschakeling voor analoge pulsen. |
| US3676783A (en) * | 1968-04-23 | 1972-07-11 | Japan Atomic Energy Res Inst | Waveform discriminating circuit |
| US3668532A (en) * | 1971-01-25 | 1972-06-06 | Sperry Rand Corp | Peak detection system |
| FR2497958A1 (fr) * | 1981-01-09 | 1982-07-16 | Thomson Csf | Dispositif de determination de l'instant d'arrivee d'impulsions, utilisation dans un equipement de mesure de distances et equipement de mesure comportant un tel dispositif |
| US4431916A (en) * | 1981-05-20 | 1984-02-14 | International Telephone And Telegraph Corporation | Optical data bus receiver with signal waveform restoring means |
| US4507795A (en) * | 1983-02-14 | 1985-03-26 | Motorola, Inc. | Apparatus and method for locating leading and trailing edges of RF pulses |
-
1985
- 1985-03-05 FR FR8503228A patent/FR2578701A1/fr not_active Withdrawn
-
1986
- 1986-02-25 US US06/833,734 patent/US4694200A/en not_active Expired - Fee Related
- 1986-03-04 EP EP86400451A patent/EP0194924A1/fr not_active Withdrawn
- 1986-03-05 JP JP61048172A patent/JPS61205884A/ja active Pending
- 1986-03-05 CA CA000503312A patent/CA1245750A/fr not_active Expired
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| Publication number | Priority date | Publication date | Assignee | Title |
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| JPH03130580U (ja) * | 1990-04-12 | 1991-12-27 | ||
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| JP2010164381A (ja) * | 2009-01-14 | 2010-07-29 | Toshiba Corp | パルス検出装置及びパルス検出方法 |
| JP2010286335A (ja) * | 2009-06-11 | 2010-12-24 | Toshiba Corp | パルス検出装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0194924A1 (fr) | 1986-09-17 |
| US4694200A (en) | 1987-09-15 |
| CA1245750A (fr) | 1988-11-29 |
| FR2578701A1 (fr) | 1986-09-12 |
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