JPS61198833A - 時分割多重通信方式 - Google Patents
時分割多重通信方式Info
- Publication number
- JPS61198833A JPS61198833A JP3796685A JP3796685A JPS61198833A JP S61198833 A JPS61198833 A JP S61198833A JP 3796685 A JP3796685 A JP 3796685A JP 3796685 A JP3796685 A JP 3796685A JP S61198833 A JPS61198833 A JP S61198833A
- Authority
- JP
- Japan
- Prior art keywords
- analog
- digital
- sampling
- circuit
- switching circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J3/00—Time-division multiplex systems
- H04J3/16—Time-division multiplex systems in which the time allocation to individual channels within a transmission cycle is variable, e.g. to accommodate varying complexity of signals, to vary number of channels transmitted
- H04J3/1682—Allocation of channels according to the instantaneous demands of the users, e.g. concentrated multiplexers, statistical multiplexers
- H04J3/1688—Allocation of channels according to the instantaneous demands of the users, e.g. concentrated multiplexers, statistical multiplexers the demands of the users being taken into account after redundancy removal, e.g. by predictive coding, by variable sampling
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
この発明は時分割多重通信方式において、音声信号のサ
ンプリング周期を切り替えることによって、伝送される
音声信号の通話品質を通常品位と高品位に切り替え出来
るようにしたものである。
ンプリング周期を切り替えることによって、伝送される
音声信号の通話品質を通常品位と高品位に切り替え出来
るようにしたものである。
本発明は時分割多重通信方式の改良に関するものである
。
。
時分割多重通信方式においては伝送される音声信号の品
質はサンプリング周期に関係し、特定時間内におけるサ
ンプリング回数が大となればなる程通話品質が高品位と
なる。
質はサンプリング周期に関係し、特定時間内におけるサ
ンプリング回数が大となればなる程通話品質が高品位と
なる。
しかし、高品質通話だけでなく通常品質の通話も用いら
れるので、任意にその一つを選択出来るような時分割多
重通信方式の提供が望まれる。
れるので、任意にその一つを選択出来るような時分割多
重通信方式の提供が望まれる。
第８図は従来の適応形差分ＰＣＭ時分割多重伝送システ
ムの一例をブロック図で示す。
ムの一例をブロック図で示す。
図は３２通話路を多重化処理をするものを示し、３２通
話路のアナログ信号はアナログ・ディジタル変換回路１
−１．１−２、−１１−３２を介しマルチプレクサ３に
て多重化され、適応形差分ＰＣＭコーダ５で通話路１か
ら３２迄の変調符号化処理が行われる。
話路のアナログ信号はアナログ・ディジタル変換回路１
−１．１−２、−１１−３２を介しマルチプレクサ３に
て多重化され、適応形差分ＰＣＭコーダ５で通話路１か
ら３２迄の変調符号化処理が行われる。
７は係数メモリで符号化処理に使われる。
コーグ５からの出力は受信側において、適応形差分ＰＣ
Ｍデコーダ６において通話路ｌがら３２迄のｔｌ ｄＱ
ｆｊｆ号化処理が行われ、デマルチプレクサ４で多重
化が分離され、各通話路がディジタル・アナログ変換回
路２−１．２−２、−１２−３２で３２通話路のアナロ
グ信号に復調される。８は適応形差分ＰＣＭデコ〜ダ６
用の係数メモリである。
Ｍデコーダ６において通話路ｌがら３２迄のｔｌ ｄＱ
ｆｊｆ号化処理が行われ、デマルチプレクサ４で多重
化が分離され、各通話路がディジタル・アナログ変換回
路２−１．２−２、−１２−３２で３２通話路のアナロ
グ信号に復調される。８は適応形差分ＰＣＭデコ〜ダ６
用の係数メモリである。
Ｓ発明が解決しようとする問題点〕
上記従来方式は高品質通話と通常品質の通話に共用する
ことが考慮されていない。
ことが考慮されていない。
伝送周波数帯域幅が一定でサンプリング回数を大にして
高品位通話を行う場合、伝送可能な通話路数は減少する
。例えば電話のような通常品質でもよい通話と会議電話
のように高品位の通話が望まれるような場合、後者に合
わせ回線を設計すると電話に使用する時に収容出来る通
話路数が少なくなり伝送効率が悪くなるという問題があ
る。
高品位通話を行う場合、伝送可能な通話路数は減少する
。例えば電話のような通常品質でもよい通話と会議電話
のように高品位の通話が望まれるような場合、後者に合
わせ回線を設計すると電話に使用する時に収容出来る通
話路数が少なくなり伝送効率が悪くなるという問題があ
る。
上記の問題点を解決するため、本発明はｎ通話路時分割
多重化処理装置のｍ通話路（ｍ≦ｎ ／ ２）目とｍ＋
ｎ／２通話路目通話少目グ・ディジタル変換器のサンプ
リング時期を、サンプリングパルスの繰返周期の半周期
分ずらしておき、高品位通信を行うときは、例えば、上
記ｍ通話路とｍ＋ｎ／２通話路に対応して設けたアナロ
グ・ディジタル変換回路に入力するようにした。
多重化処理装置のｍ通話路（ｍ≦ｎ ／ ２）目とｍ＋
ｎ／２通話路目通話少目グ・ディジタル変換器のサンプ
リング時期を、サンプリングパルスの繰返周期の半周期
分ずらしておき、高品位通信を行うときは、例えば、上
記ｍ通話路とｍ＋ｎ／２通話路に対応して設けたアナロ
グ・ディジタル変換回路に入力するようにした。
本発明によれば、サンプリングパルスの繰返周期を半周
期分ずらしたｍ番目とｍ ＋ ｎ ７２番目の通話路は
、通常品質の伝送の際にはアナログ・ディジタル変換回
路１−ｎ＋ 、１−ｍ＋ ｎ／２でそれぞれ独立の通話
路信号となり、ＡＤＰＣＭ変換部の係数メモリアドレス
部もｎ多重用に、またディジタル・アナログ変換回路２
−ｍ ２−ｍ＋ ｎ／２はそれぞれ独立の通話路信号を
出力するように切替回路が切り替えられ、伝送システム
はｎ多電化システムとして働く。
期分ずらしたｍ番目とｍ ＋ ｎ ７２番目の通話路は
、通常品質の伝送の際にはアナログ・ディジタル変換回
路１−ｎ＋ 、１−ｍ＋ ｎ／２でそれぞれ独立の通話
路信号となり、ＡＤＰＣＭ変換部の係数メモリアドレス
部もｎ多重用に、またディジタル・アナログ変換回路２
−ｍ ２−ｍ＋ ｎ／２はそれぞれ独立の通話路信号を
出力するように切替回路が切り替えられ、伝送システム
はｎ多電化システムとして働く。
高品質の伝送の際には、上記両道話路は切替回路によっ
て組合われ、即ちｍ番目の通話路信号はアナログ・ディ
ジタル変換回路１−ｍ、１−ｍ＋ ｎ／２の両方へ供給
されサンプリング数が倍増され、ＰＣＭ変換部の係数メ
モリアドレス部もｎ／２多重用に切り替えられまた、受
信側においてはディジタル・アナログ変換回路２−ｍに
て２個の通話路を合成した受信出力を得る。
て組合われ、即ちｍ番目の通話路信号はアナログ・ディ
ジタル変換回路１−ｍ、１−ｍ＋ ｎ／２の両方へ供給
されサンプリング数が倍増され、ＰＣＭ変換部の係数メ
モリアドレス部もｎ／２多重用に切り替えられまた、受
信側においてはディジタル・アナログ変換回路２−ｍに
て２個の通話路を合成した受信出力を得る。
このようにしてｎ通話路多重システムはｎ／２通話路多
重システムに切り替えられ、通常の伝送システムと高品
質伝送システムが容易に実現される。
重システムに切り替えられ、通常の伝送システムと高品
質伝送システムが容易に実現される。
以下図示実施例に従い本発明の要旨を詳細に説明する。
第１図は本発明による適応形差分ＰＣＭ多重通信システ
ムのブロック構成図、第２図はアナログ・ディジタル変
換回路のブロック図、第３図はアナログ・ディジタル変
換回路のサンプリング波形図、第４図はＡＤＰＣＭ部の
切替回路、第５図はディジクル・アナログ変換回路のブ
ロック図、第６図はディジタル・アナログ変換回路の動
作波形図、また第７図は３２通話路パルス時分割多重通
信システムにおける３２及び１６通話路処理切り替え前
後の各通話路波形のタイムチャートを示す。
ムのブロック構成図、第２図はアナログ・ディジタル変
換回路のブロック図、第３図はアナログ・ディジタル変
換回路のサンプリング波形図、第４図はＡＤＰＣＭ部の
切替回路、第５図はディジクル・アナログ変換回路のブ
ロック図、第６図はディジタル・アナログ変換回路の動
作波形図、また第７図は３２通話路パルス時分割多重通
信システムにおける３２及び１６通話路処理切り替え前
後の各通話路波形のタイムチャートを示す。
第１図において、ｎ通話路の音声信号（：ｌ１ｌ−ＣＩ
Ｉｎは左側から入力し、切替回路９−１．９−２、−１
９−ｎ／２、アナログ・ディジタル変換回路１−１、−
１−ｎ、マルチプレックサ３、コーグ５を介し伝送路へ
送出され、受信側で、デコーダ６、デマルチプレックサ
４、ディジタル・アナログ変換回路２−１、−１２−ｎ
を介し元の音声信号ＣＨＩ 、−２ＣＨｎに復元される
。本発明により、本システムは第ｍ通話路と第ｍ＋ｎ／
２通話路のアナログ・ディジタル変換回路１−ｍと１−
ｍ十ｎ／２には、マルチプレックサ回路３の８ ＫＨ
ｚの同期パルス１２から導出された互いに半周期ずれた
８ ＫＨｚのサンプリングパルスが供給される。また該
両変換回路の入力部には通話路数切替用切替回路９−ｍ
が設けられている。
Ｉｎは左側から入力し、切替回路９−１．９−２、−１
９−ｎ／２、アナログ・ディジタル変換回路１−１、−
１−ｎ、マルチプレックサ３、コーグ５を介し伝送路へ
送出され、受信側で、デコーダ６、デマルチプレックサ
４、ディジタル・アナログ変換回路２−１、−１２−ｎ
を介し元の音声信号ＣＨＩ 、−２ＣＨｎに復元される
。本発明により、本システムは第ｍ通話路と第ｍ＋ｎ／
２通話路のアナログ・ディジタル変換回路１−ｍと１−
ｍ十ｎ／２には、マルチプレックサ回路３の８ ＫＨ
ｚの同期パルス１２から導出された互いに半周期ずれた
８ ＫＨｚのサンプリングパルスが供給される。また該
両変換回路の入力部には通話路数切替用切替回路９−ｍ
が設けられている。
ＡＤＰＣＭ部のコーグ５と係数メモリ７、デコーダ６と
係数メモリ８の間にはアドレス変更のための切替回路１
１が設けられ。
係数メモリ８の間にはアドレス変更のための切替回路１
１が設けられ。
さらに、第ｍ通話路と第ｍ＋ｎ／２通話路のディジタル
・アナログ変換回路２−ｍと、２− ｍ＋ｎ／２の入力
部には通話路数切替回路１０−ｍが設けられる。
・アナログ変換回路２−ｍと、２− ｍ＋ｎ／２の入力
部には通話路数切替回路１０−ｍが設けられる。
第１図のシステム動作の詳細は第２図乃至第７図の３２
多重の一実施例に従って説明される。
多重の一実施例に従って説明される。
第２図において、通話路ＣＨ１と通話路Ｃ旧７は切替回
路９−１を介してアナログ・ディジタル変換回路１−１
．１４７に接続され、切替回路９−１は接点ａｂを備え
、接点が実線で示すａ側にあるときはＣ１１１とＣ１１
１７の音声信号はそれぞれ独立にアナログ・ディジタル
変換回路１−１．１−１７を介し、マルチプレックサ回
路３へ供給され、接点が破線のｂ側に切り替えられると
、Ｃ）１１だけの音声信号がアナログ・ディジタル変換
回路１−１．１−１７の両回路に与えられる。 変換回
路１−１、■−１７には８ＫＨｚのサンプリングパルス
１２−１．１２−１７が供給される。
路９−１を介してアナログ・ディジタル変換回路１−１
．１４７に接続され、切替回路９−１は接点ａｂを備え
、接点が実線で示すａ側にあるときはＣ１１１とＣ１１
１７の音声信号はそれぞれ独立にアナログ・ディジタル
変換回路１−１．１−１７を介し、マルチプレックサ回
路３へ供給され、接点が破線のｂ側に切り替えられると
、Ｃ）１１だけの音声信号がアナログ・ディジタル変換
回路１−１．１−１７の両回路に与えられる。 変換回
路１−１、■−１７には８ＫＨｚのサンプリングパルス
１２−１．１２−１７が供給される。
サンプリングパルスの波形図は第３図にあり、Ｃ１１１
とＣＨ７、ＣＨ２とＣＨ１８の間でそれぞれ３ Ｋ ｆ
ｌ ｚの半周期骨づつ位相差がある。
とＣＨ７、ＣＨ２とＣＨ１８の間でそれぞれ３ Ｋ ｆ
ｌ ｚの半周期骨づつ位相差がある。
ＣＨＩからの音声信号は切替回路の接点がａ！こあると
きは８ＫＨｚのサンプリング波にてサンプリングされ、
また接点がｂにあるときは２個の半周期ずれた８ ＫＨ
ｚのサンプリング波にて倍速度にてサンプリングされる
ことになる。
きは８ＫＨｚのサンプリング波にてサンプリングされ、
また接点がｂにあるときは２個の半周期ずれた８ ＫＨ
ｚのサンプリング波にて倍速度にてサンプリングされる
ことになる。
ディジタル変換された信号は多重化されたのち、適応形
差分ＰＣＭ部に送られ、該ＰＣＭ部は第４図のように切
替回路１１を備え、３２通話路処理と１６通話路処理に
応じてＡＤＰＣＭ部と係数メモリ間の接続を切り替え、
１６通話路処理に際しては最高ビットを地気に接続する
。
差分ＰＣＭ部に送られ、該ＰＣＭ部は第４図のように切
替回路１１を備え、３２通話路処理と１６通話路処理に
応じてＡＤＰＣＭ部と係数メモリ間の接続を切り替え、
１６通話路処理に際しては最高ビットを地気に接続する
。
受信側で分離されたディジタル信号は第５図のディジタ
ル・アナログ変換回路へ与えられる。変換回路の入力部
には切替回路１０−１があり、該切替回路は、通話路１
と通話路１７を入力とし８ ＫＨｚサンプリング用矩形
波信号１３−１或いは地気を制御信号とするセレクタを
もつ。
ル・アナログ変換回路へ与えられる。変換回路の入力部
には切替回路１０−１があり、該切替回路は、通話路１
と通話路１７を入力とし８ ＫＨｚサンプリング用矩形
波信号１３−１或いは地気を制御信号とするセレクタを
もつ。
第６図にはセレクタの制御信号と入力信号とが示される
。
。
スイッチがａ側にあるときは、１３−１の制御信号がセ
レクタに与えられる。セレクタは、制御信号波形がハイ
レベルにある間のみ入力信号を通過させるので、図示の
場合、Ｃ旧のディジタル信号はセレクタを通過出来るが
、ＣＨ１７のディジタル信号はローレベルの制御信号と
なるので通過出来ない。
レクタに与えられる。セレクタは、制御信号波形がハイ
レベルにある間のみ入力信号を通過させるので、図示の
場合、Ｃ旧のディジタル信号はセレクタを通過出来るが
、ＣＨ１７のディジタル信号はローレベルの制御信号と
なるので通過出来ない。
従って、変換回路２−１にはＣＨＩの信号だけが供給さ
れ、また変換回路２−１７にはＣ１１１７の信号だけが
供給される。
れ、また変換回路２−１７にはＣ１１１７の信号だけが
供給される。
スイッチがｂ側にあるときは、１０−１のセレクタはＣ
ＨＩ とＣＨ１７のディジタル信号をディジタル・アナ
ログ変換回路２−１に供給、該変換回路の出力部に、２
個の通話路の合成信号を音声信号ＣＨＩとして出力する
。
ＨＩ とＣＨ１７のディジタル信号をディジタル・アナ
ログ変換回路２−１に供給、該変換回路の出力部に、２
個の通話路の合成信号を音声信号ＣＨＩとして出力する
。
この際、送信側では、Ｃ）ＩＩの音声信号が２個のアナ
ログ・ディジタル変換回路１−１．１−１７に２分され
たており、受信側で、１個のディジタル・アナログ変換
回路にて２通話路の信号が合成されて音声信号ＣＨＩに
戻る。
ログ・ディジタル変換回路１−１．１−１７に２分され
たており、受信側で、１個のディジタル・アナログ変換
回路にて２通話路の信号が合成されて音声信号ＣＨＩに
戻る。
第７図において、
（ａ）列はマルチプレクサ３並びにデマルチプレクサ４
に供給される８ＫＨｚ同期パルス１２．１３、（ｂ）列
はアナログ・ディジタル変換回路１−１の８ＫＨｚサン
プリングパルス１２−１、（ｃ）列はアナログ・ディジ
タル変換回路１−１７の８ＫＨｚサンプリングパルス１
２−１７、（ｄ）列は３２通話路多重処理に切り替えた
ときのマルチプレクサ３及びデマルチプレクサ４の出力
信号、 （ｅ）列は８ Ｋ Ｈｚのサンプリング信号で、切替回
路１０−１のセレクタの制御信号１３−１、（ｆ）列は
１６通話路多重処理に切り替えたときのマルチプレクサ
３及びデマルチプレクサ４の出力信号を示す。
に供給される８ＫＨｚ同期パルス１２．１３、（ｂ）列
はアナログ・ディジタル変換回路１−１の８ＫＨｚサン
プリングパルス１２−１、（ｃ）列はアナログ・ディジ
タル変換回路１−１７の８ＫＨｚサンプリングパルス１
２−１７、（ｄ）列は３２通話路多重処理に切り替えた
ときのマルチプレクサ３及びデマルチプレクサ４の出力
信号、 （ｅ）列は８ Ｋ Ｈｚのサンプリング信号で、切替回
路１０−１のセレクタの制御信号１３−１、（ｆ）列は
１６通話路多重処理に切り替えたときのマルチプレクサ
３及びデマルチプレクサ４の出力信号を示す。
（ｄ）（ｆ）列の波形中に示される番号は通話路番号で
ある。
ある。
３２多重処理を１６多重処理にすると、８ Ｋ １１
ｚのサンプリングが１６ＫＩｌｚのサンプリングとなり
、伝送品質が向上する。
ｚのサンプリングが１６ＫＩｌｚのサンプリングとなり
、伝送品質が向上する。
本発明は、サンプリングパルスに特定の位相差をもたせ
ることにより、簡単な切替回路を用いて伝送品質の切り
替えを可能とするものであり、その作用効果は極めて大
きい。
ることにより、簡単な切替回路を用いて伝送品質の切り
替えを可能とするものであり、その作用効果は極めて大
きい。
第１図は本発明による適応形差分ＰＣＭ多重通信システ
ムの原理図、 第２図はアナログ・ディジタル変換回路のブロック図、 第３図はアナログ・ディジタル変換回路のサンプリング
波形図、 第４図はＡＤＰＣＭ部の切替回路図、 第５図はディジタル・アナログ変換回路のブロック図、 第６図はディジタル・アナログ変換回路の動作波形図、 第７図はパルス時分割多重通信システムにおける３２及
び１６通話路処理切り替え前後の各通話路波形のタイム
チャート、 第８図は従来の適応形差分ＰＣｔ’１時分割多重伝送シ
ステムのブロック構成図である。 図において、 Ｌｌ 、−１Ｌｍ ％−１１−ｎはアナログ・ディジタ
ル変換回路、 ２−１、−１２−ｍ 、−１２−ｎはディジタル・アナ
ログ変換回路、 ３はマルチプレクサ、 ４はデマルチプレクサ、 ５は適応形差分ＰＣＭコーダ、 ６は適応形差分ＰＣＭデコーダ、 ７．８は係数メモリ、 ９−１．９−２、〜．９−ｎ／２はアナログ・ディジタ
ル変換回路用の切替回路 １０−１．１０−２、−１１０−ｎ／２はディジタル・
アナログ変換回路用切替回路、 １１はコーグ、デコーダ用切替回路、 １２．１３は８ Ｋ）Ｉｚ同期パルス、１２−１．１２
−２、− はアナログ・ディジタル変換回路のサンプリ
ングパルス、 １３−１．１３−２、− はディジタル・アナログ変換
回路のサンプリングパルス、 ＣＨＩ 、Ｃ１１２、−は通話路１、通話路２等を示す
。
ムの原理図、 第２図はアナログ・ディジタル変換回路のブロック図、 第３図はアナログ・ディジタル変換回路のサンプリング
波形図、 第４図はＡＤＰＣＭ部の切替回路図、 第５図はディジタル・アナログ変換回路のブロック図、 第６図はディジタル・アナログ変換回路の動作波形図、 第７図はパルス時分割多重通信システムにおける３２及
び１６通話路処理切り替え前後の各通話路波形のタイム
チャート、 第８図は従来の適応形差分ＰＣｔ’１時分割多重伝送シ
ステムのブロック構成図である。 図において、 Ｌｌ 、−１Ｌｍ ％−１１−ｎはアナログ・ディジタ
ル変換回路、 ２−１、−１２−ｍ 、−１２−ｎはディジタル・アナ
ログ変換回路、 ３はマルチプレクサ、 ４はデマルチプレクサ、 ５は適応形差分ＰＣＭコーダ、 ６は適応形差分ＰＣＭデコーダ、 ７．８は係数メモリ、 ９−１．９−２、〜．９−ｎ／２はアナログ・ディジタ
ル変換回路用の切替回路 １０−１．１０−２、−１１０−ｎ／２はディジタル・
アナログ変換回路用切替回路、 １１はコーグ、デコーダ用切替回路、 １２．１３は８ Ｋ）Ｉｚ同期パルス、１２−１．１２
−２、− はアナログ・ディジタル変換回路のサンプリ
ングパルス、 １３−１．１３−２、− はディジタル・アナログ変換
回路のサンプリングパルス、 ＣＨＩ 、Ｃ１１２、−は通話路１、通話路２等を示す
。
Claims (1)
- 【特許請求の範囲】 ｎ通話路時分割多重化処理装置のｍ通話路目のサンプリ
ング時期とｍ＋ｎ／２通話路目のサンプリング時期を、
サンプリングパルスの繰返周期の半周期分ずらし、 高品位通信時、上記ｍ（またはｍ＋ｎ／２）通話路の信
号をｍ通話路およびｍ＋ｎ／２通話路用のアナログ・デ
ィジタル変換回路に入力することをを特徴とする時分割
多重通信方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3796685A JPS61198833A (ja) | 1985-02-27 | 1985-02-27 | 時分割多重通信方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3796685A JPS61198833A (ja) | 1985-02-27 | 1985-02-27 | 時分割多重通信方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61198833A true JPS61198833A (ja) | 1986-09-03 |
Family
ID=12512304
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3796685A Pending JPS61198833A (ja) | 1985-02-27 | 1985-02-27 | 時分割多重通信方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61198833A (ja) |
-
1985
- 1985-02-27 JP JP3796685A patent/JPS61198833A/ja active Pending
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