JPS61196531A - 電子線描画装置 - Google Patents

電子線描画装置

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Publication number
JPS61196531A
JPS61196531A JP3640285A JP3640285A JPS61196531A JP S61196531 A JPS61196531 A JP S61196531A JP 3640285 A JP3640285 A JP 3640285A JP 3640285 A JP3640285 A JP 3640285A JP S61196531 A JPS61196531 A JP S61196531A
Authority
JP
Japan
Prior art keywords
data
chip
field
corollary
center
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3640285A
Other languages
English (en)
Inventor
Tadao Konishi
小西 忠雄
Akira Yanagisawa
柳沢 章
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP3640285A priority Critical patent/JPS61196531A/ja
Publication of JPS61196531A publication Critical patent/JPS61196531A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Electron Beam Exposure (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明は、微小チップを多数描画する場合のデータ合成
による一括描画に関する。
〔発明の背景〕
従来、電子線の調向による描画範囲(以下フィールドと
云う)以下のチップについては、lテンプlフィールド
のデータを作成し、lチップ毎にステージを移動しなが
ら汲畝チップを描画している。友とえは、100鴫 に
0.3 m  のチップを描画する場合、10万回のス
テージ移動を伴い、スループントの低下を生じ実用的で
なかつfc。
〔発明の目的〕
本発明の目的は、複数チップのデータをマトリクス状に
配列し、1つのフィールド(ステージの移動を半なわず
に描画できる領域)としての複合データを作成し、あた
かも、一つのチップとして、複数チップを描画可能とす
る装置を提供することある。
〔発明の概要〕
第1図に示すように、電子線源、電子レンズおよび偏向
器等から構成される電子光学系1と、試料3を移動させ
るステージとからなる電子線描画装置で、偏向器2で描
画できる範囲(フィールド4)を描画後、試料3を移動
させ、再び描画を行う、いわゆるステップマントリピー
ト方式のものでは、微小テンプデータは、lチップlフ
ィールドの描画データとなるため、試料を1チツプ毎に
移動させる必要がある。そのため移動回数が増加する欠
点があった。本発明では、複数データ乞配列し、複数デ
ータのアドレス情報を配列情報に従い修正し、複数チッ
プ分のデータを一つのフィールドデータとして合成する
機能を咀子線描画装置に付加する。同一チップのデータ
を複数配列する場合は、相対アドレスを用いる事により
、同一データの繰返しをさけ、データ量を増大させる事
なく合成する事ができる。
〔発明の実施例〕
例としてマスク描画における実施例を示す。第2図に於
て、5eまマスク全体の描画域を示す。5は、電子線の
偏向制御で描画し得る範囲すなわちフィールド4を描画
した後、フィールド間をステージ移動によシ移動させ、
描画を繰かえすことで5全体が描画される。
フィールド4の内部は、チンプロが複数個配列されてい
る。チップデータは元来、例えばチップ中心を原点とし
た座標系で衆現されている。その座標系をフィールド中
心を原点とする座標系に、配列情報を元に変換しデータ
を合成する事で、複数チップデータを1フイールドデー
タとしてまとめる事ができる。lフィールドデータとし
てまとまった場合は試料の移動を早わず、複数チップを
描画できる。
同一チップを配列する場合は、繰かえし配列する/こめ
、描画データが増大する無駄が生じる。この場合は、1
チツプ内を1つ又は複数個の領域にわけ、領域中心を原
点とする座標系でデータを表現(例として4つにわけた
場合を示す)すれば各領域毎、全く同じ図形データとし
て表現できる。
(A、B、C・・・それぞれ)。しかるのち、各領域中
心を、フィールド中心とする座標系で表現するデータ7
.8を作成すれば、同一データt−a数持つことなく、
データを表現できる。
〔発明の効果〕
0.3鴎 チップを300X300=90000ケ描画
する場合、六ツブ毎にステージを移動するとすれば、0
,3秒で1ステツプ移動するとしても、aoooo秒の
移動時間がかかる。3關 フィールドを仮定し、1Ox
tO=100ケのチップelフィールドとして配列した
とき、ステージ移動回数は900回移動時間で300秒
と100分のlに短縮できる。
【図面の簡単な説明】
第1図は描画装置及び描画手順を示す図、第2図はlフ
ィールド内に複数チップデータを配列し一つに合成した
実施例を示す図である。 1・・・電子光学系、2・・・偏向器、3・・・試料、
4・・・フィールド、5・・・マスク描画域、6・・・
微小チップ、7、訃・・フィールド中心を原点とする領
域中心アドレス。

Claims (1)

    【特許請求の範囲】
  1. 1、ステージ移動と電子線制御を組合せたステップアン
    ドリピート方式の電子線描画装置に於て、小チップの描
    画を行う場合複数チップのデータを合成し複合データを
    作成する機能を有しステージの移動を伴わずに複数チッ
    プを描画する事を特徴とする電子線描画装置。
JP3640285A 1985-02-27 1985-02-27 電子線描画装置 Pending JPS61196531A (ja)

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JP3640285A JPS61196531A (ja) 1985-02-27 1985-02-27 電子線描画装置

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JPS61196531A true JPS61196531A (ja) 1986-08-30

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JP (1) JPS61196531A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61292320A (ja) * 1985-05-20 1986-12-23 Fujitsu Ltd 電子ビ−ム露光装置
JP2002184681A (ja) * 2000-12-19 2002-06-28 Jeol Ltd 荷電粒子ビーム描画方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61292320A (ja) * 1985-05-20 1986-12-23 Fujitsu Ltd 電子ビ−ム露光装置
JP2002184681A (ja) * 2000-12-19 2002-06-28 Jeol Ltd 荷電粒子ビーム描画方法

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