JPS611912U - 増幅器の入力バイアス調整回路 - Google Patents

増幅器の入力バイアス調整回路

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JPS611912U
JPS611912U JP8651084U JP8651084U JPS611912U JP S611912 U JPS611912 U JP S611912U JP 8651084 U JP8651084 U JP 8651084U JP 8651084 U JP8651084 U JP 8651084U JP S611912 U JPS611912 U JP S611912U
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JP
Japan
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transistor
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circuit
input
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JP8651084U
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JPS6324653Y2 (ja
Inventor
亮 西岡
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パイオニア株式会社
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
− 第１図は本考案の実施例回路図、第２図は第１図回
路の基礎となる構成を示す回路図、第３図は従来の入力
バイアス調整回路の例を説明する図である。 主要部分の符号の説明、１・・・・・・第１の電流ミラ
ー回路、２・・・・・・第２の電流ミラー回路、Ｑ１〜
Ｑ、６・・・・・・ＮＰＮトランジスタ、Ｑ７〜Ｑ２０
・・・・・・ＰＮＰ Ｉ−ランジスタ。

Claims (2)

    【実用新案登録請求の範囲】
  1. （１）入力段が差動増幅回路構成の帰還型増幅器におけ
    る入力バイアス調整回路であって、前記増幅回路の定電
    流源を構成する第１の電流ミラー回路と、前記定電流値
    を定めるミラー電源に応じた電流を前記第１の電流ミラ
    ー回路から導出してこの導出電流を所望値に変換する電
    流変換手段とを含み、前記電流交換手段はベース及びコ
    レクタが夫々共通接続された４個のトランジスタ群と前
    記トランジスタ群の共通ベースに接続されたベースを有
    する第１のトランジスタとを有する第２の電流ミラー回
    路と、前記トランジスタ群のコレクタ出力をエミツタ入
    力としかつベースから前記第１の電流ミラー回路のベー
    ス共通接続トランジスタのベースバイアス電流を導出す
    る第２のトランジスタと、前記第２の電流ミラー回路の
    第１のトランジスタのコレクタ出力をエミツタ入力とす
    る第３のトランジスタとを含み、前記第３のトランジス
    タのベース電流を前記差動増幅回路入力信号印加用トラ
    ンジスタのベースへ供給することを特徴とする増幅器の
    入力バイアス調整回路。
  2. （２） 前記電流変換手段は更に、前記第２の電流ミ
    ラー回路のトランジスタ群の共通ベースに接続されたベ
    ースを有する第４のトランジスタと、前記第４のトラン
    ジスタのコレクタ出力をエミツタ入力とする第５のトラ
    ンジスタを有し、前記第５のトランジスタのベース電流
    を前記差動増幅回路の帰還入力印加用トランジスタのベ
    ースへ供給することを特徴とする実用新案登録請求の範
    囲第１項記載の回路。
JP8651084U 1984-06-11 1984-06-11 増幅器の入力バイアス調整回路 Granted JPS611912U (ja)

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JPS611912U true JPS611912U (ja) 1986-01-08
JPS6324653Y2 JPS6324653Y2 (ja) 1988-07-06

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