JPS61189355U - - Google Patents
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- Publication number
- JPS61189355U JPS61189355U JP7244685U JP7244685U JPS61189355U JP S61189355 U JPS61189355 U JP S61189355U JP 7244685 U JP7244685 U JP 7244685U JP 7244685 U JP7244685 U JP 7244685U JP S61189355 U JPS61189355 U JP S61189355U
- Authority
- JP
- Japan
- Prior art keywords
- computers
- computer
- control device
- outputs
- memory circuit
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Multi Processors (AREA)
Description
第１図は本考案の実施例による計算機の二重化
制御装置のブロツク図、第２図は本考案の実施例
による計算機の二重化制御装置の動作を表わすフ
ローチヤートである。 １……二重化制御装置、２……第１の計算機、
３……第２の計算機、４……切り換えスイツチ、
５……入出力装置、１１……マイクロプロセツサ
、１２……不揮発性メモリ回路、１２１……ラン
ダム・アクセス・メモリＲＡＭ，１２２……バツ
テリ。
制御装置のブロツク図、第２図は本考案の実施例
による計算機の二重化制御装置の動作を表わすフ
ローチヤートである。 １……二重化制御装置、２……第１の計算機、
３……第２の計算機、４……切り換えスイツチ、
５……入出力装置、１１……マイクロプロセツサ
、１２……不揮発性メモリ回路、１２１……ラン
ダム・アクセス・メモリＲＡＭ，１２２……バツ
テリ。
Claims (1)
- 第１、２の計算機によつて二重化された計算機
を監視してどちらか一方の計算機を切り換える切
り換え信号を出力する二重化制御装置において、
現在制御権を持つている計算機側を記憶する不揮
発性メモリ回路と、この不揮発性メモリ回路の記
憶内容を判断して前記第１、２の計算機の切り換
え信号を出力することを特徴とする計算機の二重
化制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7244685U JPS61189355U (ja) | 1985-05-16 | 1985-05-16 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7244685U JPS61189355U (ja) | 1985-05-16 | 1985-05-16 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61189355U true JPS61189355U (ja) | 1986-11-26 |
Family
ID=30610854
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7244685U Pending JPS61189355U (ja) | 1985-05-16 | 1985-05-16 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61189355U (ja) |
-
1985
- 1985-05-16 JP JP7244685U patent/JPS61189355U/ja active Pending
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