JPS61168449U - - Google Patents
Info
- Publication number
- JPS61168449U JPS61168449U JP4996686U JP4996686U JPS61168449U JP S61168449 U JPS61168449 U JP S61168449U JP 4996686 U JP4996686 U JP 4996686U JP 4996686 U JP4996686 U JP 4996686U JP S61168449 U JPS61168449 U JP S61168449U
- Authority
- JP
- Japan
- Prior art keywords
- address
- data
- set time
- time
- clocking
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 244000145845 chattering Species 0.000 claims 3
- 238000001514 detection method Methods 0.000 claims 3
- 238000000034 method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 1
Landscapes
- Debugging And Monitoring (AREA)
Description
第１図は本考案の一実施例を示すブロツク図、
第２図は第１図ＲＡＭ内のレジスタ構成図、第３
図は第１図プログラム記憶用ＲＡＭのプログラム
記憶状態図、第４図はプログラムの各命令と表示
フオーマツトの関係を示す変換テーブル、第５図
は同例の動作を説明するためのフローチヤート、
第６図ａ，ｂはＦＳＴキー操作とプログラム内容
の表示との関係を示す状態図、第７図は第１図表
示部におけるプログラム内容の表示装置を示す図
である。 １０……入力部、１０４……ＦＳＴキー、１０
５……ＢＳＴキー、１２……演算回路、１３……
ＲＯＭアドレス部、１４……ＲＯＭ、１５……Ｒ
ＡＭ、２１……プログラム記憶用ＲＡＭ、２３…
…表示部、２５……デコーダ、２７……表示コー
ド記憶ＲＯＭ、２９……インストラクシヨンデコ
ーダ、３０……プログラムカウンタ。
第２図は第１図ＲＡＭ内のレジスタ構成図、第３
図は第１図プログラム記憶用ＲＡＭのプログラム
記憶状態図、第４図はプログラムの各命令と表示
フオーマツトの関係を示す変換テーブル、第５図
は同例の動作を説明するためのフローチヤート、
第６図ａ，ｂはＦＳＴキー操作とプログラム内容
の表示との関係を示す状態図、第７図は第１図表
示部におけるプログラム内容の表示装置を示す図
である。 １０……入力部、１０４……ＦＳＴキー、１０
５……ＢＳＴキー、１２……演算回路、１３……
ＲＯＭアドレス部、１４……ＲＯＭ、１５……Ｒ
ＡＭ、２１……プログラム記憶用ＲＡＭ、２３…
…表示部、２５……デコーダ、２７……表示コー
ド記憶ＲＯＭ、２９……インストラクシヨンデコ
ーダ、３０……プログラムカウンタ。
Claims (1)
- 特定キーを有し、少なくともデータを入力する
ための複数のキーを有するキー入力手段と、該キ
ー入力手段から入力された複数のデータを記憶す
る記憶手段と、該記憶手段のアドレスを指定する
ためのアドレス指定手段と、該アドレス指定手段
のアドレスを更新するアドレス更新手段と、上記
特定キーの指示により、上記アドレス指定手段の
アドレス指定に基づいて上記記憶手段に記憶され
ているデータを読出すデータ読出し手段と、該デ
ータ読出し手段により上記記憶手段から読出され
たデータを表示する表示手段と、キーのチヤタリ
ング防止のための所定時間を計時する第１の計時
手段と、上記特定キーの押圧時間を計時する第２
の計時手段と、上記第１の計時手段でチヤタリン
グ防止のための所定時間の計時終了前に、上記特
定キーが操作され、且つ上記第２の計時手段に対
して予め設定された時間中継続して押圧されたこ
とを検出する検出手段と、該検出手段の検出信号
に基づきフラグを記憶するフラグ記憶手段と、該
フラグ記憶手段により記憶されたフラグに従つて
上記第２の計時手段に対し、第１の設定時間ある
いは該第１の設定時間よりは短かい第２の設定時
間を設定する時間設定手段と、上記特定キーの操
作により上記第１の計時手段が上記第１の設定時
間あるいは第２の設定時間を計時する毎に上記ア
ドレス更新手段に対してアドレスを更新せしめる
と共に上記データを読出し手段に対し上記記憶手
段から連続的にデータを読出す様制御する手段と
を具備したことを特徴とする小型電子式計算器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4996686U JPS6230112Y2 (ja) | 1986-04-03 | 1986-04-03 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4996686U JPS6230112Y2 (ja) | 1986-04-03 | 1986-04-03 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61168449U true JPS61168449U (ja) | 1986-10-18 |
| JPS6230112Y2 JPS6230112Y2 (ja) | 1987-08-03 |
Family
ID=30567647
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4996686U Expired JPS6230112Y2 (ja) | 1986-04-03 | 1986-04-03 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6230112Y2 (ja) |
-
1986
- 1986-04-03 JP JP4996686U patent/JPS6230112Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6230112Y2 (ja) | 1987-08-03 |
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