JPS61164532U - - Google Patents

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JPS61164532U
JPS61164532U JP4879785U JP4879785U JPS61164532U JP S61164532 U JPS61164532 U JP S61164532U JP 4879785 U JP4879785 U JP 4879785U JP 4879785 U JP4879785 U JP 4879785U JP S61164532 U JPS61164532 U JP S61164532U
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Description

【図面の簡単な説明】
第1図は本考案の実施例を示す回路図、第2図
は第1図に示された実施例の動作を示す波形図、
第3図及び第4図は従来の動作を説明する波形図
である。 1……スタンバイ制御端子、2,3……NOR
ゲート、4……R−Sフリツプフロツプ、5,7
……インバータ、6……ANDゲート、8……R
−Sフリツプフロツプ、9……コンピユータ回路
、10……データバス、11……クロツクパルス
発生回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 主電源の遮断等によつて印加されるスタンバイ
    要求信号を検出したとき内部動作を停止し、主電
    源の復帰等によつて印加されるスタンバイ解除要
    求信号を検出したとき動作を再開するスタンバイ
    機能を有するマイクロコンピユータに於いて、前
    記スタンバイ要求信号及びスタンバイ解除要求信
    号が印加される入力端子と、所定のスレツシヨル
    ド電圧に設定された入力を有し、該入力の一つに
    前記入力端子が接続されたR−Sフリツプフロツ
    プと、該R−Sフリツプフロツプの入力のスレツ
    シヨルド電圧より低く設定されたスレツシヨルド
    電圧を有する入力が前記入力端子に接続され出力
    が前記R−Sフリツプフロツプの他の入力に接続
    されたインバータとを備え、前記R−Sフリツプ
    フロツプの出力をスタンバイ解除要求信号の検出
    出力とし、前記インバータの出力をスタンバイ要
    求信号の検出出力とすることを特徴とするマイク
    ロコンピユータ。
JP1985048797U 1985-04-02 1985-04-02 Expired JPH0431621Y2 (ja)

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JP1985048797U JPH0431621Y2 (ja) 1985-04-02 1985-04-02

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JP1985048797U JPH0431621Y2 (ja) 1985-04-02 1985-04-02

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Publication Number Publication Date
JPS61164532U true JPS61164532U (ja) 1986-10-13
JPH0431621Y2 JPH0431621Y2 (ja) 1992-07-29

Family

ID=30565391

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Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5415553U (ja) * 1977-07-04 1979-02-01
JPS56147220A (en) * 1980-04-17 1981-11-16 Nec Corp Clock controller
JPS5955521A (ja) * 1982-09-25 1984-03-30 Matsushita Electric Ind Co Ltd 電源回路
JPS5971525A (ja) * 1982-10-18 1984-04-23 Nec Corp 状態制御装置

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5415553U (ja) * 1977-07-04 1979-02-01
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JPS5955521A (ja) * 1982-09-25 1984-03-30 Matsushita Electric Ind Co Ltd 電源回路
JPS5971525A (ja) * 1982-10-18 1984-04-23 Nec Corp 状態制御装置

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Publication number Publication date
JPH0431621Y2 (ja) 1992-07-29

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