JPS61142964A - 電力同期整流器 - Google Patents
電力同期整流器Info
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- JPS61142964A JPS61142964A JP60281853A JP28185385A JPS61142964A JP S61142964 A JPS61142964 A JP S61142964A JP 60281853 A JP60281853 A JP 60281853A JP 28185385 A JP28185385 A JP 28185385A JP S61142964 A JPS61142964 A JP S61142964A
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- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
- H02M3/325—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
- H02M3/3353—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only having at least two simultaneously operating switches on the input side, e.g. "double forward" or "double (switched) flyback" converter
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- H02M3/33576—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only having several active switching elements having at least one active switching element at the secondary side of an isolation transformer
- H02M3/33592—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only having several active switching elements having at least one active switching element at the secondary side of an isolation transformer having a synchronous rectifier circuit or a synchronous freewheeling circuit at the secondary side of an isolation transformer
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02B—CLIMATE CHANGE MITIGATION TECHNOLOGIES RELATED TO BUILDINGS, e.g. HOUSING, HOUSE APPLIANCES OR RELATED END-USER APPLICATIONS
- Y02B70/00—Technologies for an efficient end-user side electric power management and consumption
- Y02B70/10—Technologies improving the efficiency by using switched-mode power supplies [SMPS], i.e. efficient power electronics conversion e.g. power factor correction or reduction of losses in power supplies or efficient standby modes
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- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
この発明は電力整流回路、特にバイポーラ−・スイッチ
ング・トランジスタを組み込んだ電力同期整流器に関す
る。
ング・トランジスタを組み込んだ電力同期整流器に関す
る。
（従来技術）
高密度０ＭＯ８論理、高速度ＢＯＬ論理などの如き装置
に供給する調整された電圧電源のオフラインでの開閉に
おいては、出力整流器内における消費電力は全入力電力
の２０〜３０ノや一セントを占める。
に供給する調整された電圧電源のオフラインでの開閉に
おいては、出力整流器内における消費電力は全入力電力
の２０〜３０ノや一セントを占める。
シリコン整流器からの電力損失は、電力用ショットキー
整流器を代用することによって減少させることができる
。しかしながら、ショットキー整流器による場合でも、
供給電力中における電力消費の減少は認め得る程度であ
る。
整流器を代用することによって減少させることができる
。しかしながら、ショットキー整流器による場合でも、
供給電力中における電力消費の減少は認め得る程度であ
る。
（註釈： ０Ｍ０Ｂ ＝ Ｃｏｍｐｌｅｍｅｎｔａｒｙ
Ｍｅｔａｌ−ＯｘｉｄｅＳｅｍｉ Ｃｏｎｄｕｃｔｏ
ｒ ＝相補型金属酸化膜半導体、Ｋ ＯＬ ＝： Ｅｍ
ｉｔｔｅｒ （１！ｏｕｐｌｅｄ Ｌｏｇｉｃ ＝ ｘ
ミッタ結合型論理） 同期整流器は小電力の信号装置においてはよく知られて
いるが、電力装置としては実用的ではなかった。パイＩ
−ラ・トランジスタは大きな飽和抵抗を示し、かつかな
りの励振ペース電流を必要とする。なお、電力の整流に
は逆方向絶縁破壊特性が不適当であった。その上に、従
来入手可能であったパイ？−ラ・トランジスタの蓄積時
間は、有効な高周波調整器用としては値が大き過ぎた。
Ｍｅｔａｌ−ＯｘｉｄｅＳｅｍｉ Ｃｏｎｄｕｃｔｏ
ｒ ＝相補型金属酸化膜半導体、Ｋ ＯＬ ＝： Ｅｍ
ｉｔｔｅｒ （１！ｏｕｐｌｅｄ Ｌｏｇｉｃ ＝ ｘ
ミッタ結合型論理） 同期整流器は小電力の信号装置においてはよく知られて
いるが、電力装置としては実用的ではなかった。パイＩ
−ラ・トランジスタは大きな飽和抵抗を示し、かつかな
りの励振ペース電流を必要とする。なお、電力の整流に
は逆方向絶縁破壊特性が不適当であった。その上に、従
来入手可能であったパイ？−ラ・トランジスタの蓄積時
間は、有効な高周波調整器用としては値が大き過ぎた。
上記の代わりに、電力用ＭＯ８ＦＥＴ装置が開閉要素と
して使用できる。ただし、現在知られている電力用ＭＯ
８ＩＣＴ装置の逆方向絶縁破壊特性はダイオード（温度
依存性で順方向電圧降下の大きい）のそれに類似してお
り、従ってこのような用途には魅力的ではない。
して使用できる。ただし、現在知られている電力用ＭＯ
８ＩＣＴ装置の逆方向絶縁破壊特性はダイオード（温度
依存性で順方向電圧降下の大きい）のそれに類似してお
り、従ってこのような用途には魅力的ではない。
（註釈： ＭＯ８ＦＢＴ ＝ Ｍｅｔａｌ−Ｏｘｉｄｅ
ＳｅｍｉｃｏｎｄｕＣｔｏｒＦｉｅｌｄ Ｅｆｆｅｃ
ｔ Ｔｒａｎｓｉｓｔｏｒ ＝ −Ｅ−スミ界効果トラ
ンジスタ。） （発明の目的） この発明による電力同期整流器は、その中における作動
に対してバイポーラ型デ／（イスを組み込ンテオリ（マ
サチューセッツ州Ｕｎｉｔｒｏｄｅ Ｃｏｒｐｏ−ｒａ
ｔｉｏｎ ｏｆ Ｌｅｘｉｎｇｔｏｎ社のＢ工ＳＹＮ
）、新規な回路要素によって、その制約を克服している
。
ＳｅｍｉｃｏｎｄｕＣｔｏｒＦｉｅｌｄ Ｅｆｆｅｃ
ｔ Ｔｒａｎｓｉｓｔｏｒ ＝ −Ｅ−スミ界効果トラ
ンジスタ。） （発明の目的） この発明による電力同期整流器は、その中における作動
に対してバイポーラ型デ／（イスを組み込ンテオリ（マ
サチューセッツ州Ｕｎｉｔｒｏｄｅ Ｃｏｒｐｏ−ｒａ
ｔｉｏｎ ｏｆ Ｌｅｘｉｎｇｔｏｎ社のＢ工ＳＹＮ
）、新規な回路要素によって、その制約を克服している
。
ｂｉｓｙｎには数ミリオーム程度の低い飽和抵抗（Ｒｃ
ｅ（ＳＡＴ） ）、高い強制利得での低い飽和電圧、超
高速スイッチング時間、および第１象限ならびに第３象
限スイツチング能力と言う傑出した特徴を備えている。
ｅ（ＳＡＴ） ）、高い強制利得での低い飽和電圧、超
高速スイッチング時間、および第１象限ならびに第３象
限スイツチング能力と言う傑出した特徴を備えている。
その上に、Ｂ工ＳＹＮのパラメータは電力用のＭＯＳＦ
ＥＴに比べて温度係数が低い。まだその上に、この半導
体要素Ｂ工ＳＹＮの整流損失はショットキー、電力用Ｍ
Ｏ８ＦＥＴ 、および従来のシリコン・ダイオード要素
よりも少ない。
ＥＴに比べて温度係数が低い。まだその上に、この半導
体要素Ｂ工ＳＹＮの整流損失はショットキー、電力用Ｍ
Ｏ８ＦＥＴ 、および従来のシリコン・ダイオード要素
よりも少ない。
（発明の構成）
この発明による同期整流回路要素にはＢ工ＳＹＨのスイ
ッチング時間についてのスイッチング・シグナルを自動
調整する機能をも備えている。この調整は特定のｂｉｓ
ｙｎのスイッチング速度に応答することができる。
ッチング時間についてのスイッチング・シグナルを自動
調整する機能をも備えている。この調整は特定のｂｉｓ
ｙｎのスイッチング速度に応答することができる。
単一終端同期整流回路およびプッシュプル同期整流回路
を含む各種の同期整流回路形態が示されている。なお、
回路の具現化には、電圧の調整を行なうために、同期整
流器の・ぐルス幅の変調をも含んでいる。上記の結果に
よる回路は、他の技術によって得られる電源に比べて著
しく効率が良く、価額の低い電源を提供する。
を含む各種の同期整流回路形態が示されている。なお、
回路の具現化には、電圧の調整を行なうために、同期整
流器の・ぐルス幅の変調をも含んでいる。上記の結果に
よる回路は、他の技術によって得られる電源に比べて著
しく効率が良く、価額の低い電源を提供する。
上に述べたこの発明の特徴およびそれ以外の特徴は図面
と併せて以下の詳細な説明によって一層よ（理解されよ
う。
と併せて以下の詳細な説明によって一層よ（理解されよ
う。
（実施例）
第１図に単−終端同期整流器回路刃を示す。回路は、ト
ランジスタＱ１および（１１を同時に導通させることに
より、トランジスタＱ１の電流を、変圧器Ｔ１ の巻
数Ｎ！なる一次巻線および負帰線へのトランジスタＱ２
を通すことによって生かされる。トランジスタ（１１お
よび（１１が生かされている期間の間、主変圧器Ｔ１の
インダクタンスによって電流が発生し、この電流はダイ
オードＤｚおよびＤ２を流れて維持される。変圧器Ｔｌ
には巻数Ｎ２．Ｎ３、およびＮ４のいくつかのセクショ
ンを有する二次巻線があり、これらは、代表的にはその
中にいくつかのタップを備えた単一の巻線によって構成
されている。変圧器Ｔｌの二次のいくつかのセクション
の代りに、幾組かの別々の巻線によって形成され、この
技術部門で知られているような適当な結合要素によって
、それぞれの回路要素に結合されてもよい。
ランジスタＱ１および（１１を同時に導通させることに
より、トランジスタＱ１の電流を、変圧器Ｔ１ の巻
数Ｎ！なる一次巻線および負帰線へのトランジスタＱ２
を通すことによって生かされる。トランジスタ（１１お
よび（１１が生かされている期間の間、主変圧器Ｔ１の
インダクタンスによって電流が発生し、この電流はダイ
オードＤｚおよびＤ２を流れて維持される。変圧器Ｔｌ
には巻数Ｎ２．Ｎ３、およびＮ４のいくつかのセクショ
ンを有する二次巻線があり、これらは、代表的にはその
中にいくつかのタップを備えた単一の巻線によって構成
されている。変圧器Ｔｌの二次のいくつかのセクション
の代りに、幾組かの別々の巻線によって形成され、この
技術部門で知られているような適当な結合要素によって
、それぞれの回路要素に結合されてもよい。
動作は、負荷ＲＬに加えられる出力電圧ｖＯは、巻数Ｎ
ｒを有する誘導子Ｌｌを流れる電流によって充電される
コンデンサＣＯの両端に発生する。この電流は変圧器Ｔ
ｒの中の巻数Ｎ３をもつ二次セクションによって、（１
１および（１１が生かされている間だけ作動するＱ３を
通じて供給される。トランジスタＱ３は巻線Ｎ２の二次
巻線セクションの両端に現れる励振電圧によって生かさ
れる。
ｒを有する誘導子Ｌｌを流れる電流によって充電される
コンデンサＣＯの両端に発生する。この電流は変圧器Ｔ
ｒの中の巻数Ｎ３をもつ二次セクションによって、（１
１および（１１が生かされている間だけ作動するＱ３を
通じて供給される。トランジスタＱ３は巻線Ｎ２の二次
巻線セクションの両端に現れる励振電圧によって生かさ
れる。
トランジスタ（１１および（１１の導通が止まって、こ
んどは変圧器Ｔｌの一次からの電流がダイオードＤｌお
よびＤ２を流れると、Ｑ３はオフとなる。電流が流れて
いる誘導子ＬｌはトランジスタＱ４によって電流を維持
する。トランジスタＱ４は誘導子Ｌ１における巻数Ｎ２
なる二次巻線によって発生される信号により抵抗器Ｒ２
によって生かされる。トランジスタＱ４に電流が流れ始
めると、トランジスタＱ１訊２）、およびＱ３が再び生
かされた後にも、電流は正常に流れ続ける。これは、ト
ランジスタＱ４がＬｌの二次巻線に誘起されるそれぞれ
の信号によって生かされるからである。しかしながらト
ランジスタＱ４は、誘導子Ｌ１の巻線によって発生した
信号を除去すると共にトランジスタＱ４から蓄積電荷を
放電させる巻数Ｎ４の二次巻線からダイオードＤ３を流
れる電流によってオフとなる。なお、トランジスタＱ４
からの電流がダイオードＤ３を流れている限りは、その
中で発生された励起信号に反対する信号が巻数Ｎ２０巻
線に発生するが、この信号はトランジスタＱ３を生かせ
る。ダイオードＤ３を流れる電流が停止すると、変圧器
Ｔｌの巻数Ｎ２なる二次セクション中にトランジスタＱ
３に対する励起信号が発生して、トランノスタＱ３を再
び導通させる。それ故に、完全なサイクルが無限に継続
される。
んどは変圧器Ｔｌの一次からの電流がダイオードＤｌお
よびＤ２を流れると、Ｑ３はオフとなる。電流が流れて
いる誘導子ＬｌはトランジスタＱ４によって電流を維持
する。トランジスタＱ４は誘導子Ｌ１における巻数Ｎ２
なる二次巻線によって発生される信号により抵抗器Ｒ２
によって生かされる。トランジスタＱ４に電流が流れ始
めると、トランジスタＱ１訊２）、およびＱ３が再び生
かされた後にも、電流は正常に流れ続ける。これは、ト
ランジスタＱ４がＬｌの二次巻線に誘起されるそれぞれ
の信号によって生かされるからである。しかしながらト
ランジスタＱ４は、誘導子Ｌ１の巻線によって発生した
信号を除去すると共にトランジスタＱ４から蓄積電荷を
放電させる巻数Ｎ４の二次巻線からダイオードＤ３を流
れる電流によってオフとなる。なお、トランジスタＱ４
からの電流がダイオードＤ３を流れている限りは、その
中で発生された励起信号に反対する信号が巻数Ｎ２０巻
線に発生するが、この信号はトランジスタＱ３を生かせ
る。ダイオードＤ３を流れる電流が停止すると、変圧器
Ｔｌの巻数Ｎ２なる二次セクション中にトランジスタＱ
３に対する励起信号が発生して、トランノスタＱ３を再
び導通させる。それ故に、完全なサイクルが無限に継続
される。
電力用のブツシュゾル同期整流回路（４）を第２図に示
す。エネルギーはトランジスタＱ、ｔおよびｑ２を交互
に励起して変圧器Ｔ１の一次巻線を交互に励磁すること
によって供給される。この場合に、それぞれのトランジ
スタの励起時間は、実質的に同等である。トランジスタ
Ｑ１およびＱｚの励起時間は両者を合わせて、トランジ
スタｑ１およびＱｚにおける電荷の消失を可能ならしめ
、それによってトランジスタＱ１およびＱｚが同時に励
起されることの生ずるのを避けるためのデッド・タイム
と称する短かい介在時間を除いて、実質的に励起サイク
ルの全体の時間的な期間を形成する。負荷ＲＬに加えら
れる出力電圧ｖＯは、前記の回路５０におけると同様な
方法によって、誘導子Ｌｌを流れる電流により、コンデ
ンサＣＯの両端に発生する。誘導子Ｌｌは巻数Ｎ２
またはＮ３を有する二次巻線セクションのいずれかが、
トランジスタＱ３およびＱ４がそれぞれに励起されるこ
とによって流れる電流によって交互に励磁される。トラ
ンジスタｑ３およびＱ４はそれぞれ巻数Ｎ１およびＮ４
を有する二次セクションによって発生し、それぞれが抵
抗Ｒ＋ ？通過するシグナルによって励起される。誘導
子Ｌｌの巻数Ｎ２なる第２巻線は、選択的にダイオード
Ｄ２およびＤ３を経てそれぞれトランジスタＱ３および
Ｑ４に供給される励起打消しシグナルをＲ２を経由して
与える。このようにして与えられるシグナルは、それぞ
れのベース領域に蓄積されている電荷を放電させてトラ
ンジスタＱ３およびＱ４のターンオフ特性を向上させる
。トランジスタＱ３およびＱ４のいずれもが導電性でな
いときに、前記のデッド・タイムの期間内に、誘導子Ｌ
１からの電流がダイオードＤ１を経て供給され、この電
流はトランジスタＱ、３またはＱ４のいずれかが導電性
となるまで維持される。
す。エネルギーはトランジスタＱ、ｔおよびｑ２を交互
に励起して変圧器Ｔ１の一次巻線を交互に励磁すること
によって供給される。この場合に、それぞれのトランジ
スタの励起時間は、実質的に同等である。トランジスタ
Ｑ１およびＱｚの励起時間は両者を合わせて、トランジ
スタｑ１およびＱｚにおける電荷の消失を可能ならしめ
、それによってトランジスタＱ１およびＱｚが同時に励
起されることの生ずるのを避けるためのデッド・タイム
と称する短かい介在時間を除いて、実質的に励起サイク
ルの全体の時間的な期間を形成する。負荷ＲＬに加えら
れる出力電圧ｖＯは、前記の回路５０におけると同様な
方法によって、誘導子Ｌｌを流れる電流により、コンデ
ンサＣＯの両端に発生する。誘導子Ｌｌは巻数Ｎ２
またはＮ３を有する二次巻線セクションのいずれかが、
トランジスタＱ３およびＱ４がそれぞれに励起されるこ
とによって流れる電流によって交互に励磁される。トラ
ンジスタｑ３およびＱ４はそれぞれ巻数Ｎ１およびＮ４
を有する二次セクションによって発生し、それぞれが抵
抗Ｒ＋ ？通過するシグナルによって励起される。誘導
子Ｌｌの巻数Ｎ２なる第２巻線は、選択的にダイオード
Ｄ２およびＤ３を経てそれぞれトランジスタＱ３および
Ｑ４に供給される励起打消しシグナルをＲ２を経由して
与える。このようにして与えられるシグナルは、それぞ
れのベース領域に蓄積されている電荷を放電させてトラ
ンジスタＱ３およびＱ４のターンオフ特性を向上させる
。トランジスタＱ３およびＱ４のいずれもが導電性でな
いときに、前記のデッド・タイムの期間内に、誘導子Ｌ
１からの電流がダイオードＤ１を経て供給され、この電
流はトランジスタＱ、３またはＱ４のいずれかが導電性
となるまで維持される。
・やルス幅変調を組み込んだ調整電源７０を第３図に示
す。変圧器Ｔ１は、前記の第１図の回路５０にお゛いて
変圧器Ｔ１の一次が励磁されたのと同一の方法によって
励磁される。同様に、出力電圧ＶＯは負荷ＲＬ に加え
られ、二次セクションＮ２によって発生した電流によっ
て同期的に時機を合わせたトランジスタＱ３に対する選
択的な励起に従って誘導子りに流れる電流によりコンデ
ンサＶＯの両端に発生する。トランジスタＱ、ｔおよび
Ｑｚが励起されていない期間中でかつ、二次セクション
Ｎ２を流れる電流の降下期間中は、誘導子りを流れる電
流はダイオードＤ３によって維持される。出力電圧ＶＯ
の調整は制御回路８０によって行なわれるが、この回路
において、トランジスタＱ３に対する励起信号の期間は
、広く知られているパルス幅変調技法に従った制御用工
Ｃにより感知する出力電圧によって制御される。なお、
制御回路間は巻数Ｎ２をもつ二次セクションが巻数Ｎｒ
を有する二次セクションから与えられる信号によって励
起されることによって同期されるので、ノヤルス幅の変
調は整流されるべき信号と同期して発生する。
す。変圧器Ｔ１は、前記の第１図の回路５０にお゛いて
変圧器Ｔ１の一次が励磁されたのと同一の方法によって
励磁される。同様に、出力電圧ＶＯは負荷ＲＬ に加え
られ、二次セクションＮ２によって発生した電流によっ
て同期的に時機を合わせたトランジスタＱ３に対する選
択的な励起に従って誘導子りに流れる電流によりコンデ
ンサＶＯの両端に発生する。トランジスタＱ、ｔおよび
Ｑｚが励起されていない期間中でかつ、二次セクション
Ｎ２を流れる電流の降下期間中は、誘導子りを流れる電
流はダイオードＤ３によって維持される。出力電圧ＶＯ
の調整は制御回路８０によって行なわれるが、この回路
において、トランジスタＱ３に対する励起信号の期間は
、広く知られているパルス幅変調技法に従った制御用工
Ｃにより感知する出力電圧によって制御される。なお、
制御回路間は巻数Ｎ２をもつ二次セクションが巻数Ｎｒ
を有する二次セクションから与えられる信号によって励
起されることによって同期されるので、ノヤルス幅の変
調は整流されるべき信号と同期して発生する。
この発明の他の実施例はこの発明の範囲の中にある。例
えば、この発明の電源は第１図、第２図、または第３図
に示され、あるいはこの技術における他の方法の如き種
々の一次側励起技法を具現し得る。なお、第１図に示す
回路刃の第２トランジスタＱ４およびこれに関連する同
期的励起回路は、第２図および第３図の回路器および７
０において、ダイオードＤ１およびＤ３に代えて組み込
むこともできる。特殊技術による上記以外の具現化、代
替、および回路の変更は明らかにこの発明の範囲内であ
り、これは下記の請求範囲による外は制限されるべきで
はない。
えば、この発明の電源は第１図、第２図、または第３図
に示され、あるいはこの技術における他の方法の如き種
々の一次側励起技法を具現し得る。なお、第１図に示す
回路刃の第２トランジスタＱ４およびこれに関連する同
期的励起回路は、第２図および第３図の回路器および７
０において、ダイオードＤ１およびＤ３に代えて組み込
むこともできる。特殊技術による上記以外の具現化、代
替、および回路の変更は明らかにこの発明の範囲内であ
り、これは下記の請求範囲による外は制限されるべきで
はない。
第１図は、単一終端回路構成による同期整流器の概略図
を示し、 第２図はセンター・タップ出力構成による同期整流器を
示す概略図であり、 第３図は・ぞルス幅変調（ＰＷＭ）調整器のもとで作動
し得る単一終端同期整流器を示す概略図である。 恥・・・・・・単一終端同期整流器回路、６０・・・・
・・ブツシュゾル同期整流回路、７０・・・・・・調整
電源、 閏・・・・・・制御回路。
を示し、 第２図はセンター・タップ出力構成による同期整流器を
示す概略図であり、 第３図は・ぞルス幅変調（ＰＷＭ）調整器のもとで作動
し得る単一終端同期整流器を示す概略図である。 恥・・・・・・単一終端同期整流器回路、６０・・・・
・・ブツシュゾル同期整流回路、７０・・・・・・調整
電源、 閏・・・・・・制御回路。
Claims (11)
- （１）、同期的な間隔で電流を供給する電源、前記の電
源からの電流を受け入れるように 接続され、かつ、前記の周期的期間の間前記の電流を通
過させるため前記の電源によって周期的に制御される第
１の半導体装置、 １個のコンデンサー、 前記の電流を受け入れて前記のコンデンサ ーに充電電流を供給するために、前記の電源および前記
のコンデンサーに接続された誘導子、 前記の電源からの電流が第一の半導体要素 に供給されていない時間間隔の間、前記の誘導子からの
第２の電流を前記のコンデンサーへ供給するように接続
された第２の半導体要素、 から構成される電力同期整流器。 - （２）、特許請求の範囲第１項の電力同期整流器におい
て、 前記の電源には二次巻線を備えた変圧器を 包含し、前記の電流は前記の二次巻線の一部分から供給
され、前記の同期制御には前記の二次巻線の一部分が提
供されることを特徴とする整流器。 - （３）、特許請求の範囲第１項の電力同期整流器におい
て、 前記の第２の半導体には選択制御バイポー ラ半導体を包含し、かつ 前記の誘導子には前記の第２の半導体が前 記の第２の電流を発生するように接続された二次巻線を
含んでいることを特徴とする整流器。 - （４）、特許請求の範囲第１項の電力同期整流器に、さ
らに 前記の周期的間隔の始めにおいて前記第２ の半導体をターンオフするために前記第２の半導体に接
続された手段を含んでいることを特徴とする整流器。 - （５）、特許請求の範囲第４項の電力同期整流器におい
て、 前記第２の半導体をターンオフするための 手段はさらに、前記第２の半導体を流れる前記第２の電
流が停止されるまで前記第１の半導体の導通を抑制する
ことを特徴とする整流器。 - （６）、特許請求の範囲第１項の電力同期整流器におい
て、 前記の電源は連続して複数の周期的電流を 供給し、前記の電力同期整流器にはさらに 前記複数の電流の中の１つを受け入れるよ うにそれぞれが接続された複数の第１半導体要素を含ん
でいることを特徴とする整流器。 - （７）、特許請求の範囲第６項の電力同期整流器におい
て、 前記の誘導子は二次巻線を備えていて、前 記電源からの前期周期的電流が停止されるときにターン
オフ信号を与え、前記の電力同期整流器にはさらに、 周期的間隔の直前の期間中に、導通中の特 定の第１半導体に前記のターンオフ信号を選択的に与え
るための手段を包含することを特徴とする整流器。 - （８）、特許請求の範囲第７項の電力同期整流器におい
て、 選択的に与えるための前記の手段には、そ れぞれが誘導子の二次からそれぞれの第１半導体に接続
された複数のダイオードを包含していることを特徴とす
る整流器。 - （９）、特許請求の範囲第１項の電力同期整流器はさら
に、 前記コンデンサーの両端の電圧の調整を行 なうための前記第１半導体の導通の期間を可変的に制御
し得る調整手段を含んでいることを特徴とする整流器。 - （１０）、特許請求の範囲第９項の電力同期整流器にお
いて、 前記の調整手段は前記の周期的な期間に同 期していることを特徴とする整流器。 - （１１）、特許請求の範囲第１０項の電力同期整流器に
おいて、 前記の調整手段は前記の電源によって与え られる前記の同期的制御を選択的に抑止することを特徴
とする整流器。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US68101684A | 1984-12-13 | 1984-12-13 | |
| US681016 | 1984-12-13 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61142964A true JPS61142964A (ja) | 1986-06-30 |
Family
ID=24733444
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60281853A Pending JPS61142964A (ja) | 1984-12-13 | 1985-12-13 | 電力同期整流器 |
Country Status (2)
| Country | Link |
|---|---|
| EP (1) | EP0184963A3 (ja) |
| JP (1) | JPS61142964A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7793939B2 (en) | 2006-09-25 | 2010-09-14 | Jtekt Corporation | Sealing structure of wheel supporting device |
Families Citing this family (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| AU602960B2 (en) * | 1987-03-26 | 1990-11-01 | Alcatel Australia Limited | A rectifier circuit |
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| DE4123386A1 (de) * | 1991-07-15 | 1993-01-21 | Ant Nachrichtentech | Verfahren zum steuern eines feldeffekttransistors sowie anordnung und anwendung |
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| DE102010014941A1 (de) | 2010-04-14 | 2011-10-20 | Semikron Elektronik Gmbh & Co. Kg | Schaltungsanordnung und Verfahren zur potentialgetrennten Energieübertragung mit zwei Ausgangsgleichspannungen |
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| JPS5739430A (en) * | 1980-08-22 | 1982-03-04 | Tohoku Metal Ind Ltd | Switching regulator |
| JPS59204466A (ja) * | 1983-05-09 | 1984-11-19 | Fujitsu Ltd | コンバ−タの整流回路 |
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| Publication number | Priority date | Publication date | Assignee | Title |
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-
1985
- 1985-12-06 EP EP85402424A patent/EP0184963A3/en not_active Withdrawn
- 1985-12-13 JP JP60281853A patent/JPS61142964A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
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Also Published As
| Publication number | Publication date |
|---|---|
| EP0184963A2 (en) | 1986-06-18 |
| EP0184963A3 (en) | 1987-08-19 |
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