JPS6095640A - Method and device for correcting error - Google Patents

Method and device for correcting error

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JPS6095640A
JPS6095640A JP58202602A JP20260283A JPS6095640A JP S6095640 A JPS6095640 A JP S6095640A JP 58202602 A JP58202602 A JP 58202602A JP 20260283 A JP20260283 A JP 20260283A JP S6095640 A JPS6095640 A JP S6095640A
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decoding
flag
error
circuit
correction
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宏夫 岡本
Masaharu Kobayashi
正治 小林
Hiroyuki Kimura
寛之 木村
Takaharu Noguchi
敬治 野口
Takao Arai
孝雄 荒井
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    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/18Error detection or correction; Testing, e.g. of drop-outs
    • G11B20/1806Pulse code modulation systems for audio signals
    • G11B20/1809Pulse code modulation systems for audio signals by interleaving
    • GPHYSICS
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    • G06F11/10Adding special bits or symbols to the coded information, e.g. parity check, casting out 9's or 11's
    • HELECTRICITY
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    • H03M13/00Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes
    • H03M13/29Coding, decoding or code conversion, for error detection or error correction; Coding theory basic assumptions; Coding bounds; Error probability evaluation methods; Channel models; Simulation or testing of codes combining two or more codes or code structures, e.g. product codes, generalised product codes, concatenated codes, inner and outer codes

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Abstract

PURPOSE:To execute error correction excellent in error correct ability and detect ability, by executing the error correction in the first signal, also adding a flag for indicating a decoding state, and executing plural decodings by using said flag in the second decoding. CONSTITUTION:When a receiving signal is inputted to an input/output terminal 38, a syndrome is generated by said receiving signal in a syndrome generating circuit 20, and the number of flags is counted and a state of the flag is stored in an RAM29, in a C2 decoding. Subsequently, decoding is executed by a program, an error position and an error pattern are derived by an operating circuit 24, and an erroneous data is corrected. In case the correction becomes impossible in a C1 decoding and the C2 decoding, a flag to be added to a data is outputted from a flag input/output terminal 40. In this way, a system for controlling each circuit by a program is used, therefore, a circuit scale is small, and also, with respect to decoding of a different error correcting code, too, it can be coped with by only changing the program.

Description

【発明の詳細な説明】 〔発明の利用分野〕 本発明はディジタル信号の再生装置における誤り訂正に
gfり、44に2重符号化された誤り訂正符号を用いる
場合に好適な誤り訂正方法及び装装置に関する。
DETAILED DESCRIPTION OF THE INVENTION [Field of Application of the Invention] The present invention relates to error correction in a digital signal reproducing device, and relates to an error correction method and apparatus suitable for using an error correction code doubly encoded in 44. Regarding equipment.

〔発明の背景〕[Background of the invention]

ディジタル信号の伝送を行なう場合には、伝送系で発生
するデータ誤シに対処するために、送信時に検査ワード
を付加し、受信時にその検査ワードによって誤シ検出及
び訂正を行なう場合が多い。検査ワードとしては、能率
が良く、復号の容易なリード・ソロモン符号が多く用い
られている。特に、リード・ソロモン符号によって2重
符号化を行なう方式は後れた訂正nにカを得ることがで
き、ディジタル・オーディオ・ディスク等で用いられて
いる。
When transmitting digital signals, in order to deal with data errors occurring in the transmission system, a check word is often added at the time of transmission, and error detection and correction is performed using the test word at the time of reception. Reed-Solomon codes, which are efficient and easy to decode, are often used as check words. In particular, a method of performing double encoding using a Reed-Solomon code can obtain power for late correction n, and is used in digital audio discs and the like.

第1凶はリード・ソロモン符号による2M符号化の一例
である。1は情報ワード、2は第1の検査ワード、3は
第2の検査ワードである。
The first problem is an example of 2M encoding using a Reed-Solomon code. 1 is an information word, 2 is a first check word, and 3 is a second check word.

符号化は、まず、12個の情報ワードWO−vVI+に
対して第1の検査ワードQO1Ql、Q2、Q3を付加
する。この12個の情報ワード及び4個の第1の検査ワ
ードよりなるブロックを02ブロツク5とする0次に、
C2ブロック5の谷シンボルに対してインターリーブを
行ない第1図に示すような配例にする。そして、それぞ
れ異なるC2ブロックに含まれる12個の情報ワードν
yo 、 W u及び第1の検査ワードQO1Ql、+
42、(、I3に対して第2の検査ワードPO1Plを
付加する。この12個の情報ワード、4個の第1の検査
ワード及び2個の第2の検査ワードよりなるブロックを
Olブロックとする。復号時には、C1ブロックで誤シ
検出及び誤シ検出及び誤シ訂正を行なった彼にゲインタ
ーリーブを行ない、そして、02ブロツクで課シ検出及
び誤シ訂正を行なう・ C1ブロックでは符号長18、検量ワード数2最小距離
3、C2ブロックでは符号長16、検査ワード数4、最
小距離5のリード・ソロモン符号を用いている。したが
って、C1俊号では1シンボルの誤シ訂正が可能である
。また、02復号では、8個の誤シ位置が不明の誤りと
E個の誤り位置が既知の誤り(以下の説明では、前者を
誤シ、後者を消失とする。)について、28+B≦4 の範囲で誤シ訂正を行なうことができる(特願昭58−
110931 )そこで、C1復号では誤シ検出及び1
シンボル訂正を行ない、同時に復号の状態を示すフラグ
を各ワードに付加し、OQI号ではCl0I1.号で付
加されたフラグの状況に応じて以下に示す3檎仙の復号
のうちの最適なり号を行なうことにより、能力の優れた
誤り訂正を行なうことができる。
In encoding, first check words QO1Ql, Q2, Q3 are added to 12 information words WO-vVI+. The block consisting of these 12 information words and 4 first check words is defined as 02 block 5.
Interleaving is performed on the valley symbol of C2 block 5 to create an arrangement as shown in FIG. Then, 12 information words ν included in different C2 blocks
yo, W u and the first test word QO1Ql, +
42, (, Add the second check word PO1Pl to I3. Let the block consisting of these 12 information words, 4 first check words, and 2 second check words be the Ol block. At the time of decoding, gain interleaving is performed on the C1 block which performs false beam detection, false beam detection and false beam correction, and then imposed beam detection and false beam correction is performed in the 02 block.In the C1 block, the code length is 18, The C2 block uses a Reed-Solomon code with a code length of 16, a check word count of 4, and a minimum distance of 5.The C2 block uses a Reed-Solomon code with a code length of 16, a check word count of 4, and a minimum distance of 5. Therefore, in the C1 code, one symbol error correction is possible. In addition, in 02 decoding, 28+B≦4 for 8 errors with unknown error positions and E errors with known error positions (in the following explanation, the former are assumed to be errors and the latter are assumed to be erasures). Errors can be corrected within the range (Patent application 1983-
110931) Therefore, in C1 decoding, false detection and 1
Symbol correction is performed and at the same time a flag indicating the decoding status is added to each word.In the OQI code, Cl0I1. By performing the optimal decoding of the three decoding methods shown below according to the status of the flag added in the code, it is possible to perform error correction with excellent performance.

(1)S、−2、E−0:2イ固の誤シを言」正する(
2) S=1. E−2:1個の誤シと2個の消失を訂
正する。
(1) S, -2, E-0: 2 Correct the fixed error (
2) S=1. E-2: Correct one error and two erasures.

(3) 8=、o E−4:4個の消失を訂正する第2
図は01復号のフローチャートでめる。N■はC1復号
で検出された誤シ数であシ、誤9が1個と判断された場
合には1シンボル訂正を行なう、また、C1復号での復
号の状態を示すフラグとしてFOフラグF1フラグを用
いるm poフラグは誤シ刀i検出された場合に亀1〃
とし、Fl−yラグは2個以上誤シがあシ訂正不能とな
った場合に%1〃とする。第3図はC2復号のフローチ
ャートである。N()”0)、N(Ft)は、それぞれ
FOフラグ及びFlフラグの数である。024号では、
フラグの数によって誤りの状況を推定し、最適な復号方
法を判断する。
(3) 8=,o E-4: 2nd correction to correct 4 erasures
The figure is a flow chart of 01 decoding. N■ is the number of erroneous symbols detected in C1 decoding, and if it is determined that there is one erroneous 9, one symbol correction is performed.In addition, FO flag F1 is used as a flag indicating the decoding status in C1 decoding. The m po flag uses a flag when a false sword i is detected.
The Fl-y lag is set to %1 if there are two or more erroneous scratches and the scratches cannot be corrected. FIG. 3 is a flowchart of C2 decoding. N()"0) and N(Ft) are the number of FO flags and Fl flags, respectively. In No. 024,
The error situation is estimated based on the number of flags, and the optimal decoding method is determined.

例えば、 N (Fo) −4すなわちFOフラグの数
(F1フラグが付加されているものも含む)が4個の場
合には、フラグの付加されている位置をpb位置として
(3)の消失訂正を行なう。第4図は誤pが6個ある場
合の例である。同図において、6はOlブロック、7は
C2ブロックを示している。また、8はフラグが付加さ
れていて誤シのシンボル、9はフラグが付加されていて
正しいシンボルを示している。C1復号では誤シがある
とブロック内のすべてのシンボルにフラグを付加するが
、誤りが1シンボルガらは正しく訂正され、まだ、誤シ
が2シンボル以上ある場合でも正しいシンボルと誤って
いるシンボルがある。したがって、フラグが付加されて
いて誤りのシンボルと、フラグが付加されていて正しい
シンボルが存在する。
For example, if N (Fo) -4, that is, the number of FO flags (including those to which the F1 flag is attached) is 4, then the erasure correction in (3) is performed using the position where the flag is attached as the pb position. Do the following. FIG. 4 shows an example where there are six incorrect ps. In the figure, 6 indicates an Ol block and 7 indicates a C2 block. Further, 8 indicates an incorrect symbol with a flag attached thereto, and 9 indicates a correct symbol with a flag attached thereto. In C1 decoding, if there is an error, a flag is added to all symbols in the block, but symbols with one error are correctly corrected, and even if there are two or more symbols with an error, the correct symbol and the erroneous symbol are still separated. be. Therefore, there are symbols that are flagged and are incorrect, and symbols that are flagged and correct.

(3)の消失訂正ではフラグの付加されている4個捷で
の誤シを訂正できるが、誤り構出能力がないので、フラ
グの付加されていない誤シがあると誤訂正を行なってし
まう。第5図に一例を示す。10がフラグの付加されて
いない誤りを示している。このフラグの付加されていな
い誤りは、C1復号での検出もれによるものである。
In erasure correction (3), it is possible to correct the erroneous lines in the four lines that have flags attached, but it does not have the ability to detect errors, so if there is an erroneous line that does not have a flag attached, it will be incorrectly corrected. . An example is shown in FIG. 10 indicates an error to which no flag is attached. This error in which no flag is added is due to a failure to detect in C1 decoding.

しだがって、第1図のようにC1の検査ワード数が少な
く、誤シ検出能力か十分でない場合には問題となる。第
1図の場合には、検査ワード数が2なので、誤りが3個
以上あると検出もれが発生する場合がある。このような
検出もれによる誤訂正を防止するには、N (Fo) 
= 4の場合にも(1)の誤シ訂正を行なえはよい。こ
の場合には、フラグの付加されていない誤りがあっても
検出可能であり、また、フラグの付加されている誤シが
1個以下ならば訂正可能である。
Therefore, a problem arises when the number of test words of C1 is small as shown in FIG. 1, and the ability to detect false errors is insufficient. In the case of FIG. 1, the number of test words is two, so if there are three or more errors, a detection error may occur. In order to prevent such erroneous correction due to missed detection, N (Fo)
Even in the case of = 4, it is a good idea to perform the error correction in (1). In this case, even if there is an error to which no flag is attached, it can be detected, and if the number of errors to which a flag is attached is one or less, it can be corrected.

しかし、(1)の誤り訂正では第4図のように誤りが3
個以上ある場合に訂正不能となってしまい訂正能力が悪
くなってしまう。
However, in error correction (1), there are 3 errors as shown in Figure 4.
If there are more than 1, correction becomes impossible and the correction ability deteriorates.

〔発明の目的〕[Purpose of the invention]

本発明の目的は、2重符号化された誤り訂正符号の持つ
課υ訂正能力を最大限に活用できる誤り訂正方法及び装
置を提供することにある。
SUMMARY OF THE INVENTION An object of the present invention is to provide an error correction method and apparatus that can make maximum use of the correction capability of a double-encoded error correction code.

〔発明の概要〕[Summary of the invention]

本発明は、第1の復号において誤り訂正を行なうと同時
に復号の状態を示すフラグを付加し、第2の復号では上
記フラグを用いて被数の復号を行ない、その復号結果に
よって最適な復号方法の判断を行ない、最適と判断され
た復号方法による復号結果を用いて誤υ訂正を行なうこ
とによシ、誤シ訂正能力及び検出能力が共に優れた誤シ
訂正を行なうものである。
In the present invention, a flag indicating the decoding status is added at the same time as error correction is performed in the first decoding, and in the second decoding, the augend is decoded using the flag, and the optimum decoding method is selected based on the decoding result. By making a judgment and performing error υ correction using the decoding result of the decoding method determined to be optimal, error correction with excellent error correction ability and detection ability is performed.

〔発明の実施例〕[Embodiments of the invention]

以下、本発明の一実施例を第1図に示した誤シ訂正符号
に適用した場合について説明する・前述したように、第
1図の誤シ訂正符号の復号としては、C1復号では1シ
ンボルのib訂正が可能であシ、C2復号では2シンボ
ルの誤シ訂正、1シンボルの誤りと2シンボルの消失の
訂正、4シンボルの消失訂正の3褌類の復号が可能であ
る。
Hereinafter, a case will be explained in which an embodiment of the present invention is applied to the error correction code shown in FIG. 1. As mentioned above, in C1 decoding, one symbol C2 decoding is capable of three types of decoding: 2-symbol error correction, 1-symbol error and 2-symbol erasure correction, and 4-symbol erasure correction.

そこで、C1復号としては、第2図と同様に、誤シ検出
及び1シンボル訂正を行ない、誤シを検出した場合には
FOフラグ、百」正不能の場合にはF1フラグを付加す
る。
Therefore, in C1 decoding, as in FIG. 2, erroneous symbol detection and one symbol correction are performed, and when an erroneous symbol is detected, an FO flag is added, and when an error cannot be corrected, an F1 flag is added.

次に、CZ俊号のフローチャートを第7図に示す。以下
、第7図によってC2復号の手順を説明する。
Next, a flowchart for CZ Shungo is shown in FIG. Hereinafter, the procedure of C2 decoding will be explained with reference to FIG.

(υ まず、S−2、E=oとして復号を行なう。(υ First, decoding is performed with S-2 and E=o.

これによシ、任意の位置にある2シンボルまでの諜シの
位置を検出できる。誤シか2個以下と判断された場合、
誤シ位置に付加されているフラグの有無やブロック内の
7ラグ叡から判断して誤訂正の可能性が少ない場合には
訂正を行なう。誤訂正の可能性がある場合には訂正不能
とする。
With this, the position of up to two symbols at any position can be detected. If it is determined that there are 2 or fewer errors,
If the possibility of erroneous correction is low, judging from the presence or absence of a flag added to the erroneous position and the number of 7 lags in the block, correction is performed. If there is a possibility of incorrect correction, correction will not be possible.

(2) (1)で誤りが3個以上と判断された場合、F
Oフラグの数が3個ならば FOフラグの付加でれてい
る3シンボル内の2シンボルを消失して S−1,E−
2の復号を行なう。
(2) If it is determined that there are three or more errors in (1), F
If the number of O flags is 3, 2 symbols out of the 3 symbols added by the FO flag are deleted and S-1, E-
2 is decrypted.

そして、フラグの付加されているシンボルのみに誤シが
あると判断された場合には、この復号の結果を用いて訂
正を行なう。
If it is determined that only the symbol to which the flag is attached has an error, correction is performed using the result of this decoding.

(3) (1)で誤りが6個以上と判断きれた場合、F
Oフラグの数が4個ならば、)゛Oフラグの付加されて
いる4シンボルを消失としてS−D、E=4の復号を行
ない、4シンボル訂正を行なう・ (4)(1)で誤シが31t!L1以上と判断され、F
Oフラグの数が5個以上の場合、Flフラグの数が31
固ならば、t”1フラグの付加されている3シンボルの
内の2シンボルを消失としてS=1、E−2の復号を行
なう、そして、F1フラグの付加されているシンボルの
みに誤りがあると判断された場合には、この復号の結果
を用いて訂正を行なう。
(3) If it is determined that there are six or more errors in (1), F
If the number of O flags is 4, ) ``The 4 symbols to which the O flag is attached are treated as erasures, and S-D, E = 4 decoding is performed, and 4 symbol correction is performed. (4) If the error occurs in (1), Shi is 31t! It was judged to be L1 or higher, and F
If the number of O flags is 5 or more, the number of Fl flags is 31.
If it is, S=1, E-2 is decoded by assuming that 2 out of 3 symbols to which the t”1 flag is attached are erased, and only the symbol to which the F1 flag is attached has an error. If it is determined that this is the case, correction is performed using the result of this decoding.

(5) (1)で誤りか6個以上と判断され、(2)〜
(4)の訂正条件に該当しない場合には訂正不能とする
(5) If (1) is judged to be an error or 6 or more, (2) ~
If the correction conditions in (4) are not met, correction will not be possible.

このように、異なる榎号方歩によって2回の復号を行な
うことによって、1回の復号では訂正不能あるいは誤訂
正となる場合でも訂正可能である〃υえば前述した第4
図及び第5図の場合でも、第4図は(6)によって、第
5図は(1)によって訂正可iヒである・(1)〜(5
)によって削正できないのは、第1に示すように、N(
1+’o)−4ではフラグの付加されている誤シが2個
以上あシ、かつ、フラグの付加されていない誤シがある
場合のみである。さらに、このような場合でも、復号の
回数を増せば、S−1、E−2の復号を消失の位置を変
えて行なうことによって、任意6個の誤シまでは訂正O
J能とすることができる。また、(1)〜(5)では復
号を2回行なうように説明したが、2裡褪の異なる復号
を同時に行ない、復号後に最適な復号方法を判断し、最
適と判断した復号方法による復号結果によって誤り訂正
を行なうようにしてもよい。
In this way, by performing decoding twice using different Enoki methods, it is possible to correct cases that cannot be corrected or are incorrectly corrected with one decoding.
Even in the case of Fig. 4 and Fig. 5, Fig. 4 can be corrected by (6), and Fig. 5 can be corrected by (1).
) cannot be reduced by N(
1+'o)-4 only applies when there are two or more erroneous lines with flags attached and there are erroneous lines with no flags attached. Furthermore, even in such a case, if the number of decodings is increased, by decoding S-1 and E-2 with different erasure positions, it is possible to correct up to six arbitrary errors.
It can be J Noh. In addition, in (1) to (5), it was explained that decoding is performed twice, but two different decodings are performed at the same time, and after decoding, the optimal decoding method is determined, and the decoding result by the decoding method determined to be optimal. Error correction may be performed by

第8図は、第7図に示しだ本発明の鳩り削正方法をさら
に詳細に説明したものである。同図において、2 (F
o)、2(F+ )はC2復号ニj つ”C検出した誤
り位置とFOフラグ捷たはFlフラグの付加されている
位負の一致叔である。また、Fは訂正不能と判断したシ
ンボルに付加する訂正不能フラグであシ、F=1の場合
には02ブロツクのすべてのシンボルにフラグを付加し
、F−FOの場合にはFoフラグの付加されているシン
ボルにのみフラグを付加する。Fフラグの付加されたシ
ンボルは、丹生時に平均値補間等によってiAD補正を
行なう、第8図に示したように、復号結果についてC1
復号で付加しだFoフラグ及びI!′1:yラグによっ
てチェックを行なうことによって誤WJ正の確率を少な
くすることができ、誤シ訂正能力及び誤シ検出能カが共
に優れた誤シ訂正を行なうことができる・ 本発明の誤シ訂正方法は、第1図に示した実施例の他に
も、2型打号化された誤り訂正符号であれば適用できる
。第9図及び第10図は、本発明の誤り訂正方法の他の
一実施例である。
FIG. 8 explains in more detail the dovetail cutting method of the present invention shown in FIG. 7. In the same figure, 2 (F
o), 2(F+) is the coincidence of the error position detected by C2 decoding and the position of the FO flag change or Fl flag added. Also, F is the symbol judged to be uncorrectable. In the case of F=1, the flag is added to all symbols of the 02 block, and in the case of F-FO, the flag is added only to the symbols to which the Fo flag is added. .The symbol to which the F flag is added is subjected to iAD correction by mean value interpolation, etc. at the time of Nyu, and as shown in Fig. 8, the decoding result is C1
The Fo flag and I! are added during decoding. '1: By checking with the y lag, it is possible to reduce the probability of incorrect WJ being correct, and it is possible to perform error correction with excellent error correction ability and error detection ability. In addition to the embodiment shown in FIG. 1, the error correction method can be applied to any type 2 encoded error correction code. 9 and 10 show another embodiment of the error correction method of the present invention.

11は情報ワード、12は第1の検査ワード、13は第
2の検査ワードである。符号化は、まず、24個(7)
 t* 報’;7−ドvvi o 〜vvi、 23 
(i −o 〜29)に対して第1の検査ワードリ10
””’ QL、 7を付加し02ブロツク15とする。
11 is an information word, 12 is a first check word, and 13 is a second check word. First, the encoding consists of 24 pieces (7)
t* Report'; 7-devvio ~vvi, 23
The first test word library 10 for (i − o ~ 29)
""' QL, 7 is added to make 02 block 15.

次に、30個の情報ワ−)”WO,J〜W29.)’ 
(J −0〜23)または3゜個の 1の検査ワードQ
o、 k−C29,&(A = 0〜7)に対して 2
の検査ワードPθノ、Pす(ノー0〜61)を付加しQ
l、ブロック14とする。
Next, 30 information words)"WO, J~W29.)'
(J -0~23) or 3° 1 test word Q
o, k-C29, & (A = 0-7) 2
Add the test words Pθ, Psu (no 0 to 61) to Q
l, block 14.

復号時には、C1ブロックで誤り検出及び誤り訂正を行
なった後に、C2フロックで誤り検出及び誤シ訂正を行
なった後に、C2ブロックで誤シ検出及び誤シ訂正を行
なう。
During decoding, error detection and error correction are performed in the C1 block, error detection and error correction are performed in the C2 block, and then error detection and error correction are performed in the C2 block.

C1ブロックでは符号長32・検査ワード数2最小距離
3.のリード・ソロモン符号を用いている。したがって
、1シンボルの誤り訂正が可能であり、C1復号は第2
図の場合ど同じになる。
In the C1 block, the code length is 32, the number of check words is 2, the minimum distance is 3. A Reed-Solomon code is used. Therefore, one symbol error correction is possible, and C1 decoding is performed by the second
It is the same in the case of the figure.

また、C2ブロックでは符号長32、検査ワード数8、
最小距離9のリードソロモン符号を用いている。したが
って、 2 S +’E≦8 の範囲で誤シ訂正を行なうことができる。以下、第10
図に示したフローチャートに従って02 (i号の手順
を説明する。
In addition, in the C2 block, the code length is 32, the number of check words is 8,
A Reed-Solomon code with a minimum distance of 9 is used. Therefore, error correction can be performed within the range of 2 S +'E≦8. Below, the 10th
The procedure of No. 02 (i) will be explained according to the flowchart shown in the figure.

(1ン まず、S=4.E−oとして復号を行なう。(1) First, perform decoding with S=4.E-o.

コレニより、任意の位16.にある4シンボルノ誤シの
位置を検出できる。誤シが6個以下と判断された場合、
または、誤シが4個で誤訂正の可能性が少ないと判断さ
れた場合には誤り訂正を行なう。
From Koreni, any number 16. The position of the four symbols in error can be detected. If it is determined that there are 6 or fewer errors,
Alternatively, if there are four errors and it is determined that there is little possibility of error correction, error correction is performed.

(2) (1)で誤りが5個以上と判断された場合、ハ
フラグの数が4個ならば、poフラグの付加されている
4シンボルを消失として S−2゜E’−4の復号を行
ない、検出された誤シが2個以下ならは誤シ訂正を行な
う。
(2) If it is determined that there are 5 or more errors in (1), and the number of half flags is 4, decode S-2゜E'-4 by assuming that the 4 symbols with po flags are erased. If the number of detected errors is two or less, error correction is performed.

(3)(りで誤りが5個以上と判断された場合、FOフ
ラグの数が5個ならば%FOフラグの付加されている5
シンボルを消失として 5−IE−5の復号を行ない、
検出された誤りが1個以下ならば誤シ訂正を行なう。
(3) (If it is determined that there are 5 or more errors, if the number of FO flags is 5, %FO flags are added.
Perform 5-IE-5 decoding with symbols erased,
If the number of errors detected is one or less, error correction is performed.

(4) (1)で誤りが5個以上と判断された場合、F
Oフラグの数が6個ならば、FOフラグの付加されてい
るるシンボルを消失として S−1゜B−6の復号を行
ない、検出された誤シが1個以下力らは誤シ訂正を行な
う。
(4) If it is determined that there are 5 or more errors in (1), F
If the number of O flags is 6, the symbols to which the FO flag is attached are treated as erasures, and S-1°B-6 is decoded, and if less than one error is detected, error correction is performed. Let's do it.

(5) (1)で誤りが5個以上と判断された場合、F
0フラグの数が7個ならば、FOフラグの付加されてい
る7シンボルの内の6シンボルを消失として s−i、
E−6の一復号を行ない、フラグの付加されているシン
ボルのみに誤pがあると判断された場合には誤シ訂正を
行なう。
(5) If it is determined that there are 5 or more errors in (1), F
If the number of 0 flags is 7, 6 symbols out of 7 symbols to which FO flags are attached are assumed to be erasures, s-i,
E-6 is decoded, and if it is determined that there is an error p only in the symbol to which the flag is attached, error correction is performed.

(<5) (1)で誤りが5個以上と判断された場合、
F。
(<5) If it is determined that there are 5 or more errors in (1),
F.

フラグの数が8個ならば、FOフラグの付加されている
8シンボルを消失として S=o。
If the number of flags is 8, the 8 symbols to which the FO flag is attached are considered to be lost, S=o.

E−8の復号を行ない、8シンボルil正を行なう。E-8 is decoded and 8 symbols are corrected.

(7) (1)〜(6)の訂正条件に該当しない場合に
は訂正不能とする。
(7) If the correction conditions in (1) to (6) are not met, correction will not be possible.

次に、本発明の誤シ訂正方法により誤シ訂正を行なう誤
シ訂正装置について第11図により説明する。
Next, an error correction apparatus that performs error correction using the error correction method of the present invention will be described with reference to FIG.

第11図は、誤シ訂正装置のプロ、り図である。FIG. 11 is a professional diagram of the error correction device.

同図において、17〜19はパスライン、20はシンド
ローム生成回路、21.22はROM 、 25.27
゜29はRAM、24は演算回路、26はカウンタ、2
8は比較回路、50は条件判陣T回路、31はグログラ
ムR,OM、32はアドレスカウンタである。
In the figure, 17 to 19 are pass lines, 20 is a syndrome generation circuit, 21.22 is a ROM, 25.27
゜29 is RAM, 24 is an arithmetic circuit, 26 is a counter, 2
8 is a comparison circuit, 50 is a condition judgment T circuit, 31 is a grogram R, OM, and 32 is an address counter.

本回路は、3本のパスライン及びそのノくスラインに接
続されている回路と、プログラムによ、CG回路の動作
をコントロールするコントロール回路によシ構成されて
いる。ノくスライン17は受信信号や誤シバターン等の
データをやシとシするデータバス、パスライン18はデ
ータ装置(ロケーション)等のデータをやりとシする。
This circuit consists of three pass lines, a circuit connected to the cross line, and a control circuit that controls the operation of the CG circuit according to a program. The cross line 17 is a data bus for transmitting data such as received signals and erroneous data turns, and the pass line 18 is for transmitting data from data devices (locations) and the like.

ロケーションバス、パスライン19はデータに付加され
るフラグのデータをやりと9するフラグノくスである。
A location bus or path line 19 is a flag node for transmitting flag data added to data.

まだ、各バスには、それぞれデータ入出力端子68、ロ
ケーション入出力端子39、フラグ入出力端子40が接
続されている・シンドローム生成回路20は、データ入
出力端子12よシ入力された受信信号によシンドローム
を生成する。
The data input/output terminal 68, the location input/output terminal 39, and the flag input/output terminal 40 are still connected to each bus.The syndrome generation circuit 20 receives the received signal input from the data input/output terminal 12. Generate a yo syndrome.

演算回路24は、上記シンドローム生成回路で生成され
たシンドロームによって誤り位置及び誤りパターンをめ
るだめの演算を行なうものである。演算回路では、(1
”(υ0上での乗其除算及び加算を行なう。
The arithmetic circuit 24 performs arithmetic operations to determine the error position and error pattern based on the syndrome generated by the syndrome generation circuit. In the arithmetic circuit, (1
”(Multiply, divide, and add on υ0.

RAM25は、シンドロームや演算回路25での演算結
果を記憶しておくだめのものである。
The RAM 25 is used to store syndromes and calculation results from the calculation circuit 25.

また、23は8人力OR回路であシ、データバス17上
のデータが気0〃かどうかを判断するだめのものである
Further, 23 is an 8-man OR circuit, which is used to judge whether the data on the data bus 17 is 0 or not.

ROM 21.22はデータバス17とロケーションバ
ス18の間のデータ変換を行なうためのROMである。
ROMs 21 and 22 are ROMs for converting data between data bus 17 and location bus 18.

すなわち、データバス上ではデータはベクトル表現で取
扱われており、ロケーションバス上ではべき表現で取扱
われている。
That is, data is handled in vector representation on the data bus, and data is handled in power representation on the location bus.

したがって、データバス17とロケーションバス18の
間でデータのやシとりを行なう場合には、ROM 21
またはROM22によってデータの変換を行なう必要が
ある。
Therefore, when transferring data between the data bus 17 and the location bus 18, the ROM 21
Alternatively, data must be converted by the ROM 22.

カウンタ26は1ブロツク内のフラグ数をカラ第 ン卜するものである。 20儂号では、カウンタ26で
Fo、 Ftの数をカウントし、その数を比較回路28
によって所定の数と比較し、何ワードの訂正を行なうか
、あるいは訂正を行なうか訂正を行なわないで訂正不能
とするか等の判断を行なう。
The counter 26 counts the number of flags in one block. In No. 20, the counter 26 counts the number of Fo and Ft, and the number is sent to the comparison circuit 28.
This is compared with a predetermined number to determine how many words to correct, or whether to make corrections or not to make corrections possible.

RAM 27は、カウンタ26でカウントしてフラグ数
や誤シ位置等を記憶しておくためのものである。また、
比較回路28は、上述したフラグ数と所定の数の比較や
、復号処理途中におけるデータと定数の比較に用いられ
る。
The RAM 27 is for counting by the counter 26 and storing the number of flags, erroneous positions, etc. Also,
The comparison circuit 28 is used to compare the above-mentioned number of flags with a predetermined number, and to compare data with a constant during the decoding process.

RAM 29は、第2の復号においてデータに付加され
ている第1の復号の結果を示すフラグFO1FlをH己
憶しておくものである。RAM29にH己憶されている
フラグの状況は、復号によってめられた誤シ位置におけ
るフラグの有無をチェックするために用いられる。
The RAM 29 is for storing a flag FO1Fl indicating the result of the first decoding, which is added to the data in the second decoding. The flag status stored in the RAM 29 is used to check the presence or absence of a flag at an erroneous position detected by decoding.

条件判断回路30は、OR回路26や比較回路28で判
断された結果やRAM 29に記憶されているフラグの
状況に基づいてプログラムの分岐を行なうかどうかを判
断するものである。
The condition determination circuit 30 determines whether or not to branch the program based on the results determined by the OR circuit 26 and the comparison circuit 28 and the status of flags stored in the RAM 29.

プログラムROM61は、上述した各回路をコントロー
ルして復号を行なうだめのプログラムを記憶しておくも
のである。65は、f(、AMのアドレスの決定や各パ
スライン及び比較l!21路へ入力する定数を決める信
号である。34はプログラムの分岐を行なう場合の条件
を決める信号であり条件f8IJ断回跪60では64の
同各とOR回路23、比較回路28 、I(AM 29
寺の状況を比較して分岐を行なうかどうかを決定する。
The program ROM 61 stores programs for controlling and decoding each of the circuits described above. 65 is a signal that determines the address of f(, AM, and constants input to each path line and comparison l!21 path. 34 is a signal that determines the conditions for branching the program, and the condition f8IJ disconnection In the kneeling 60, each of 64, the OR circuit 23, the comparison circuit 28, I (AM 29
Compare the status of the temples and decide whether to branch out.

35け分岐する場合の分岐先を決める信号である。まだ
、36は谷バスに接続されているバッファ及びレジスタ
を制御する信号である。
This signal determines the branch destination when branching 35 times. Still, 36 are signals that control the buffers and registers connected to the valley bus.

カウンタ32は、プログラムのアドレスをコントロール
するものである。このカウンタは、マスタークロック人
力41より入力されるクロックによシブログラムROM
31のアドレスを進め、プログラムを実行させる。捷だ
、プログラムの分岐を行なう場合には、分岐砧令37に
より分岐先アドレス35をカウンタにロードし、プログ
ラムを分岐させる。なお、入力端子42は、プログラム
スタート時にカウンタ62をリセットする信号を入力す
るものである。
The counter 32 controls the address of the program. This counter is controlled by the clock input from the master clock 41.
31 address and execute the program. If the program is to be branched, the branch destination address 35 is loaded into the counter by the branch instruction 37, and the program is branched. Note that the input terminal 42 is used to input a signal for resetting the counter 62 at the time of program start.

誤シ訂正を行なう手順としては、まず、受信信号を入力
し、シンドロームの生成を行ない、02J号ではフラグ
数のカウント、フラグの状態のRAM 29への記憶を
行なう。次にプログラムによシ復号を行ない、誤シ位置
及び誤シバターンをめ、誤シデータの訂正を行なう、ま
た、01復号及びC2復号において訂正不能となった場
合には、フラグ入出力40よシデータに付加するフラグ
を出力する。
The procedure for correcting errors is to first input a received signal, generate a syndrome, and in No. 02J, count the number of flags and store the state of the flags in the RAM 29. Next, the program decodes the erroneous digits, finds the erroneous digit position and erroneous digit pattern, and corrects the erroneous digit data.If correction becomes impossible in 01 decoding and C2 decoding, the flag input/output 40 is used to correct the erroneous digit data. Outputs the flag to be added.

以上述べたように、本発明の賜り訂正装置では、プログ
ラムによシ谷回路をコントロールする方式を用いており
、回路規模が小さく、また異なる誤シ引正符号の復号に
対してもプログラムの変更のみによって対処できる。
As described above, the error correction device of the present invention uses a method to control the valley circuit by a program, and the circuit scale is small, and the program can be changed for decoding different error error positive codes. It can be dealt with only by

〔発明の効果〕〔Effect of the invention〕

本発明によれば、2重符号化された誤り訂正符号の能力
を最大限に活用することができ、誤り訂正能力及びxb
検出能力を向上させることができる。
According to the present invention, it is possible to make maximum use of the ability of the double-encoded error correction code, and the error correction ability and xb
Detection ability can be improved.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は2厘符号化された誤り訂正符ちのデータ配列を
示す図、第2図はC1復号のフローチャート図、第3図
は従来のC2復号のフローチャート図、第4図〜第6図
はc2ブロックでフラグが4個ある場合の誤シバターン
図、第7図は本発明の02復号の70−チャート図、第
8図鴎7図の詳細な説明を示す図、第9図は2重符号化
された誤シ訂正符号の他の一例を示す図、第10図は本
発明を第9図の符号に適用した場合のC2復号のフロー
チャート図、第11図は木兄明の誤シ訂正回路のブロッ
ク図である。 20・・・・・・シンドローム生成回路21、22・・
・・・・)t、0M 23・・・・・・OR回路 24・・・・・・演算回路 25、 27. 29 ・・・・・・RAM26・・・
・・・カウンタ 28・・・・・・比較回路 30・・・・・・条件判断囲路 31・・・・・・プログラム)LOM 32・・・・・・アドレスカウンタ 第1図 第Z 図 第3 図 茎+劇 第5図 第2 図
Figure 1 is a diagram showing the data array of a 2-bit encoded error correction code, Figure 2 is a flowchart of C1 decoding, Figure 3 is a flowchart of conventional C2 decoding, and Figures 4 to 6 are An incorrect Shiba turn diagram when there are four flags in the c2 block, Figure 7 is a 70-chart diagram of 02 decoding of the present invention, Figure 8 is a diagram showing a detailed explanation of Figure 7, and Figure 9 is a double code Figure 10 is a flowchart of C2 decoding when the present invention is applied to the code in Figure 9, and Figure 11 is Akira Kinie's error correction circuit. FIG. 20...Syndrome generation circuit 21, 22...
...)t, 0M 23...OR circuit 24...Arithmetic circuit 25, 27. 29...RAM26...
... Counter 28 ... Comparison circuit 30 ... Condition judgment circuit 31 ... Program) LOM 32 ... Address counter Fig. 1 Fig. Z Fig. 3 Figure Stem + Drama Figure 5 Figure 2

Claims (1)

【特許請求の範囲】 1、第1の配列状態にある複数の情報ワードと上記情報
ワードに対して最小距離がdlである符号により生成し
た複数の第1の検査ワードにょシ第1の符号ブロックが
形成され、夫々異なる第1の符号ブロックに含まれる複
数の情報ワード及び複数の第1の検査ワードよシなる第
2の配列状態における複数の情報ワード及び複数の第1
の検査ワードと、上記複数の情報ワード及び複数の第1
の検査ワードに対して最小距離がd2である符号によシ
生成した複数の第2の検査ワードによシ第2の符号ブロ
ックが形成される符号飴の復号を行なう誤り訂正方式に
おいて、第1の復号として第2の符号ブロックに対して
誤シ検出及び2 Sl≦ d2−1となるSsシンボル
の訂正を行ない1.同時に復号の状態を示すフラグを付
加し、第20復号として第1の符号ブロックに対して誤
シ検出及び282 +E≦d171となる任意の82シ
ンボルの誤りと該フラグの付加されたEシンボルの誤シ
の訂正を複数の82及びEについて行ない、該複数の訂
正結果よシ訂正能力が^く誤訂正の確率の少ないS2及
びEを判断し、その82及びEにおける訂正結果によっ
て第2の復号における誤り訂正を行なうことを特徴とす
る誤9訂正方法。 2、特許請求の範囲第1項記載の誤シ訂正方法によって
誤シ訂正を行なう装置で、入力信号よりシンドロームを
生成するシンドローム生成回路と、前記シンドローム生
成回路で生成されたシンドロームの値またはシンドロー
ムの値とフラグの付加されたワードの位1度を用いてガ
ロア体上の加舞、・除算及び加算を行なう演p、回路と
、ガロア体の任意の元αtにおいてαtよシtをめる及
び/またはtよりαtをめる変換回路と入力された各ワ
ードに付加されているmMの種類のフラグの数を数える
カウンタと、咳シンドロームの値、演其回路で演其され
た結果、前記変換回路で変換された結果s RIJ記フ
ラフラグ加されている入力ワードの位置カウンタでカワ
ノドされたフラグの数及び前記入力信号に付加されてい
るフラグを記憶する記憶回路と、前記演算回路、前記変
換回路及び前記記憶回路を制御して誤り訂正動作を行な
うプログラムを記憶しているプログラム記憶回路と、該
プログラム及びフラグの付加されている状態等によシ上
記プログラム記憶回路のアドレスを制御する制御回路よ
りなることを特徴とする誤り訂正装置。
[Claims] 1. A first code block containing a plurality of first check words generated by a code having a minimum distance dl between a plurality of information words in a first arrangement state and the information words. is formed, and a plurality of information words and a plurality of first check words are formed in a second arrangement state including a plurality of information words and a plurality of first check words respectively included in different first code blocks.
the plurality of information words and the plurality of first
In an error correction method for decoding a code block, a second code block is formed by a plurality of second check words generated by a code whose minimum distance is d2 with respect to a check word. As decoding, error detection and correction of Ss symbols such that 2 Sl≦d2-1 are performed on the second code block.1. At the same time, a flag indicating the decoding status is added, and as the 20th decoding, error detection is performed for the first code block, and an error of any 82 symbols where 282 +E≦d171 is detected, and an error of the E symbol to which the flag is attached is detected. S2 and E are corrected for a plurality of 82 and E, and based on the correction results, S2 and E with high correction ability and low probability of erroneous correction are determined. An error 9 correction method characterized by performing error correction. 2. An apparatus that performs error correction using the error correction method according to claim 1, which includes a syndrome generation circuit that generates a syndrome from an input signal, and a syndrome value or syndrome generated by the syndrome generation circuit. Operations p and circuits that perform operations, division, and addition on a Galois field using the digit 1 degree of a word with a value and a flag added, and a circuit that calculates αt by αt in an arbitrary element αt of the Galois field. /or a conversion circuit that subtracts αt from t; a counter that counts the number of mm type flags added to each input word; and a cough syndrome value, the result calculated by the calculation circuit, and the conversion circuit. a memory circuit for storing the number of flags converted by the position counter of the input word to which the RIJ flag has been added and the flag added to the input signal; the arithmetic circuit; and the conversion circuit; and a program storage circuit that stores a program that controls the storage circuit to perform an error correction operation, and a control circuit that controls the address of the program storage circuit depending on the program and the state in which a flag is attached. An error correction device characterized by:
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