JPS607534Y2 - 多分岐分配器 - Google Patents
多分岐分配器Info
- Publication number
- JPS607534Y2 JPS607534Y2 JP3816179U JP3816179U JPS607534Y2 JP S607534 Y2 JPS607534 Y2 JP S607534Y2 JP 3816179 U JP3816179 U JP 3816179U JP 3816179 U JP3816179 U JP 3816179U JP S607534 Y2 JPS607534 Y2 JP S607534Y2
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- JP
- Japan
- Prior art keywords
- printed circuit
- circuit board
- printed
- distribution
- stage
- Prior art date
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Description
【考案の詳細な説明】
本考案は、マイクロ波用分配器に関するもので、極めて
小形で、例えば８分配、１附配又は３２２分配の多分岐
分配の可能な分配器を実現することを目的とする。
小形で、例えば８分配、１附配又は３２２分配の多分岐
分配の可能な分配器を実現することを目的とする。
第１図は、本考案の一実施例を示す正面図、第２図は平
面図、第３図は背面図、第４図は側面図、第５図は要部
の展開図で、各図においてＥｌはコの字型に折曲した接
地導体、Ｂ２は板状の接地導体で、導体Ｅ１及びＢ２を
一体に固着して筒状の接地導体を形成しである。
面図、第３図は背面図、第４図は側面図、第５図は要部
の展開図で、各図においてＥｌはコの字型に折曲した接
地導体、Ｂ２は板状の接地導体で、導体Ｅ１及びＢ２を
一体に固着して筒状の接地導体を形成しである。
ＰＢｌないしＰＢ３はプリント基板で、ＰＢ ｌは筒状
接地導体の前部垂直面に、ＰＢ２は上部水平面に、ＰＢ
３は背部垂直面にそれぞれ取付けである。
接地導体の前部垂直面に、ＰＢ２は上部水平面に、ＰＢ
３は背部垂直面にそれぞれ取付けである。
ＰＢＣ１ないしＰＢＣ３は各プリント基杆Ｂ１ないしＰ
Ｂ３の裏面に設けた導体層、Ｔｉは入力端子、ＴＯｌな
いしＴＯ８は出力端子で、各端子は同軸端子より戒る。
Ｂ３の裏面に設けた導体層、Ｔｉは入力端子、ＴＯｌな
いしＴＯ８は出力端子で、各端子は同軸端子より戒る。
Ｄｌは第１段の２分配回路で、プリント基板上にプリン
ト配線を以て形成した例えばマイクロストリップライン
より成る伝送線路Ｌ１及びＬｌ’並にプリント配線を以
て形成した平衡用抵抗ＢＲｌより戒る。
ト配線を以て形成した例えばマイクロストリップライン
より成る伝送線路Ｌ１及びＬｌ’並にプリント配線を以
て形成した平衡用抵抗ＢＲｌより戒る。
伝送線路Ｌ１及びＬｌ’はそれぞれλ／２（λは伝送波
長）の長さに形成すると共にスペースファクタを良好な
らしめるためにだ行せしめである。
長）の長さに形成すると共にスペースファクタを良好な
らしめるためにだ行せしめである。
尚、線路Ｌ１及びＬｌ’のだ行形状は左右対称の必要な
く、線路長がλ／２であれば任意形状で差支えない。
く、線路長がλ／２であれば任意形状で差支えない。
又、線路Ｌ１及びＬｌ’の幅及び厚さを適当ならしめて
それぞれの特性インピーダンスヲ−／ ２Ｒｏ （Ｒｏ
は入出力インピーダンス）ならしめると共に分岐点に設
けた平衡用抵抗ＢＲｌの抵抗値を２ＲＯに選んで、いわ
ゆるウィルキンラフ２分配回路を構威せしめである。
それぞれの特性インピーダンスヲ−／ ２Ｒｏ （Ｒｏ
は入出力インピーダンス）ならしめると共に分岐点に設
けた平衡用抵抗ＢＲｌの抵抗値を２ＲＯに選んで、いわ
ゆるウィルキンラフ２分配回路を構威せしめである。
Ｄ２及びＤ３は第２段の２分配回路、Ｄ４ないしＤ７は
第３段の２分配回路で、それぞれ伝送線Ｌ２ないしＬ７
、Ｌ２′ないしＬ７’及び平衡用抵抗ＢＲ２ないしＢＲ
７を以て第１段の２分配回路Ｄ１と全く同様に構威しで
ある。
第３段の２分配回路で、それぞれ伝送線Ｌ２ないしＬ７
、Ｌ２′ないしＬ７’及び平衡用抵抗ＢＲ２ないしＢＲ
７を以て第１段の２分配回路Ｄ１と全く同様に構威しで
ある。
ＣＷは接地導線で、プリント基＠）Ｂ１及びＰＢ２のプ
リント配線相互差にプリント基ｆＢ２及びＰＢ３のプリ
ント配線相互を接続する。
リント配線相互差にプリント基ｆＢ２及びＰＢ３のプリ
ント配線相互を接続する。
入力端子Ｔｉに導入された信号は第１段の分配回路Ｄ１
において第２段の分配回路Ｄ２及びＤ３に分配され、回
路Ｄ２に導入された信号は第３段の分配回路Ｄ４及びＤ
５に、回路Ｄ３に導入された信号は第３段の分配回路Ｄ
６及びＤＩにそれぞれ分配される。
において第２段の分配回路Ｄ２及びＤ３に分配され、回
路Ｄ２に導入された信号は第３段の分配回路Ｄ４及びＤ
５に、回路Ｄ３に導入された信号は第３段の分配回路Ｄ
６及びＤＩにそれぞれ分配される。
第３段の分配回路Ｄ４ないしＤＤ７に導入された信号は
、それぞれ出力端子ＴＯ１ないしＴＯ８に分配されるの
で、入力端子Ｔｉに導入された信号は８分配されること
になる。
、それぞれ出力端子ＴＯ１ないしＴＯ８に分配されるの
で、入力端子Ｔｉに導入された信号は８分配されること
になる。
そして本案案分配器は、接地導体Ｅ１及びＢ２より戒る
筒体の前部垂直面、上部水平面及び背部垂直面に設けた
プリント基板、即ち立体的に形威したプリント基杆Ｂ１
ないしＰＢ３の各表面に各段の２分配回路ＤＩないしＤ
Ｉを被着形威しであるので、一平面上に形威した場合に
比し、全体を遥かに小形に形成することができる。
筒体の前部垂直面、上部水平面及び背部垂直面に設けた
プリント基板、即ち立体的に形威したプリント基杆Ｂ１
ないしＰＢ３の各表面に各段の２分配回路ＤＩないしＤ
Ｉを被着形威しであるので、一平面上に形威した場合に
比し、全体を遥かに小形に形成することができる。
尚、接地導体Ｅ２の表面にもプリント基板を取付け、プ
リント基ｖＢ１ないしＰＢ３と共に筒体を形威せしめる
ようにしてもよく、方形の筒体の代りに例えば円筒形の
プリント基板を用いても本考案を実施することが出来、
何れの場合も筒体の外表面にプリント配線を施す代りに
内表面或は両面にプリント配線を施すようにしてもよい
。
リント基ｖＢ１ないしＰＢ３と共に筒体を形威せしめる
ようにしてもよく、方形の筒体の代りに例えば円筒形の
プリント基板を用いても本考案を実施することが出来、
何れの場合も筒体の外表面にプリント配線を施す代りに
内表面或は両面にプリント配線を施すようにしてもよい
。
以上は８分配型分配器につき説明したが、第３段の分配
回路Ｄ４ないしＤＩの各後段に第４段の分配回路を設け
ることにより１附記型分配器を構威せしめることが出来
、同様にして３２分配型分配器或はそれ以上の多分岐分
配器を構威することができる。
回路Ｄ４ないしＤＩの各後段に第４段の分配回路を設け
ることにより１附記型分配器を構威せしめることが出来
、同様にして３２分配型分配器或はそれ以上の多分岐分
配器を構威することができる。
分岐数が増加して１本の筒状プリント基板の表面に全て
の分配回路を被着し得ない場合には、筒状プリント基板
の直径を犬ならしめて表面積を大ならしめるか、筒状プ
リント基板を複数本並べ各筒状プリント基板に分配回路
を分散して設けるようにしてもよい。
の分配回路を被着し得ない場合には、筒状プリント基板
の直径を犬ならしめて表面積を大ならしめるか、筒状プ
リント基板を複数本並べ各筒状プリント基板に分配回路
を分散して設けるようにしてもよい。
尚、例えば方形のプリント基板を用いる場合、１枚のプ
リント基板（例えば第１図ないし第４図におけるＰＢ
ｌ ）上に２分配回路、例えばＤ４全体を設ける代りに
２分配回路Ｄ４の一部はＰＢｌに、残部はＰＢ２に設け
、ＰＢｌ側の回路とＰＢ２側の回路を接続導線（図面に
示したＣＷと同様、プリント配線によらない導線）を以
て接続し、この接続導線を含めた線路長がλハとなるよ
うに形威しても本考案を実施することが出来る。
リント基板（例えば第１図ないし第４図におけるＰＢ
ｌ ）上に２分配回路、例えばＤ４全体を設ける代りに
２分配回路Ｄ４の一部はＰＢｌに、残部はＰＢ２に設け
、ＰＢｌ側の回路とＰＢ２側の回路を接続導線（図面に
示したＣＷと同様、プリント配線によらない導線）を以
て接続し、この接続導線を含めた線路長がλハとなるよ
うに形威しても本考案を実施することが出来る。
以上の説明から明らかなように本案分配器は、筒又はこ
れに類似形状（即ち第１図ないし第４図に示したように
接地導体Ｅ２の表面を除いて接地導体Ｅ１の各表面にプ
リント基＠）Ｂ１ないしＰＢ３をコの字型に設けた場合
の形状）のプリント基板に各段の２分配回路を設け、全
体として立体的に構威しであるので、一平面上に２分配
回路を設けた場合に比し全体を小形に形威し得るもので
、実用上の効果甚だ大である。
れに類似形状（即ち第１図ないし第４図に示したように
接地導体Ｅ２の表面を除いて接地導体Ｅ１の各表面にプ
リント基＠）Ｂ１ないしＰＢ３をコの字型に設けた場合
の形状）のプリント基板に各段の２分配回路を設け、全
体として立体的に構威しであるので、一平面上に２分配
回路を設けた場合に比し全体を小形に形威し得るもので
、実用上の効果甚だ大である。
第１図は、本考案の一実施例を示す正面図、第２図は平
面図、第３図は背面面図、第４図は側面図、第５図は要
部の展開図で、Ｅｌ及びＢ２：接地導体、ＰＢｌないし
ＰＢ３ニブリント基板、ＰＢＣｌないしＰＢＣ３：導体
層、Ｔｉ：入力端子、ＴＯｌないしＴＯ８：出力端子、
ＤＩないしＤＩ：２分配回路、ＬｌないしＬ７及びＬｌ
’ないしＬ７′：伝送線路、ＢＲｌないしＢＲ７：平衡
用抵抗、ＣＷ：接続導線である。
面図、第３図は背面面図、第４図は側面図、第５図は要
部の展開図で、Ｅｌ及びＢ２：接地導体、ＰＢｌないし
ＰＢ３ニブリント基板、ＰＢＣｌないしＰＢＣ３：導体
層、Ｔｉ：入力端子、ＴＯｌないしＴＯ８：出力端子、
ＤＩないしＤＩ：２分配回路、ＬｌないしＬ７及びＬｌ
’ないしＬ７′：伝送線路、ＢＲｌないしＢＲ７：平衡
用抵抗、ＣＷ：接続導線である。
Claims (1)
- ｊ２ＲＯ（ＲＯは入出力インピーダンス）なる特性イン
ピーダンスを有すると共に、伝送波長のＩＩ４の長さの
２本の伝送線路の各一端を共通に接続し、前記２本の伝
送線路の各他端間に２ＲＯなる抵抗値を有する平衡用抵
抗を介在せしめて戒る２分配回路を適宜段数、筒又はこ
れに類似形状のプリント基板にプリント配線手法により
被着形成せしめると共に、前記適宜段数の２分配回路に
おける信号の伝送方向を最終的に前記プリント基板の筒
軸の周りの方向に一致せしめたことを特徴とする多分岐
分配器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3816179U JPS607534Y2 (ja) | 1979-03-24 | 1979-03-24 | 多分岐分配器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3816179U JPS607534Y2 (ja) | 1979-03-24 | 1979-03-24 | 多分岐分配器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55138802U JPS55138802U (ja) | 1980-10-03 |
| JPS607534Y2 true JPS607534Y2 (ja) | 1985-03-14 |
Family
ID=28902594
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3816179U Expired JPS607534Y2 (ja) | 1979-03-24 | 1979-03-24 | 多分岐分配器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS607534Y2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0129871Y2 (ja) * | 1984-12-15 | 1989-09-12 | ||
| US7489283B2 (en) * | 2006-12-22 | 2009-02-10 | The Boeing Company | Phased array antenna apparatus and methods of manufacture |
-
1979
- 1979-03-24 JP JP3816179U patent/JPS607534Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55138802U (ja) | 1980-10-03 |
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