JPS6074718A - 直流バイアス回路 - Google Patents
直流バイアス回路Info
- Publication number
- JPS6074718A JPS6074718A JP18024983A JP18024983A JPS6074718A JP S6074718 A JPS6074718 A JP S6074718A JP 18024983 A JP18024983 A JP 18024983A JP 18024983 A JP18024983 A JP 18024983A JP S6074718 A JPS6074718 A JP S6074718A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- switching
- bias
- switching element
- level
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/51—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used
- H03K17/56—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices
- H03K17/687—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors
- H03K17/689—Electronic switching or gating, i.e. not by contact-making and –breaking characterised by the components used by the use, as active elements, of semiconductor devices the devices being field-effect transistors with galvanic isolation between the control circuit and the output circuit
Landscapes
- Power Conversion In General (AREA)
- Electronic Switches (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は直流バイアス回路、更に詳しく言えばスイッチ
ングパルスのデユーティで出力電圧文は電流を制御する
ＤＣ−ＤＣコンバータのスイッチング回路の直流バイア
ス回路に関するものである。
ングパルスのデユーティで出力電圧文は電流を制御する
ＤＣ−ＤＣコンバータのスイッチング回路の直流バイア
ス回路に関するものである。
従来の直流バイアス回路の欠点について、第１図及び第
２図によル説明する。第１図は、従来の直流パ４ ’Ｔ
ス回路の１例であシ、Ｑはスイッチング素子でたとえば
ＭＯ８）ランジスタ等、Ｌは負荷、Ｒは容量Ｃとの時定
数にょシ、ｃの電荷を放電させるための抵抗、Ｄは第２
図に示すスイッチングパルスのローレベルｔ−Ｅ点のア
ースレベルに固定するためのダイオードであシ、ｃはス
イッチングパルスを出力する回路の直流電圧をカットす
るための容量である。第２図は、第１図の回路のスイッ
チングパルス波形と直流バイアスレベルヲ示すものであ
！５、（ａ）は、立上＃）／立下シ時間が無視出来る程
短い場合を示し、（ｂ）は、立上シ及び立下シ時間（Ｔ
ｓ＝Ｔａ）が長い場合を示すものである。（ａ）及び（
ｂ）において、Ｇレベルは、第１図のＥ点即ちｒ−スレ
ベルを示し、ｔｈレベルは、同じくスイッチング素子Ｑ
のオン・オフしきい値レベルを示し、ｔｌｌはスイッチ
ングパルスの高レベルを、ｔＬは同じく低レベルを示し
、それぞれのｔｈレベルに対する振巾をｈｌ及びｈｌで
示す。
２図によル説明する。第１図は、従来の直流パ４ ’Ｔ
ス回路の１例であシ、Ｑはスイッチング素子でたとえば
ＭＯ８）ランジスタ等、Ｌは負荷、Ｒは容量Ｃとの時定
数にょシ、ｃの電荷を放電させるための抵抗、Ｄは第２
図に示すスイッチングパルスのローレベルｔ−Ｅ点のア
ースレベルに固定するためのダイオードであシ、ｃはス
イッチングパルスを出力する回路の直流電圧をカットす
るための容量である。第２図は、第１図の回路のスイッ
チングパルス波形と直流バイアスレベルヲ示すものであ
！５、（ａ）は、立上＃）／立下シ時間が無視出来る程
短い場合を示し、（ｂ）は、立上シ及び立下シ時間（Ｔ
ｓ＝Ｔａ）が長い場合を示すものである。（ａ）及び（
ｂ）において、Ｇレベルは、第１図のＥ点即ちｒ−スレ
ベルを示し、ｔｈレベルは、同じくスイッチング素子Ｑ
のオン・オフしきい値レベルを示し、ｔｌｌはスイッチ
ングパルスの高レベルを、ｔＬは同じく低レベルを示し
、それぞれのｔｈレベルに対する振巾をｈｌ及びｈｌで
示す。
ここで、ｈｌ＞ｈ茸で６る。
スイッチング素子Ｑのオン時間について、波形（ａ）と
（ｂ）を比較してみると、前者がＴｔに対し、後者はＴ
１となシ、オン時間が長くなる。したがって、一定のデ
ユーティを持つスイツチングノ（ルスでも、その立上シ
及び立下り時間の変動によって、スイッチング素子Ｑの
オン時間のデユーティが変動することになり、装置の性
能劣化につながる。
（ｂ）を比較してみると、前者がＴｔに対し、後者はＴ
１となシ、オン時間が長くなる。したがって、一定のデ
ユーティを持つスイツチングノ（ルスでも、その立上シ
及び立下り時間の変動によって、スイッチング素子Ｑの
オン時間のデユーティが変動することになり、装置の性
能劣化につながる。
本発明の目的は、ノ（ルスの立上シ及び立下り時間の変
動に影響されない、安定したデユーティによシ駆動する
ための最適な直流）くイ゛γスを最も経済的に得る回路
を提供することにある。
動に影響されない、安定したデユーティによシ駆動する
ための最適な直流）くイ゛γスを最も経済的に得る回路
を提供することにある。
〔発明の概要〕
本発明は上記目的を達成するため、スイッチング素子の
二つのスイッチング制御信号入力端子の少なくとも一方
がコンデンサによシ直流カットされた回路において、上
記二つの入力端子間にツェナダイオードを接続して構成
したことを特徴とする。
二つのスイッチング制御信号入力端子の少なくとも一方
がコンデンサによシ直流カットされた回路において、上
記二つの入力端子間にツェナダイオードを接続して構成
したことを特徴とする。
第３図によシ、本発明に関する基本的考え方を述べる。
同図（ａ）はスイッチングパルスの立上シ、立下少時間
が短く無視出来る場合を示し、（ｂ）は立上り及び立下
少時間がそれぞれＴｓ 、Ｔ４で、’ｒ３＝＝’ｒ４の
場合を示す。（ａ）、 （ｂ）におイーＣ−１ｔｈ。
が短く無視出来る場合を示し、（ｂ）は立上り及び立下
少時間がそれぞれＴｓ 、Ｔ４で、’ｒ３＝＝’ｒ４の
場合を示す。（ａ）、 （ｂ）におイーＣ−１ｔｈ。
Ｇ、Ｌｍ 、ＬＬについては、第２図と同様であるので
説明を省略するが、ｈ３及びｈ４は、それぞれ、ｔｈレ
ベルに対する振巾を示し、互いに等しい。同じく、ｖｚ
Ｉ 及びＶｚ２ は、Ｇレベル（第１図Ｅ点レベル）に
対する振巾を示すものである。
説明を省略するが、ｈ３及びｈ４は、それぞれ、ｔｈレ
ベルに対する振巾を示し、互いに等しい。同じく、ｖｚ
Ｉ 及びＶｚ２ は、Ｇレベル（第１図Ｅ点レベル）に
対する振巾を示すものである。
同図（ｂ）において、スイッチング素子のオン時間Ｔ
、 ／は、Ｔｓ ＝Ｔ４１ ｈ３ ＝ｈ４の条件によシ
、（ａ）における場合のオン時間Ｔ里と等しく、スイッ
チングパルスの立上り、立下少時間に対する依存性がな
くなることが明らかである。
、 ／は、Ｔｓ ＝Ｔ４１ ｈ３ ＝ｈ４の条件によシ
、（ａ）における場合のオン時間Ｔ里と等しく、スイッ
チングパルスの立上り、立下少時間に対する依存性がな
くなることが明らかである。
本発明の実施例を第４図によシ説明する。同図においｒ
、Ｌ、Ｑ、Ｌ Ｃは、第１図と同様であるので、説明を
省略し、本発明に係るＺＤ、。
、Ｌ、Ｑ、Ｌ Ｃは、第１図と同様であるので、説明を
省略し、本発明に係るＺＤ、。
ＺＤ２の動作について、説明する。Ｚ Ｄ ｔ ＊ｚＤ
２は、ともにツェナーダイオードであり、前者は、アー
ス点Ｅに対するスイッチング／＜ルスの高レベル（第３
図ｔ１１）を、後者は同じく低レベル（第３図ｔＬ）を
決定する鋤をする。即ち、ＺＤＩ ノツ：ｒ−ｆ −電
圧を、第３図Ｖｚ１ に、ＺＩｈのそれを同じ（Ｖｔ＠
に選択することによシ、第３図に示すスイッチングパ
ルスのスイッチ素子に対する直流レベルを得ることが出
来る。
２は、ともにツェナーダイオードであり、前者は、アー
ス点Ｅに対するスイッチング／＜ルスの高レベル（第３
図ｔ１１）を、後者は同じく低レベル（第３図ｔＬ）を
決定する鋤をする。即ち、ＺＤＩ ノツ：ｒ−ｆ −電
圧を、第３図Ｖｚ１ に、ＺＩｈのそれを同じ（Ｖｔ＠
に選択することによシ、第３図に示すスイッチングパ
ルスのスイッチ素子に対する直流レベルを得ることが出
来る。
同様のことを、通常のダイオードのみで行なう場合は、
第３図に示す電圧ＶＥＩ またはＶｗｘ を有する何ら
かの定電圧源が必要とな９、例えば抵抗とツェナーダイ
オードそれぞれ１ケを使用すれば、可能であるが、この
ための電力損失と１ケの部品点数増加をさけることが出
来ない。
第３図に示す電圧ＶＥＩ またはＶｗｘ を有する何ら
かの定電圧源が必要とな９、例えば抵抗とツェナーダイ
オードそれぞれ１ケを使用すれば、可能であるが、この
ための電力損失と１ケの部品点数増加をさけることが出
来ない。
以上の様に、直流バイアス回路にツェナーダイオードを
使用することによシ、スイッチング素子のしきい値電圧
に応じて必要とするツェナーダイオードの電圧を選択す
るだけで、最適な直流ノくイアスレペルを設定出来るた
めスイツチングノくルスの立上シ、立下少時間の変動に
対して、スイッチング素子の実効的動作デユーティの安
定した回路を経済的に実現することが出来る。
使用することによシ、スイッチング素子のしきい値電圧
に応じて必要とするツェナーダイオードの電圧を選択す
るだけで、最適な直流ノくイアスレペルを設定出来るた
めスイツチングノくルスの立上シ、立下少時間の変動に
対して、スイッチング素子の実効的動作デユーティの安
定した回路を経済的に実現することが出来る。
第１図は従来の直流バイアス回路の回路図、第２図は第
１図の動作波形図、第３図は本発明の回路の動作説明の
ための波形図、第４図は本発明の一実施例を示す回路図
である。 Ｑ・・・スイッチング素子、Ｃ・・・コンデンサ、Ｒ・
・・抵抗、Ｄ・・・ダイオード、ＺＤｌ ＋ Ｚｌ）！
・・・ツエナー高１図 第２図 ＭＪ図 第４図
１図の動作波形図、第３図は本発明の回路の動作説明の
ための波形図、第４図は本発明の一実施例を示す回路図
である。 Ｑ・・・スイッチング素子、Ｃ・・・コンデンサ、Ｒ・
・・抵抗、Ｄ・・・ダイオード、ＺＤｌ ＋ Ｚｌ）！
・・・ツエナー高１図 第２図 ＭＪ図 第４図
Claims (1)
- 【特許請求の範囲】 １、スイッチング素子の二つのスイッチング制御信号入
力端子の少なくとも一方がコンデンサにより直流カット
された回路において、上記二つの入力端子間にツェナー
ダイオードを接続したことを特徴とする直流バイアス回
路。 ２６第１項記載の直流バイアス回路において、二つのス
イッチング制御信号入力端子間に、互いに逆極性で直列
接続したツェナーダイオードを接続したことを特徴とす
る直流バイアス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18024983A JPS6074718A (ja) | 1983-09-30 | 1983-09-30 | 直流バイアス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18024983A JPS6074718A (ja) | 1983-09-30 | 1983-09-30 | 直流バイアス回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6074718A true JPS6074718A (ja) | 1985-04-27 |
Family
ID=16079967
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18024983A Pending JPS6074718A (ja) | 1983-09-30 | 1983-09-30 | 直流バイアス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6074718A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0723337A2 (en) * | 1995-01-23 | 1996-07-24 | Sony Corporation | Switching circuit and composite arrangement |
-
1983
- 1983-09-30 JP JP18024983A patent/JPS6074718A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0723337A2 (en) * | 1995-01-23 | 1996-07-24 | Sony Corporation | Switching circuit and composite arrangement |
| EP0723337A3 (en) * | 1995-01-23 | 1997-04-23 | Sony Corp | Circuit and composite device |
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