JPS6045292A - 表示装置 - Google Patents
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- JPS6045292A JPS6045292A JP15421784A JP15421784A JPS6045292A JP S6045292 A JPS6045292 A JP S6045292A JP 15421784 A JP15421784 A JP 15421784A JP 15421784 A JP15421784 A JP 15421784A JP S6045292 A JPS6045292 A JP S6045292A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、アナログ入力信号の大きさをディジタル量に
変換し、複数の表示素子を駆動して棒グラフ表示をする
ようにした表示装置に関するものであって、詳しくは、
比較的少数の表示素子で高精度のアナログ指示を行なう
表示装置を提供するものである。
変換し、複数の表示素子を駆動して棒グラフ表示をする
ようにした表示装置に関するものであって、詳しくは、
比較的少数の表示素子で高精度のアナログ指示を行なう
表示装置を提供するものである。
第１図は、従来のこの種の表示装置の表示プロ、りの−
例を示す構成図であって、Ｂは基板、Ｄ１〜Ｄ１ｏけ表
示素子、ＳＬは目盛線、ＳＮは目盛数字でよび目盛数字
ＳＮは表示素子Ｄ１〜Ｄ１ｏに対応するように基板Ｂ上
に長手方向に沿ってたとえば印刷によシ形成さｈている
。
例を示す構成図であって、Ｂは基板、Ｄ１〜Ｄ１ｏけ表
示素子、ＳＬは目盛線、ＳＮは目盛数字でよび目盛数字
ＳＮは表示素子Ｄ１〜Ｄ１ｏに対応するように基板Ｂ上
に長手方向に沿ってたとえば印刷によシ形成さｈている
。
このような構成において、表示素子りは、アナログ入力
信号の大きさを変換したパルス数に応じて駆動される。
信号の大きさを変換したパルス数に応じて駆動される。
たとえば、第１図に示すように、表示素子Ｄ□〜Ｄ４が
駆動されている状態では、入力信号Ｘの大きさは、４０
≦Ｘ〈５０の範囲にあることを表わすことになシ、１の
桁の大きさについては知ることができない。すなわち、
第１図の構成では）表示素子りの数が１０個であるため
に、１０チの精度でしかアナログ指示を行なうことがで
きない。
駆動されている状態では、入力信号Ｘの大きさは、４０
≦Ｘ〈５０の範囲にあることを表わすことになシ、１の
桁の大きさについては知ることができない。すなわち、
第１図の構成では）表示素子りの数が１０個であるため
に、１０チの精度でしかアナログ指示を行なうことがで
きない。
本発明は、このような欠点を解決したものであり、従来
と同様な構成を有するアナログ表示部を用いてより精度
の高いアナログ指示を行なう表示装置を実現したもので
あって、以下、図面を用いて詳細に説明する。
と同様な構成を有するアナログ表示部を用いてより精度
の高いアナログ指示を行なう表示装置を実現したもので
あって、以下、図面を用いて詳細に説明する。
第２図は、本発明に用いる表示ブロックの一例を示す構
成図であって、第１図と同等部分には同一符号を付して
いる。第２図において、ＳＬＤは目盛線を表示する表示
素子、ＳＮＤ□〜５ＮＤ７は目盛数字を表示する７セグ
メントの表示素子であり、これら表示素子８ＬＤ 、
ＳＮＤ□〜５ＮＤ７は表示素子Ｄ１〜Ｄ１゜で構成され
るアナログ表示部に対応した目盛表示部を構成している
。なお、これら表示ブロックを構成する表示素子として
は、たとえば液晶を用−いる０ このような構成において、アナログ表示部を構成する表
示素子Ｄ□〜Ｄ１ｏは入力信号の大きさに対応したパル
スによシ駆動され、目盛表示部を構成する表示素子ＳＬ
Ｄ、ＳＮＤ□〜５ＮＤ７は外部からの信号で制御される
。
成図であって、第１図と同等部分には同一符号を付して
いる。第２図において、ＳＬＤは目盛線を表示する表示
素子、ＳＮＤ□〜５ＮＤ７は目盛数字を表示する７セグ
メントの表示素子であり、これら表示素子８ＬＤ 、
ＳＮＤ□〜５ＮＤ７は表示素子Ｄ１〜Ｄ１゜で構成され
るアナログ表示部に対応した目盛表示部を構成している
。なお、これら表示ブロックを構成する表示素子として
は、たとえば液晶を用−いる０ このような構成において、アナログ表示部を構成する表
示素子Ｄ□〜Ｄ１ｏは入力信号の大きさに対応したパル
スによシ駆動され、目盛表示部を構成する表示素子ＳＬ
Ｄ、ＳＮＤ□〜５ＮＤ７は外部からの信号で制御される
。
第３図は、これらの関係を概念的に示すブロック図であ
って、ＩＮは入力信号が印加される入力端子、ＤＩＳＰ
、Ｂは第２図に示した構成を有する表示ブロックＮ Ｃ
ＮＴＬ、Ｂは表示ブロックＤＩＳｐ、Ｈの表示状態を制
御する機能を有する制御プロ、りである。制御ブロック
ＣＮＴＬ 、Ｂは、表示ブロックＤＩＳＰ、Ｂを構成す
るアナログ表示部Ａと目盛表示部Ｂの表示状態を連動し
て変化させるための信号を発生するように構成されてい
る。
って、ＩＮは入力信号が印加される入力端子、ＤＩＳＰ
、Ｂは第２図に示した構成を有する表示ブロックＮ Ｃ
ＮＴＬ、Ｂは表示ブロックＤＩＳｐ、Ｈの表示状態を制
御する機能を有する制御プロ、りである。制御ブロック
ＣＮＴＬ 、Ｂは、表示ブロックＤＩＳＰ、Ｂを構成す
るアナログ表示部Ａと目盛表示部Ｂの表示状態を連動し
て変化させるための信号を発生するように構成されてい
る。
第４図は、第３図の具体的な回路の一例を示すブロック
図であって、ＩＮｌ′ｉ被測定信号の入力端子、Ａ／Ｄ
は入力信号の大きさをディジタル量たとえばパルス数に
変換する信号変換器、ＳＲ□、ＳＲ２は信号変換器Ａ／
Ｄの出力パルスを格納する格納手段として用いるシフト
レジスタでアシ、第１のシフトレジスタＳＲ□の最上位
ビット出力は第２のシフトレジスタＳＲ２のクロック端
子に接続されているｏ ＳＷは１粗１測定（ＣＯＡＲ８
Ｅ）と１密１測定（ＦＩ邪）とを切シ換える切換スイッ
チ、ＲＥＧは粗測定時の目盛表示部Ｂの目盛数字情報を
格納する格納手段として用いるレジスタ、ｓｗｃｌは切
換スイッチｓ１ｖにしたがってシフトレジスタ５ｒｔ１
． ＳＲ２のいずれか一方の内容をアナログ表示部Ａに
送出する第１の切換回路、５ＷＣ２は切換スイッチＳＷ
にしたがって第２のシフトレジスタＳＲ２，Ｎるいはレ
ジスタＲＥＧのいずれがの内容を目盛表示部Ｂに接続さ
れたデコーダＤＥＣ１に送出する第２の切換回路である
。デコーダＤＥＣ１１１″ｔ１第２の切換回路５ＷＣ２
の出力にしたがって目盛表示部Ｂを構成する表示素子Ｓ
ＬＤ 、 ＳＮＤ□〜５ＮＤ７を駆動するための信号を
発生する。ＤＶ□は第１の切換回路ＳＷＣ□の出力にし
たがってアナログ表示部Ａを構成する表示素子Ｄ□〜Ｄ
１ｏを駆動する第１の駆動回路、Ｄｖ２はデコーダＤＥ
Ｃ工の出力にしたがって目盛表示部Ｂを構成するＳＬＤ
、 ＳＮＤ −５ＮＤ７を駆動す、る第２の駆動回路
である。
図であって、ＩＮｌ′ｉ被測定信号の入力端子、Ａ／Ｄ
は入力信号の大きさをディジタル量たとえばパルス数に
変換する信号変換器、ＳＲ□、ＳＲ２は信号変換器Ａ／
Ｄの出力パルスを格納する格納手段として用いるシフト
レジスタでアシ、第１のシフトレジスタＳＲ□の最上位
ビット出力は第２のシフトレジスタＳＲ２のクロック端
子に接続されているｏ ＳＷは１粗１測定（ＣＯＡＲ８
Ｅ）と１密１測定（ＦＩ邪）とを切シ換える切換スイッ
チ、ＲＥＧは粗測定時の目盛表示部Ｂの目盛数字情報を
格納する格納手段として用いるレジスタ、ｓｗｃｌは切
換スイッチｓ１ｖにしたがってシフトレジスタ５ｒｔ１
． ＳＲ２のいずれか一方の内容をアナログ表示部Ａに
送出する第１の切換回路、５ＷＣ２は切換スイッチＳＷ
にしたがって第２のシフトレジスタＳＲ２，Ｎるいはレ
ジスタＲＥＧのいずれがの内容を目盛表示部Ｂに接続さ
れたデコーダＤＥＣ１に送出する第２の切換回路である
。デコーダＤＥＣ１１１″ｔ１第２の切換回路５ＷＣ２
の出力にしたがって目盛表示部Ｂを構成する表示素子Ｓ
ＬＤ 、 ＳＮＤ□〜５ＮＤ７を駆動するための信号を
発生する。ＤＶ□は第１の切換回路ＳＷＣ□の出力にし
たがってアナログ表示部Ａを構成する表示素子Ｄ□〜Ｄ
１ｏを駆動する第１の駆動回路、Ｄｖ２はデコーダＤＥ
Ｃ工の出力にしたがって目盛表示部Ｂを構成するＳＬＤ
、 ＳＮＤ −５ＮＤ７を駆動す、る第２の駆動回路
である。
第５図（、）、 （ｂ）は、第４図の動作状態の一例を
示す表示ブロックの動作図である。たとえば、第４図に
おいて、測定範囲を０〜１００ とし、入力信号の大き
さをＷ４７１とする。このとき、第１のシフトレジスタ
ＳＲ□には下位桁の１１７１１の情報が格納され、第２
のシフトレジスタＳＲ２には上位桁の１１４１１の情報
が格納されている。そして、切換スイッチＳＷを１粗１
に設定すると、アナログ表示部Ａには第２のシフトレジ
スタＳＲｊの内容撃“４曾゛が送出され、目盛表示部Ｂ
にはレジスタＲＥＧの内容が送出される０これによシ、
表示ブロックの表示状態は第５図（、）のようになシ、
第１図の装置と同様に１０ ％の精度でアナログ指示を
行なう。次に、切換スイッチ蒲を５密１に切シ換えると
、アナログ表示部Ａには第１のシフトレジスタＳＲ１の
内容１１７１１が送出され、目盛表示部Ｂには第２のシ
フトレジスタＳＲ２の内容゛４“°が送出される。そし
て、アナログ表示部Ａは入力信号の下位桁＋１７“１を
アナログ指示し、目盛表示部Ｂは入力信号の上位桁＋１
４１１の範囲である“”４０〜４５〜５０”をディジタ
ル表示することになる。これにより、表示ブロックの表
示状態は第５図（ｂ）のようになり、１チの精度でアナ
ログ指示を行なうことができる。なお、密測定時におけ
る表示ブロックの表示状態は、入力信号の変化に応じて
自動的に切シ換わり、オートレンジの表示装置が実現で
きる。
示す表示ブロックの動作図である。たとえば、第４図に
おいて、測定範囲を０〜１００ とし、入力信号の大き
さをＷ４７１とする。このとき、第１のシフトレジスタ
ＳＲ□には下位桁の１１７１１の情報が格納され、第２
のシフトレジスタＳＲ２には上位桁の１１４１１の情報
が格納されている。そして、切換スイッチＳＷを１粗１
に設定すると、アナログ表示部Ａには第２のシフトレジ
スタＳＲｊの内容撃“４曾゛が送出され、目盛表示部Ｂ
にはレジスタＲＥＧの内容が送出される０これによシ、
表示ブロックの表示状態は第５図（、）のようになシ、
第１図の装置と同様に１０ ％の精度でアナログ指示を
行なう。次に、切換スイッチ蒲を５密１に切シ換えると
、アナログ表示部Ａには第１のシフトレジスタＳＲ１の
内容１１７１１が送出され、目盛表示部Ｂには第２のシ
フトレジスタＳＲ２の内容゛４“°が送出される。そし
て、アナログ表示部Ａは入力信号の下位桁＋１７“１を
アナログ指示し、目盛表示部Ｂは入力信号の上位桁＋１
４１１の範囲である“”４０〜４５〜５０”をディジタ
ル表示することになる。これにより、表示ブロックの表
示状態は第５図（ｂ）のようになり、１チの精度でアナ
ログ指示を行なうことができる。なお、密測定時におけ
る表示ブロックの表示状態は、入力信号の変化に応じて
自動的に切シ換わり、オートレンジの表示装置が実現で
きる。
第６図は、第３図の他の具体的な回路例を示したブロッ
ク図であって、第４図と同等部分圧は同一符号を付して
いる。第６図において、ＰＯＬは入力信号の極性を判別
する極性判別回路Ｎ ＳＲ３は極性判別回路ＰＯＬの出
力に応じて左右いずれかの方向に信号変換器Ａ／Ｄの出
力パルスを格納してアナログ表示部Ａに送出する格納手
段として用いるシフトレジスタ、５ＷＣ３は極性判別回
路ＰＯＬの出力に応じて目盛表示部Ｂの表示を切り換え
る切換回路である。
ク図であって、第４図と同等部分圧は同一符号を付して
いる。第６図において、ＰＯＬは入力信号の極性を判別
する極性判別回路Ｎ ＳＲ３は極性判別回路ＰＯＬの出
力に応じて左右いずれかの方向に信号変換器Ａ／Ｄの出
力パルスを格納してアナログ表示部Ａに送出する格納手
段として用いるシフトレジスタ、５ＷＣ３は極性判別回
路ＰＯＬの出力に応じて目盛表示部Ｂの表示を切り換え
る切換回路である。
第７図（、）〜（ｃ）は、第６図の構成において用いる
表示ブロックの一例を示す構成図および動作状態を示す
動作図である。第７図（、）に示すように、表示ブロッ
クには、表示素子Ｄ□〜Ｄ工、よシなるアナログ表示部
、および表示素子５ＬＩ）よりなる目盛線と表示素子Ｓ
Ｄ＋、 ＳＤ−よ如なる目盛数字とで構成された目盛表
示部が設けられている。たとえば、第６図において、測
定範囲を０〜±１０とする。そして、入力信号＋１＋７
＋＋が加えられると、シフトレジスタＳＲ３には右方向
に所定数のパルスが格納されてアナログ表示部人に送出
され、切換回路ＳＷＣは表１１°０・０″３０１・＊ｙ
ｐｆｏｙ／”ｄ＠７ 、、、、。
表示ブロックの一例を示す構成図および動作状態を示す
動作図である。第７図（、）に示すように、表示ブロッ
クには、表示素子Ｄ□〜Ｄ工、よシなるアナログ表示部
、および表示素子５ＬＩ）よりなる目盛線と表示素子Ｓ
Ｄ＋、 ＳＤ−よ如なる目盛数字とで構成された目盛表
示部が設けられている。たとえば、第６図において、測
定範囲を０〜±１０とする。そして、入力信号＋１＋７
＋＋が加えられると、シフトレジスタＳＲ３には右方向
に所定数のパルスが格納されてアナログ表示部人に送出
され、切換回路ＳＷＣは表１１°０・０″３０１・＊ｙ
ｐｆｏｙ／”ｄ＠７ 、、、、。
図（ｂ）のような表示状態となる。また、入力信号＋＋
−７＋＋が加えられると、シフトレジスタＳＲには左方
向に所定数のパルスが格納されてアナログ表示部Ａに送
出され、切換回路ｓｗ３は表示素子ＳＤ を選択駆動し
、表示ブロックＢは第７図（Ｃ）のような表示状態とな
る。このように、第６図の構成によれば、入力信号の極
性に応じて表示ブロックの表示状態が自動的に切シ換わ
る表示装置が得られる。
−７＋＋が加えられると、シフトレジスタＳＲには左方
向に所定数のパルスが格納されてアナログ表示部Ａに送
出され、切換回路ｓｗ３は表示素子ＳＤ を選択駆動し
、表示ブロックＢは第７図（Ｃ）のような表示状態とな
る。このように、第６図の構成によれば、入力信号の極
性に応じて表示ブロックの表示状態が自動的に切シ換わ
る表示装置が得られる。
なお、第６図の構成に第４図の機能を付加することによ
り、測定精度を高めることもできる。
り、測定精度を高めることもできる。
第８図も、第３図の他の具体的な回路例を示したブロッ
ク図であって、第４図と同等部分には同一符号を付して
いる。第８図において、Ｒ８ｗは測定範囲を選択するレ
ンジ切換スイッチ、ＥＮＣはレンジ切換スイッチＲ８Ｗ
の設定状態をコード化するエンコーダ、ＭＰは信号変換
器Ａ／Ｄの出力パルスをレンジ切換スイッチＲ８Ｗの設
定状態にしたがって逓倍あるいは分周する信号処理回路
、ＳＲは信号処理回路ＭＰの出力パルスを格納してアナ
ログ表示部Ａに送出する格納手段として用いるシフトレ
ジスタ、５ＷＣ４はレンジ切換スイッチＲ８Ｗの設定状
態にしたがって目盛表示部Ｂの表示を切り換える切換回
路である。ここで、目盛表示部ＢＫは指数表示部が設け
られていて、この指数表示部の表示は、レンジ切換スイ
ッチＲＡＷの設定状態に連動して切シ換わるように構成
されている。これによシ、測定範囲の切シ換えに応じて
表示ブロックの表示状態が自動的に切り換わるように構
成された表示装置が実現できる。なお、第８図の構成に
１前述第４図および第６図の機能を付加して測定精度を
高めるとともに入力信号の極性に応じて自動的に・表示
状態が切シ換わるようにすることもできる。
ク図であって、第４図と同等部分には同一符号を付して
いる。第８図において、Ｒ８ｗは測定範囲を選択するレ
ンジ切換スイッチ、ＥＮＣはレンジ切換スイッチＲ８Ｗ
の設定状態をコード化するエンコーダ、ＭＰは信号変換
器Ａ／Ｄの出力パルスをレンジ切換スイッチＲ８Ｗの設
定状態にしたがって逓倍あるいは分周する信号処理回路
、ＳＲは信号処理回路ＭＰの出力パルスを格納してアナ
ログ表示部Ａに送出する格納手段として用いるシフトレ
ジスタ、５ＷＣ４はレンジ切換スイッチＲ８Ｗの設定状
態にしたがって目盛表示部Ｂの表示を切り換える切換回
路である。ここで、目盛表示部ＢＫは指数表示部が設け
られていて、この指数表示部の表示は、レンジ切換スイ
ッチＲＡＷの設定状態に連動して切シ換わるように構成
されている。これによシ、測定範囲の切シ換えに応じて
表示ブロックの表示状態が自動的に切り換わるように構
成された表示装置が実現できる。なお、第８図の構成に
１前述第４図および第６図の機能を付加して測定精度を
高めるとともに入力信号の極性に応じて自動的に・表示
状態が切シ換わるようにすることもできる。
第９図も、第３図の他の具体的な回路例を示したブロッ
ク図であって、第４図と同等部分には同一符号を付して
いる。第９図において、ＳＲ５〜ＳＲ８は信号変換１５
Ａ／Ｄの出力パルスを格納しその内容を切換回路５Ｗ
Ｃ５を介してアナログ表示部Ａに送出するとともに目盛
表示部Ｂに接続されたデコーダＤＥＣ２に送出する格納
手段として用いるシフトレジスタで、これらシフトレジ
スタＳＲ５〜ＳＲ８は、下位桁の最上位ビット出力が次
の上位桁のシフトレジスタのクロック端子にそれぞれ接
続されている。ＤＥＴは桁検出回路で、各シフトレジス
タＳＲ５〜ＳＲ８の最下位ピット出力にしたがって入力
信号Ｚの最上位桁を検出する。ＣＮＴＬは制御回路で、
桁検出回路ＤＥＴの出力にしたがって切換回路５ＷＣ５
およびデコーダＤＥＣ２を制御する信号を送出する。こ
こで、目盛表示部Ｂには第８図と同様に指数表示部が設
けられている。このような構成において、シフトレジス
タＳＲ５〜ＳＲ８は、それぞれ官’１−４０−１００−
１０００“′の桁に対応するものとする。そして、たと
えば入力信号として”５６７Ｉ「 が加えられたとする
と、シフトレジスタＳＲ５には１の桁の＋＋７＋＋に対
応した情報が格納され、ＳＲには１０の桁の“°６０に
対応した情報が格納され、ＳＲ７には１００の桁の＋＋
５＋＋に対応した情報が格納される。一方、桁検出回路
ＤＥＴは、これらシフトレジスタＳＲ５〜ＳＲ８の最下
位ビット出力にしたがって、入力信号の最上位桁が”１
００ ”であることを検出する。制御回路ＣＮＴＬは、
この検出回路ＤＥＴの出力にしたがって、デコーダＤＥ
Ｃ２に指数・・１０２・・を表示する指令を送出すると
ともに、切換回路５ＷＣ５に最上位桁に対応したシフト
レジスタＳＲ７の内容をデコーダＤＥＣ２に送出し上位
第２桁に対応したシフトレジスタＳＲ６の内容をアナロ
グ表示部Ａに送出する指令を送出する。デコーダＤＥＣ
２は、このシフトレジスタＳＲ７の内容にしたがって、
前述第４図の密測定時と同様に、目盛表示部Ｂに入力信
号の最上位桁“５＋１の範囲である・“６と指数・・１
０２”をディジタル表示する。オた、アナログ表示部Ａ
Ｉ′ｉ、上位第２桁ｕ６ｎをアナログ指示する。このよ
うに、第９図の構成によれば、表示ブロックの表示状態
が入力信号の大きさに応じて自動的に切シ換わり、入力
信号の最上位桁を目盛表示部Ｂによりディジタル指示す
るとともに上位第２桁をアナログ表示部Ａによシアナロ
グ指示することができ、第４図の構成と同様、精度の高
い表示動作を行なう表示装置が実現できる。
ク図であって、第４図と同等部分には同一符号を付して
いる。第９図において、ＳＲ５〜ＳＲ８は信号変換１５
Ａ／Ｄの出力パルスを格納しその内容を切換回路５Ｗ
Ｃ５を介してアナログ表示部Ａに送出するとともに目盛
表示部Ｂに接続されたデコーダＤＥＣ２に送出する格納
手段として用いるシフトレジスタで、これらシフトレジ
スタＳＲ５〜ＳＲ８は、下位桁の最上位ビット出力が次
の上位桁のシフトレジスタのクロック端子にそれぞれ接
続されている。ＤＥＴは桁検出回路で、各シフトレジス
タＳＲ５〜ＳＲ８の最下位ピット出力にしたがって入力
信号Ｚの最上位桁を検出する。ＣＮＴＬは制御回路で、
桁検出回路ＤＥＴの出力にしたがって切換回路５ＷＣ５
およびデコーダＤＥＣ２を制御する信号を送出する。こ
こで、目盛表示部Ｂには第８図と同様に指数表示部が設
けられている。このような構成において、シフトレジス
タＳＲ５〜ＳＲ８は、それぞれ官’１−４０−１００−
１０００“′の桁に対応するものとする。そして、たと
えば入力信号として”５６７Ｉ「 が加えられたとする
と、シフトレジスタＳＲ５には１の桁の＋＋７＋＋に対
応した情報が格納され、ＳＲには１０の桁の“°６０に
対応した情報が格納され、ＳＲ７には１００の桁の＋＋
５＋＋に対応した情報が格納される。一方、桁検出回路
ＤＥＴは、これらシフトレジスタＳＲ５〜ＳＲ８の最下
位ビット出力にしたがって、入力信号の最上位桁が”１
００ ”であることを検出する。制御回路ＣＮＴＬは、
この検出回路ＤＥＴの出力にしたがって、デコーダＤＥ
Ｃ２に指数・・１０２・・を表示する指令を送出すると
ともに、切換回路５ＷＣ５に最上位桁に対応したシフト
レジスタＳＲ７の内容をデコーダＤＥＣ２に送出し上位
第２桁に対応したシフトレジスタＳＲ６の内容をアナロ
グ表示部Ａに送出する指令を送出する。デコーダＤＥＣ
２は、このシフトレジスタＳＲ７の内容にしたがって、
前述第４図の密測定時と同様に、目盛表示部Ｂに入力信
号の最上位桁“５＋１の範囲である・“６と指数・・１
０２”をディジタル表示する。オた、アナログ表示部Ａ
Ｉ′ｉ、上位第２桁ｕ６ｎをアナログ指示する。このよ
うに、第９図の構成によれば、表示ブロックの表示状態
が入力信号の大きさに応じて自動的に切シ換わり、入力
信号の最上位桁を目盛表示部Ｂによりディジタル指示す
るとともに上位第２桁をアナログ表示部Ａによシアナロ
グ指示することができ、第４図の構成と同様、精度の高
い表示動作を行なう表示装置が実現できる。
なお、これら実施例では、表示素子として液晶を用いて
いるので消費電力が少なくてすむという利点もあるが、
よシ高β度の表示を得たい場合には、発光ダイオードや
プラズマ表示素子、蛍光表示素子を用いることもできる
。
いるので消費電力が少なくてすむという利点もあるが、
よシ高β度の表示を得たい場合には、発光ダイオードや
プラズマ表示素子、蛍光表示素子を用いることもできる
。
また、これら実施例では、入力信号の大きさをパルス数
に変換してこれら出力パルスを格納手段として用いるシ
フトレジスタに格納する例について示したが、シフトレ
ジスタのかゎシにカウンタとデコーダとを組み合わせて
用いても同様の効果が得られる。
に変換してこれら出力パルスを格納手段として用いるシ
フトレジスタに格納する例について示したが、シフトレ
ジスタのかゎシにカウンタとデコーダとを組み合わせて
用いても同様の効果が得られる。
さらに、目盛表示部に、測定対象の物理量の種類（電圧
、抵抗、温度等）を切シ換え表示するように構成するこ
ともできる。
、抵抗、温度等）を切シ換え表示するように構成するこ
ともできる。
以上説明したように、本発明によれば、比較的少数の表
示素子で高精度のアナログ指示を行なう表示装置が実現
でき、テスターや工業計器用の指示計等に好適である。
示素子で高精度のアナログ指示を行なう表示装置が実現
でき、テスターや工業計器用の指示計等に好適である。
第１図は従来の表示装置の表示ブロックの一例を示す構
成図、第２図は本発明に用いる表示ブロックの一例を示
す構成図、第３図は本発明の概念を示すブロック図、第
４図は第３図の具体的な回路の一例を示すブロック図、
第５図は第４図の動作状態の一例を示す表示ブロックの
動作図、第６図は第３図の他の具体的な回路例を示すブ
ロック図、第７図は第６因の構成において用いる表示ブ
ロックの一例を示す構成図および動作図、第８図および
第９図もそれぞれ第３図の他の具体的な回路例を示すブ
ロック図である。 ＩＮ・・・入力端子、ＤＩＳＰ、Ｂ・・・表示ブロック
、ＣＮＴＬ、Ｂ・・・制御ブロック、Ａ・・・アナログ
表示部、Ｂ・・・目盛表示部。
成図、第２図は本発明に用いる表示ブロックの一例を示
す構成図、第３図は本発明の概念を示すブロック図、第
４図は第３図の具体的な回路の一例を示すブロック図、
第５図は第４図の動作状態の一例を示す表示ブロックの
動作図、第６図は第３図の他の具体的な回路例を示すブ
ロック図、第７図は第６因の構成において用いる表示ブ
ロックの一例を示す構成図および動作図、第８図および
第９図もそれぞれ第３図の他の具体的な回路例を示すブ
ロック図である。 ＩＮ・・・入力端子、ＤＩＳＰ、Ｂ・・・表示ブロック
、ＣＮＴＬ、Ｂ・・・制御ブロック、Ａ・・・アナログ
表示部、Ｂ・・・目盛表示部。
Claims (1)
- 一次元的に配列された複数の表示素子で構成され入力信
号の大きさをアナログ的に表糸するアナログ表示部およ
びこのアナログ表示部の配列方向に沿って配置された複
数の表示素子で構成されアナログ表示部の目盛を表示す
る目盛表示部を含む表示ブロックと、入力信号の大きさ
に対応したディジタル信号および表示ブロックのアナロ
グ表示部および目盛表示部の動作を制御する制御信号を
表示ブロックに送出する１ｌｒｆ制御ブロツクとを具備
し、これら制御ブロックから送出されるディジタル信号
および制御信号によシ表示ブロックのアナログ表示部お
よび目盛表示部の表示状態を連動して変化させるように
構成された表示装置において、前記制御ブロックとして
、入力信号の大きさをディジタル量に変換する信号変換
器と、この信号変換器の出力信号を格納する第１．第２
の格納手段と、粗測定と密測定とを切り換える切換スイ
ッチと、粗測定時の目盛数字情報を格納する第５の格納
手段と、前記切換スイ、テにしたがって前記第１゜第２
の格納手段のいずれか一方の内容をアナログ表示部に送
出する第１の切換回路と、前記切換スイッチにしたがっ
て前記第２あるいは第３の格納手段のいずれかの内容を
目盛表示部に送出する第２の切換回路とを含むものを用
い、粗測定と密測定の切シ換えに応じて表示ブロックの
アナログ表示部および目盛表示部の表示状態が自動的に
切り換わるようにしたことを特徴とする表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15421784A JPS6045292A (ja) | 1984-07-25 | 1984-07-25 | 表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15421784A JPS6045292A (ja) | 1984-07-25 | 1984-07-25 | 表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6045292A true JPS6045292A (ja) | 1985-03-11 |
| JPS6348075B2 JPS6348075B2 (ja) | 1988-09-27 |
Family
ID=15579401
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15421784A Granted JPS6045292A (ja) | 1984-07-25 | 1984-07-25 | 表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6045292A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6348596A (ja) * | 1986-08-18 | 1988-03-01 | カルロ・ガバッツイ・ホ−ルディング・アクチエンゲゼルシャフト | バ−グラフ表示方法 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5232341U (ja) * | 1975-08-29 | 1977-03-07 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5232341B2 (ja) * | 1974-01-14 | 1977-08-20 |
-
1984
- 1984-07-25 JP JP15421784A patent/JPS6045292A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5232341U (ja) * | 1975-08-29 | 1977-03-07 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6348596A (ja) * | 1986-08-18 | 1988-03-01 | カルロ・ガバッツイ・ホ−ルディング・アクチエンゲゼルシャフト | バ−グラフ表示方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6348075B2 (ja) | 1988-09-27 |
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