JPS6043035B2 - semiconductor equipment - Google Patents

semiconductor equipment

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JPS6043035B2
JPS6043035B2 JP54150034A JP15003479A JPS6043035B2 JP S6043035 B2 JPS6043035 B2 JP S6043035B2 JP 54150034 A JP54150034 A JP 54150034A JP 15003479 A JP15003479 A JP 15003479A JP S6043035 B2 JPS6043035 B2 JP S6043035B2
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Japan
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thyristor
reverse
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公裕 村岡
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Toyo Electric Manufacturing Ltd
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    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L25/00Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
    • H01L25/18Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
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    • H01L2924/0001Technical content checked by a classifier
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Description

【発明の詳細な説明】 近年の可変電圧、可変周波制御技術の進歩に伴い、その
制御装置は大容量化し車輌駆動誘導電動機にまで応用範
囲が拡大しつつある。
DETAILED DESCRIPTION OF THE INVENTION With recent advances in variable voltage and variable frequency control technology, the capacity of control devices has increased and the scope of application is expanding to include vehicle drive induction motors.

これに伴い可変電圧、可変周波制御装置に使用される半
導体素子も大容量化し、かつ特殊定格の素子が必要とな
つて来た。一例として車輌駆動誘導電動機用可変電圧、
可変周波制御装置に使用される半導体素子でも前記装置
の転流用サイリスタは2.5KVの逆阻止能力を有し、
そのターンオフタイムは30psecで平均オン電流は
400Aであるが、パルス電流は5000A)通電期間
60μsecdi/dtは300A/μsecを有する
特殊サイリスタが要求されている。前記サイリスタを通
常構造のサイリスタで実現することはサイリスタの点弧
特性の悪化を招き実使用り耐えない。本発明は前述した
ような要求を実現するためになされたものである。
Along with this, semiconductor elements used in variable voltage and variable frequency control devices have also increased in capacity, and elements with special ratings have become necessary. For example, variable voltage for vehicle drive induction motors,
Even in the semiconductor device used in the variable frequency control device, the commutation thyristor of the device has a reverse blocking ability of 2.5 KV,
The turn-off time is 30 psec, the average on-current is 400 A, but the pulse current is 5000 A). A special thyristor is required that has a conduction period of 60 μsec di/dt of 300 A/μsec. If the thyristor is realized by a thyristor having a normal structure, the ignition characteristics of the thyristor will deteriorate and it will not be suitable for practical use. The present invention has been made to fulfill the above-mentioned requirements.

本発明は現在車輌用電機子チョッパーに使用されている
逆導通サイリスタのサイリスタ部(逆導電形サイリスタ
)の特性は、前述のサイリスタの順方向特性を備えてい
るので、この部分を利用すること、即ち2.5KVの高
速逆導電形サイリスタの逆阻止能力を補う方向に2.5
KVの高速ダイオードを直列に一体化することにより、
2.5KVの逆阻止能力を有し、かつサイリスタとして
点弧特性の優れた前記要求の素子を実現することが可能
となる。本発明の特長とするところは、逆導電形サイリ
スタウエフア逆阻止能力を補う方向にダイオードウエフ
アを直列に固着一体化するに際して、両ウエフアの電圧
阻止接合に負ベベルを与えたことである。
The present invention utilizes the characteristics of the thyristor portion (reverse conduction type thyristor) of the reverse conduction thyristor currently used in vehicle armature choppers since it has the forward direction characteristics of the thyristor described above. In other words, 2.5 KV is required to compensate for the reverse blocking ability of the 2.5 KV high speed reverse conduction type thyristor.
By integrating KV high-speed diodes in series,
It becomes possible to realize the above-required element which has a reverse blocking ability of 2.5 KV and has excellent ignition characteristics as a thyristor. A feature of the present invention is that when diode wafers are fixedly integrated in series in a direction that supplements the reverse blocking ability of the reverse conduction type thyristor wafer, a negative bevel is given to the voltage blocking junction of both wafers.

この理由の一つは素子構造面に起因する機械的な信頼性
の向上にあり、他の一つは2.5KV級高速ダイオード
では正ベベルよりも負ベベルの方・が高温時におけるも
れ電流が小さいと言う実験事実に基き素子の信頼性向上
を計つた点である。以下図面により本発明の一実施例に
ついて詳細に説明する。第1図は本発明の半導体装置の
一実施例の縦断・面図であり、半導体装置1はPNIP
N接合を有する逆導電形サイリスタウエフア2、一つの
PN接合を有するグイオードウエフア3、アノード電極
24およびカソード電極24′が一体化されたものであ
る。
One of the reasons for this is improved mechanical reliability due to the element structure, and the other is that in 2.5KV class high-speed diodes, the leakage current at high temperatures is higher with a negative bevel than with a positive bevel. The aim is to improve the reliability of the device based on the experimental fact that the An embodiment of the present invention will be described in detail below with reference to the drawings. FIG. 1 is a vertical cross-sectional view of an embodiment of the semiconductor device of the present invention, and the semiconductor device 1 is a PNIP
A reverse conductivity type thyristaulic wafer 2 having an N junction, a guiode wafer 3 having one PN junction, an anode electrode 24 and a cathode electrode 24' are integrated.

サイリスタウエフア2は比抵抗100〜130ΩαのN
形シリコンで直径4『、厚さ400μである。これにP
形およびN形の不純物をそれぞれ選択的に拡散すること
により、図示のような五つの層が形成される。すなわち
、5は厚さ270μを有するN形母材層、6はエピタキ
シャル成長法で形成した比抵抗0.1Ω礪、、厚さ40
μを有するN+層、7はボロン拡散で形成されたシート
抵抗5Ω/口、厚さ10μを有するP形エミッタ層、8
はガリウム拡散で形成したシート抵抗30Ω/口、厚さ
90μを有するP形層、9はリン拡散で形成されたシー
ト抵抗0.4Ω/口、厚さ20μを有するN形エミッタ
層である。10はN形ベース層6とP形エミッタ層7に
よつて形成されたアノードエミッタ接合、11はN形母
材層5とP形ベース層8によつて形成された中央PN接
合、12はP形ベース層8とN形エミッタ層9によつて
形成されたカソードエミッタ接合である。
Thyristauer Furia 2 has a specific resistance of 100 to 130 Ωα.
It is made of silicon and has a diameter of 4" and a thickness of 400μ. P for this
By selectively diffusing type and N type impurities, five layers as shown are formed. That is, 5 is an N-type base material layer having a thickness of 270μ, 6 is a resistivity 0.1Ω layer formed by epitaxial growth, and a thickness of 40μ.
7 is a P-type emitter layer formed by boron diffusion with a sheet resistance of 5 Ω/hole and a thickness of 10 μ; 8
9 is a P-type layer formed by gallium diffusion and has a sheet resistance of 30 Ω/hole and a thickness of 90 μm, and 9 is an N-type emitter layer formed by phosphorus diffusion and has a sheet resistance of 0.4 Ω/hole and a thickness of 20 μm. 10 is an anode emitter junction formed by N type base layer 6 and P type emitter layer 7, 11 is a central PN junction formed by N type base material layer 5 and P type base layer 8, and 12 is P type emitter junction. The cathode-emitter junction is formed by the N-type base layer 8 and the N-type emitter layer 9.

サイリスタウエフア2はP形エミッタ層7および低比抵
抗N+層6の表面より、サイリスタウエフア2のターン
オフタイムを短縮するため820〜860℃の温度で6
@間の金拡散が実施される。P形エミッタ層7および低
比抵抗のN+層6の表面は、中間支持板22へ金属ろう
層23″を介して低抵抗接触すると共に、さらに金属ろ
う層23とP形低比抵抗シリコン25および金属ろう層
23″を介してダイオードウエフア3と固着している。
N形エミッタ層9および低比抵抗のP形層8の表面には
カソード電極24″とゲート電極21が低抵抗接触で設
けられる。タイオードウエフア3はサイリスタウエフア
、.2の逆方向阻止能力を補うために、その順方向阻止
能力も同等もしくはそれ以上の逆耐圧をもつPN接合1
8が形成されており、N形シリコンの比抵抗は100〜
130f1礪、直径4亡、厚さ370μのシリコンウエ
フアの片面よりN形不純物のリンを!シート抵抗0.4
Ω/口で50μ拡散してN+形層17が、他面よりP形
不純物のボロンをシート抵抗5Ω/口で50μ拡散して
P形層16が形成される。従つてN形母材層15の厚み
は270μである。ダイオードウエフア3の低比抵抗の
P形層16から(ダイオードウエフア3の逆回復電荷を
小さくするため820〜860℃の温度で6吟間の金拡
散が実施される。N+形層17はその表面がP形低比抵
抗シリコン25へ金属ろう層23″により低抵抗接触で
固着される。中間支持板22は熱膨張係数の小さい導電
性のよい金属、例えばタングステン、モリブデンが望ま
しく、金属ろう23,23″,23″はアルミニウムを
主成分とした薄い箔が好ましい。第一段階としてサイリ
スタウエフア2、中間支持板22、P形低比抵抗シリコ
ン25は、製造過程で金属ろう23,23″を上記詳細
に説明した図示の順序で重ね合わせて不活性ガス中で7
20〜)750℃に加熱することにより、それぞれを接
着し一体化される。
From the surface of the P-type emitter layer 7 and the low resistivity N+ layer 6, the thyristue air 2 is heated at a temperature of 820 to 860°C in order to shorten the turn-off time of the thyristau air 2.
Gold diffusion between @ will be implemented. The surfaces of the P-type emitter layer 7 and the low-resistivity N+ layer 6 are in low-resistance contact with the intermediate support plate 22 via the metal solder layer 23'', and the metal solder layer 23 and the P-type low-resistivity silicon 25 and It is fixed to the diode wafer 3 via a metal brazing layer 23''.
A cathode electrode 24'' and a gate electrode 21 are provided in low resistance contact on the surfaces of the N-type emitter layer 9 and the low resistivity P-type layer 8. In order to supplement the capacity, we use a PN junction 1 whose forward blocking capacity has the same or higher reverse breakdown voltage.
8 is formed, and the specific resistance of N-type silicon is 100~
Phosphorus, an N-type impurity, is removed from one side of a silicon wafer with a diameter of 130 f1, a diameter of 4 mm, and a thickness of 370 μ. Sheet resistance 0.4
An N+ type layer 17 is formed by diffusing 50 μm with a sheet resistance of 5Ω/portion to form an N+ type layer 17, and a P type layer 16 is formed by diffusing boron as a P type impurity from the other side by 50 μm with a sheet resistance of 5Ω/portion. Therefore, the thickness of the N-type base material layer 15 is 270μ. From the low resistivity P-type layer 16 of the diode wafer 3 (to reduce the reverse recovery charge of the diode wafer 3, gold diffusion is carried out at a temperature of 820 to 860° C. for 6 minutes. Its surface is fixed to the P-type low resistivity silicon 25 by a metal solder layer 23'' with low resistance contact.The intermediate support plate 22 is preferably made of a highly conductive metal with a small coefficient of thermal expansion, such as tungsten or molybdenum, and is made of metal solder. 23, 23'', and 23'' are preferably thin foils mainly made of aluminum.As a first step, the thyristaulic flame 2, intermediate support plate 22, and P-type low resistivity silicon 25 are made of metal solder 23, 23 during the manufacturing process. '' in the order shown in the detailed explanation above and 7 in an inert gas.
By heating to 750°C (20~), they are bonded and integrated.

第二段階としてP形低比抵抗シリコン25に対してダイ
オードウエフア3は、金属ろう層23″を介して不活性
ガス中で660゜Cの温度で加熱され.る。
As a second step, the diode wafer 3 with respect to the P-type low resistivity silicon 25 is heated at a temperature of 660 DEG C. in an inert gas via the metal solder layer 23''.

この結果サイリスタウエフア2、中間支持板22、P形
低比抵抗シリコン25、ダイオードウエフア3が一体に
固着される。その後サイリスタウエフア2のカソード電
極24″とゲート電極21とは金属マスクを利用して約
10μのアルミニウム蒸着が行われる。またダイオード
ウエフア3のアノード電極24もアルミニウム蒸着によ
り形成され、蒸着後550℃の温度て熱処理が実施され
る。しかる後、サイリスタウエフア2とダイオードウエ
フア3のそれぞれの周縁部において、それぞれのPN接
合を斜めに切る端面整形(ベベル)を行う。サイリスタ
ウエフア2のベベル19はその中央PN接合(順方向阻
止接合)11に対し、表面電界強度を低減するために設
けられ。そのベベル19の傾斜角は、図示されるように
不純物濃度の高いP形ベース層8からN形母材層5の方
向に、その中央PN接合11に対し鈍角をなしているの
で負ベベルとなつている。ダイオードウエフア3のベベ
ル20はそのPN接合18に対して、表面電界強度を低
減するように設けられる。ベベル20の傾斜角は図示さ
れるように、不純物濃度の高いP形層16からN形母材
層15の方向にそのPN接合18に対して鈍角をなす負
ベベルとなつている。このようにして形成された本発明
の半導体装置の特徴を次に列記する。
As a result, the thyristor wafer 2, the intermediate support plate 22, the P-type low resistivity silicon 25, and the diode wafer 3 are fixed together. Thereafter, the cathode electrode 24'' and gate electrode 21 of the thyristor wafer fabric 2 are coated with aluminum to a thickness of about 10μ using a metal mask.The anode electrode 24 of the diode wafer fabric 3 is also formed by aluminum vapor deposition, A heat treatment is carried out at a temperature of 0.degree. The bevel 19 is provided in order to reduce the surface electric field intensity with respect to the central PN junction (forward blocking junction) 11.The inclination angle of the bevel 19 is as shown in the figure for the P-type base layer 8 with a high impurity concentration. The bevel 20 of the diode wafer 3 has a negative bevel because it forms an obtuse angle with respect to the central PN junction 11 in the direction of the N-type base material layer 5.The bevel 20 of the diode wafer 3 has a surface electric field strength As shown in the figure, the inclination angle of the bevel 20 is a negative bevel that forms an obtuse angle with respect to the PN junction 18 in the direction from the P-type layer 16 with a high impurity concentration to the N-type base material layer 15. The characteristics of the semiconductor device of the present invention formed in this manner are listed below.

(1)中間支持板のダイオードウエフア面にP形低比抵
抗シリコンを使用することにより、アルミニウムとシリ
コンの共晶温度(57rC)近くでダイオードウエフア
のN+層にアルミニウムを固着できるので、良好なオー
ミックコンタクトが得られる。
(1) By using P-type low resistivity silicon on the diode wafer surface of the intermediate support plate, aluminum can be fixed to the N+ layer of the diode wafer near the eutectic temperature of aluminum and silicon (57rC), which is good. ohmic contact can be obtained.

ちなみにP形低比抵抗シリコンを使用しない場合とを比
較すると順方向電流1500Aにおいて0.3〜0.4
Vの改善が可能である。
By the way, if you compare it to the case where P-type low resistivity silicon is not used, it is 0.3 to 0.4 at a forward current of 1500A.
It is possible to improve V.

(2)中間支持板に導電性の良好な金属板を使用するこ
とにより、金属板より導電性の小さいP形低比抵抗シリ
コン中で生じる不均一な電流分布を中間支持板で一且均
一化した後、サイリスタウエフア側へ順方向電流が供給
されるので電流サージ耐量を高めることが可能である。
(2) By using a metal plate with good conductivity as the intermediate support plate, the uneven current distribution that occurs in P-type low resistivity silicon, which has lower conductivity than the metal plate, is made uniform by the intermediate support plate. After that, a forward current is supplied to the thyristor air side, making it possible to increase current surge resistance.

金属から成る中間支持板のない場合では電流サージ耐量
10rT1seCで、5500Aのサイリスタに中間支
持板を入れると7500〜8000Aと耐量が向上する
。(3)サイリスタウエフア、ダイオードウエフアとも
負ベベルを形成するため、高温時における漏れ電流の小
さい半導体装置を容易に実現できる。本願による素子に
おいては、125℃の温度で2.5KV時の漏れ電流は
順方向、逆方向とも15〜20rT1A程度であるのに
対し、両ウエフアに正ベベルを形成した素子では30〜
40mAである。(4)従来逆阻止サイリスタでは実現
不可能であつた耐圧2.5K■サイリスタにおいて、逆
導電形サイリスタと直列にダイオードを固着一体化する
ことにより、ターンオフタイム30μSecを実現する
ことが可能である。(5)本サイリスタは逆導電形サイ
リスタウエフアの低比抵抗のP形層8とN形エミッタ層
9との間にゲート信号を与えて制御するので、リモート
ゲート形のサイリスタよりもゲート信号に対する応答速
度が速い。
In the case where there is no intermediate support plate made of metal, the current surge withstand capacity is 10 rT1secC, but when the intermediate support plate is inserted into a 5500A thyristor, the withstand capacity increases to 7500 to 8000A. (3) Since both the thyristor wafer and the diode wafer form a negative bevel, a semiconductor device with low leakage current at high temperatures can be easily realized. In the device according to the present application, the leakage current at 2.5 KV at a temperature of 125° C. is about 15 to 20 rT1A in both forward and reverse directions, whereas in the device with a positive bevel formed on both wafers, the leakage current is about 30 to
It is 40mA. (4) It is possible to achieve a turn-off time of 30 μSec by fixing and integrating a diode in series with a reverse conductivity type thyristor in a 2.5K■ thyristor with a withstand voltage, which was impossible to achieve with conventional reverse blocking thyristors. (5) Since this thyristor is controlled by applying a gate signal between the low resistivity P-type layer 8 and the N-type emitter layer 9 of the reverse conductivity type thyristor fan, it is more sensitive to the gate signal than a remote gate type thyristor. Fast response speed.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の半導体装置の一実施例の縦断面図であ
る。 1・・・・・・半導体装置、2・・・・・・サイリスタ
ウエフア、3・・・・・・ダイオードウエフア、24・
・・・アノード電極、2『・・・・カソード電極、23
,23″,23″・・・・・・金属ろう層、21・・・
・・ゲート電極、22・・・・・・中間支持板、25・
・・・・・P形低比抵抗シリコン板。
FIG. 1 is a longitudinal sectional view of one embodiment of the semiconductor device of the present invention. 1...Semiconductor device, 2...Thyrist wafer, 3...Diode wafer, 24.
... Anode electrode, 2 "... Cathode electrode, 23
, 23″, 23″...metal brazing layer, 21...
... Gate electrode, 22 ... Intermediate support plate, 25.
...P type low resistivity silicon plate.

Claims (1)

【特許請求の範囲】[Claims] 1 逆導電形サイリスタウエフアの逆阻止能力を補う方
向にダイオードウエフアを直列に接続し一体化するに際
して、両ウエフアを固着一体化するため熱膨張係数の小
さい導電性の良好な金属板からなる中間支持板を使用し
、この中間支持板から遠ざかるに従つて両ウエフアの外
径が減少するような台形構造を有し、且つ中間支持板の
ダイオードウエフアに接合する面に薄いP形低比抵抗シ
リコンを使用した構造となし、前記逆導電形サイリスタ
ウエフアの電圧阻止接合と前記ダイオードウエフアの電
圧阻止接合とを共に負ベベルに整形したことを特徴とす
る半導体装置。
1 When connecting and integrating diode wafers in series in a direction that supplements the reverse blocking ability of the reverse conductivity type thyristaulic wafer, a metal plate with good conductivity and a small coefficient of thermal expansion is used to securely integrate both wafers. An intermediate support plate is used, and the outer diameter of both wafers decreases as the distance from the intermediate support plate increases. 1. A semiconductor device having a structure using resistive silicon, and characterized in that a voltage blocking junction of the reverse conductivity type thyristor wafer and a voltage blocking junction of the diode wafer are both shaped to have a negative bevel.
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