JPS6025798B2 - リズムパタ−ンバリエ−シヨン装置 - Google Patents
リズムパタ−ンバリエ−シヨン装置Info
- Publication number
- JPS6025798B2 JPS6025798B2 JP51120750A JP12075076A JPS6025798B2 JP S6025798 B2 JPS6025798 B2 JP S6025798B2 JP 51120750 A JP51120750 A JP 51120750A JP 12075076 A JP12075076 A JP 12075076A JP S6025798 B2 JPS6025798 B2 JP S6025798B2
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- JP
- Japan
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- rhythm pattern
- rhythm
- line
- output
- pattern
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- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】
本発明は記憶装置の容量を増すことなく簡単に音楽的に
多様のIJズムパターソを付加できるリズムパターンバ
リエーション装置に関するものである。
多様のIJズムパターソを付加できるリズムパターンバ
リエーション装置に関するものである。
従来のリズムパターン発生装置は固定メモリ(ROM)
に各小節または数小節のリズムパターンの線返しを記憶
させている。
に各小節または数小節のリズムパターンの線返しを記憶
させている。
このパターンにバリェーションを付加しようとするとR
OMの内容がぼう大なものとなり回路、構造が複雑にな
ったりする。従来のリズム発生装置の基本構造を第1図
について説明すると、リズムクロック発生器1からのり
ズムクロツクによってアドレスカウン夕2をカウントさ
せ、アドレスカウンタ2からのアドレス信号に応じてR
OM3に記憶されているリズムパターンをラインla〜
lnに出力する。各々のラインの出力はそのリズムパタ
ーンに従ってゲート‘114,〜(n)4nを開き、そ
れぞれの音源5,〜5nからの音を出力し、ミキサ6で
これらを加え合せて出力する。これからも分かるように
リズムはROM3に記憶されたりズムパターンだけに限
定されるからバリエーションの多様化とともにその記憶
容量は非常に大きなものとなる。本発明の目的は記憶装
置の容量を増すことなく簡単に音楽的に多様なりズムパ
ターンを付加できるリズムパターンバリエーション装置
を提供することである。前記目的を達成するため、本発
明のリズムパターンバリエーション装置はリズムクロッ
クに従い記憶袋暦読出し用アドレス信号を発生するアド
レスカウンタ、あらかじめ格納されたりズムパターンを
前記アドレス信号により出力する記憶装置、該出力され
たりズムパターンを2ラインに分岐する手段、分岐され
た一方のラインのリズムパターンから所望の時間遅れの
りズムパターンを作るバリエーション回路、および前記
分岐された他方のラインのリズムパターンと前記バリエ
ーション回路の時間遅れのりズムパターンとを合成する
手段を具えたことを特徴とするものである。
OMの内容がぼう大なものとなり回路、構造が複雑にな
ったりする。従来のリズム発生装置の基本構造を第1図
について説明すると、リズムクロック発生器1からのり
ズムクロツクによってアドレスカウン夕2をカウントさ
せ、アドレスカウンタ2からのアドレス信号に応じてR
OM3に記憶されているリズムパターンをラインla〜
lnに出力する。各々のラインの出力はそのリズムパタ
ーンに従ってゲート‘114,〜(n)4nを開き、そ
れぞれの音源5,〜5nからの音を出力し、ミキサ6で
これらを加え合せて出力する。これからも分かるように
リズムはROM3に記憶されたりズムパターンだけに限
定されるからバリエーションの多様化とともにその記憶
容量は非常に大きなものとなる。本発明の目的は記憶装
置の容量を増すことなく簡単に音楽的に多様なりズムパ
ターンを付加できるリズムパターンバリエーション装置
を提供することである。前記目的を達成するため、本発
明のリズムパターンバリエーション装置はリズムクロッ
クに従い記憶袋暦読出し用アドレス信号を発生するアド
レスカウンタ、あらかじめ格納されたりズムパターンを
前記アドレス信号により出力する記憶装置、該出力され
たりズムパターンを2ラインに分岐する手段、分岐され
た一方のラインのリズムパターンから所望の時間遅れの
りズムパターンを作るバリエーション回路、および前記
分岐された他方のラインのリズムパターンと前記バリエ
ーション回路の時間遅れのりズムパターンとを合成する
手段を具えたことを特徴とするものである。
以下本発明を実施例につき詳述する。
第2図は本発明の実施例の構成を示す基本ブロック図で
ある。
ある。
リズムクロツク発器11によってアドレスカウンタ12
をカウントさせアドレスカゥンタ12からのアドレス信
号に応じてROM13に記憶されているリズムパターン
をラインla〜lnに出力する。ラインlaに出力され
たりズムパターンはゲート14が閉じていれば、すなわ
ちSWIがオンとなる場合にはライン2だけからゲート
17を通って音源1に導かれる。つまりメインリズムパ
ターンだけが取出されることになる。次にゲート14が
開くと、すなわちSWIがオフとなる場合にはリズムパ
タ−ンはライン2とともにライン3に分岐出力される。
をカウントさせアドレスカゥンタ12からのアドレス信
号に応じてROM13に記憶されているリズムパターン
をラインla〜lnに出力する。ラインlaに出力され
たりズムパターンはゲート14が閉じていれば、すなわ
ちSWIがオンとなる場合にはライン2だけからゲート
17を通って音源1に導かれる。つまりメインリズムパ
ターンだけが取出されることになる。次にゲート14が
開くと、すなわちSWIがオフとなる場合にはリズムパ
タ−ンはライン2とともにライン3に分岐出力される。
このライン3の出力はライン4とライン5に分れて、ラ
イン5のパルスは第3図で具体例を示すセレクトゲート
15に入り、セレクトスイッチSW2によりS,,S2
,……,Snのいずれかのラインに出力されたシフトレ
ジスタ16に入力される。一方ライン4のパルスは遅延
回路18で遅延されてシフトレジスター6に入れられ議
込みパルスとなる。またリズムクロック発生器11から
出力するりズムクロックを分岐しシフトレジス夕16に
与えられシフトクロツクとなる。このシフトレジスタ1
6の出力として所望の時間遅れのIJズムパターンをラ
イン10より音源ローこ出力するとともに、ライン8を
通しライン2よりのIJズムパターンとともにOR回路
17に入れて合成し、ライン9より音源1に出力する。
第3図は第2図のセレクトゲート15の具体例を示す。
イン5のパルスは第3図で具体例を示すセレクトゲート
15に入り、セレクトスイッチSW2によりS,,S2
,……,Snのいずれかのラインに出力されたシフトレ
ジスタ16に入力される。一方ライン4のパルスは遅延
回路18で遅延されてシフトレジスター6に入れられ議
込みパルスとなる。またリズムクロック発生器11から
出力するりズムクロックを分岐しシフトレジス夕16に
与えられシフトクロツクとなる。このシフトレジスタ1
6の出力として所望の時間遅れのIJズムパターンをラ
イン10より音源ローこ出力するとともに、ライン8を
通しライン2よりのIJズムパターンとともにOR回路
17に入れて合成し、ライン9より音源1に出力する。
第3図は第2図のセレクトゲート15の具体例を示す。
すなわち、セレクトスイッチ(SW2)21の閉成時ラ
イン20に電圧が印加されるようにそれぞれ抵抗22を
介して電源+Vに接続され、インバータ23を通してA
ND回路24の一方の入力とし、他の入力としてゲート
14から分岐したライン5が入力する。各AND回路の
出力ラインS,,S2,……,Snをシフトレジスタ1
6に入れる。この構成で、たとえばセレクトスイッチ
21によりSn‐,が選択されているとする。
イン20に電圧が印加されるようにそれぞれ抵抗22を
介して電源+Vに接続され、インバータ23を通してA
ND回路24の一方の入力とし、他の入力としてゲート
14から分岐したライン5が入力する。各AND回路の
出力ラインS,,S2,……,Snをシフトレジスタ1
6に入れる。この構成で、たとえばセレクトスイッチ
21によりSn‐,が選択されているとする。
Sn‐・ラインにきたりズムパターンはライン4より議
込みパルスによってシフトレジスタ16に謙込まれる。
次にライン7よりのシフトクロツクの立上りによってた
とえば2パルス分シフトされライン10に出力される。
第4図は第2図および第3図の本発明の実施例の動作波
形図を示す。
込みパルスによってシフトレジスタ16に謙込まれる。
次にライン7よりのシフトクロツクの立上りによってた
とえば2パルス分シフトされライン10に出力される。
第4図は第2図および第3図の本発明の実施例の動作波
形図を示す。
同図Aは第2図のIJズムクロック発生器11からのI
Jズムクロックであり、ライン7を介してシフトレジス
タ16に与えられる同図Dのシフトクロツクと同じもの
である。同図Bはアドレスカウンタ12からのアドレス
信号により読出されたROMの出力を示し、ライン2お
よびゲート14がオンの場合のライン3に現われるリズ
ムパターンを示す。同図Cはライン3のリズムパターン
が遅延回路18を通して遅延させライン4を介してシフ
トレジスタ16に入れる読込みパルスであり、セレクト
ゲート15でセレクトスイッチ(SW2)21で選択さ
れた出力ラインS,〜Snのリズムパターンをシフトレ
ジスタ16に競込む。これを同図Dのシフトクロツクで
2パルス分だけシフトしたものが同図Eのシフトレジス
ター6の出力すなわちライン10の出力を示す。この出
力を分岐したライン8の出力をOR回路17によりライ
ン2の出力と合成すれば同図Fで示されるゲート14オ
ン時のライン9の出力リズムパターンが得られる。なお
ライン10の出力を音源1とは別の音源ローこ導くこと
によりさらに変ったバリエーションが得られる。以上説
明したように、本発明によれば、ROMに記憶するりズ
ムパターン容量を増大することなく、記憶装置から出力
されるリズムパターンを2ラインに分岐して、その一方
のラインのリズムパターンからバリエーション回路によ
り所望の時間遅れのりズムパターンを作り、これを分岐
した他方のラインのリズムパターンと合成するという方
法で簡単にしかも音楽的にリズムパターンのバリエーシ
ョンが得られるものである。
Jズムクロックであり、ライン7を介してシフトレジス
タ16に与えられる同図Dのシフトクロツクと同じもの
である。同図Bはアドレスカウンタ12からのアドレス
信号により読出されたROMの出力を示し、ライン2お
よびゲート14がオンの場合のライン3に現われるリズ
ムパターンを示す。同図Cはライン3のリズムパターン
が遅延回路18を通して遅延させライン4を介してシフ
トレジスタ16に入れる読込みパルスであり、セレクト
ゲート15でセレクトスイッチ(SW2)21で選択さ
れた出力ラインS,〜Snのリズムパターンをシフトレ
ジスタ16に競込む。これを同図Dのシフトクロツクで
2パルス分だけシフトしたものが同図Eのシフトレジス
ター6の出力すなわちライン10の出力を示す。この出
力を分岐したライン8の出力をOR回路17によりライ
ン2の出力と合成すれば同図Fで示されるゲート14オ
ン時のライン9の出力リズムパターンが得られる。なお
ライン10の出力を音源1とは別の音源ローこ導くこと
によりさらに変ったバリエーションが得られる。以上説
明したように、本発明によれば、ROMに記憶するりズ
ムパターン容量を増大することなく、記憶装置から出力
されるリズムパターンを2ラインに分岐して、その一方
のラインのリズムパターンからバリエーション回路によ
り所望の時間遅れのりズムパターンを作り、これを分岐
した他方のラインのリズムパターンと合成するという方
法で簡単にしかも音楽的にリズムパターンのバリエーシ
ョンが得られるものである。
図面の簡単な説頚
第1図は従来例の説明図、第2図は本発明の実施例の構
成を示す説明図、第3図は第2図の実施例の菱部の具体
回路例、第4図は実施例の動作波形図であり、図中、1
1はリズムクロック発生器、12はアドレスカウンタ、
13は記憶装置(ROM)、1 4はゲート、1 5は
セレクトゲ−ト、16はシフトレジスタ、17はOR回
路、I8は遅延回路を示す。
成を示す説明図、第3図は第2図の実施例の菱部の具体
回路例、第4図は実施例の動作波形図であり、図中、1
1はリズムクロック発生器、12はアドレスカウンタ、
13は記憶装置(ROM)、1 4はゲート、1 5は
セレクトゲ−ト、16はシフトレジスタ、17はOR回
路、I8は遅延回路を示す。
第1図
第2図
第3図
第4図
Claims (1)
- 【特許請求の範囲】 1 リズムクロツクに従い記憶装置読出し用アドレス信
号を発生するアドレスカウンタ、あらかじめ格納された
リズムパターンを前記アドレス信号により出力する記憶
装置、該出力されたリズムパターンを2ラインに分岐す
る手段、分岐された一方のラインのリズムパターンから
所望の時間遅れのリズムパターンを作るバリエーシヨン
回路、および前記分岐された他方のラインのリズムパタ
ーンと前記バリエーシヨン回路の時間遅れのリズムパタ
ーンとを合成する手段を具えたことを特徴とするリズム
パターンバリエーシヨン装置。 2 前記バリエーシヨン回路が前記分岐された一方のリ
ズムパターンをシフトレジスタの任意のアドレスに入力
させるセレクトゲートと、該セレクトゲートに入力させ
るリズムパターンを前記リズムクロツクによりシフトさ
せ所望の時間遅延させるシフトレジスタより成ることを
特徴とする特許請求の範囲第1項記載のリズムパターン
バリエーシヨン装置。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP51120750A JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
US05/838,500 US4154132A (en) | 1976-10-07 | 1977-10-03 | Rhythm pattern variation device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP51120750A JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5346010A JPS5346010A (en) | 1978-04-25 |
JPS6025798B2 true JPS6025798B2 (ja) | 1985-06-20 |
Family
ID=14794050
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP51120750A Expired JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6025798B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03287886A (ja) * | 1990-03-30 | 1991-12-18 | Nagano Pref Gov Noukiyou Chiiki Kaihatsu Kiko | 多機能繊維ロープ |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62269997A (ja) * | 1987-02-04 | 1987-11-24 | ローランド株式会社 | 自動リズム演奏装置 |
-
1976
- 1976-10-07 JP JP51120750A patent/JPS6025798B2/ja not_active Expired
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH03287886A (ja) * | 1990-03-30 | 1991-12-18 | Nagano Pref Gov Noukiyou Chiiki Kaihatsu Kiko | 多機能繊維ロープ |
Also Published As
Publication number | Publication date |
---|---|
JPS5346010A (en) | 1978-04-25 |
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