JPS6025798B2 - リズムパタ−ンバリエ−シヨン装置 - Google Patents
リズムパタ−ンバリエ−シヨン装置Info
- Publication number
- JPS6025798B2 JPS6025798B2 JP51120750A JP12075076A JPS6025798B2 JP S6025798 B2 JPS6025798 B2 JP S6025798B2 JP 51120750 A JP51120750 A JP 51120750A JP 12075076 A JP12075076 A JP 12075076A JP S6025798 B2 JPS6025798 B2 JP S6025798B2
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- Japan
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- rhythm pattern
- rhythm
- line
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- pattern
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- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】
本発明は記憶装置の容量を増すことなく簡単に音楽的に
多様のＩＪズムパターソを付加できるリズムパターンバ
リエーション装置に関するものである。
多様のＩＪズムパターソを付加できるリズムパターンバ
リエーション装置に関するものである。
従来のリズムパターン発生装置は固定メモリ（ＲＯＭ）
に各小節または数小節のリズムパターンの線返しを記憶
させている。
に各小節または数小節のリズムパターンの線返しを記憶
させている。
このパターンにバリェーションを付加しようとするとＲ
ＯＭの内容がぼう大なものとなり回路、構造が複雑にな
ったりする。従来のリズム発生装置の基本構造を第１図
について説明すると、リズムクロック発生器１からのり
ズムクロツクによってアドレスカウン夕２をカウントさ
せ、アドレスカウンタ２からのアドレス信号に応じてＲ
ＯＭ３に記憶されているリズムパターンをラインｌａ〜
ｌｎに出力する。各々のラインの出力はそのリズムパタ
ーンに従ってゲート‘１１４，〜（ｎ）４ｎを開き、そ
れぞれの音源５，〜５ｎからの音を出力し、ミキサ６で
これらを加え合せて出力する。これからも分かるように
リズムはＲＯＭ３に記憶されたりズムパターンだけに限
定されるからバリエーションの多様化とともにその記憶
容量は非常に大きなものとなる。本発明の目的は記憶装
置の容量を増すことなく簡単に音楽的に多様なりズムパ
ターンを付加できるリズムパターンバリエーション装置
を提供することである。前記目的を達成するため、本発
明のリズムパターンバリエーション装置はリズムクロッ
クに従い記憶袋暦読出し用アドレス信号を発生するアド
レスカウンタ、あらかじめ格納されたりズムパターンを
前記アドレス信号により出力する記憶装置、該出力され
たりズムパターンを２ラインに分岐する手段、分岐され
た一方のラインのリズムパターンから所望の時間遅れの
りズムパターンを作るバリエーション回路、および前記
分岐された他方のラインのリズムパターンと前記バリエ
ーション回路の時間遅れのりズムパターンとを合成する
手段を具えたことを特徴とするものである。
ＯＭの内容がぼう大なものとなり回路、構造が複雑にな
ったりする。従来のリズム発生装置の基本構造を第１図
について説明すると、リズムクロック発生器１からのり
ズムクロツクによってアドレスカウン夕２をカウントさ
せ、アドレスカウンタ２からのアドレス信号に応じてＲ
ＯＭ３に記憶されているリズムパターンをラインｌａ〜
ｌｎに出力する。各々のラインの出力はそのリズムパタ
ーンに従ってゲート‘１１４，〜（ｎ）４ｎを開き、そ
れぞれの音源５，〜５ｎからの音を出力し、ミキサ６で
これらを加え合せて出力する。これからも分かるように
リズムはＲＯＭ３に記憶されたりズムパターンだけに限
定されるからバリエーションの多様化とともにその記憶
容量は非常に大きなものとなる。本発明の目的は記憶装
置の容量を増すことなく簡単に音楽的に多様なりズムパ
ターンを付加できるリズムパターンバリエーション装置
を提供することである。前記目的を達成するため、本発
明のリズムパターンバリエーション装置はリズムクロッ
クに従い記憶袋暦読出し用アドレス信号を発生するアド
レスカウンタ、あらかじめ格納されたりズムパターンを
前記アドレス信号により出力する記憶装置、該出力され
たりズムパターンを２ラインに分岐する手段、分岐され
た一方のラインのリズムパターンから所望の時間遅れの
りズムパターンを作るバリエーション回路、および前記
分岐された他方のラインのリズムパターンと前記バリエ
ーション回路の時間遅れのりズムパターンとを合成する
手段を具えたことを特徴とするものである。
以下本発明を実施例につき詳述する。
第２図は本発明の実施例の構成を示す基本ブロック図で
ある。
ある。
リズムクロツク発器１１によってアドレスカウンタ１２
をカウントさせアドレスカゥンタ１２からのアドレス信
号に応じてＲＯＭ１３に記憶されているリズムパターン
をラインｌａ〜ｌｎに出力する。ラインｌａに出力され
たりズムパターンはゲート１４が閉じていれば、すなわ
ちＳＷＩがオンとなる場合にはライン２だけからゲート
１７を通って音源１に導かれる。つまりメインリズムパ
ターンだけが取出されることになる。次にゲート１４が
開くと、すなわちＳＷＩがオフとなる場合にはリズムパ
タ−ンはライン２とともにライン３に分岐出力される。
をカウントさせアドレスカゥンタ１２からのアドレス信
号に応じてＲＯＭ１３に記憶されているリズムパターン
をラインｌａ〜ｌｎに出力する。ラインｌａに出力され
たりズムパターンはゲート１４が閉じていれば、すなわ
ちＳＷＩがオンとなる場合にはライン２だけからゲート
１７を通って音源１に導かれる。つまりメインリズムパ
ターンだけが取出されることになる。次にゲート１４が
開くと、すなわちＳＷＩがオフとなる場合にはリズムパ
タ−ンはライン２とともにライン３に分岐出力される。
このライン３の出力はライン４とライン５に分れて、ラ
イン５のパルスは第３図で具体例を示すセレクトゲート
１５に入り、セレクトスイッチＳＷ２によりＳ，，Ｓ２
，……，Ｓｎのいずれかのラインに出力されたシフトレ
ジスタ１６に入力される。一方ライン４のパルスは遅延
回路１８で遅延されてシフトレジスター６に入れられ議
込みパルスとなる。またリズムクロック発生器１１から
出力するりズムクロックを分岐しシフトレジス夕１６に
与えられシフトクロツクとなる。このシフトレジスタ１
６の出力として所望の時間遅れのＩＪズムパターンをラ
イン１０より音源ローこ出力するとともに、ライン８を
通しライン２よりのＩＪズムパターンとともにＯＲ回路
１７に入れて合成し、ライン９より音源１に出力する。
第３図は第２図のセレクトゲート１５の具体例を示す。
イン５のパルスは第３図で具体例を示すセレクトゲート
１５に入り、セレクトスイッチＳＷ２によりＳ，，Ｓ２
，……，Ｓｎのいずれかのラインに出力されたシフトレ
ジスタ１６に入力される。一方ライン４のパルスは遅延
回路１８で遅延されてシフトレジスター６に入れられ議
込みパルスとなる。またリズムクロック発生器１１から
出力するりズムクロックを分岐しシフトレジス夕１６に
与えられシフトクロツクとなる。このシフトレジスタ１
６の出力として所望の時間遅れのＩＪズムパターンをラ
イン１０より音源ローこ出力するとともに、ライン８を
通しライン２よりのＩＪズムパターンとともにＯＲ回路
１７に入れて合成し、ライン９より音源１に出力する。
第３図は第２図のセレクトゲート１５の具体例を示す。
すなわち、セレクトスイッチ（ＳＷ２）２１の閉成時ラ
イン２０に電圧が印加されるようにそれぞれ抵抗２２を
介して電源＋Ｖに接続され、インバータ２３を通してＡ
ＮＤ回路２４の一方の入力とし、他の入力としてゲート
１４から分岐したライン５が入力する。各ＡＮＤ回路の
出力ラインＳ，，Ｓ２，……，Ｓｎをシフトレジスタ１
６に入れる。この構成で、たとえばセレクトスイッチ
２１によりＳｎ‐，が選択されているとする。
イン２０に電圧が印加されるようにそれぞれ抵抗２２を
介して電源＋Ｖに接続され、インバータ２３を通してＡ
ＮＤ回路２４の一方の入力とし、他の入力としてゲート
１４から分岐したライン５が入力する。各ＡＮＤ回路の
出力ラインＳ，，Ｓ２，……，Ｓｎをシフトレジスタ１
６に入れる。この構成で、たとえばセレクトスイッチ
２１によりＳｎ‐，が選択されているとする。
Ｓｎ‐・ラインにきたりズムパターンはライン４より議
込みパルスによってシフトレジスタ１６に謙込まれる。
次にライン７よりのシフトクロツクの立上りによってた
とえば２パルス分シフトされライン１０に出力される。
第４図は第２図および第３図の本発明の実施例の動作波
形図を示す。
込みパルスによってシフトレジスタ１６に謙込まれる。
次にライン７よりのシフトクロツクの立上りによってた
とえば２パルス分シフトされライン１０に出力される。
第４図は第２図および第３図の本発明の実施例の動作波
形図を示す。
同図Ａは第２図のＩＪズムクロック発生器１１からのＩ
Ｊズムクロックであり、ライン７を介してシフトレジス
タ１６に与えられる同図Ｄのシフトクロツクと同じもの
である。同図Ｂはアドレスカウンタ１２からのアドレス
信号により読出されたＲＯＭの出力を示し、ライン２お
よびゲート１４がオンの場合のライン３に現われるリズ
ムパターンを示す。同図Ｃはライン３のリズムパターン
が遅延回路１８を通して遅延させライン４を介してシフ
トレジスタ１６に入れる読込みパルスであり、セレクト
ゲート１５でセレクトスイッチ（ＳＷ２）２１で選択さ
れた出力ラインＳ，〜Ｓｎのリズムパターンをシフトレ
ジスタ１６に競込む。これを同図Ｄのシフトクロツクで
２パルス分だけシフトしたものが同図Ｅのシフトレジス
ター６の出力すなわちライン１０の出力を示す。この出
力を分岐したライン８の出力をＯＲ回路１７によりライ
ン２の出力と合成すれば同図Ｆで示されるゲート１４オ
ン時のライン９の出力リズムパターンが得られる。なお
ライン１０の出力を音源１とは別の音源ローこ導くこと
によりさらに変ったバリエーションが得られる。以上説
明したように、本発明によれば、ＲＯＭに記憶するりズ
ムパターン容量を増大することなく、記憶装置から出力
されるリズムパターンを２ラインに分岐して、その一方
のラインのリズムパターンからバリエーション回路によ
り所望の時間遅れのりズムパターンを作り、これを分岐
した他方のラインのリズムパターンと合成するという方
法で簡単にしかも音楽的にリズムパターンのバリエーシ
ョンが得られるものである。
Ｊズムクロックであり、ライン７を介してシフトレジス
タ１６に与えられる同図Ｄのシフトクロツクと同じもの
である。同図Ｂはアドレスカウンタ１２からのアドレス
信号により読出されたＲＯＭの出力を示し、ライン２お
よびゲート１４がオンの場合のライン３に現われるリズ
ムパターンを示す。同図Ｃはライン３のリズムパターン
が遅延回路１８を通して遅延させライン４を介してシフ
トレジスタ１６に入れる読込みパルスであり、セレクト
ゲート１５でセレクトスイッチ（ＳＷ２）２１で選択さ
れた出力ラインＳ，〜Ｓｎのリズムパターンをシフトレ
ジスタ１６に競込む。これを同図Ｄのシフトクロツクで
２パルス分だけシフトしたものが同図Ｅのシフトレジス
ター６の出力すなわちライン１０の出力を示す。この出
力を分岐したライン８の出力をＯＲ回路１７によりライ
ン２の出力と合成すれば同図Ｆで示されるゲート１４オ
ン時のライン９の出力リズムパターンが得られる。なお
ライン１０の出力を音源１とは別の音源ローこ導くこと
によりさらに変ったバリエーションが得られる。以上説
明したように、本発明によれば、ＲＯＭに記憶するりズ
ムパターン容量を増大することなく、記憶装置から出力
されるリズムパターンを２ラインに分岐して、その一方
のラインのリズムパターンからバリエーション回路によ
り所望の時間遅れのりズムパターンを作り、これを分岐
した他方のラインのリズムパターンと合成するという方
法で簡単にしかも音楽的にリズムパターンのバリエーシ
ョンが得られるものである。
図面の簡単な説頚
第１図は従来例の説明図、第２図は本発明の実施例の構
成を示す説明図、第３図は第２図の実施例の菱部の具体
回路例、第４図は実施例の動作波形図であり、図中、１
１はリズムクロック発生器、１２はアドレスカウンタ、
１３は記憶装置（ＲＯＭ）、１ ４はゲート、１ ５は
セレクトゲ−ト、１６はシフトレジスタ、１７はＯＲ回
路、Ｉ８は遅延回路を示す。
成を示す説明図、第３図は第２図の実施例の菱部の具体
回路例、第４図は実施例の動作波形図であり、図中、１
１はリズムクロック発生器、１２はアドレスカウンタ、
１３は記憶装置（ＲＯＭ）、１ ４はゲート、１ ５は
セレクトゲ−ト、１６はシフトレジスタ、１７はＯＲ回
路、Ｉ８は遅延回路を示す。
第１図
第２図
第３図
第４図
Claims (1)
- 【特許請求の範囲】 １ リズムクロツクに従い記憶装置読出し用アドレス信
号を発生するアドレスカウンタ、あらかじめ格納された
リズムパターンを前記アドレス信号により出力する記憶
装置、該出力されたリズムパターンを２ラインに分岐す
る手段、分岐された一方のラインのリズムパターンから
所望の時間遅れのリズムパターンを作るバリエーシヨン
回路、および前記分岐された他方のラインのリズムパタ
ーンと前記バリエーシヨン回路の時間遅れのリズムパタ
ーンとを合成する手段を具えたことを特徴とするリズム
パターンバリエーシヨン装置。 ２ 前記バリエーシヨン回路が前記分岐された一方のリ
ズムパターンをシフトレジスタの任意のアドレスに入力
させるセレクトゲートと、該セレクトゲートに入力させ
るリズムパターンを前記リズムクロツクによりシフトさ
せ所望の時間遅延させるシフトレジスタより成ることを
特徴とする特許請求の範囲第１項記載のリズムパターン
バリエーシヨン装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51120750A JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
| US05/838,500 US4154132A (en) | 1976-10-07 | 1977-10-03 | Rhythm pattern variation device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP51120750A JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5346010A JPS5346010A (en) | 1978-04-25 |
| JPS6025798B2 true JPS6025798B2 (ja) | 1985-06-20 |
Family
ID=14794050
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP51120750A Expired JPS6025798B2 (ja) | 1976-10-07 | 1976-10-07 | リズムパタ−ンバリエ−シヨン装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6025798B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03287886A (ja) * | 1990-03-30 | 1991-12-18 | Nagano Pref Gov Noukiyou Chiiki Kaihatsu Kiko | 多機能繊維ロープ |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62269997A (ja) * | 1987-02-04 | 1987-11-24 | ローランド株式会社 | 自動リズム演奏装置 |
-
1976
- 1976-10-07 JP JP51120750A patent/JPS6025798B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03287886A (ja) * | 1990-03-30 | 1991-12-18 | Nagano Pref Gov Noukiyou Chiiki Kaihatsu Kiko | 多機能繊維ロープ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5346010A (en) | 1978-04-25 |
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