JPS60230884A - Printer - Google Patents

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JPS60230884A
JPS60230884A JP8895784A JP8895784A JPS60230884A JP S60230884 A JPS60230884 A JP S60230884A JP 8895784 A JP8895784 A JP 8895784A JP 8895784 A JP8895784 A JP 8895784A JP S60230884 A JPS60230884 A JP S60230884A
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    • BPERFORMING OPERATIONS; TRANSPORTING
    • B41PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
    • B41JTYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
    • B41J19/00Character- or line-spacing mechanisms
    • B41J19/18Character-spacing or back-spacing mechanisms; Carriage return or release devices therefor
    • B41J19/20Positive-feed character-spacing mechanisms
    • B41J19/202Drive control means for carriage movement

Abstract

PURPOSE:To prevent controlling efficiency from being lowered and enhance printing quality, by providing a carriage-controlling part which is provided additionally with a mode-selecting circuit for changing over a voltage impressed on a DC motor, and a part which generates a printing timing. CONSTITUTION:When the speed of the motor 4 is lowered below a preset speed, a phase advance signal 8 is outputted, and the mode-selecvting circuit 19 is changed over, thereby returning to a controlling operation conducted before braking. In this controlling circuit, a brake by passing a reverse current is applied at the time of deceleration, so that response as high as that at the time of of acceleration can be obtained. According to an output 20 from the circuit 19, the current-passing direction and curring-passing time for the motor 4 are varied by a switching-type driver 3 consisting of four transistors. A programmable phase-dividing circuit 50 subjects an encoder signal 7 to 1/N phase division by a phase division value signal 52, and a programmable phase-dividing circuit 51 subjects an output signal 56 of a voltage-controlled type variable frequency oscillator 55 to 1/N phase division on the basis of the phase division signal 52. The phase difference between output signals 57, 57 thus obtained by phase division is outputted as a pulse width signal 59 by a phase difference detector 53.

Description

【発明の詳細な説明】 く技術分野〉 本発明はシリアルドツトのプリンタ装置に関する。[Detailed description of the invention] Technical fields> The present invention relates to a serial dot printer device.

〈従来技術〉 従来シリアリプリンタ装置のキャリッジ駆動系にはその
制御の容易さからステップモータが多く使用されてきた
<Prior Art> Conventionally, step motors have been widely used in the carriage drive systems of serial printers because of their ease of control.

しかしながら、プリンタの性能向上にともない駆動源と
してDoモータが使用され始めている。
However, as the performance of printers has improved, Do motors have begun to be used as drive sources.

また文字を構成するドツト数の増加により舟形印字に近
い印字品質が得られるようになシ、それとともに舟形印
字プリンタと同様の多種フォント、多種文字ピッチのプ
リンタの要求が高まっている。
Furthermore, as the number of dots forming a character increases, it is becoming possible to obtain print quality close to that of boat-shaped printing, and at the same time, there is an increasing demand for printers with a variety of fonts and character pitches similar to boat-shaped printing printers.

本発明はシリアルドツトプリンタのキャリッジ駆動系に
直流モータ金剛いた、低コスト、高性能高精度のキャリ
ッジ制御装置と、キャリッジ移動にともない発生される
固定間隔の印字タイミング信号からフェーズ・ロックド
・ループ制御系によシ任意の間隔で印字タイミングを発
生させ、任意の文字ピッチ全同一のキャラクタジェネレ
ータ全使用して印字させる事を可能にする、印字タイミ
ング発生回路により構成されるシリアルドットプリンク
の印字制御装置に関するものである。
The present invention is a low-cost, high-performance, high-precision carriage control device that uses a DC motor in the carriage drive system of a serial dot printer, and a phase-locked loop control system that uses print timing signals at fixed intervals generated as the carriage moves. This invention relates to a serial dot link printing control device comprised of a printing timing generation circuit that generates printing timing at arbitrary intervals and enables printing using all character generators with the same arbitrary character pitch. It is.

Doモータを用いたシリアルドツトプリンタのキャリッ
ジ制御装置には、タコジェネレータ音用いたアナログ形
のものが従来よシ広く使用されている。近年、ロータリ
エンコーダ、リニアエンコーダ等のディジタル形の検出
器が容易に使用可能となり、これを用いたディジタル形
の制御系が使用されるようになった。特に制御精度の良
さ、制御回路構成の簡易さから、設定速度に対応する基
準発振器の信号とエンコーダの位相差信号を検出し、こ
のディジタル信号によりモータに加える電圧を直接スイ
ッチングして速度を制御するフェーズロックドループ形
のディジタル制御装置が多く使用されている。
Conventionally, analog type carriage control devices using tacho generator sound have been widely used as carriage control devices for serial dot printers using Do motors. In recent years, digital detectors such as rotary encoders and linear encoders have become easily available, and digital control systems using them have come into use. In particular, due to its high control accuracy and simple control circuit configuration, the speed is controlled by detecting the phase difference signal between the reference oscillator signal and the encoder corresponding to the set speed, and directly switching the voltage applied to the motor using this digital signal. Phase-locked loop type digital control devices are often used.

第1図にこの従来の制御装置の基本的なブロック図を示
す。基準発振器1で発振した基準速度ノ(ルス6とモー
タに取付けたエンコーダ5からの速度に対応したパルス
列との位置差を位相比較器2で検出し、その位相差によ
りデユーティが変化するパルス信号8によりスイッチン
グ回路5を介してDQモータ4を駆動し速度制御をおこ
なう。
FIG. 1 shows a basic block diagram of this conventional control device. The phase comparator 2 detects the position difference between the reference speed signal oscillated by the reference oscillator 1 and the pulse train corresponding to the speed from the encoder 5 attached to the motor, and the pulse signal 8 changes the duty depending on the phase difference. The DQ motor 4 is driven via the switching circuit 5 to perform speed control.

この様な制御系は基準発振器1や位相比較器2が集積回
路として市販されており、スイッチング回路5もトラン
ジスタを用いて簡単に構成できることから、民生用機器
の制御系に多く使用されている。この制御系の特徴とし
て、速度の精度が基準発振器1の安全性で決定されるた
め、きわめて高い制御精度が得られる、回路やモータの
発熱が小さい等の長所を有する反面、制御ループのゲイ
ンが高く、またこれ全容易に変える事ができないため、
発振を起しやすく、安定性が悪い欠点を有する。特に高
速応答を要求されるシリアルプリンタのキャリッジ制御
装置に使用する際はモータの出力に比して、摩擦負荷、
慣性負荷をともに小さくとる設計をするため、この欠点
が顕著に現われてしまう。高い印字品質を目的としたシ
リアル形の高ドツト密度のドツトインパクトプリンタや
インクジェットプリンタではこの欠点に起因する撮動現
象によりドツト間隔が一定とならず、印字品質が低下し
てしまう。
In such a control system, the reference oscillator 1 and phase comparator 2 are commercially available as integrated circuits, and the switching circuit 5 can be easily constructed using transistors, so it is often used in control systems of consumer equipment. The characteristics of this control system are that the speed accuracy is determined by the safety of the reference oscillator 1, so it has advantages such as extremely high control accuracy and low heat generation in the circuit and motor. Because it is expensive and cannot be changed easily,
It has the disadvantage of being prone to oscillation and having poor stability. In particular, when used in serial printer carriage control devices that require high-speed response, the frictional load and
Since the design is such that both inertial loads are small, this drawback becomes noticeable. In serial-type high-dot-density dot impact printers and inkjet printers aimed at high print quality, the dot spacing is not constant due to the imaging phenomenon caused by this defect, resulting in a decrease in print quality.

かかる欠点を取シ除くために、制御ループのゲインを下
げる方法が考えられるが回路が複雑になり、また制御精
度が低下してしまう。
In order to eliminate this drawback, a method of lowering the gain of the control loop has been considered, but the circuit becomes complicated and the control accuracy decreases.

〈目的〉 本発明は従来のかかる欠点を除去したプリンタ装置を提
供すること全目的とする。
<Objects> The entire object of the present invention is to provide a printer device that eliminates the above drawbacks of the conventional printers.

〈構成〉 本発明のシリアルドツトのプリンタ装置は、該装置のキ
ャリッジ駆動系に直流モータを用い、ローパスフィルタ
と微分回路よりなる基準発振器の周波数変調形のフィー
ドバックループを付加したフェーズロックドループ形速
度制御回路、および直流モータへの印加電圧を切り替え
るモード選択回路全付加したキャリッジ制御部、および
基準エンコーダ、分周回路、位相差検出回路、フィルタ
′畦圧制御発撮器によシ印字タイミングを発生させる印
字タイミング発生部によシ構成される印字制御部を有す
るものである。
<Configuration> The serial dot printer device of the present invention uses a DC motor in the carriage drive system of the device, and has phase-locked loop speed control with a frequency modulation feedback loop of a reference oscillator consisting of a low-pass filter and a differential circuit. The print timing is generated by the carriage control section with all the circuits and mode selection circuit that switches the voltage applied to the DC motor, reference encoder, frequency divider circuit, phase difference detection circuit, filter and ridge pressure control generator. The printer has a print control section configured by a print timing generation section.

〈実施例〉 本発明のシリアルドツトのプリンタ装置は、ループゲイ
ンを低下させずに簡単な回路を付加することにより、こ
のキャリッジ制御装置の安定性を向上させ発振をおさえ
る方式を採用した。第2図はこの方式のブロック図であ
る。位相比較器2で検出した位相差信号8をローパスフ
ィルタ9を介してアナログの速度信号11に変換し更に
微分回路10により疑似加速度信号12に変換する。こ
の信号12で基準発振器1の出力信号を周波数変調する
。この制御系はアナログ回路で構成した速度制御装置に
、加速歴フィードバックループ會付加したものと同様の
効果が得られるもので、フェーズロックドループ形の制
御装置が持つ即応性。
<Embodiment> The serial dot printer device of the present invention employs a method of improving the stability of the carriage control device and suppressing oscillation by adding a simple circuit without reducing the loop gain. FIG. 2 is a block diagram of this method. The phase difference signal 8 detected by the phase comparator 2 is converted into an analog speed signal 11 via a low-pass filter 9, and further converted into a pseudo acceleration signal 12 by a differentiating circuit 10. This signal 12 frequency-modulates the output signal of the reference oscillator 1. This control system achieves the same effect as adding an acceleration history feedback loop to a speed control device composed of analog circuits, and has the same quick response as a phase-locked loop control device.

高精度性を低下させず安定性全向上させる効果を持って
いる。第3図(a)に第1図に示したフェーズロックド
ループ制御装置の応答16および同図(b)に第2図に
示した方式の制御装置の応答17を示す。図中の18F
i設定速度kyrくし、時刻0で停止状態から設定速度
18の信号が加えられた状態を示す。
It has the effect of completely improving stability without reducing high accuracy. FIG. 3(a) shows the response 16 of the phase-locked loop control device shown in FIG. 1, and FIG. 3(b) shows the response 17 of the control device of the type shown in FIG. 18F in the diagram
i Set speed kyr indicates a state where a signal of set speed 18 is applied from a stopped state at time 0.

シリアルプリンタのキャリッジ制御においては無印字区
間を高速でスキップしたり、1行の印字終了後、次の印
字開始位置まで高速で移動する事r(より実質的な印字
速度を向上することができる。
In the carriage control of a serial printer, it is possible to skip non-printing sections at high speed, or move at high speed to the next printing start position after printing one line (substantive printing speed can be improved).

本発明は上記の点に鑑みて、特別な機械的ブレーキ装置
などを付加する事なく簡単な回路で設定スピード全低下
させる際の応答性を改善する方式を提供するもので第4
図のブロック図を用いてこの実姉例ヲ鰭、明する。第4
図は第2図の方式にモード4択回路19全付加したもの
で24は基準発振51の周波数全変化させる入力信号で
設定速度を変化させる、ある設定速度信号24を入力す
ると、発[辰器1の出力周波数6が変化する。この時、
入力されfcG定速度が変化する前の設定速度より大き
い時は、位相検出器2の6γ相進み信号8(エンコーダ
出力信号7 VC比べて発振器出力信号の位+]:か進
んでいるとき)が出カバれこの信号がモード桝択回路1
9、ドライバ回路3を介して干−タ4に力11えられ速
度全上荷きせる。制御方法Fi、第2図のものと回しで
ある。一方入力された設定速度幅−号24″fJ・それ
以前の設定速度よシ小さい時は設定速度信号24の変化
と同時に速度低下信号25をブレーキ用フリッフリロッ
プ25に加え、このフリップフロップ23をセットする
。このフリップフロップ23の出力信号21にょシモー
ド選択IC!1路19で制御信号を位相遅れ信号22(
エンコーダ出力信号7に比べて発振器出力信号の位相が
遅れている時)に切り換え、更に通電方向ケ変えてドラ
イバ5へ出力し、ブレーキをかける。モータの速度が設
定速度より低下すると、位相進み信号8が出力されるた
め、ブレーキ用フリップフロップ23がリセットされモ
ード選択回路19全切り換えてブレーキ前の制御動作に
もどる。この制御回路では減速時に逆通電のブレーキを
加えるため、加速時と同程度の即応性が得られる。第5
図に設定速度全変化させた時の応答例を示す。時刻31
で設定速度24を0から28に示す値まで変化するとこ
の制御装置の速度は26に示すようにOから30の値ま
で増加し、更に時刻32で設定速度24を27の値まで
増加すると速度26は29の値まで上昇する。時刻33
に逆に設定速度24忙もとの28の値まで減少すると速
度26は30の値まで減速される。34に示す破#r、
Jこの回路金付カロしない時のI車席特性を示す。
In view of the above points, the present invention provides a method for improving responsiveness when completely reducing the set speed using a simple circuit without adding a special mechanical brake device.
This example will be explained using the block diagram shown in the figure. Fourth
The diagram shows the system shown in Figure 2 with all mode 4 selection circuits 19 added. 24 is an input signal that changes the entire frequency of the reference oscillation 51 to change the set speed. When a certain set speed signal 24 is input, the oscillator 1's output frequency 6 changes. At this time,
When the input fcG constant speed is larger than the set speed before changing, the 6γ phase advance signal 8 of the phase detector 2 (when the oscillator output signal is ahead compared to the encoder output signal 7 VC) is This output signal is the mode selection circuit 1.
9. A force 11 is applied to the dryer 4 through the driver circuit 3, allowing it to load at full speed. The control method Fi is the same as that shown in FIG. On the other hand, if the input set speed width is smaller than the previous set speed, a speed reduction signal 25 is applied to the brake flip-flop 25 at the same time as the set speed signal 24 changes, and this flip-flop 23 is set. The output signal 21 of this flip-flop 23 is converted into a control signal by the mode selection IC!1 path 19 to a phase delayed signal 22 (
When the phase of the oscillator output signal is delayed compared to the encoder output signal 7), the current direction is changed and the current is output to the driver 5, and the brake is applied. When the speed of the motor decreases below the set speed, the phase advance signal 8 is output, so the brake flip-flop 23 is reset and the mode selection circuit 19 is completely switched to return to the control operation before braking. This control circuit applies reverse energization to the brakes during deceleration, providing the same level of responsiveness as during acceleration. Fifth
The figure shows an example of the response when the set speed is completely changed. Time 31
When the set speed 24 is changed from 0 to the value shown at 28 at time 26, the speed of this control device increases from O to the value 30 as shown at 26, and when the set speed 24 is further increased to the value 27 at time 32, the speed 26 increases to a value of 29. Time 33
Conversely, when the set speed 24 decreases to the original value of 28, the speed 26 is decelerated to the value of 30. Break #r shown in 34,
J This circuit shows the characteristics of the car seat when it is not fitted with metal.

第6図に第4図に示した実施例の具体的な図を示す。1
01は加速度信号12で周波数変調が可能な集積回路で
その出力信号68全速朋設定信号14に応した周波数に
7゛ログラマブル周器57で分周しこの出力信号6とエ
ンコーダ信号7の位相を位相差検出器2で検出する。6
9は光放電ポンプと呼ばれる回路で、これと演算増幅器
4oとで千1へ成されるローパスフィルタ9により、位
相差信号をアナログの速度信号11に変換し、さらに微
分回路10によシ加速度信号12に変伊する。
FIG. 6 shows a concrete diagram of the embodiment shown in FIG. 4. 1
01 is an integrated circuit capable of frequency modulation with the acceleration signal 12, and its output signal 68 is divided into a frequency corresponding to the full speed setting signal 14 by a 7 programmable frequency divider 57, and the phase of this output signal 6 and encoder signal 7 is shifted. Detected by phase difference detector 2. 6
Reference numeral 9 denotes a circuit called a photodischarge pump, which is combined with an operational amplifier 4o to convert the phase difference signal into an analog velocity signal 11 by a low-pass filter 9, which is then converted into an analog velocity signal 11 by a differentiating circuit 10. Changed to 12th.

47の点線内はフエーズロンクドループ制御用として市
販されている集積回路に内蔵されている部分である。一
方35の信号は第4図の13に示すキャリッジの進向方
向全決定する信号で、この信号とブレーキ用スリップフ
ロップ25の出力信号21によp、位相進み信号8と位
相遅れ信号22ケ切り換える回路が、モード選択回路1
9である。
The part within the dotted line 47 is a part built into a commercially available integrated circuit for controlling the phase linear loop. On the other hand, the signal 35 is a signal that completely determines the advancing direction of the carriage shown in 13 in FIG. The circuit is mode selection circuit 1
It is 9.

モード1@択回路19の出力2oにより、4個のトラン
ジスタで構成されるスイッチング形ドライバ3でモータ
4に通電する方向および時間を変化させる。36idモ
ータの逆通電時および起動時に流れる大電流を制御する
ための電流制限回路で直流モータをシリアルプリンタの
キャリッジ駆動系の様な起動。停止、逆転のくり返しが
頻繁な装置に使用する際の寿命の大幅低下全防止する。
Mode 1@The output 2o of the selection circuit 19 changes the direction and time of energization of the motor 4 by the switching type driver 3 made up of four transistors. A current limiting circuit is used to control the large current that flows during reverse energization and startup of the 36id motor, allowing the DC motor to be started like the carriage drive system of a serial printer. Prevents a significant reduction in service life when used in equipment that frequently stops and reverses.

ローパスフィルタ9のバンド幅ハ抵抗44とコンデンサ
43により決定されるが、この値は、設定速度に対応し
たエンコーダ信号の周波数よシ十分低く、実測あるいは
計篇により得られる制御系の固有撮動数を充分通過可能
な帯域幅に設定する。
The bandwidth of the low-pass filter 9 is determined by the resistor 44 and the capacitor 43, but this value is sufficiently lower than the frequency of the encoder signal corresponding to the set speed, and the specific frequency of the control system can be obtained by actual measurement or measurement. Set the bandwidth to be sufficient to pass through.

このローパスフィルタの高域補正を行う抵抗42は抵抗
44に比して充分小さな値を選ぶ。また抵抗41と抵抗
44の比がこの制御系のダンピング比の調整パラメータ
となる。また微分回路1oの抵抗45とコンデンサ46
の積で時定数が決定されるが、この値は制御系の固有撮
動数に対して微分効果を持つ値に設定する。
The value of the resistor 42 that performs high frequency correction of this low-pass filter is selected to be sufficiently smaller than that of the resistor 44. Further, the ratio between the resistor 41 and the resistor 44 becomes an adjustment parameter for the damping ratio of this control system. Also, the resistor 45 and capacitor 46 of the differentiating circuit 1o
The time constant is determined by the product of , and this value is set to a value that has a differential effect on the specific number of motions of the control system.

次に印字タイミング発生回路について欽明する。Next, the print timing generation circuit will be explained.

一般にシリアルドツトプリンタの印字ピッチは10文字
/インチのものが使われているが、印字品質の向上にと
もない、舟形印字形プリンタで採用されている12文字
/インチのものや、15文字/インチのものが要求され
ている。簡便な方法としては印字ピッチに相当する数だ
けキャラクタジェネレータを持つ方式が有るが、キャラ
クタジェネレータのためのメモリヲ多く必要とする高価
なものとなる。印字タイミングを異なったピンチで発生
することによυ同一キャラクタジエネレータを異ピンチ
の文字に使用可能とすることができる。本発明では、こ
の印字タイミング発生回路を考案した。以下にその詳略
をのぺる。
Generally, serial dot printers use a printing pitch of 10 characters/inch, but as printing quality has improved, the printing pitch has changed to 12 characters/inch, which is used in boat-type printers, and 15 characters/inch. is required. A simple method is to have as many character generators as there are printing pitches, but this is expensive as it requires a large amount of memory for the character generators. By generating print timing at different pinches, the same character generator can be used for characters with different pinches. In the present invention, this print timing generation circuit has been devised. The details are given below.

一般に印字タイミング発生にはロータリエンコーダやリ
ニアエンコーダが使用されている。これらのエンコーダ
からはキャリッジ移動に際上固定11」1隔で印字タイ
ミングが出力式れる。従来ドツトの印刷ピンチを変化感
せるためには、エンコーダのし一ンチを実際の印刷ピン
チに比較して細かく設定し、出力される印字タイミング
を分周することにより所定の印刷ピッチの印字信号を得
る方法や、印字タ′イミング信号の数パルスの開音タイ
マを使って分割する方法がとられている。しかしこれら
の方法では、商価な高分解能のエンコーダが必要であっ
たり、誤差が累積し、分割区間の最後の印字ピンチの誤
差が大きくなる欠点があった。係る欠点を取り除くため
に本発明ではフェーズ・ロックド・ループによる印字タ
イミング発生回路を考案した。第7図を使って本発明の
説明をする。同図50はプログラマブル分周回路で、プ
リンタの主制御をおこなうマイクロプロセッサからの分
周値信号52に基づいてエンコーダ信号7を百に分周す
る。同じくプログラマブル分周回路51は分周値信号5
2に基づいて電圧制御形可変周波数発振器55の出力信
号56を−に分周する。分周された出力信号57.58
の位相差全位相差検出器53によシバルス幅イH号59
として出力する。
Generally, a rotary encoder or a linear encoder is used to generate print timing. These encoders output print timing at fixed intervals of 11" when the carriage moves. Conventionally, in order to feel the change in the printing pinch of dots, the encoder's inch is set finely compared to the actual printing pinch, and the printing signal of the predetermined printing pitch is generated by dividing the output printing timing. There are methods to obtain the print timing signal, and methods to divide the print timing signal using an open timer with several pulses. However, these methods require a commercially priced high-resolution encoder, accumulate errors, and have the disadvantage that the error in the printing pinch at the end of the divided section increases. In order to eliminate such drawbacks, the present invention has devised a printing timing generation circuit using a phase-locked loop. The present invention will be explained using FIG. 50 is a programmable frequency dividing circuit which divides the encoder signal 7 by 100 based on a frequency dividing value signal 52 from a microprocessor which mainly controls the printer. Similarly, the programmable frequency divider circuit 51 receives the frequency division value signal 5.
2, the output signal 56 of the voltage controlled variable frequency oscillator 55 is frequency-divided by −. Divided output signal 57.58
The total phase difference detector 53 determines the phase difference of the phase difference.
Output as .

54はパルス幅信号全アナログ電圧信号6(1m変換す
るためのフィルタ回路でローパス形のフィルタである。
54 is a filter circuit for converting the pulse width signal to the all analog voltage signal 6 (1 m), and is a low-pass type filter.

この位相差に比例したアナログ電圧を、′…、圧制御形
司変周波数発振器55に加え、主制御用マイクロプロセ
ッサに印字タイミング信号56として送られる。
An analog voltage proportional to this phase difference is applied to the pressure-controlled variable frequency oscillator 55 and sent as a print timing signal 56 to the main control microprocessor.

プリンタのキャリッジ移動に伴ないエンコーダ信号7が
出力され、印字タイミング信号は、エンコーダ信号の周
波数の−の周波数(M、Nは整数)VCロックされ、エ
ンコーダ信号の周波数変化に追従する。−の値は例えば
エンコーダの印字ピッチが10文字/インチに設定した
嚇合、12文字/インチの印字では−、15文字/イン
チでは−に2 設定する。またフィルタ回路54のバンド幅はキャリッ
ジ駆動系の応答周波数の少なくとも2倍以上とし、印字
タイミング回路の安定性。追従精度を考慮して決定する
The encoder signal 7 is output as the printer carriage moves, and the print timing signal is VC locked to the negative frequency (M, N are integers) of the encoder signal frequency, and follows the frequency change of the encoder signal. For example, when the encoder print pitch is set to 10 characters/inch, the value of - is set to -2 for printing of 12 characters/inch, and - for 15 characters/inch. Furthermore, the bandwidth of the filter circuit 54 is at least twice the response frequency of the carriage drive system to ensure stability of the print timing circuit. Determine by considering tracking accuracy.

〈効果〉 以上述べた様に本発明はシリアルドツトプリンタの印字
制御装置に関して、そのキャリッジ駆動系に直流モータ
を用いたキャリンジ制御装置において、従来の直流モー
タを用いたフェーズロックドループ形速度制御系に、簡
単な加速度信号検出回路とこの信号で基準発掘器を周波
数変調する回路全付加する事により、制御精度全低下さ
せずに安定性を増し、発掘を防止する効果がある。また
、更にモード選択回路にて、速度変更時から、位相差信
号が検出されるまでの間、逆方向通電のブレーキを掛け
る事により速度変更に要する時間を短縮する事が可能と
なり、これらの効果として高ドツト密度印字の際の印字
品質を向上させ、また見かけ上の印字速W、に増加する
ことが可能となる。
<Effects> As described above, the present invention relates to a print control device for a serial dot printer, and in a carriage control device that uses a DC motor in its carriage drive system, it has the following advantages: By adding a simple acceleration signal detection circuit and a circuit that frequency modulates the reference excavator with this signal, stability is increased without reducing control accuracy, and excavation can be prevented. In addition, the mode selection circuit applies a reverse energization brake from the time the speed is changed until the phase difference signal is detected, making it possible to shorten the time required to change the speed. As a result, it is possible to improve the printing quality during high dot density printing and to increase the apparent printing speed W.

また印字タイミング発生回路において、基準エンコーダ
からの印字タイミング信号全フェーズロックドループ1
回路により任意に分割することにより同一キャラクタジ
ェネレータを用いて任意の文字ピンチで印字することが
可能となる。
In addition, in the print timing generation circuit, the print timing signal from the reference encoder is all-phase locked loop 1.
By arbitrarily dividing the characters using the circuit, it becomes possible to print any character with a pinch using the same character generator.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のフエーズロンラドループ形制御装置のブ
ロック図で、15r:プリンタのキャリッジ、14はベ
ルトプーリ、15は印字紙を示す。 第2図はフェーズロックドループ制御装置に加速度フィ
ードバックループを付加した時の制御装置のフロック図
である。 第3図σ第1図に示す従来のフェーズロックドループ制
御装置6の応答例16と、第2図に示す力a速度フィー
ドバックループを付加した制御装置の応答例17の比幹
ケした図である。 l!J]41〆1−゛本祐明のキャリッジ制御装置のブ
ロック図を示す。 第5121は本発明のギヤリッジ制御装置の応答例なら
1)−にこの時の各信号の′状態を示す。 均・61z1は第41z1に示す本発明のプリンタ装置
のキャリッジ制御装置の回路図実施例でめる。 第7図は本発明のプリンタ装置の印字タイミンク元生回
路のフロック図である。 以 上 出願人 エプソン株式会社 代理人 弁理士 最 上 務
FIG. 1 is a block diagram of a conventional Phazron rad-loop type control device, in which 15r represents a printer carriage, 14 represents a belt pulley, and 15 represents printing paper. FIG. 2 is a block diagram of the control device when an acceleration feedback loop is added to the phase-locked loop control device. Fig. 3 σ is a comparative diagram of response example 16 of the conventional phase-locked loop control device 6 shown in Fig. 1 and response example 17 of the control device added with the force-a-velocity feedback loop shown in Fig. 2. . l! J] 41〆1-゛Shows a block diagram of Yumei Moto's carriage control device. No. 5121 is a response example of the gear ridge control device of the present invention. 1)-- indicates the state of each signal at this time. 61z1 is shown in the circuit diagram embodiment of the carriage control device of the printer device of the present invention shown in No. 41z1. FIG. 7 is a block diagram of the print timing generator circuit of the printer device of the present invention. Applicant: Epson Corporation Agent Patent Attorney Mogami

Claims (1)

【特許請求の範囲】[Claims] シリアルドツトのプリンタ装置において、該装置のキャ
リッジ駆動系に直流モータを用い、ローパスフィルタと
微分回路よりなる基準発振器の周波数変調形のフィード
バックループを付加したフェーズロックドループ形速度
制御回路、および直流モ〜りへの印加電圧を切り替える
モード選択回路を付加したキャリッジ制御部、および基
準エンコーダ、分周回路、位相差検出回路、フィルタ、
電圧制御発振器によシ印字タイミングを発生させる印字
タイミング発生部により構成される印字制御部を有する
ことを特徴とするプリンタ装置。
In a serial dot printer device, a DC motor is used in the carriage drive system of the device, and a phase-locked loop type speed control circuit is added with a frequency modulation type feedback loop of a reference oscillator consisting of a low-pass filter and a differentiation circuit, and a DC motor is used. A carriage control unit with a mode selection circuit that switches the voltage applied to the
What is claimed is: 1. A printer device comprising: a print control section including a print timing generation section that generates print timing using a voltage controlled oscillator.
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