JPS6011079U - Ｐｒｆ計測装置 - Google Patents

Ｐｒｆ計測装置

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Publication number
JPS6011079U
JPS6011079U JP10220483U JP10220483U JPS6011079U JP S6011079 U JPS6011079 U JP S6011079U JP 10220483 U JP10220483 U JP 10220483U JP 10220483 U JP10220483 U JP 10220483U JP S6011079 U JPS6011079 U JP S6011079U
Authority
JP
Japan
Prior art keywords
circuit
output
pulse
measured
clock oscillator
Prior art date
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Pending
Application number
JP10220483U
Other languages
English (en)
Inventor
中嶋　正則
Original Assignee
三菱電機株式会社
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Filing date
Publication date
Application filed by 三菱電機株式会社 filed Critical 三菱電機株式会社
Priority to JP10220483U priority Critical patent/JPS6011079U/ja
Publication of JPS6011079U publication Critical patent/JPS6011079U/ja
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  • Measuring Frequencies, Analyzing Spectra (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のパルスくり返し周期を計測する装置のブ
ロック図、第２図は被計測パルス波形図、第３図はこの
考案の一実施例を示すＰＲＦ計測装置のブロック図、第
４図は第３図のＰＲＦ計測装置の動作波形図、第５図は
カウンタのカウント数（パルス周期時間）とＤ／Ａ変換
器出力の電圧との関係を示す特性図である。　　　　 図において、４は入力回路、６は被計測パルス、７はク
ロック発振器、８は第１の遅延回路、９は第２の遅延回
路、１０は第１のＡＮＤ回路、１１は第２のＡＮＤ回路
、１２はリセット回路′、１３はカウンタ、１４はラッ
チ回路、１５はＤ／Ａ変換器、１６は計測回路である。 なお図中同一あるいは相当部分には同一符号を付して示
しである。 Ｂ　　　　　　　　　　　　−−−−−一［−一］−に
＝−−−一■期−−−−用 方つ〉ト数（）Ｖルス闇舅Ｄ

Claims (1)

    【実用新案登録請求の範囲】
  1. 被計測パルスより高い周波数の基準パルスを発生するク
    ロック発振器と、上記被計測パルスを上記クロック発振
    器の基準パルスに同期させて波形成形する入力回路と、
    この入力回路の出力（被計測パルス）を一定時間遅延さ
    せて出力する遅延回路と、上記入力回路の出力と上記遅
    延回路の出力の論理積をとる第１のＡＮＤ回路と、この
    第１のＡＮＤ回路の出力と上記クロック発振器の基準パ
    ルスの論理積をとる第２のＡＮＤ回路と、この第２のＡ
    ＮＤ回路の出力をカウントするカウントと、上記入力回
    路の出力と上記遅延回路の出力とにより上記カウンタを
    リセットするリセット回路と、上記遅延回路の出力によ
    り上記カウンタのディジタル出力を保持するラッチ回路
    と、このラッチ回路の出力をアナログ信号に変換するＤ
    ／Ａ変換器とを具備したことを特徴とするＰＲＦ計測装
    置。
JP10220483U 1983-07-01 1983-07-01 Ｐｒｆ計測装置 Pending JPS6011079U (ja)

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JP10220483U JPS6011079U (ja) 1983-07-01 1983-07-01 Ｐｒｆ計測装置

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JPS6011079U true JPS6011079U (ja) 1985-01-25

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ID=30241018

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