JPS60101818U - 利得制御回路 - Google Patents

利得制御回路

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JPS60101818U
JPS60101818U JP19383483U JP19383483U JPS60101818U JP S60101818 U JPS60101818 U JP S60101818U JP 19383483 U JP19383483 U JP 19383483U JP 19383483 U JP19383483 U JP 19383483U JP S60101818 U JPS60101818 U JP S60101818U
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JP
Japan
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resistor
switching element
amplifier
gain control
control circuit
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JP19383483U
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Inventor
健司 横山
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ヤマハ株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来における利得制御回路の一例を示す回路図
、第２図はこの考案の一実施例を示す回路図、第３図は
ＰＷＭ信号ＰＣがデユーティ５０％の場合め第２図の回
路の動作を示す波形図、第４図はＰＷＭ信号Ｐｃがデユ
ーティ５０％より小さい場合の第２図の回路の動作を示
す波形図、第５図は第２図の実施例の変形例を示す回路
図、第６図は第′　２図および第５図の回路を電圧制御
型増幅器に改良する場合に利得制御用ＰＷＭ信号入力端
子に接続する電圧−パルス幅変換回路の一例を示す回路
図である。　　　　・ １１・・・バッファアンプ、１２・・・反転アンプ、１
３・・・第４アンプ、１〜４・・−スイッチング素子Ｆ
ＥＴ。

Claims (1)

    【実用新案登録請求の範囲】
  1. オペアンプ１３と抵抗ｒｆｌと抵抗＄１およびコンデン
    サ０月とにより構成され入力信号Ｖ１を入力する反転増
    幅器と、オペアンプ１３と抵抗ｒＳ２と抵抗ｄ２および
    コンデンサＣｆ２とにより構成され入力信号■１の逆相
    信号■１を入力する反転増・　幅器と、前記抵抗ｒｓｌ
    と抵抗ｒｆｌの接続点とオ淑゛　　　　アンプ１３の反
    転入力端子との間に介挿されたスイッチング素子４と、
    前記抵抗ｒｓ２と抵抗ｒｆ２との接続点との間に介挿さ
    れたスイッチング素子２と、前記スイッチング素子２，
    ４を交写にスイッチングする手段とを具え、前記スイッ
    チング素子２．４の駆動パルスのデユーティ比により利
    得を゛　　制御して、オペアンプ１３から出力を取り出
    すようにした利得制御回路。
JP19383483U 1983-12-16 1983-12-16 利得制御回路 Granted JPS60101818U (ja)

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JP19383483U JPS60101818U (ja) 1983-12-16 1983-12-16 利得制御回路

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JPS60101818U true JPS60101818U (ja) 1985-07-11
JPH0311936Y2 JPH0311936Y2 (ja) 1991-03-22

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010068339A (ja) * 2008-09-11 2010-03-25 Asahi Kasei Electronics Co Ltd 可変利得反転増幅回路
JP2012217223A (ja) * 2012-08-17 2012-11-08 Asahi Kasei Electronics Co Ltd 可変利得反転増幅回路

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010068339A (ja) * 2008-09-11 2010-03-25 Asahi Kasei Electronics Co Ltd 可変利得反転増幅回路
JP2012217223A (ja) * 2012-08-17 2012-11-08 Asahi Kasei Electronics Co Ltd 可変利得反転増幅回路

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JPH0311936Y2 (ja) 1991-03-22

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