JPS6066110U - 増幅器のミユ−テイング回路 - Google Patents

増幅器のミユ−テイング回路

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Publication number
JPS6066110U
JPS6066110U JP15755283U JP15755283U JPS6066110U JP S6066110 U JPS6066110 U JP S6066110U JP 15755283 U JP15755283 U JP 15755283U JP 15755283 U JP15755283 U JP 15755283U JP S6066110 U JPS6066110 U JP S6066110U
Authority
JP
Japan
Prior art keywords
muting
circuit
amplifier
muting circuit
function switch
Prior art date
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Pending
Application number
JP15755283U
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English (en)
Inventor
高木 次男
司 西野
Original Assignee
日本コロムビア株式会社
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Publication date
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Priority to JP15755283U priority Critical patent/JPS6066110U/ja
Publication of JPS6066110U publication Critical patent/JPS6066110U/ja
Pending legal-status Critical Current

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  • Amplifiers (AREA)
  • Noise Elimination (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図は従来例を示す回路図、第2図は本考案の一実施
例を示す回路図である。 3′、7及び15・・・増幅器、9’、16及び19・
・・直流制御回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の入力信号のうちの1つを選択するファンクション
    スイッチと、該ファンクションスイッチの後段に接続さ
    れたリアイコライザ回路と、出力段増幅器と、該出力段
    増幅器と負荷端との間に設けられた第1のミューティン
    グ回路とを有する増幅器において、上記複数の入力端子
    の各々と上記リアイコライザ回路との間に入るべき増幅
    器を、上記各入力端子の各々と上記ファンクションスイ
    ッチとの間にそれぞれ別個に設けると共に、上記各増幅
    器と上記リアイコライザ回路との間に第2のミューティ
    ング回路を設け、上記第2のミューティング回路のミュ
    ーティング時間を上記第1のミューティング回路(7)
     ミューティング時間より小さく設定したことを特徴と
    する増幅器のミューティング回路。
JP15755283U 1983-10-12 1983-10-12 増幅器のミユ−テイング回路 Pending JPS6066110U (ja)

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JPS6066110U true JPS6066110U (ja) 1985-05-10

Family

ID=30347328

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