JPS58523U - チヨツパ式スイツチング回路 - Google Patents

チヨツパ式スイツチング回路

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Publication number
JPS58523U
JPS58523U JP9485681U JP9485681U JPS58523U JP S58523 U JPS58523 U JP S58523U JP 9485681 U JP9485681 U JP 9485681U JP 9485681 U JP9485681 U JP 9485681U JP S58523 U JPS58523 U JP S58523U
Authority
JP
Japan
Prior art keywords
transistor
switching circuit
chiyotsupa
control
main
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Pending
Application number
JP9485681U
Other languages
English (en)
Inventor
袴田　恵一
Original Assignee
新電元工業株式会社
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Filing date
Publication date
Application filed by 新電元工業株式会社 filed Critical 新電元工業株式会社
Priority to JP9485681U priority Critical patent/JPS58523U/ja
Publication of JPS58523U publication Critical patent/JPS58523U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図及び第２図は従来回路及びその各部動作波形図、
第３図及び第４図は来者率の一実施例回路図及びその各
部動作波形図である。図において、Ｅは入力直流電源、
Ｑ１はスイッチング用主トラ　　・ンジスタ、Ｑ２は駆
動用トランジスタ、Ｑ３ｓ　Ｑ４は補助トランジスタ、
Ｑ５は制御用トランジスタ、ＣＯＮは制御部、Ｌｃ、　
Ｃ，は出力平滑用チョークコ　　　゛イル及びコンデン
サ、ＲＬは負荷である。

Claims (1)

    【実用新案登録請求の範囲】
  1. 主トランジスタのベース回路に駆動用トランジスタを有
    し、前記駆動用トランジスタを制御信号によりオン、オ
    フして前記主トランジスタをスイッチングせしめるよう
    にしたチョッパ式スイッチング回路において、前記主ト
    ランジスタのベース、エミッタ間に制御用トランジスタ
    を設け、前記制御用トランジスタを前記制御信号により
    オン、オフせしめると共に前記駆動用トランジスタとオ
    ン・オフ送動作を行うように構成したことを特徴とする
    チョッパ式スイッチング回路。
JP9485681U 1981-06-26 1981-06-26 チヨツパ式スイツチング回路 Pending JPS58523U (ja)

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JPS58523U true JPS58523U (ja) 1983-01-05

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ID=29889777

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