JPS5946129B2 - 選局装置 - Google Patents

選局装置

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JPS5946129B2
JPS5946129B2 JP51038007A JP3800776A JPS5946129B2 JP S5946129 B2 JPS5946129 B2 JP S5946129B2 JP 51038007 A JP51038007 A JP 51038007A JP 3800776 A JP3800776 A JP 3800776A JP S5946129 B2 JPS5946129 B2 JP S5946129B2
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JP
Japan
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circuit
memory
channel
output
tuning
Prior art date
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JP51038007A
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久男 岡田
尚雄 茂木
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Sony Corp
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Sony Corp
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Publication date
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Priority to CA275,429A priority patent/CA1069230A/en
Priority to US05/784,599 priority patent/US4127821A/en
Priority to DE19772715032 priority patent/DE2715032A1/de
Priority to FR7710295A priority patent/FR2347825A1/fr
Priority to NLAANVRAGE7703740,A priority patent/NL187946C/xx
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
    • H03J7/18—Automatic scanning over a band of frequencies
    • H03J7/20—Automatic scanning over a band of frequencies where the scanning is accomplished by varying the electrical characteristics of a non-mechanically adjustable element
    • H03J7/28—Automatic scanning over a band of frequencies where the scanning is accomplished by varying the electrical characteristics of a non-mechanically adjustable element using counters or frequency dividers
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03J—TUNING RESONANT CIRCUITS; SELECTING RESONANT CIRCUITS
    • H03J5/00—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner
    • H03J5/02—Discontinuous tuning; Selecting predetermined frequencies; Selecting frequency bands with or without continuous tuning in one or more of the bands, e.g. push-button tuning, turret tuner with variable tuning element having a number of predetermined settings and adjustable to a desired one of these settings
    • H03J5/0245—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form
    • H03J5/0254—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being transfered to a D/A converter
    • H03J5/0263—Discontinuous tuning using an electrical variable impedance element, e.g. a voltage variable reactive diode, in which no corresponding analogue value either exists or is preset, i.e. the tuning information is only available in a digital form the digital values being transfered to a D/A converter the digital values being held in an auxiliary non erasable memory
    • H—ELECTRICITY
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    • H03J7/00—Automatic frequency control; Automatic scanning over a band of frequencies
    • H03J7/02—Automatic frequency control
    • H03J7/04—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant
    • H03J7/06—Automatic frequency control where the frequency control is accomplished by varying the electrical characteristics of a non-mechanically adjustable element or where the nature of the frequency controlling element is not significant using counters or frequency dividers

Description

【発明の詳細な説明】 本発明は電子同調チューナを用い、然もこれに対する同
調電圧を発生するためのポテンショメータを省略し、選
局コード発生用カウンタの出力を同調電圧にＤＡ変換し
て与えるようにした電子式の選局装置に関する。
この選局装置にはメモリーが設けられてお広最初に局に
対応する選局コードをメモリーに書き込んでおき、次に
選局するときには希望する局の選局コードをメモリーか
ら読み出すようにしたものがある。
また、微同調回路或いはＡＦＴ回路が設けられておシ、
プリセットした選局コードにより決定される同調電圧に
対応する同調周波数が正規の同調点からずれているとき
には、手動或いは自動的に補正パルスが選局コードに対
して加算又は減算されるようにした装置がある。
更に、このＡＦＴ補正パルスが所定数以上に達したとき
には、メモリーに記憶されている選局コード自体を自動
的に書き換えるようにした装置も提案されている。
ところが上述の如＜ＡＦＴ補正パルスが所定数以上に達
した時にメモリーに記憶されている選局コード自体を自
動的に書き換える場合、次に述べるような不都合が生じ
る虞れがある。
例えば深夜、放送が既に終了しているのに気づかずにあ
るチャンネルを選局した場合、放送が受信できないので
、実際には正しい受信周波数であるにもかかわらず受信
周波数がずれていると誤認して補正操作を行なってしま
い、補正パルスが所定値以上となった時点でメモリー内
の選局コード７５椙動的に書き換えられてしまい誤った
データがメモリーに記憶される。
従って、次に選局動作を行なってこのチャンネルを選択
した時、受信周波数が狂ってしまい正常な選局ができな
くなる。
本発明は上述の点を考慮して、放送波の有る場合にのみ
選局コードをメモリーに書き込むことができるようにし
たものである。
以下、本発明の一実施例を図面を参照して説明しよう。
第１図において、１は電子同調チューナを示し、その各
同調回路に可変容量ダイオードが設けられており、後述
するように形成された同調電圧Ｖｃが可変容量ダイオー
ドの逆バイアス電圧とされ、そのレベルによって受信周
波数（受信チャンネル）が決定されるようになされてい
る。
実際には、電子同調チューナ１には、バンド切換信号が
与えられて、ｖＨＦのバイチャンネル及びローチャンネ
ル、ＵＨＦの各バンドのチャンネルを切り替えて受信し
うるようになされているが、本例の説明では簡単のため
省略されている。
２は映像中間周波増幅器、３は映像検波器、４は映像増
幅器、５はブラウン管を示す。
６はＡＦＴ回路で、映像中間周波増幅器２の出力をリミ
ッタを介して周波数弁別し、その弁別出力を波形整形し
て第２図Ａ及びＢに示すＡＦＴ補正指令ＥＵ及びＥＤを
発生するようになされている。
即ち補正指令ＥＵは受信周波数を変化させたときに、正
規の同調点ｆｏよ、９１．２ＭＨｚ低い周波数から「１
」となって、（ｆｏ −５０ＫＨｚ ）まで「１」の状
態を維持し、これ以外の周波数範囲で「０」となるもの
であシ、補正指令ＥＤは正規の同調点（ｆｏ ＋５０Ｋ
Ｈｚ ）よ〃「１」となってｆｏから１．２ＭＨｚ高い
周波数まで「１」の状態を維持し、これ以外の周波数範
囲で「０」となるものである。
１．２ＭＨｚ及び５０ＫＨｚという数値は一例であるが
、（ｆｏ±５０ＫＨｚ）が最良の同調点となるものであ
る。
以下、同調電圧を形成するだめの構成について述べるに
、１１はチャンネルメモリーで、例えばＮ個の受信可能
なチャンネルに対応したアドレスを有し、各アドレスに
はそのチャンネルに対応したｎビットの選局コードを記
憶しうるようになされている。
このチャンネルメモリー１１は電源が断たれてもその内
容が保持される不揮発性のメモリーである。
１２はアドレス指定回路で、アドレス指定用の即ち受信
チャンネルに対応させられるべきＮ個のスイッチ８１〜
ＳＮからなるスイッチ群１０が設けられてお拡スイッチ
８１〜ＳＮの何れかが選択的に操作されることによシ対
応するチャンネルメモリー１１のアドレスが指定される
。
１３はチャンネルメモリー制御回路でモード切換スイッ
チＳＷ１ と、書き込み用スイッチｓＷ２とが設けられ
ている。
プログラム時、即ち予めチャンネルメモリー１１の指定
されたアドレスに選局コードを書き込むべきときにはモ
ード切換スイッチＳＷ１は正の電圧が得られる接点ａ側
に切換えられ、選局時には接地された接点す側に切換え
られるもので、このスイッチＳＷ１の出力がナンド回路
３２に供給される。
また、書き込み用スイッチＳＷ２の一端が接地され、他
端に得られる信号がインバータ３３を通じてナンド回路
３２に供給され、ナンド回路３２の出力がアンド回路３
４に供給される。
アンド回路３４には後述のメモリー書き換え回路４１よ
り書換え指令Ｐ、が供給され、アンド回路３４の出力が
チャンネルメモリー制御回路１３に供給される。
１４は選局コード発生用のカウンタで、これは可逆カウ
ンタの構成とされ、加算（ＵＰ）入力によシその出力（
２進コード）Ａ１〜Ａｎが増加方向に歩進し、減算（Ｄ
ＯＷＮ）入力によりその出力Ａ１〜Ａｎが減少方向に歩
進する。
そしてプログラム時には掃引パルスを計数してｎビット
の選局コードＡ１〜Ａｎを発生して、これをチャンネル
メモリー１１に供給し、一方選局時には各選局操作ごと
にチャンネルメモリー１１よシ読み出されたｎビットの
選局コードＢ１〜Ｂｎがこの選局コード発生用カウンタ
１４に供給されて、これが出力コードＡ１〜Ａｎとされ
る。
そして上述のアンド回路３４の出力が「１」のときは、
チャンネルメモリー制御回路１３から読み出し指令ＰＲ
が発生して、チャンネルメモリー１１は読み出し状態と
され、チャンネルメモリー１１から選局コードＢ１〜Ｂ
ｎが読み出される。
また、アンド回路３４の出力が「０」となると、まず消
去指令Ｐ０が発生して指定されたアドレスの内容が消去
され、次いで書き込み指令Ｐｗが発生し、指定されたア
ドレスに選局コードＡ１〜Ａｎが書き込まれる。
本例では、このチャンネルメモリー制御回路１３から発
生する消去指令Ｐ。
をアンド回路３５を介してチャンネルメモリー１１に与
えると共に、書き込み指令Ｐｗをアンド回路３６を介し
てチャンネルメモリー１１に与える。
このアンド回路３５及び３６は放送波の有無に応じた検
出出力によシ制御されるものである。
即ち、映像中間周波増幅器２の出力が狭帯域フィルタ３
１に供給されうこの狭帯域フィルタ３１の出力が検波器
３８に供給されることによシ、放送波の有るときのみ検
波器３８の出力が「１」となシ、これによってアンド回
路３５及び３６を介して消去指令Ｐ０及び書き込み指令
Ｐｗがチャンネルメモリー１１に供給されるようになさ
れている。
１５はカウンタ１４に対する加算或いは減算人力パルス
を発生するためのパルス発生回路で、高速上昇掃引スイ
ッチ１６ＣＵ、低速上昇掃引スイッチ１６ＦＵ、高速下
降掃引スイッチ１６ＣＤ。
低速下降掃引スイッチ１６ＦＤが設けられ、夫々のスイ
ッチからはこれをオンしたときに「０」なる信号が得ら
れるようになされ、このスイッチ１６ＣＵ、１６ＦＵ、
１６ＣＤ、１６ＦＤよシの信号がインバータ１７，１８
，１９，２０を通じてアンド回路２１．２２，２３，２
４に供給され、アンド回路２１．２３にはパルス発振器
２５よ如第１のパルスＰ１が供給され、アンド回路２２
゜２４にはパルスＰｌが分周回路２６を介されることに
よシ、パルスＰｉ の周期よ殴長い周期とされた第２の
パルスＰ２が供給される。
従ってスイッチ１６ＣＵ或いは１６ＣＤをオンにしたと
きには、アンド回路２１或いは２３の出力にパルスＰｌ
が現れ、スイッチ１６ＦＵ或いは１６ＦＤをオンしたと
きにはアンド回路２２或いは２４の出力にパルスＰ２が
現れる。
このアンド回路２１及び２２の出力はオア回路２９を介
してカウンタ１４に加算入力として供給され、アンド回
路２３及び２４の出力はオア回路３０を介してカウンタ
１４に減算入力として供給される。
またオア回路２９及び３０にはアンド回路２７及び２８
の出力が供給される。
アンド回路２７゜２８にはパルス発振器２５からパルス
Ｐ１及びアンド回路３１の出力が供給されると共に、一
方のアンド回路２７に前述のＡＦＴ回路６からの補正指
令ＥＵが供給され、他方のアンド回路２８に補正指令Ｅ
Ｄが供給される。
アンド回路３１には掃引スイッチ１６ＣＵ 、１６ＦＵ
、１６ＣＤ、１６ＦＤの出力が供給され、従って何れ
の掃引スイッチもオンされないときにアンド回路３１の
出力が「１」となるようにされ、この状態で補正指令Ｅ
Ｕ或いはＥＤによシ選択された補正パルスがカウンタ１
４に供給されるようになされている。
言い換えると、掃引スイッチをオンにしているときには
ＡＦＴ動作が行なわれないような優先順位が設けられて
いる。
これはＡＦＴ動作によシ最良の同調点に引き込まれてい
る受信周波数を動かすために必要である。
３９はカウンタ１４の出力に得られる選局コードＡ１〜
Ａｎをアナログ信号即ち同調電圧Ｖｃに変換するＤＡ変
換装置である。
ＤＡ変換装置３９としては種々のものを用いることがで
きるが、一例として掃引パルスによって選局コードＡ、
〜Ａｎが変化する一周期の間にｎビットのコードを発生
し、かつその内容が上記１周期内で一巡するように駆動
される別個のタイミングカウンタを設け、選局コードが
変化する時点から、この選局コードとタイミングカウン
タの出力コードが一致する時点までのパルス幅のパルス
を形成し、このパルスを平滑する手段を用いることがで
きる。
メモリー書さ換え回路４１は、アドレス指定検知回路４
２と、単安定マルチバイブレータ４３゜４４と、カウン
タ４５と、デコーダ４６と、フリップフロップ４Ｔと、
ナンド回路４８．４９とから構成されている。
アドレス指定検知回路４２はスイッチ群１０のうちで何
れかのスイッチがオンとされることを検知するもので、
スイッチがオンとされてから一定時間「０」となる検知
出力Ｍ１が発生し、これにより単安定マルチバイブレー
タ４３がトリガされ、その出力Ｍ２により単安定マルチ
バイブレータ４４がトリガされると共に、カウンタ４５
が９セツトされ、更に単安定マルチバイブレータ４４の
出力Ｍ３によってフリップフロップ４７がリセットされ
る。
またパルス発生回路１５のアンド回路２７及び２８の出
力がオア回路４０に供給されることにより得られる補正
パルスＰＵＤ及びモード切換スイッチＳＷ１の出力への
否定値ＰＡがナンド回路４８を通じてカウンタ４５に供
給され、これが計数される。
そして、カウンタ４５の出力が供給されるデコーダ４６
のｎ番目の出力線Ｌｎに生じる出力によってフリップフ
ロップ４７がセットされる。
このフリップフロップ４Ｔの出力Ｍ４ と単安定マイチ
バイブレータ４４の出力Ｍ３がナンド回路４９に供給さ
れ、その出力に書き換え指令ＰＭが得られる。
上述の構成で受信チャンネルのプログラムを行なうには
、選局コード発生用カウンタ１４をリセット状態とし、
モード切換スイッチＳＷ１を接点ａ側に切シ換え次に関
東地方のチャンネル割当であれば、スイッチ群１０のう
ちでまず１チヤンネルに対応させられるスイッチＳ１が
オンとされ、スイッチＳ１ に対応したアドレスが指定
される。
その後、パルス発生回路１５において、高速上昇掃引ス
イッチ１６ＣＵをオンする。
スイッチ１６１６ＣＵをオンすると、インバーターＴの
出力が「１」となり、周期がＴの加算人力パルスＰ１が
アンド回路２１及びオア回路２９を介じてカウンター４
に供給される。
第３図ＡはこのパルスＰ１を示し、このパルスＰ１によ
ってカウンター４よりの選局コードＡ１〜ＡＨが同図Ｂ
に示すように（００・・・・・・０）の状態より出発し
て、順次上昇方向に変化し、同図Ｃに示すようにＤＡ変
換装置３９よ如の変換電圧Ｖｃが△Ｖずつ上昇し、従っ
て受信周波数が上昇する。
そして画面を見ながら１チヤンネルを受信する状態に近
（なったら、高速上昇掃引スイッチ１６ＣＵよ９手を離
してこれをオフさせ、次に低速上昇掃引スイッチ１６Ｆ
Ｕをオンさせ、第３図Ｂに示すように分周回路２６の分
周比が例えば−であれば、５Ｔの周期のパルスＰ２をア
ンド回路２２及びオア回路２９を介してカウンター４に
供給する。
また低速下降掃引スイッチ１６ＦＤを必要に応じて操作
することによ〃略々１チャンネルを受信する状態に微同
調をとることができる。
そして、掃引スイッチをオフにすれば、正規の同調点ｆ
ｏを中心にして±１．２ＭＨｚの範囲ではＡＦＴ動作が
働らくので、自動的に補正パルスがカウンター４に供給
されて最良の同調点に引き込まれ、従ってカウンター４
よ乃の選局コードＡ１〜Ａｎは１チヤンネルを受信する
ような同調電圧Ｖｃがチューナーに供給される状態で停
止する。
そしてその後に書き込み用スイッチＳＷ２をオンする。
これによ）ナンド回路３２の出力が「０」とな如、アン
ド回路３４の出力がｒＯＪとなシ、チャンネルメモリー
制御回路１３から消去指令Ｐｏ１ 次いで書き込み指
令Ｐｗが発生する。
なお、アンド回路３４には書き換え指令へが与えられて
いるが、書き換え指令へは書き換え時に「０」となるも
ので、プログラム時或いは書き換えを必要としないとき
は「１」となる。
また、上述の操作で１チヤンネルを受信する状態とされ
ているから、検波回路３８の出力が「１」となっており
、従って消去指令Ｐ。
及び書き込み指令Ｐｗがアンド回路３５及び３６を介し
てチャンネルメモリー１１に供給される。
かくして、スイッチＳ１ で指定されたアドレスの内
容が消去されて後、このアドレスにカウンタ１４よりの
１チヤンネルに対応した選局コードＡ１〜Ａｎが書き込
まれる。
次いで３チヤンネルの書き込みを行なうときも同様で、
３チヤンネルに対応されるべきスイッチＳ２をオンさせ
、その後高速上昇掃引スイッチ１６ＣＵをオンさせ、３
チヤンネルを受信する状態に近（なったら、スイッチ１
６ＣＵをオフさせ、低速掃引スイッチ１６ＦＵ或いは１
６ＦＤをオンして略々同調状態とし、その後書き込み用
スイッチＳＷ２をオンさせれば良い。
次に選局時では、モード切換スイッチＳＷ１を操作して
接点す側に切換える。
従ってナンド回路３２の出力が「１」となり、書き換え
指令へが「１」のときは、アンド回路３４の出力が「１
」となシ、チャンネルメモリー制御回路１３から読み出
し指令ＰＲが発生してチャンネルメモリー１１を読み出
し状態とする。
°そしてスイッチ８１〜Ｓｎのうちの選択するチャンネ
ルに対応するものをオンさせ、アドレスを指定すれば良
い。
この指定されたアドレスの選局コードＢ１〜Ｂｎが読み
出されてカウンタ１４にセットされ、これがそのままカ
ウンタ１４の出力コードＡ１〜Ａｎとなシ、ＤＡ変換装
置３９により所定の同調電圧Ｖｃに変換されるから、操
作されたスイッチに対応するチャンネルを受信すること
ができる。
この選局動作において、チャンネルメモリー１１よ如読
み出された選局コードＢ１〜Ｂｎによ）対応するチャン
ネルを受信した場合、温度変動などの原因で正規の同調
点からずれていれば、そのずれの方向によりＡＦＴ回路
６から補正指令恥或いはＥＤが発生し、最良の同調点と
なるまでカウンタ１４にチャンネルメモリー１１から移
された選局コードに対して補正パルスが加算或いは減算
される。
メモリー書き換え回路４１において、選局時にスイッチ
群１０で例えば第４図Ａに示すようにスイッチＳ１をオ
ンにしたとすると、アドレス指定検知回路４２よシ、同
図Ｂに示す所定パルス幅の検知出力Ｍ□が発生し、この
立上りで単安定マルチバイブレータ４３がトリガされ、
同図Ｃに示す出力Ｍ２が発生し、カウンタ４５が９セツ
トされる。
これと共に、出力Ｍ２が「１」で且つ選局時で鰹が「１
」のときに、ナンド回路４８を通じてＡＦＴ補正用の第
４図Ｅに示す補正パルスＰＵＤがカウンタ４５に供給さ
れて計数される。
勿論、選局時にチャンネルメモリー１１から読み出され
た選局コードで定まる受信周波数が正規の同調点になっ
ていれば、補正パルスＰＵＤは発生しない。
そしてカウンタ４５の出力に接続されたデコーダ４６の
出力線が順次「１」となり、ｎ個の補正パルスＰＵＤが
カウンタ４５に与えられると、第４図Ｆに示すようにデ
コーダ４６の出力線Ｌｎが「１」とな〃、これによって
フリップフロップ４７がセットされ、単安定マルチバイ
ブレータ４４の出力Ｍ３の立下りでリセットされるから
、フリップフロップ４７の出力Ｍ４が同図Ｇに示すもの
となる。
この信号Ｍ４と信号Ｍ３がナンド回路４９に供給される
から、その出力に第４図Ｈに示す書き換え指令ＰＭが発
生する。
この書き換え指令式がアンド回路３４に供給され、アン
ド回路３４の出力が「１」から「０」となる。
従って消去指令ＰＦ、及び書き込み指令〜がチャンネル
メモリー制御回路１３から発生する。
この場合、放送波が有ればアンド回路３５及び３６を介
して消去指令ＰＥ及び書き込み指令Ｐｗがチャンネルメ
モリー１１に供給され、そのときカウンタ１４の出力に
生じる選局コードＡ１〜Ａｎがチャンネルメモリー１１
に書き込まれる。
上述の本発明に依れば、メモリー１１を設けることによ
り、瞬時に所望の局を受信することができる。
この場合に、スイッチ８１〜Ｓｎ％ モード切換スイッ
チＳＷ１、書込み用スイッチＳＷ２、低速掃引スイッチ
１６ＦＵ、１６ＦＤ等を誤操作したり、幼児がいたずら
するなどによ〃、チャンネルメモリー１１に放送波の有
る周波数と対応しないでたらめのコードが書き込まれ、
そｑ後の選局操作が良好になされないおそれがあるが、
本発明に依れば、放送波の有るときのみに書き込みを可
能としているので、このようなおそれを一掃できる。
また、上述実施例のように、メモリー書き換え回路４１
が設けられていれば、最初にプログラムした選局コード
が、温度特性、経年変化などの原因でＡＦＴの引込み範
囲から外れた同調点となってしまうようにずれたときに
、改めてプログラムを行なう必要が防止される利益があ
る。
さらに、本発明によれば、放送波が存在する時のみメモ
リーの書き換えを可能としたので、放送終了後等に誤っ
て補正操作を行なってもメモリーが誤って書き換えられ
ることがないという効果を有する。
【図面の簡単な説明】
第１図は本発明の一実施例のブロック図、第２図〜第４
図はその説明に用いる線図である。 １は電子同調チューナ、２は映像中間周波増幅器、６は
ＡＦＴ回路、１１はチャンネルメモリー、１２はアドレ
ス指定回路、１３はチャンネルメモリー制御回路、１４
はカウンタ、１５はパルス発生回路、４１はメモリー書
き換え回路、ＳＷｌはモード切換スイッチ、ＳＷ２は書
き込み用スイッチである。

Claims (1)

    【特許請求の範囲】
  1. １ 各チャンネルに対応する選局コードが記憶されたメ
    モリーと、このメモリーの内容が転送される可逆カウン
    タと、このカウンタの出力が供給されるＤＡ変換回路と
    、このＤＡ変換回路の出力が同調電圧として供給される
    電子同調チューナと、上記可逆カウンタに加算又は減算
    パルスを供給するパルス発生回路と、上記パルス発生回
    路からの加算又は減算パルスによる周波数の変化が一定
    値以上になった時上記可逆カウンタの内容を上記メモリ
    に書き込むメモリー書き換え回路と、放送波の有無を検
    出し放送波のある時のみ上記メモリー書き換え回路を動
    作させる検出回路とよ如なり、放送波の無い時は上記メ
    モリーの書き換えを禁止するようにした選局装置。
JP51038007A 1976-04-05 1976-04-05 選局装置 Expired JPS5946129B2 (ja)

Priority Applications (8)

Application Number Priority Date Filing Date Title
JP51038007A JPS5946129B2 (ja) 1976-04-05 1976-04-05 選局装置
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AU23225/77A AU504640B2 (en) 1976-04-05 1977-03-15 Receiver channel tuning with memory rewrite
CA275,429A CA1069230A (en) 1976-04-05 1977-04-04 Channel selecting apparatus
US05/784,599 US4127821A (en) 1976-04-05 1977-04-04 Channel selecting apparatus with automatic rewriting of channel identifying codes in a memory
DE19772715032 DE2715032A1 (de) 1976-04-05 1977-04-04 Kanalwaehler fuer fernsehempfaenger mit elektronischem tuner
FR7710295A FR2347825A1 (fr) 1976-04-05 1977-04-05 Selecteur de canaux pour recepteur de television
NLAANVRAGE7703740,A NL187946C (nl) 1976-04-05 1977-04-05 Kanaalkiesinrichting.

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP51038007A JPS5946129B2 (ja) 1976-04-05 1976-04-05 選局装置

Publications (2)

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