JPS5939653Y2 - キヤパシタンス測定装置 - Google Patents
キヤパシタンス測定装置Info
- Publication number
- JPS5939653Y2 JPS5939653Y2 JP7267178U JP7267178U JPS5939653Y2 JP S5939653 Y2 JPS5939653 Y2 JP S5939653Y2 JP 7267178 U JP7267178 U JP 7267178U JP 7267178 U JP7267178 U JP 7267178U JP S5939653 Y2 JPS5939653 Y2 JP S5939653Y2
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- JP
- Japan
- Prior art keywords
- resistor
- circuit
- amplifier circuit
- resistance value
- terminal
- Prior art date
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- Measurement Of Resistance Or Impedance (AREA)
Description
【考案の詳細な説明】
本考案は抵抗と並列接続されたコンデンサのキャパシタ
ンスｌＩ３定−するキャパシタンス測定装置に関する。
ンスｌＩ３定−するキャパシタンス測定装置に関する。
従来の測定器ではＰＣ板上やターミナルに実装された第
１図に示すように抵抗Ｒに並列接続されたコンデンサＣ
のキャパシタンスを測定することができなかった。
１図に示すように抵抗Ｒに並列接続されたコンデンサＣ
のキャパシタンスを測定することができなかった。
本考案は抵抗に並列接続されたコンデンサのキャパシタ
ンスをＰＣ板やターミナルに実装された状態で測定し得
るキャパシタンス測定装置を提供するものである。
ンスをＰＣ板やターミナルに実装された状態で測定し得
るキャパシタンス測定装置を提供するものである。
地下図面を参照して本考案に係るキャパシタンス測定装
置の一実施例を説明する。
置の一実施例を説明する。
極性反転自任の直流電源１１の一端は基準電位点に接続
され他端は抵抗値Ｒ１の第１の抵抗１２を介して第１の
直流差動増幅回路１３の第１の入力端（ここでは反転入
力端）に接続される。
され他端は抵抗値Ｒ１の第１の抵抗１２を介して第１の
直流差動増幅回路１３の第１の入力端（ここでは反転入
力端）に接続される。
前記第１の増幅回路１３の第２の入力端（ここでは非反
転入力端）は基準電圧回路１４に接続される。
転入力端）は基準電圧回路１４に接続される。
前記第１の増幅回路１３の出力端及び前記第１の入力端
相互間には抵抗値Ｒ２の第２の抵抗１５及び抵抗値Ｒ１
の第３の抵抗１６の並列回路が接続される。
相互間には抵抗値Ｒ２の第２の抵抗１５及び抵抗値Ｒ１
の第３の抵抗１６の並列回路が接続される。
前記第１の増幅回路１３の出力端は抵抗値Ｒ１の第４の
抵抗１７を介して第２の直流差動増幅回路１８の第１の
入力端（ここでは反転入力端）に接続される。
抵抗１７を介して第２の直流差動増幅回路１８の第１の
入力端（ここでは反転入力端）に接続される。
前記第２の増幅回路１８の第２の入力端（ここでは非反
転入力端）は抵抗値Ｒ１の第５の抵抗１９を介して基準
電位点に接続されると共に抵抗値Ｒ２の第６の抵抗２０
を介して第２の増幅回路１８の出力端に接続される。
転入力端）は抵抗値Ｒ１の第５の抵抗１９を介して基準
電位点に接続されると共に抵抗値Ｒ２の第６の抵抗２０
を介して第２の増幅回路１８の出力端に接続される。
前記第２の増幅回路１８の第１の入力端には測定端子の
一方２１が接続され、前記第２の増幅回路１８の出力端
は前記測定端子の他方２２が接続される。
一方２１が接続され、前記第２の増幅回路１８の出力端
は前記測定端子の他方２２が接続される。
前記測定端子２Ｌ２２に被測定回路である抵抗ＲＸ及び
コンデンサＣＸの並列回路が接続される。
コンデンサＣＸの並列回路が接続される。
前記第２の増幅回路１８の出力端はゲート回路２３の制
御端に接続される。
御端に接続される。
前記ゲート回路２３の入力端はクロックパルス発生回路
２４に接続され、出力端はパルス出力端子２５を介して
パルスカウンク（図示せず）に接続される。
２４に接続され、出力端はパルス出力端子２５を介して
パルスカウンク（図示せず）に接続される。
次に動作を説明する。
第１の増幅回路１３に対する入力電圧ｅｉとして第３図
Ａに示すと釦り直流ステップ電圧を加えると第１の増幅
回路１３の出力電圧ｅ「は次式のと釦シである。
Ａに示すと釦り直流ステップ電圧を加えると第１の増幅
回路１３の出力電圧ｅ「は次式のと釦シである。
但し、Ｒ１・・・・・・第１の抵抗１２及び第３の抵抗
１６の抵抗値 Ｒ２・・・・・・第２の抵抗１５の抵抗値ここでＲ２”
” Ｒｘと設定すればｅｌはとなる。
１６の抵抗値 Ｒ２・・・・・・第２の抵抗１５の抵抗値ここでＲ２”
” Ｒｘと設定すればｅｌはとなる。
第２の増幅回路１８の入力として前記ｅ′ｉが印加され
ると同増幅回路１８の出力電圧ｅＯは次式但し、Ｒ１・
・・・−・第４の抵抗１７及び第５の抵抗１９の抵抗値 Ｒ２・・・・・・第６の抵抗２０の抵抗値τ・−・・・
・ＣＸ−ＲＸ ここでＲ２−Ｒｘと設定すればｅｏは となる。
ると同増幅回路１８の出力電圧ｅＯは次式但し、Ｒ１・
・・・−・第４の抵抗１７及び第５の抵抗１９の抵抗値 Ｒ２・・・・・・第６の抵抗２０の抵抗値τ・−・・・
・ＣＸ−ＲＸ ここでＲ２−Ｒｘと設定すればｅｏは となる。
（２）式、（ω式よりｅｏは
但し、
τ・・・・・・ＣＸ、ＲＸ・・・・・・・・・・・・・
・・・・・・・・・・・（５）となる。
・・・・・・・・・・・（５）となる。
（つ式にむいて、ｔ）τとし第一次近似１で求めるとｅ
Ｑは となる。
Ｑは となる。
（６）式に示されるように第２の増幅回路１８の出力ｅ
ｏは完全に時間に則し比例する。
ｏは完全に時間に則し比例する。
従って出力電圧ｅｏ推移をゲート回路２３及びクロック
パルス発生回路２４により時間推移変換することにより
被測定コンデンサＣｘのキャパシタンスを求めることが
できる。
パルス発生回路２４により時間推移変換することにより
被測定コンデンサＣｘのキャパシタンスを求めることが
できる。
以上の様子を第３図に示す。
入力電圧ｅ１として第３図Ａに示すように一１■の直流
電圧を加えると出力電圧ｅｏは同図Ｃに示すように時間
比例で下降し−１，１ｖに達したときゲート回路２３を
開きクロックパルス発生回路２４の出力パルスが出力端
子２５に導出される。
電圧を加えると出力電圧ｅｏは同図Ｃに示すように時間
比例で下降し−１，１ｖに達したときゲート回路２３を
開きクロックパルス発生回路２４の出力パルスが出力端
子２５に導出される。
このとき人力眼圧ｅｉは自動的に＋１ｖに反転し出力電
圧ｅｏは零電位の方向に積分を開始し、ｅ。
圧ｅｏは零電位の方向に積分を開始し、ｅ。
が−〇、ＩＶに達したとき前記ゲート回路２３が閉じ、
クロックパルス発生回路２４の出力パルスが出力端子２
５に導出されなくなる。
クロックパルス発生回路２４の出力パルスが出力端子２
５に導出されなくなる。
出力端子２５にあられれたパルスは前記カウンタによっ
て計数される。
て計数される。
第３図ＣＩ−いてｔ ｄ 、ｔ ｓは被測定コンデンサ
のキャパシタンスが小さいとき短かく大きいとき長い。
のキャパシタンスが小さいとき短かく大きいとき長い。
従って前記パルスの計数は被測定コンデンサのキャパシ
タンスに比例する。
タンスに比例する。
しかして計測の各レンジにおいてキャパシタンスとパル
ス計数の絶苅値が等しくなるように前記第４の抵抗１７
、入力電圧ｅｉ１パルス周波数の切換えを行なうことに
よりキャパシタンスを測定し得る。
ス計数の絶苅値が等しくなるように前記第４の抵抗１７
、入力電圧ｅｉ１パルス周波数の切換えを行なうことに
よりキャパシタンスを測定し得る。
なお、第３図にあ−いて、同図Ａは入力直流電圧ｅｉを
示し、同図Ｂは第２の増幅回路１８の入力直流電圧を示
し、同図Ｃは第２の増幅回路１８の出力電圧を示し、同
図りはクロックパルス発生回路２４の出力、同図Ｅはゲ
ート回路２３の開放時間を示し、同図Ｆはパルス出力端
子２５に導出されるパルスを示す。
示し、同図Ｂは第２の増幅回路１８の入力直流電圧を示
し、同図Ｃは第２の増幅回路１８の出力電圧を示し、同
図りはクロックパルス発生回路２４の出力、同図Ｅはゲ
ート回路２３の開放時間を示し、同図Ｆはパルス出力端
子２５に導出されるパルスを示す。
尉のように本考案によれば抵抗及びコンデンサの並列回
路のキャパシタンスを測定し得るので、ＰＣ板上のター
ミナルに実装された状態でキャパシタンスを短時間に測
定することができる。
路のキャパシタンスを測定し得るので、ＰＣ板上のター
ミナルに実装された状態でキャパシタンスを短時間に測
定することができる。
第１図は被測定抵抗及びコンデンサの回路図、第２図は
本考案に係るキャパシタンス測定装置の一実施例を示す
回路構成図、第３図は［ｂ′！上動作タイミングを示す
線図である。 １１・・・直流電源、１２・・・第１の抵抗、１３・・
・直流差動増幅回路、１４・・・基準電圧回路、１５・
〜・第２の抵抗、１６・・・第３の抵抗、１７・・・第
４の抵抗、１８・・・第２の増幅回路、１９・・・第５
の抵抗、２０・・・第６の抵抗、２Ｌ２２・・・測定端
子、２３・・・ゲート回路、２４・・・クロックパルス
発生回路、２５・・・パルス出力端子。
本考案に係るキャパシタンス測定装置の一実施例を示す
回路構成図、第３図は［ｂ′！上動作タイミングを示す
線図である。 １１・・・直流電源、１２・・・第１の抵抗、１３・・
・直流差動増幅回路、１４・・・基準電圧回路、１５・
〜・第２の抵抗、１６・・・第３の抵抗、１７・・・第
４の抵抗、１８・・・第２の増幅回路、１９・・・第５
の抵抗、２０・・・第６の抵抗、２Ｌ２２・・・測定端
子、２３・・・ゲート回路、２４・・・クロックパルス
発生回路、２５・・・パルス出力端子。
Claims (1)
- 極性反転自任の直流電源と、第１の入力端が抵抗値Ｒ１
の第１の抵抗を介して前記電源に接続され第２の入力端
が基準電圧回路に接続される第１の直流差動増幅回路と
、この増幅回路の出力端及び前記第１の入力端相互間に
接続される抵抗値Ｒ２の第２の抵抗及び抵抗値Ｒ１の第
３の抵抗の並列回路と、第１の入力端が抵抗値Ｒ１の第
４の抵抗を介して前記第１の増幅回路の出力端に接続さ
れ第２の入力端が抵抗値Ｒ１の第５の抵抗を介して基準
電位点に接続される第２の直流差動増幅回路と、この第
２の増幅回路の出力端及び前記第２の入力端相互間に接
続される抵抗値Ｒ２の第６の抵抗と、前記第２の増幅回
路の第１の入力端に接続される測定端子の一方と、前記
第２の増幅回路の出力端に接続される測定端子と他方と
、前記第２の増幅回路の出力側に接続されるゲート回路
と、このゲート回路の入力端に接続されるクロックパル
ス発生回路と、前記ゲート回路の出力端に接続されるパ
ルス計数出力端とを具備し、前記測定端子に抵抗及びコ
ンデンサの並列回路を接続して前記コンデンサのキャパ
シタンスを測定スルようにしたことを特徴とするキャパ
シタンス測定装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7267178U JPS5939653Y2 (ja) | 1978-05-29 | 1978-05-29 | キヤパシタンス測定装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7267178U JPS5939653Y2 (ja) | 1978-05-29 | 1978-05-29 | キヤパシタンス測定装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54174375U JPS54174375U (ja) | 1979-12-08 |
| JPS5939653Y2 true JPS5939653Y2 (ja) | 1984-11-06 |
Family
ID=28984568
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7267178U Expired JPS5939653Y2 (ja) | 1978-05-29 | 1978-05-29 | キヤパシタンス測定装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5939653Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11352089A (ja) * | 1998-06-04 | 1999-12-24 | Imura Japan Kk | 液体濃度センサ |
-
1978
- 1978-05-29 JP JP7267178U patent/JPS5939653Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54174375U (ja) | 1979-12-08 |
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