JPS5938639B2 - デイジタル表示装置 - Google Patents
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- JPS5938639B2 JPS5938639B2 JP52067670A JP6767077A JPS5938639B2 JP S5938639 B2 JPS5938639 B2 JP S5938639B2 JP 52067670 A JP52067670 A JP 52067670A JP 6767077 A JP6767077 A JP 6767077A JP S5938639 B2 JPS5938639 B2 JP S5938639B2
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- circuit
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/02—Details
- H04L12/16—Arrangements for providing special services to substations
- H04L12/18—Arrangements for providing special services to substations for broadcast or conference, e.g. multicast
- H04L12/1804—Arrangements for providing special services to substations for broadcast or conference, e.g. multicast for stock exchange and similar applications
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- G—PHYSICS
- G04—HOROLOGY
- G04C—ELECTROMECHANICAL CLOCKS OR WATCHES
- G04C13/00—Driving mechanisms for clocks by master-clocks
- G04C13/02—Circuit arrangements; Electric clock installations
- G04C13/027—Circuit arrangements; Electric clock installations master-slave systems using transmission of other driving signals, e.g. coded signals
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- G—PHYSICS
- G04—HOROLOGY
- G04G—ELECTRONIC TIME-PIECES
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- G04G9/0011—Transmission of control signals using coded signals
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
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- Arrangements For Transmission Of Measured Signals (AREA)
Description
【発明の詳細な説明】
本発明は１個の制御部からの信号でもって複数個の表示
部を駆動できるディジタル表示装置に関するものである
。
部を駆動できるディジタル表示装置に関するものである
。
従来周知のディジクル表示装置例えば時計は、制御部及
び表示部が一体化されており、表示部を２か所以上に設
けようとする場合制御部も表示部と同じ数だけ必要とな
り、スペースを広く必要とし、さらにコストが高くなる
という欠点がある。
び表示部が一体化されており、表示部を２か所以上に設
けようとする場合制御部も表示部と同じ数だけ必要とな
り、スペースを広く必要とし、さらにコストが高くなる
という欠点がある。
また従来の方式で、制御部を１つにして表示部を複数に
する場合は多くのワイヤ・ハーネスを必要とし、ワイヤ
・ハーネスが太くなり、また断線や接触不良の可能性が
増えるという欠点がある。
する場合は多くのワイヤ・ハーネスを必要とし、ワイヤ
・ハーネスが太くなり、また断線や接触不良の可能性が
増えるという欠点がある。
本発明は上述の欠点に鑑みてなされたものであり、１個
の制御部と複数個の表示部との間の信号の伝送に時分割
多重通信を用い、かつ電源線には一定周波数の交流電圧
を伝送することにより、制御部を１個ですませて制御部
の回路構成を簡単にし、また時分割多重通信を用いてワ
イヤ・ハーネスを簡略化でき、とりわけ交流電圧を用い
て、各表示部で必要な一定周波数の基準時間信号と電源
電圧とを送り、これにより各表示部側において基準時間
信号を形成する発振器を不要にできるディジタル表示装
置を提供することを目的とするものである。
の制御部と複数個の表示部との間の信号の伝送に時分割
多重通信を用い、かつ電源線には一定周波数の交流電圧
を伝送することにより、制御部を１個ですませて制御部
の回路構成を簡単にし、また時分割多重通信を用いてワ
イヤ・ハーネスを簡略化でき、とりわけ交流電圧を用い
て、各表示部で必要な一定周波数の基準時間信号と電源
電圧とを送り、これにより各表示部側において基準時間
信号を形成する発振器を不要にできるディジタル表示装
置を提供することを目的とするものである。
以下本発明を図に示す一実施例について説明する。
まず本発明の全体概要構成を、表示内容として時刻表示
を例について示す第１図において、１は制御部であり、
水晶振動子、時計用ＬＳＩ（例えばナショナル・セミコ
ンダクタ社のＭＭ５３１６）及び周辺回路から構成され
る時刻信号回路１１、前記時刻信号回路１１から形成さ
れる時刻信号を１本線の時分割多重通信信号に変換する
電気配線装置１２（以下この訳語ＥＬＥＣＴＲＩＣＡＬ
ＷＩＲＩＮＧ ＳＹＳＴＥＭを略してＥ−Ｗ−８・と
称すことにし、本実施例では米国特許扁３９４４９８１
のＥ−Ｗ−８・技術を一部使用している）、及び８ＫＨ
ｚ６Ｖの交流電圧を形成する交流電源１３からなる。
を例について示す第１図において、１は制御部であり、
水晶振動子、時計用ＬＳＩ（例えばナショナル・セミコ
ンダクタ社のＭＭ５３１６）及び周辺回路から構成され
る時刻信号回路１１、前記時刻信号回路１１から形成さ
れる時刻信号を１本線の時分割多重通信信号に変換する
電気配線装置１２（以下この訳語ＥＬＥＣＴＲＩＣＡＬ
ＷＩＲＩＮＧ ＳＹＳＴＥＭを略してＥ−Ｗ−８・と
称すことにし、本実施例では米国特許扁３９４４９８１
のＥ−Ｗ−８・技術を一部使用している）、及び８ＫＨ
ｚ６Ｖの交流電圧を形成する交流電源１３からなる。
２，２′は表示部であり、表示器回路２１、前記Ｅ−Ｗ
−８・１２と同様のもので１本線の時分割多重通信信号
をスタティックの時刻信号に変換するＥ−Ｗ−８・２２
、及びこの表示器回路２１とＥ−Ｗ−８・ ２２に＋６
■、−６ｖ、交流１．７ｖの３種類の電源を供給する変
圧・整流回路２３からなる。
−８・１２と同様のもので１本線の時分割多重通信信号
をスタティックの時刻信号に変換するＥ−Ｗ−８・２２
、及びこの表示器回路２１とＥ−Ｗ−８・ ２２に＋６
■、−６ｖ、交流１．７ｖの３種類の電源を供給する変
圧・整流回路２３からなる。
３は時刻調整部であり、時刻調整用閉成型回路３１、前
記Ｅ−Ｗ−８・１２と同様のものでこの時刻調整用閉成
型回路３１より発生する信号を１本線時分割多重通信信
号に変換し、前記制御部１に送信するＥ−Ｗ−８・３２
、及び制御部１の交流電源１４に結線され、直流６■の
電圧を形成する整流回路３３からなる。
記Ｅ−Ｗ−８・１２と同様のものでこの時刻調整用閉成
型回路３１より発生する信号を１本線時分割多重通信信
号に変換し、前記制御部１に送信するＥ−Ｗ−８・３２
、及び制御部１の交流電源１４に結線され、直流６■の
電圧を形成する整流回路３３からなる。
なお制御部１、表示部２、及び時刻調整部３の接続は信
号線！！１の１本と電源線７２ 、Ａ３の２本の計３本
のワイヤ・ハーネスで行なわれている。
号線！！１の１本と電源線７２ 、Ａ３の２本の計３本
のワイヤ・ハーネスで行なわれている。
次に、第１図に示した前記各回路の詳細な構成及びその
作動を第２図から第７図において述べる。
作動を第２図から第７図において述べる。
第２図は時刻信号回路１１の詳細を示す電気結線図で、
１１１はＮＯＴゲート、ＮＡＮＤゲート、２００ＫＨｚ
水晶振動子、抵抗、及びコンデンサで構成される公知の
水晶発振回路である。
１１１はＮＯＴゲート、ＮＡＮＤゲート、２００ＫＨｚ
水晶振動子、抵抗、及びコンデンサで構成される公知の
水晶発振回路である。
１１２は前記水晶発振回路１１１から出力される２００
ＫＨｚの信号を５０Ｈｚに分周する分周回路で、２進カ
ウンタ（ＲＣＡ社ＣＤ４０４０ ）、ＮＡＮＤゲートで
構成される１／４０００分周回路１１２１と、抵抗、Ｎ
ＰＮＩ−ランジスタで構成される電圧変換回路１１２２
とからなっている。
ＫＨｚの信号を５０Ｈｚに分周する分周回路で、２進カ
ウンタ（ＲＣＡ社ＣＤ４０４０ ）、ＮＡＮＤゲートで
構成される１／４０００分周回路１１２１と、抵抗、Ｎ
ＰＮＩ−ランジスタで構成される電圧変換回路１１２２
とからなっている。
１１３は分周回路１１２からの分周信号に基づいて時刻
信号を形成する時間計数回路で、時計用ＬＳＩ（ナショ
ナル・セミコンダクク社ＭＭ５３１６ ） １１３１と
、このＬＳ１１１３１のデ゛イスプレイ出力に結線され
るＮＯＴゲート、抵抗で構成される２２個の出力回路１
１３０２〜１１３２２と、及び前記時計用ＬＳ１１１３
１の時刻調整端子に結線されるＰＮＰトランジスタ、抵
抗で構成される電圧変換回路１１３２とからなる。
信号を形成する時間計数回路で、時計用ＬＳＩ（ナショ
ナル・セミコンダクク社ＭＭ５３１６ ） １１３１と
、このＬＳ１１１３１のデ゛イスプレイ出力に結線され
るＮＯＴゲート、抵抗で構成される２２個の出力回路１
１３０２〜１１３２２と、及び前記時計用ＬＳ１１１３
１の時刻調整端子に結線されるＰＮＰトランジスタ、抵
抗で構成される電圧変換回路１１３２とからなる。
また図中１１３ａ〜１１３■は時刻信号を形成する４桁
７−セグメント出力信号端子であり、１１３ｗ、７１３
ｘは時計用ＬＳ１１１３１の時刻調整用端子である。
７−セグメント出力信号端子であり、１１３ｗ、７１３
ｘは時計用ＬＳ１１１３１の時刻調整用端子である。
また時計用ＬＳ１１１３１中ｖ１２ 、ｖ６はそれぞれ
１２Ｖと６ｖの直流電圧が印加される電源端子である。
１２Ｖと６ｖの直流電圧が印加される電源端子である。
第３図はＥ−Ｗ−８・ １２の詳細を示す電気結線図で
ある。
ある。
１２１，１２２，１２３はＥ−Ｗ−８・専用ＬＳＩ（Ｒ
ＣＡ社Ｓ ＯＳ −ＬＳＩ−ＴＡ６９９４）で、送信信
号２２回線、受信信号２回線を送受するものである。
ＣＡ社Ｓ ＯＳ −ＬＳＩ−ＴＡ６９９４）で、送信信
号２２回線、受信信号２回線を送受するものである。
また１２４は信号出力回路で、抵抗、ＮＰＮＩ−ランジ
スクによって構成され、ＬＳ１１２１．１２２から発生
する信号を、１本線時分割信号として出力端子１２ａか
ら送信するためのものである。
スクによって構成され、ＬＳ１１２１．１２２から発生
する信号を、１本線時分割信号として出力端子１２ａか
ら送信するためのものである。
また抵抗１２５，１２６゜１２７は前記１本線時分割信
号をＬＳ１１２１゜１２２．１２３に入力する際の保護
抵抗である。
号をＬＳ１１２１゜１２２．１２３に入力する際の保護
抵抗である。
なお１２ａは前記１本線時分割信号の出力端子、１２ｂ
、１２ｃは時刻調整部３から送信された信号を受信し、
時刻信号回路１１の入力端子１１３ｗ。
、１２ｃは時刻調整部３から送信された信号を受信し、
時刻信号回路１１の入力端子１１３ｗ。
１１３Ｘにそれぞれの信号を伝達する時刻調整信号の出
力端子、１２ｄ〜１２ｙは時刻信号回路１１の出力１１
３ａ〜１１３ｖにそれぞれ結線され、時刻信号をＬＳ１
１２１，１２２に入力する端子である。
力端子、１２ｄ〜１２ｙは時刻信号回路１１の出力１１
３ａ〜１１３ｖにそれぞれ結線され、時刻信号をＬＳ１
１２１，１２２に入力する端子である。
１２ｘは８ＫＨｚのパルス信号が入り、この信号を各Ｌ
Ｓ１１２１．１２２，１２３に入力する端子である。
Ｓ１１２１．１２２，１２３に入力する端子である。
そこでＥ−Ｗ−８・ １２は、時刻信号回路１１におけ
る時間計数１１３の出力端子１１３ａ〜１１３ｖから４
桁７セグメント表示用の時刻信号及びＩＨｚ信号を、こ
のＥ−Ｗ−８・の入力端子１２ｄ〜１２ｒ及び入力端子
１２３〜１２ｙに受け、さらに後述する交流電源１３の
発振器１３１から取出した一定周波数（ここでは８ＫＨ
ｚ）のパルス信号を、このＥ−Ｗ−８・の入力端子１２
Ｚに受ける。
る時間計数１１３の出力端子１１３ａ〜１１３ｖから４
桁７セグメント表示用の時刻信号及びＩＨｚ信号を、こ
のＥ−Ｗ−８・の入力端子１２ｄ〜１２ｒ及び入力端子
１２３〜１２ｙに受け、さらに後述する交流電源１３の
発振器１３１から取出した一定周波数（ここでは８ＫＨ
ｚ）のパルス信号を、このＥ−Ｗ−８・の入力端子１２
Ｚに受ける。
そしてこの一定周波数８ＫＨｚのパルス信号を適当な周
波数まで分周して、その分周信号の複数サイクルを一周
期とすべく、第４図に示すようにその最初の第１サイク
ル（第１番地のことで以下ｃｈ・１と称す）に同期用の
基準位置信号として高周波パルス信号を乗せ、さらに第
２サイクルすなわちｃｈ・２以降の各番地に前記時刻信
号の内容を割当指定して出力端子１２ａから１本線時分
割信号として出力するものである。
波数まで分周して、その分周信号の複数サイクルを一周
期とすべく、第４図に示すようにその最初の第１サイク
ル（第１番地のことで以下ｃｈ・１と称す）に同期用の
基準位置信号として高周波パルス信号を乗せ、さらに第
２サイクルすなわちｃｈ・２以降の各番地に前記時刻信
号の内容を割当指定して出力端子１２ａから１本線時分
割信号として出力するものである。
ここで本実施例で用いた１本線時分割信号を第４図によ
り説明すると、本図はこの時分割信号の１周期を示すも
のであり、１周期は３２ｃｈ（番地）に分割され、ｃｈ
・１が前述したように１周期の始まりを示す基準位置信
号でその１区画に１６パルスの高周波信号が乗っており
、そしてｃｈ・３１までの３０ｃｈまでのうちここでは
ｃｈ・２からｃｈ・２５までの２４ｃｈを使用して、２
４個の信号を送受している。
り説明すると、本図はこの時分割信号の１周期を示すも
のであり、１周期は３２ｃｈ（番地）に分割され、ｃｈ
・１が前述したように１周期の始まりを示す基準位置信
号でその１区画に１６パルスの高周波信号が乗っており
、そしてｃｈ・３１までの３０ｃｈまでのうちここでは
ｃｈ・２からｃｈ・２５までの２４ｃｈを使用して、２
４個の信号を送受している。
すなわち表示部２，２′の表示器のうち第１桁の７セグ
メントを駆動用に７ｃｈを用い、第２桁の６セグメント
（数字１〜６までを表示すればよいため）を駆動用に６
ｃｈを用い、第３桁の７セグメントを駆動用に７ｃｈと
、第４桁のブランクと数字１の表示駆動用にｌｃｈと、
さらに時分区分用及びＩＨｚの点滅用を兼ねるコロン表
示駆動用にｌｃｈを用い、さらに時刻調整部３からの時
刻調整用信号の送受信用に２ｃｈを用い、合計２４ｃｈ
を使用している。
メントを駆動用に７ｃｈを用い、第２桁の６セグメント
（数字１〜６までを表示すればよいため）を駆動用に６
ｃｈを用い、第３桁の７セグメントを駆動用に７ｃｈと
、第４桁のブランクと数字１の表示駆動用にｌｃｈと、
さらに時分区分用及びＩＨｚの点滅用を兼ねるコロン表
示駆動用にｌｃｈを用い、さらに時刻調整部３からの時
刻調整用信号の送受信用に２ｃｈを用い、合計２４ｃｈ
を使用している。
また時分割信号は、送信時にはｃｈ・３に示すような１
区画４パルスとなり、非送信時にはｃｈ・２に示すよう
な１区画１パルスの信号となる。
区画４パルスとなり、非送信時にはｃｈ・２に示すよう
な１区画１パルスの信号となる。
第５図は交流電源１３の詳細を示す電気結線図であり、
端子１３ａより入力される発振器１３１からの８ＫＨｚ
信号により、ＮＯＴゲート１３０１゜ＰＮＰ ｌ−ラン
ジスタ１３０２．１３０３ 、ＮＰＮトランジスタ１３
０４，１３０５、抵抗１３０６゜１３０？、１３０８，
１３０９，１３１０゜１３１１、コンデンサ１３１２，
１３１３、ダイオード１３１４．定電圧ダイオード１３
１５゜１３１６、トランス１３１７で構成される駆動回
路を介して交流６ｖを形成する。
端子１３ａより入力される発振器１３１からの８ＫＨｚ
信号により、ＮＯＴゲート１３０１゜ＰＮＰ ｌ−ラン
ジスタ１３０２．１３０３ 、ＮＰＮトランジスタ１３
０４，１３０５、抵抗１３０６゜１３０？、１３０８，
１３０９，１３１０゜１３１１、コンデンサ１３１２，
１３１３、ダイオード１３１４．定電圧ダイオード１３
１５゜１３１６、トランス１３１７で構成される駆動回
路を介して交流６ｖを形成する。
なおり６は直流電圧６■を入力する端子である。
第６図は表示部２，２′の詳細を示す電気結線図であり
、表示器回路２１は、けい光表示管（例えばフタバエ業
の４ＢＴ−０２）２１Ｌ抵抗、ＰＮＰ トランジスタで
構成される点灯回路２１０１〜２１２２からなり、Ｅ−
Ｗ−８・２２から信号を受信し、さらに変圧・整流回路
２３から電源を供給されて時刻の表示を行なう。
、表示器回路２１は、けい光表示管（例えばフタバエ業
の４ＢＴ−０２）２１Ｌ抵抗、ＰＮＰ トランジスタで
構成される点灯回路２１０１〜２１２２からなり、Ｅ−
Ｗ−８・２２から信号を受信し、さらに変圧・整流回路
２３から電源を供給されて時刻の表示を行なう。
このＥ−Ｗ−８・２２は、入力端子２２ａを介して制御
部１から１本線時分割信号を受信し、この信号を、抵抗
、ダイオードで構成される電圧制限回路２２２を介して
ＬＳＩ２２３，２２４（ＳＣＡ社のＴＡ６９９４）に入
力する。
部１から１本線時分割信号を受信し、この信号を、抵抗
、ダイオードで構成される電圧制限回路２２２を介して
ＬＳＩ２２３，２２４（ＳＣＡ社のＴＡ６９９４）に入
力する。
また時分割多重通信に用いる基準時間信号は、変圧・整
流回路２３の８ＫＨｚ６Ｖの交流電源より、抵抗、ＮＯ
Ｔゲート、及び定電圧ダイオードで構成される変圧整形
回路２２１を介して８ＫＨｚ信号を形成し、これをＬＳ
Ｉ２２３゜２２４に入力する。
流回路２３の８ＫＨｚ６Ｖの交流電源より、抵抗、ＮＯ
Ｔゲート、及び定電圧ダイオードで構成される変圧整形
回路２２１を介して８ＫＨｚ信号を形成し、これをＬＳ
Ｉ２２３゜２２４に入力する。
ＬＳＩ２２３，２２４では、前記１本線時分割信号と基
準時間信号とよりこの時分割信号の各ｃｈに乗せられた
指令内容を読取り、２２本のパラレル−スタティック信
号として２１本の時刻表示用信号と１本ＩＨｚ信号を出
力する。
準時間信号とよりこの時分割信号の各ｃｈに乗せられた
指令内容を読取り、２２本のパラレル−スタティック信
号として２１本の時刻表示用信号と１本ＩＨｚ信号を出
力する。
なお変圧・整流回路２３は、変圧器２３１、ダイオード
２３２．２３３、コンデンサ２３４゜２３５で構成され
、制御部１より端子２３ａ。
２３２．２３３、コンデンサ２３４゜２３５で構成され
、制御部１より端子２３ａ。
２３ｂを介して伝送される交流６■より＋６Ｖ。
−６Ｖ、及び−６■を軸とした交流１．７■を形成し、
表示器回路２１、Ｅ−Ｗ−８・ ２２に電源を供給する
。
表示器回路２１、Ｅ−Ｗ−８・ ２２に電源を供給する
。
電７図は時刻調整部３の詳細を示す電気結線図であり、
時刻調整用開閉器回路３１はスイッチ３１１．３１２、
抵抗３１３，３１４から構成され、定常時ｕ Ｈｊｊレ
ベル、時刻調整時（スイッチ閉成時） ｔｌ Ｌ ｔｔ
レベルの信号を形成する。
時刻調整用開閉器回路３１はスイッチ３１１．３１２、
抵抗３１３，３１４から構成され、定常時ｕ Ｈｊｊレ
ベル、時刻調整時（スイッチ閉成時） ｔｌ Ｌ ｔｔ
レベルの信号を形成する。
またＥ−Ｗ−８・３２は、抵抗、定電圧ダイオード、Ｎ
ＯＴゲートから構成される変圧整形回路３２１により、
電源の交流６■より取出される８ Ｋ Ｈｚの基準時間
信号と、入力端子３２ａより抵抗、ダイオードで構成さ
れる電圧制限回路３２２を介して形成される１本線時分
割信号と、時刻調整用開閉器回路３１の出力信号とをＬ
ＳＩ３２３（ＲＣＡ社のＴＡ６９９４）に入力すること
により、時刻調整用信号を１本線時分割信号に変換して
前述のごとく時分割信号中の２ｃｈに制光て、抵抗、Ｎ
ＰＮトランジスタで構成される出力回路３２４を介して
、端子３２ａより前記時刻調整用信号を送信用制御部１
側へ送り、他方Ｅ−Ｗ−８・ １２はその出力端子１２
ａを介してＬＳＩ１２３に入力し、前記時分割信号に乗
った時刻調整用信号を読出してその出力端子１２ｂ、１
２ｃより時刻信号回路１１の入力端子１１３ｗ、１１３
ｘへ出力し、時計用ＬＳ１１１３１にて時刻調整を行う
ものである。
ＯＴゲートから構成される変圧整形回路３２１により、
電源の交流６■より取出される８ Ｋ Ｈｚの基準時間
信号と、入力端子３２ａより抵抗、ダイオードで構成さ
れる電圧制限回路３２２を介して形成される１本線時分
割信号と、時刻調整用開閉器回路３１の出力信号とをＬ
ＳＩ３２３（ＲＣＡ社のＴＡ６９９４）に入力すること
により、時刻調整用信号を１本線時分割信号に変換して
前述のごとく時分割信号中の２ｃｈに制光て、抵抗、Ｎ
ＰＮトランジスタで構成される出力回路３２４を介して
、端子３２ａより前記時刻調整用信号を送信用制御部１
側へ送り、他方Ｅ−Ｗ−８・ １２はその出力端子１２
ａを介してＬＳＩ１２３に入力し、前記時分割信号に乗
った時刻調整用信号を読出してその出力端子１２ｂ、１
２ｃより時刻信号回路１１の入力端子１１３ｗ、１１３
ｘへ出力し、時計用ＬＳ１１１３１にて時刻調整を行う
ものである。
なお、整流回路３３はダイオード３３１と一７ンデンサ
３３２で構成され、入力端子３３ａより８ＫＨｚ ６
Ｖの交流電圧を入力して直５’ｕ ６ Ｖを形成し、時
刻調整部３の電源として供給するものである。
３３２で構成され、入力端子３３ａより８ＫＨｚ ６
Ｖの交流電圧を入力して直５’ｕ ６ Ｖを形成し、時
刻調整部３の電源として供給するものである。
以上説明したように本装置は、制御部１の勝刻信号回路
１１において形成される時刻信号を、Ｅ−Ｗ−８・シス
テムにより、２個以上の表示部に送信し時刻を表示する
ものである。
１１において形成される時刻信号を、Ｅ−Ｗ−８・シス
テムにより、２個以上の表示部に送信し時刻を表示する
ものである。
また時刻の調整も、独立した時刻調整部３を持ち、Ｅ−
Ｗ−８・システムを介して行っている。
Ｗ−８・システムを介して行っている。
このため複数個の表示部２，２′の時刻調整が１個の時
刻調整部３により集中的に行え、本装置を例えばバス等
の自動車や電車、船、飛行機、あるいはビル内等の事務
室に用いた場合、各配置部所における表示器の表示時刻
が常に一致し、かつ全表示器の時刻調整を１箇所にて行
うことができる。
刻調整部３により集中的に行え、本装置を例えばバス等
の自動車や電車、船、飛行機、あるいはビル内等の事務
室に用いた場合、各配置部所における表示器の表示時刻
が常に一致し、かつ全表示器の時刻調整を１箇所にて行
うことができる。
なお、前述の実施例では、時計用のＬＳＩとして７−セ
ゲメントースタテツク出力の素子例えばＭＭ５３１６（
ナショナル・セミコンダクタ社）を使用したが、２進化
１０進出力の時計用ＬＳＩでもよく、またダイナミック
出力の時計用ＬＳＩをラッチ回路によりスタティックに
変換して用いてもよい。
ゲメントースタテツク出力の素子例えばＭＭ５３１６（
ナショナル・セミコンダクタ社）を使用したが、２進化
１０進出力の時計用ＬＳＩでもよく、またダイナミック
出力の時計用ＬＳＩをラッチ回路によりスタティックに
変換して用いてもよい。
また、表示部２の電源は変圧・整流回路により電圧が可
変であるので、表示素子として発光ダイオードや液晶等
を用いてもよい。
変であるので、表示素子として発光ダイオードや液晶等
を用いてもよい。
また、前述の実施例では時刻表示を例にとって説明した
が、この代わりに自動車や電車ならば速度表示でもよく
、ビル等の事務所では各種情報の表示が考えられる。
が、この代わりに自動車や電車ならば速度表示でもよく
、ビル等の事務所では各種情報の表示が考えられる。
以上述べたように本発明装置においては、一定周波数の
交感電圧を発生する交流電源、及び前記交流電圧から前
記一定周波数のパルス信号を取出し、このパルス信号に
基づいて１周期の始まりを示す基準位置信号を形成し、
かつ前記１周期の区間を番地指定すると共に、所定の表
示用信号に対応して所定の番地に指令パルスを乗せた時
分割多重信号を形成する時分割多重信号変換回路を有す
る１個の送信制御部と、前記時分割多重信号を伝送する
１本の信号線と、前記交流電圧を伝送する２本の電源線
と、この電源線より伝送される前記交流電圧から前記一
定周波数のパルス信号を取出し、このパルス信号に基づ
いて、前記信号線を介して受信する前記時分割多重信号
中の前記指令パルスを読出し、前記表示用信号に係る情
報をディジクル表示する複数個の表示部とを有している
から、２本の電源線の他には１本の信号線のみで信号伝
を行うことができ、複数の表示部を１個の送信制御部
よりの指令通りに作動させることができ、これにより各
表示部に前記のような制御部を設ける必要がなくなり、
かつ時分割多重通信を用いているので各表示部に信号を
伝達するための配線設計およびその配線作業を簡単化で
きるという優れた効果がある。
交感電圧を発生する交流電源、及び前記交流電圧から前
記一定周波数のパルス信号を取出し、このパルス信号に
基づいて１周期の始まりを示す基準位置信号を形成し、
かつ前記１周期の区間を番地指定すると共に、所定の表
示用信号に対応して所定の番地に指令パルスを乗せた時
分割多重信号を形成する時分割多重信号変換回路を有す
る１個の送信制御部と、前記時分割多重信号を伝送する
１本の信号線と、前記交流電圧を伝送する２本の電源線
と、この電源線より伝送される前記交流電圧から前記一
定周波数のパルス信号を取出し、このパルス信号に基づ
いて、前記信号線を介して受信する前記時分割多重信号
中の前記指令パルスを読出し、前記表示用信号に係る情
報をディジクル表示する複数個の表示部とを有している
から、２本の電源線の他には１本の信号線のみで信号伝
を行うことができ、複数の表示部を１個の送信制御部
よりの指令通りに作動させることができ、これにより各
表示部に前記のような制御部を設ける必要がなくなり、
かつ時分割多重通信を用いているので各表示部に信号を
伝達するための配線設計およびその配線作業を簡単化で
きるという優れた効果がある。
とりわけ本発明装置では一定周波数の交流電圧を発生す
る交流電源を用いているから、各表示部駆動用の電源の
他に、時分割多重信号から表示用の指令パルスを読出す
ための基準時間信号を伝達することができ、これにより
各表示部側において基準時間信号を形成する発振器を不
要にでき、システム全体からみて配線、及び送、受信装
置を簡略化できるという優れた効果がある。
る交流電源を用いているから、各表示部駆動用の電源の
他に、時分割多重信号から表示用の指令パルスを読出す
ための基準時間信号を伝達することができ、これにより
各表示部側において基準時間信号を形成する発振器を不
要にでき、システム全体からみて配線、及び送、受信装
置を簡略化できるという優れた効果がある。
第１図は本発明になるディジタル表示装置の全体構成を
示すブロック図、第２図、第３図、第５図、第６図、第
７図は本発明装置の具体的構成回路の一実施例を示す電
気結線図、第４図は本発明装置における１本線時分割多
重通信の作動説明に供する電圧波形図である。 １・・・・・・制御部、２，２′・・・・・・表示部、
３・・・・・・時刻調整部、１１・・・・・・時刻信号
回路、１２・・・・・・Ｅ−Ｗ−８・、１３・・・・・
・交流電源、２１・・・・・・表示器回路、２２・・・
・・・Ｅ−Ｗ−８・、２３・・・・・・変圧・整流回路
、１１・・・・・・信号線、１１２．１１３・・・・・
・電源線。
示すブロック図、第２図、第３図、第５図、第６図、第
７図は本発明装置の具体的構成回路の一実施例を示す電
気結線図、第４図は本発明装置における１本線時分割多
重通信の作動説明に供する電圧波形図である。 １・・・・・・制御部、２，２′・・・・・・表示部、
３・・・・・・時刻調整部、１１・・・・・・時刻信号
回路、１２・・・・・・Ｅ−Ｗ−８・、１３・・・・・
・交流電源、２１・・・・・・表示器回路、２２・・・
・・・Ｅ−Ｗ−８・、２３・・・・・・変圧・整流回路
、１１・・・・・・信号線、１１２．１１３・・・・・
・電源線。
Claims (1)
- １ 一定周波数の交流電圧を発生する交流電源、及び前
記交流電圧から前記一定周波数のパルス信号を取出し、
このパルス信号に基づいて１周期の始まりを示す基準位
置信号を形成し、かつ前記１周期の区間を番地指定する
と共に、所望の表示用信号に対応して所定の番地に指令
パルスを乗せた時分割多重信号を形成する時分割多重信
号変換回路を有する１個の送信制御部と、前記時分割多
重信号を伝送する１本の信号線と、前記交流電圧を伝送
する２本の電源線と、この電源線より伝送される前記交
流電圧から前記一定周波数のパルス信号を取出し、この
パルス信号に基づいて、前記信号線を介して受信する前
記時分割多重信号中の前記指令パルスを読出し、前記表
示用信号に係る情報をディジタル表示する複数個の表示
部とを備えることを特徴とするディジクル表示装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52067670A JPS5938639B2 (ja) | 1977-06-08 | 1977-06-08 | デイジタル表示装置 |
| US05/911,895 US4177454A (en) | 1977-06-08 | 1978-06-02 | Digital display system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52067670A JPS5938639B2 (ja) | 1977-06-08 | 1977-06-08 | デイジタル表示装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS542762A JPS542762A (en) | 1979-01-10 |
| JPS5938639B2 true JPS5938639B2 (ja) | 1984-09-18 |
Family
ID=13351655
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52067670A Expired JPS5938639B2 (ja) | 1977-06-08 | 1977-06-08 | デイジタル表示装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US4177454A (ja) |
| JP (1) | JPS5938639B2 (ja) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5334975A (en) * | 1991-07-16 | 1994-08-02 | Wachob David E | Residential time reference system |
| AU6966196A (en) * | 1995-09-05 | 1997-03-27 | C. Eric Youngberg | System, method, and device for automatic setting of clocks |
| US6963588B1 (en) | 2000-11-21 | 2005-11-08 | Cellco Partnership | System and methodology for automatically setting a clock |
| US6595811B2 (en) * | 2000-12-19 | 2003-07-22 | Bombardier Inc. | Personal watercraft vehicle component multiplex communication system |
| US7369462B2 (en) * | 2001-09-21 | 2008-05-06 | Quartex, Division Of Primex, Inc. | Wireless synchronous time system with solar powered transceiver |
| US20030169642A1 (en) * | 2002-03-08 | 2003-09-11 | Quartex, Inc., A Division Of Primex, Inc. | Time keeping system with automatic daylight savings time adjustment |
| CA2460995A1 (en) * | 2001-09-21 | 2003-03-27 | Quartex, Inc. | Time keeping system with automatic daylight savings time adjustment |
| US6873573B2 (en) * | 2001-09-21 | 2005-03-29 | Quartex, Inc. | Wireless synchronous time system |
| US7411869B2 (en) * | 2001-09-21 | 2008-08-12 | Quartex, Division Of Primex, Inc. | Wireless synchronous time system |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3861134A (en) * | 1972-12-15 | 1975-01-21 | Johnson Service Co | Remote time clock system with standby power means |
-
1977
- 1977-06-08 JP JP52067670A patent/JPS5938639B2/ja not_active Expired
-
1978
- 1978-06-02 US US05/911,895 patent/US4177454A/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS542762A (en) | 1979-01-10 |
| US4177454A (en) | 1979-12-04 |
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