JPS5931249U - トランジスタの誤実装防止構造 - Google Patents
トランジスタの誤実装防止構造Info
- Publication number
- JPS5931249U JPS5931249U JP12568182U JP12568182U JPS5931249U JP S5931249 U JPS5931249 U JP S5931249U JP 12568182 U JP12568182 U JP 12568182U JP 12568182 U JP12568182 U JP 12568182U JP S5931249 U JPS5931249 U JP S5931249U
- Authority
- JP
- Japan
- Prior art keywords
- transistors
- incorrect mounting
- terminal
- prevent incorrect
- cross
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来の実装構造を示す斜視図、第２図は本考案
の一実施例の斜視図である。 図中、１． ９は樹脂モールド型トランジスタ、２．１
０はベース端子、３．１１はコレクタ端子、４．１２は
エミッタ端子、５はプリント板、６゜７、 ８． １３
． １４． １５はスルーホールを示す。
の一実施例の斜視図である。 図中、１． ９は樹脂モールド型トランジスタ、２．１
０はベース端子、３．１１はコレクタ端子、４．１２は
エミッタ端子、５はプリント板、６゜７、 ８． １３
． １４． １５はスルーホールを示す。
Claims (1)
- プリント板に並設された孔にそれぞれの端子が挿着され
る樹脂モールド型トランジスタにおいて、並列した端子
の両端のベース端子またはエミッタ端子のいずれか一方
の端子の断面形状が他の端子の断面形状よりも大きく形
成されてなることを特徴とするトランジスタの誤実装防
止構造。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12568182U JPS5931249U (ja) | 1982-08-20 | 1982-08-20 | トランジスタの誤実装防止構造 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12568182U JPS5931249U (ja) | 1982-08-20 | 1982-08-20 | トランジスタの誤実装防止構造 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5931249U true JPS5931249U (ja) | 1984-02-27 |
Family
ID=30286046
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12568182U Pending JPS5931249U (ja) | 1982-08-20 | 1982-08-20 | トランジスタの誤実装防止構造 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5931249U (ja) |
-
1982
- 1982-08-20 JP JP12568182U patent/JPS5931249U/ja active Pending
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