JPS59182494A - Pattern generation system - Google Patents

Pattern generation system

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Publication number
JPS59182494A
JPS59182494A JP5766783A JP5766783A JPS59182494A JP S59182494 A JPS59182494 A JP S59182494A JP 5766783 A JP5766783 A JP 5766783A JP 5766783 A JP5766783 A JP 5766783A JP S59182494 A JPS59182494 A JP S59182494A
Authority
JP
Japan
Prior art keywords
character
generator
output
line
pattern
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP5766783A
Other languages
Japanese (ja)
Inventor
河東 勇
大櫛 喜代志
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP5766783A priority Critical patent/JPS59182494A/en
Publication of JPS59182494A publication Critical patent/JPS59182494A/en
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 この発明は電子計算機の入出力装置などに使われるディ
スプレイ装置のパターン発生方式に関し、さらに詳しく
は文字および文字枠を表示する、ラスタ・スキャン型デ
ィスプレイ装置の文字枠などを構成する直線のパターン
発生方式に関するものであるっ 第1図で示すように文字または文字列を囲む文字枠を表
示するには、アッパー・ライン4、アンダー・ライン1
2、縦線t、を表示することによってその目的を達成す
ることができる。第2図は、第1図のような文字および
文字枠を表示するためのディスプレイ装置の一般的な構
成図である。第2図において、(1)は画面に表示する
文字および文字枠のコードを記憶するメモリであり、(
2)はメモリ(1)から出力される文字コードに従い、
文字パターンを発生するキヤツジ・ジェネレータであり
、(3)はメモリ(1)から出力される文字枠コードに
従い、文字枠を発生するパターン・ジェネレータであp
、(4)はキャラクタ・ジェネレータダ(2)の出力お
よびパターン・ジェネレータ(3)の出力を混合して表
示信号を作る混合器である。メモリ(1)から出力され
た文字コードはキャラクタ・ジェネレータ(2)で文字
の表示信号に変換され、文字枠コードはパターン・ジェ
ネレータ(3)で文字枠の表示信号に変換される。文字
および文字枠の表示信号は混合器(4)で混合されて、
出力される。
[Detailed Description of the Invention] The present invention relates to a pattern generation method for a display device used as an input/output device of an electronic computer, and more specifically, a pattern generation method for a display device used as an input/output device of an electronic computer, and more specifically, a method for generating a pattern for a display device such as a raster scan type display device that displays characters and character frames. This is related to the pattern generation method for the straight lines that make up the line.As shown in Figure 1, to display a character frame surrounding a character or character string, use upper line 4 and under line 1.
2. The purpose can be achieved by displaying the vertical line t. FIG. 2 is a general configuration diagram of a display device for displaying characters and character frames as shown in FIG. In Figure 2, (1) is a memory that stores codes for characters and character frames to be displayed on the screen;
2) follows the character code output from memory (1),
(3) is a pattern generator that generates character frames according to the character frame code output from memory (1).
, (4) is a mixer that mixes the output of the character generator (2) and the output of the pattern generator (3) to create a display signal. The character code output from the memory (1) is converted into a character display signal by a character generator (2), and the character frame code is converted into a character frame display signal by a pattern generator (3). The character and character frame display signals are mixed in a mixer (4),
Output.

まず、従来のパターン・ジエネV−タ(3)の構成例を
第6図に示す。第6図において、(5)はメモリ(1)
から供給されるアッパー・ライン・コードにより、アッ
パー・ラインの表示信号を発生するアッパー・ライン・
ジェネレータであり、(6)はメモリ(1)から供給さ
れるアンダー・ライン・コードにより、アンダー・ライ
ンの表示信号を発生するアンダー・ライン・ジェネレー
タであり、(7)はメモリ(1)から供給される縦線コ
ードにより、縦線の表示信号を発生する縦線ジェネレー
タである。−tた、(8)は(5) (6) (7)の
各ジェネレータから出力される表示信号を混合するパタ
ーン混合器である。
First, an example of the configuration of a conventional pattern generator V-tor (3) is shown in FIG. In Figure 6, (5) is memory (1)
The upper line code, which is supplied from the upper line code, generates the upper line display signal.
(6) is an under line generator that generates an under line display signal based on the under line code supplied from memory (1), and (7) is an under line generator that generates an under line display signal based on the under line code supplied from memory (1). This is a vertical line generator that generates a vertical line display signal based on the vertical line code. -t, (8) is a pattern mixer that mixes the display signals output from each of the generators (5), (6), and (7).

次に、動作について説明する。アッパー・ライン・コー
ドがアッパーライン・ジェネレータ(5)に入力される
と、第4図(a)のタイミング図のように文字位置の最
上ラスタのみ表示信号が発生(−1他のラスタでは発生
しない。同様にアンダー・ライン・コードがアンダー・
ライン・ジェネレータ(6)に入力されると、第4図(
b)のタイミング図のように文字位置の最下ラスタのみ
表示信号が発生する。
Next, the operation will be explained. When the upper line code is input to the upper line generator (5), a display signal is generated only on the uppermost raster of the character position (-1 does not occur on other rasters) as shown in the timing diagram of Figure 4 (a). .Similarly, the underline code
When input to the line generator (6), as shown in Figure 4 (
As shown in the timing diagram b), a display signal is generated only at the bottom raster of character positions.

また、縦線コードが縦線ジェネレータに入力されると、
第4図(C)のタイミング図のように文字位置のすべて
のラスタにおいて1ドツト分の表示信号が発生する。こ
の6種類の信号をパターン混合器(8)で混合すること
によp文字枠の表示信号が作られる、 ところが、この方式では、パルス幅のせまい表示信号を
とりあつかうため、キャラクタ・ジェネレータ(2)と
の表示信号の時間的ずれを防がなければならず、回路が
複雑になる欠点がある。
Also, when a vertical line code is input into the vertical line generator,
As shown in the timing diagram of FIG. 4(C), a display signal for one dot is generated in all rasters of character positions. By mixing these six types of signals in a pattern mixer (8), a display signal for the p character frame is created. However, in this method, in order to handle display signals with narrow pulse widths, a character generator (2 ), it is necessary to prevent a time lag in the display signal, which has the disadvantage of complicating the circuit.

この発明は、上記のような従来のものの欠点を除去する
だめになされたもので、パターン・ジェネレータを1文
字範囲内の横方向ドツト数た:けの出力数を持つドツト
・ジェネレータと、シフト・レジスタで構成することに
より、単純な回路構成のパターン発生方式を提供するも
のである。
This invention was made to eliminate the above-mentioned drawbacks of the conventional ones, and it combines a pattern generator with a dot generator that has as many horizontal outputs as the number of horizontal dots within one character range, and a shift generator. By configuring it with registers, it provides a pattern generation method with a simple circuit configuration.

以下、この発明の一実施例を図について説明する。An embodiment of the present invention will be described below with reference to the drawings.

第5図はこの発明の一実施例におけるパターン・ジェネ
レータ(3)の構成図である。第5図において、(9)
はメモリ(1ンから供給されるアッパー・ライン、アン
ダー・ライン、縦線の各コードから1文字分の横方向ド
ツト数だけの出力数を持つドツト・ジェネレータで、a
Qはドツト・ジェネレータ(9)の出力を表示信号に変
えるシフト・レジスタである。
FIG. 5 is a block diagram of a pattern generator (3) in one embodiment of the present invention. In Figure 5, (9)
is a dot generator that has the number of outputs equal to the number of horizontal dots for one character from the upper line, under line, and vertical line codes supplied from the memory (1 line).
Q is a shift register that converts the output of the dot generator (9) into a display signal.

なお、ここでは説明を簡単にするために、1文字の横方
向のドツト数を5ドツトとする。
Here, in order to simplify the explanation, it is assumed that one character has five dots in the horizontal direction.

今、アッパー・ライン・コードがドツト・ジェネレータ
(9)に入力されると最上ラスタ表示の時(e)から(
1)の各出力線てが有意になり、アンダー・ライン・コ
ードがドツト・ジェネレータ(9)に入力されると最下
ラスタ表示の時(e)から(i)の各出力線てが有意に
なり、縦線コードが入力されると総てのラスタ表示にお
いて(g)の出力のみ有意になる。第1図のような文字
枠を表示する時の(G)から(1)の出力のタイミング
図を第6図に示す。出力信号のパルス幅は最小で1文字
表示時間分である。
Now, when the upper line code is input to the dot generator (9), it will change from (e) to (
Each output line in 1) becomes significant, and when the underline code is input to the dot generator (9), each output line from (e) to (i) becomes significant when the bottom raster is displayed. Therefore, when a vertical line code is input, only the output (g) becomes significant in all raster displays. FIG. 6 shows a timing diagram of outputs from (G) to (1) when displaying a character frame as shown in FIG. 1. The pulse width of the output signal is at least one character display time.

次に、ドツト・ジェネレータ(9)の出力をシフト・レ
ジスタ(10で(e)、 (f)、 (g)、 (h)
−(i)の頓のシリアル信号に変換する。この信号が文
字枠を構成する直線の表示信号になる。
Next, the output of the dot generator (9) is transferred to the shift register (10 (e), (f), (g), (h)).
- Convert (i) into an instant serial signal. This signal becomes a display signal for the straight lines forming the character frame.

なお、上記実施例では1文字の横方向のドツト数を5ド
ツトとしたが、この発明がドツト数に影響されないこと
は、もちろんである。
In the above embodiment, the number of dots in the horizontal direction of one character is 5, but it goes without saying that the present invention is not affected by the number of dots.

さらに、発生パターンがアッパー・ライン、アンダー・
ラインおよび縦線のみの場合について述べたが、中央横
線など他のパターンでも同様の効果を有することは、も
ちろんである。
Furthermore, the occurrence pattern is upper line, under line,
Although the case of only lines and vertical lines has been described, it goes without saying that other patterns such as a central horizontal line can have similar effects.

以上のように、この発明によれば文字枠などを構成する
直線の信号を1文字の表示区間の横方向ドツト数だけの
出力数を持つドツト・ジェネレータを設け、このドツト
・ジェネレータの出力をシフト・レジスタによって表示
信号に変換するようにしたので、シフト・レジスタ捷で
は1文字単位ノパルス幅の広い信号であり、シフト−レ
ジスタの出力で1ドツト単位のパルス幅の狭い信号にな
るため、回路の遅れ時間を注意する必要がなく、単純な
回路で構成できる優れた効果を有するものである。
As described above, according to the present invention, a dot generator is provided which outputs a linear signal constituting a character frame etc. as many times as the number of horizontal dots in the display section of one character, and the output of this dot generator is shifted.・Since it is converted to a display signal by a register, the signal has a wide pulse width in units of one character at the shift register, and the signal has a narrow pulse width in units of one dot at the output of the shift register, so the circuit There is no need to pay attention to the delay time, and it can be configured with a simple circuit and has excellent effects.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は文字および文字枠の表示例を示す説明図、第2
図は一般的なディスプレイ装置を示す構成図、第6図は
従来のパターン・ジェネレータヲ示す構成図、第4図は
従来のパターン・ジェネレータのタイミング図、第5図
はこの発明一実施例によるパターン・ジェネレータの構
成図、第6図はこの発明によるパターン・ジェネレータ
のタイミング図である、 図において、(1)はメモリ、(2)はキャラクタ・ジ
ェネレータ、 (3)はパターン嗜ジェネレータ、 (
4)は混合器、 (5)はアッパー・ライン・ジェネレ
ータ、(6)はアンダー・ライン・ジェオ1/−タ、(
7)は縦線ジェネレータ、(8)はパターン混合器、(
9)はドツト・ジェネレータ、oOはシフト・レジスタ
である。 なお、図中、同一符号は同一、又は相当部分を示す。 代理人 大岩増雄 第1図 ノ1 第2図 第3図 a    t)    ( 最T:社)              」−一一一一
一一1−−ローーーーーーーロー第5図 第6図 e    f    g h           i
Figure 1 is an explanatory diagram showing an example of displaying characters and character frames;
FIG. 6 is a configuration diagram showing a conventional display device, FIG. 6 is a configuration diagram showing a conventional pattern generator, FIG. 4 is a timing diagram of a conventional pattern generator, and FIG. 5 is a pattern diagram according to an embodiment of the present invention.・The configuration diagram of the generator, and FIG. 6 is a timing diagram of the pattern generator according to the present invention. In the figure, (1) is the memory, (2) is the character generator, (3) is the pattern generator, (
4) is a mixer, (5) is an upper line generator, (6) is an under line geometer, (
7) is a vertical line generator, (8) is a pattern mixer, (
9) is a dot generator, and oO is a shift register. In addition, in the figures, the same reference numerals indicate the same or equivalent parts. Agent Masuo Oiwa Figure 1 No. 1 Figure 2 Figure 3 a t) (T: Company) -111111--Ro--Ro-Ro Figure 5 Figure 6 e f g h i

Claims (1)

【特許請求の範囲】[Claims] 電子計算機の入出力装置などに使われるキャラクタ・デ
ィスプレイ装置に、文字枠などを構成する直線を表示す
るためのパターン発生方式において、1文字の表示区間
の横方向ドツト数だけの出力数を持つドツト・ジェネレ
ータを設け、このドツト・ジェネレータから上記直線の
種類に対応した出力を発生させ、この出力をシフト・レ
ジスタによって表示信号に変換することを特徴とするパ
ターン発生方式。
In a pattern generation method for displaying straight lines constituting character frames, etc. on character display devices used in computer input/output devices, etc., dots with the number of outputs equal to the number of horizontal dots in the display section of one character. - A pattern generation method characterized in that a generator is provided, the dot generator generates an output corresponding to the type of straight line, and this output is converted into a display signal by a shift register.
JP5766783A 1983-04-01 1983-04-01 Pattern generation system Pending JPS59182494A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP5766783A JPS59182494A (en) 1983-04-01 1983-04-01 Pattern generation system

Applications Claiming Priority (1)

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JP5766783A JPS59182494A (en) 1983-04-01 1983-04-01 Pattern generation system

Publications (1)

Publication Number Publication Date
JPS59182494A true JPS59182494A (en) 1984-10-17

Family

ID=13062257

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5766783A Pending JPS59182494A (en) 1983-04-01 1983-04-01 Pattern generation system

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JP (1) JPS59182494A (en)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61254983A (en) * 1985-05-07 1986-11-12 株式会社ピーエフユー Display character attribute control system

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61254983A (en) * 1985-05-07 1986-11-12 株式会社ピーエフユー Display character attribute control system
JPH0545039B2 (en) * 1985-05-07 1993-07-08 Pfu Ltd

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