JPS59152853U - 位相判定回路 - Google Patents

位相判定回路

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Publication number
JPS59152853U
JPS59152853U JP4712483U JP4712483U JPS59152853U JP S59152853 U JPS59152853 U JP S59152853U JP 4712483 U JP4712483 U JP 4712483U JP 4712483 U JP4712483 U JP 4712483U JP S59152853 U JPS59152853 U JP S59152853U
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JP
Japan
Prior art keywords
signal
phase
control circuit
synchronization
gain control
Prior art date
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Pending
Application number
JP4712483U
Other languages
English (en)
Inventor
知博 藤原
Original Assignee
三菱電機株式会社
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Filing date
Publication date
Application filed by 三菱電機株式会社 filed Critical 三菱電機株式会社
Priority to JP4712483U priority Critical patent/JPS59152853U/ja
Publication of JPS59152853U publication Critical patent/JPS59152853U/ja
Pending legal-status Critical Current

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Landscapes

  • Control Of Amplification And Gain Control (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来装置の例を示す構成図、第２図はこの考案
の実施例を示す構成図、第３図は信号スペクトラムの一
例を示す図、第４図はＡＧＣ回路の入出力特性の比較説
明図である。 １・・・・・・入力端子、２・・・・・・ＡＧＣ回路、
３・・・・・・ＡＧＣ出力端子、４・・・・・・ＡＧＣ
制御端子、５・・・・・・検波器、６・・・・・・雑音
検波器、７・・・・・・合成器、８・・・・・・位相同
期ループ、９・・・・・・同期判定端子。

Claims (1)

    【実用新案登録請求の範囲】
  1. 受信機からのレベル変化のある信号を入力する入力端子
    と、制御電圧によって利得制御される利得制御回路と、
    前記利得制御回路からの信号を基準信号として入力し、
    位相同期によって搬送波を再生すると共に同期確立した
    とき同期判定信号を出力する位相同期ループを有するも
    のにおいて、制御電圧を利得制御回路の出力を信号スペ
    クトラムをカバーする帯域にわたり抽出する検波器と信
    号スペクトラムがゼロとなる周波数を中心とした比較的
    狭い帯域に含まれる信号を抽出する雑音検波器からの出
    力信号を減算的に合成したものによってあてることを特
    徴とする位相判定回路。
JP4712483U 1983-03-29 1983-03-29 位相判定回路 Pending JPS59152853U (ja)

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JP4712483U JPS59152853U (ja) 1983-03-29 1983-03-29 位相判定回路

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JP4712483U JPS59152853U (ja) 1983-03-29 1983-03-29 位相判定回路

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JPS59152853U true JPS59152853U (ja) 1984-10-13

Family

ID=30177675

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JP4712483U Pending JPS59152853U (ja) 1983-03-29 1983-03-29 位相判定回路

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