JPS5880722A - マイクロコンピユ−タの誤動作防止回路 - Google Patents
マイクロコンピユ−タの誤動作防止回路Info
- Publication number
- JPS5880722A JPS5880722A JP56178676A JP17867681A JPS5880722A JP S5880722 A JPS5880722 A JP S5880722A JP 56178676 A JP56178676 A JP 56178676A JP 17867681 A JP17867681 A JP 17867681A JP S5880722 A JPS5880722 A JP S5880722A
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- JP
- Japan
- Prior art keywords
- microcomputer
- circuit
- load
- control signal
- computer
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/24—Resetting means
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Electronic Switches (AREA)
- Direct Current Feeding And Distribution (AREA)
- Safety Devices In Control Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はマイクロコンピュータの誤動作防止Ｎ路に関す
る。
る。
各種電子機器等の制御手段として、従来からマイクロコ
ンピュータが用いられている。この制御は、マイクロコ
ンピュータの■１０ポートから出力される制御信号によ
って行なわれている。ところが、従来のマイクロコンピ
ュータハ、マイクロコンピュータに電源が投入されたと
き、ＣＰＵのリセットが解除される１で、又それか解除
された瞬間ＣＰＵが不安定な動作状態にあるので、この
間Ｉ ／ Ｏボートからは、制御信号とは異なるランダ
ムな信号か出力される。そして、この信号により、マイ
クロコンピュータによって制御される負荷が動作状態と
なる、いわゆるマイクロコンピュータ負荷の誤動作を生
じさせるという欠点があった。
ンピュータが用いられている。この制御は、マイクロコ
ンピュータの■１０ポートから出力される制御信号によ
って行なわれている。ところが、従来のマイクロコンピ
ュータハ、マイクロコンピュータに電源が投入されたと
き、ＣＰＵのリセットが解除される１で、又それか解除
された瞬間ＣＰＵが不安定な動作状態にあるので、この
間Ｉ ／ Ｏボートからは、制御信号とは異なるランダ
ムな信号か出力される。そして、この信号により、マイ
クロコンピュータによって制御される負荷が動作状態と
なる、いわゆるマイクロコンピュータ負荷の誤動作を生
じさせるという欠点があった。
本発明は前記課題に鑑みなきれたものであり、その目的
は、マイクロコンピュータの電源投入時におけるマイク
ロコンピュータ負荷の唄動作を防止することができるマ
イクロコンピュータの誤動作防止回路を提供することに
よる１゜ 前記目的を達成するために本発ゆ」ニ１、マイクロコン
ピュータと、マイクロコンピュータからの制御信号によ
って制御きれる負荷と、を含むシステムにおいて、電源
投入時のマイクロコンピュータのリセット解除レベルが
所定値を越える時まで負荷への制御信号をしゃ断する回
路を設けたことを特徴とする特 以下、図面に基づいて本発明の好適な実施例を説明する
。
は、マイクロコンピュータの電源投入時におけるマイク
ロコンピュータ負荷の唄動作を防止することができるマ
イクロコンピュータの誤動作防止回路を提供することに
よる１゜ 前記目的を達成するために本発ゆ」ニ１、マイクロコン
ピュータと、マイクロコンピュータからの制御信号によ
って制御きれる負荷と、を含むシステムにおいて、電源
投入時のマイクロコンピュータのリセット解除レベルが
所定値を越える時まで負荷への制御信号をしゃ断する回
路を設けたことを特徴とする特 以下、図面に基づいて本発明の好適な実施例を説明する
。
第１図には、本発明の好適な実施例としての構成図が示
されている。図において、ＣＰＵ、ＲＯＭ、ＲＡＭ、Ｉ
ｌｏ等を含むマイクロコンピュータ２は、スイッチ４を
介してバッテリ６の電源が電源端子８に供給され、負荷
への制御指令を行なうだめのスイッチ１０が操作された
ときや所定のプログラムに基づいた指令によシエ１０ボ
ート１２から制御信号１００が出力されるようになって
いる。本実施例においては、ランプＩ４を含むトランジ
スタ１６が負荷として示されでおり、このランプ１４は
トランジスタ１６によって点灯駆動される。マイクロコ
ンピュータ２のリセット端子１８への電源の供鞄を遅延
するための）！Ｖ！延回路として抵抗Ｒ１、ダイオード
Ｄｌ、コンデンツーＣｌが設けられている。
されている。図において、ＣＰＵ、ＲＯＭ、ＲＡＭ、Ｉ
ｌｏ等を含むマイクロコンピュータ２は、スイッチ４を
介してバッテリ６の電源が電源端子８に供給され、負荷
への制御指令を行なうだめのスイッチ１０が操作された
ときや所定のプログラムに基づいた指令によシエ１０ボ
ート１２から制御信号１００が出力されるようになって
いる。本実施例においては、ランプＩ４を含むトランジ
スタ１６が負荷として示されでおり、このランプ１４は
トランジスタ１６によって点灯駆動される。マイクロコ
ンピュータ２のリセット端子１８への電源の供鞄を遅延
するための）！Ｖ！延回路として抵抗Ｒ１、ダイオード
Ｄｌ、コンデンツーＣｌが設けられている。
本実施例においては、マイクロコンピュータの電源投入
時のリセット解除レベルが所定値を越えるまで制御信号
１００をしゃ断する回路として、抵抗Ｒ２、ダイオード
Ｄ２、コンデンサＣ２からなる遅延回路と、抵抗Ｒ２と
コンデンサＣ２の接続点ａにおける電圧と抵抗Ｒ３と抵
抗Ｒ４によってＣＰＨのリセット解除レベルをわずかに
加える値に設定される設定電圧とを比較する比較回路２
０及び比較回路出力すと制御信号１００との論理積をと
るＡＮＤゲート回路２２が設けられでいる。
時のリセット解除レベルが所定値を越えるまで制御信号
１００をしゃ断する回路として、抵抗Ｒ２、ダイオード
Ｄ２、コンデンサＣ２からなる遅延回路と、抵抗Ｒ２と
コンデンサＣ２の接続点ａにおける電圧と抵抗Ｒ３と抵
抗Ｒ４によってＣＰＨのリセット解除レベルをわずかに
加える値に設定される設定電圧とを比較する比較回路２
０及び比較回路出力すと制御信号１００との論理積をと
るＡＮＤゲート回路２２が設けられでいる。
そしてＡＮＤゲート回路２２の出力Ｃはトランジスタ１
６のベースに接＝−ａれている。。
６のベースに接＝−ａれている。。
ガお、比較回路２０は、第２図に示される如く、ツェナ
ータイオードＺＤ、抵抗Ｒ５、Ｒ６、トランジスタ２４
からなる回路や、第３図に示される如く、抵抗Ｒ７、抵
抗Ｒ８及びオペアンプ２６からなるコンパレータ等によ
って構成されるものである。
ータイオードＺＤ、抵抗Ｒ５、Ｒ６、トランジスタ２４
からなる回路や、第３図に示される如く、抵抗Ｒ７、抵
抗Ｒ８及びオペアンプ２６からなるコンパレータ等によ
って構成されるものである。
又、比較回路２０ｏ抵抗Ｒ３、Ｒ４ｆＣよって設定され
る設定電圧は、第４図の（ｂ）に示される□ 如く、マイクロコンピュータ２に電源が投入されＣＰＨ
のリセット端子１８のレベルが上昇し、リセット電圧Ｖ
、となｊ５ｃＰＨのリセットが解除されＣＰＵが安定す
るレベルＶ、に設定されている。
る設定電圧は、第４図の（ｂ）に示される□ 如く、マイクロコンピュータ２に電源が投入されＣＰＨ
のリセット端子１８のレベルが上昇し、リセット電圧Ｖ
、となｊ５ｃＰＨのリセットが解除されＣＰＵが安定す
るレベルＶ、に設定されている。
本実施例は以上の構成からなり、スイッチ４がＯＮにな
りマイクロコンピュータ２に電源が投入されると、マイ
クロコンピュータ２の電源端子８の電圧は、第４図の＜
−＞に示される如く上昇し、ＣＰＨのリセット端子１８
が第４図の（１））に示される如く変化する。このとき
比較回路２００Å力電圧１第４図の（Ｃ）に示される如
く変化し、この電圧が時間ｔ１ においでｃｐｕのリ
セット解除電圧ｖ１ よシわずかに商い設定電圧ｖ２を
越えると、第４図の（ｄ）に示される如く、比較回路２
０からハイレベルの信号が出力される。このように、時
間ｔ。（電源投入時）〜時間ｔ、−、４での間は、ＡＮ
Ｄゲート回路２０の出力がハイレベルにならないので、
この時マイクロコンピュータ２の工１０ポー）１２から
第４図の（θ）に示されるような波形が出力されてもＡ
ＮＤゲート回路２２からはハイレベルの信号は出力され
ない。
りマイクロコンピュータ２に電源が投入されると、マイ
クロコンピュータ２の電源端子８の電圧は、第４図の＜
−＞に示される如く上昇し、ＣＰＨのリセット端子１８
が第４図の（１））に示される如く変化する。このとき
比較回路２００Å力電圧１第４図の（Ｃ）に示される如
く変化し、この電圧が時間ｔ１ においでｃｐｕのリ
セット解除電圧ｖ１ よシわずかに商い設定電圧ｖ２を
越えると、第４図の（ｄ）に示される如く、比較回路２
０からハイレベルの信号が出力される。このように、時
間ｔ。（電源投入時）〜時間ｔ、−、４での間は、ＡＮ
Ｄゲート回路２０の出力がハイレベルにならないので、
この時マイクロコンピュータ２の工１０ポー）１２から
第４図の（θ）に示されるような波形が出力されてもＡ
ＮＤゲート回路２２からはハイレベルの信号は出力され
ない。
そして時間ｔ１以後、ＣＰＵ２が安定動作領域ニ入すマ
イクロコンピュータ２の工１０ボート１２から第４図の
（θ）の波形Ａに示されるような信号が出力されると、
第４図の（ｆ）に示される如く、ＡＮＤゲート回路２２
からは第４図の（ｆ）の波形Ｂで示されるハイレベルの
信号が出力され、トランジスタ１６のベースに供給され
る１、そしてランプ１４が点灯きれる。
イクロコンピュータ２の工１０ボート１２から第４図の
（θ）の波形Ａに示されるような信号が出力されると、
第４図の（ｆ）に示される如く、ＡＮＤゲート回路２２
からは第４図の（ｆ）の波形Ｂで示されるハイレベルの
信号が出力され、トランジスタ１６のベースに供給され
る１、そしてランプ１４が点灯きれる。
以上説明したように、本発明によればマイクロコンピュ
ータに電源が投入されＣＰＨのリセットが解除状態とな
ってマイクロコンビュータカ安定動作領域となるまで制
御信号が負荷に供給されないので、マイクロコンピュー
タによって負荷が誤動作するのを防止できるという優れ
た効果がある。
ータに電源が投入されＣＰＨのリセットが解除状態とな
ってマイクロコンビュータカ安定動作領域となるまで制
御信号が負荷に供給されないので、マイクロコンピュー
タによって負荷が誤動作するのを防止できるという優れ
た効果がある。
【図面の簡単な説明】
第１図は、本発明によるマイクロコンピュータの誤動作
防止回路の一実施例を示す構成図、第２図、第３図はそ
れぞれ第１図に示されている比較回路の一例を示す回路
図、第４図は、第１図に示されている各部の波形を示す
波形図である。 ２ｅ−・マイクロコンピュータ、 ８・・・電源端子、 １２・・・工１０ボート
、１４・・・ラング、 １６．２４・・トランジスタ、 １８・・・リセット端子、 ２０・・・比較回路、２
２・・・Ａ Ｎ ］）ゲート回路、 Ｒ１、ｋ＜ ２、Ｒ３、” ４、Ｒ５、Ｒ（５，’Ｌ（
７、Ｊ（１３・・・抵抗、ＤＩ、Ｄ２・・・タイオード
、 ｃｌ、ｃ２…：コンデンサし 代理人 鵜 沼 ｈｔ 之 （ｌゴか２名）
防止回路の一実施例を示す構成図、第２図、第３図はそ
れぞれ第１図に示されている比較回路の一例を示す回路
図、第４図は、第１図に示されている各部の波形を示す
波形図である。 ２ｅ−・マイクロコンピュータ、 ８・・・電源端子、 １２・・・工１０ボート
、１４・・・ラング、 １６．２４・・トランジスタ、 １８・・・リセット端子、 ２０・・・比較回路、２
２・・・Ａ Ｎ ］）ゲート回路、 Ｒ１、ｋ＜ ２、Ｒ３、” ４、Ｒ５、Ｒ（５，’Ｌ（
７、Ｊ（１３・・・抵抗、ＤＩ、Ｄ２・・・タイオード
、 ｃｌ、ｃ２…：コンデンサし 代理人 鵜 沼 ｈｔ 之 （ｌゴか２名）
Claims (1)
- （１１マイクロコンピュータト、マイクロコンピュータ
からの制御信号により制御される負荷と、を含むシステ
ムにおいて、電源投入時のマイクロコンピュータのリセ
ット解除レベルが所定値を越える時１で負荷への制御信
号をしゃ断する回路を設けたことを特徴とするマイクロ
コンピュータの誤動作防止回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56178676A JPS5880722A (ja) | 1981-11-06 | 1981-11-06 | マイクロコンピユ−タの誤動作防止回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56178676A JPS5880722A (ja) | 1981-11-06 | 1981-11-06 | マイクロコンピユ−タの誤動作防止回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5880722A true JPS5880722A (ja) | 1983-05-14 |
Family
ID=16052604
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56178676A Pending JPS5880722A (ja) | 1981-11-06 | 1981-11-06 | マイクロコンピユ−タの誤動作防止回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5880722A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59147536A (ja) * | 1983-02-10 | 1984-08-23 | Matsushita Electric Ind Co Ltd | 入力制御回路 |
| JPS60117594A (ja) * | 1983-11-29 | 1985-06-25 | 松下電器産業株式会社 | 調光制御装置 |
| JPS6157628U (ja) * | 1984-09-17 | 1986-04-18 | ||
| JPH01113704U (ja) * | 1988-01-26 | 1989-07-31 |
-
1981
- 1981-11-06 JP JP56178676A patent/JPS5880722A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59147536A (ja) * | 1983-02-10 | 1984-08-23 | Matsushita Electric Ind Co Ltd | 入力制御回路 |
| JPS60117594A (ja) * | 1983-11-29 | 1985-06-25 | 松下電器産業株式会社 | 調光制御装置 |
| JPH0522358B2 (ja) * | 1983-11-29 | 1993-03-29 | Matsushita Electric Ind Co Ltd | |
| JPS6157628U (ja) * | 1984-09-17 | 1986-04-18 | ||
| JPH01113704U (ja) * | 1988-01-26 | 1989-07-31 |
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