JPS5872955U - シングルワイヤ制御システムのバツクアツプ装置 - Google Patents

シングルワイヤ制御システムのバツクアツプ装置

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Publication number
JPS5872955U
JPS5872955U JP16844181U JP16844181U JPS5872955U JP S5872955 U JPS5872955 U JP S5872955U JP 16844181 U JP16844181 U JP 16844181U JP 16844181 U JP16844181 U JP 16844181U JP S5872955 U JPS5872955 U JP S5872955U
Authority
JP
Japan
Prior art keywords
switch
cpu
control system
clock
electrical component
Prior art date
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Pending
Application number
JP16844181U
Other languages
English (en)
Inventor
和雄 平井
一男 中村
Original Assignee
本田技研工業株式会社
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Filing date
Publication date
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Priority to JP16844181U priority Critical patent/JPS5872955U/ja
Publication of JPS5872955U publication Critical patent/JPS5872955U/ja
Pending legal-status Critical Current

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Landscapes

  • Remote Monitoring And Control Of Power-Distribution Networks (AREA)
  • Selective Calling Equipment (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は本考案によるシングルワイヤ制御システムのバック
テップ装置の一実施例を示す電気回路図である。 1.8・・・スイッチコントローラ、2・・・メインC
PU、3,9・・・パルス増幅回路、4・・・異常検出
口L5−・・クロックcpu、6;・・クロックトライ
バ、7・・・デジタル時計、10.11・・・定電圧回
路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 走行体に搭載された全ての電装品における各スイッチの
    オン、オフ状態に応じて第「のスイッチコントローラか
    ら出されるデジタルスイッチ指令に応じて所定の制御信
    号を各電装品のオン、オフ制御を行なわせるサブコント
    ローラに与え、かつ異常発生時の自己リセット機能を有
    するメインCPUからなるシングルワイヤ制御システム
    において、デジタル時計の表示制御用のクロックCPU
    に対して走行体の走行に際して最小限必要とされる各電
    装品に応じたデジタルスイッチ指令を与える第2のスイ
    ッチコントローラを設け、メインCPUの異常発生時に
    それから出される異常発生信号に応じてクロックCPU
    による制御モードの切換えを行なわせ、そのクロ、ツク
    CPUにより第2のスイッチコントローラから与えられ
    るスイッチ指令に応じた各電装品のバックアップ制御を
    行なわせるようにしたことを特徴とするシングルワイヤ
    制御システムのバックアップ装置。   ゛  −
JP16844181U 1981-11-12 1981-11-12 シングルワイヤ制御システムのバツクアツプ装置 Pending JPS5872955U (ja)

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JPS5872955U true JPS5872955U (ja) 1983-05-17

Family

ID=29960490

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