JPS5840637A - Resetting circuit - Google Patents

Resetting circuit

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Publication number
JPS5840637A
JPS5840637A JP56137744A JP13774481A JPS5840637A JP S5840637 A JPS5840637 A JP S5840637A JP 56137744 A JP56137744 A JP 56137744A JP 13774481 A JP13774481 A JP 13774481A JP S5840637 A JPS5840637 A JP S5840637A
Authority
JP
Japan
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voltage
circuit
reset
output
power supply
Prior art date
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Pending
Application number
JP56137744A
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Japanese (ja)
Inventor
Kojiro Tajima
田島 浩二郎
Shozo Komaki
小牧 省三
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Nippon Telegraph and Telephone Corp
Original Assignee
Nippon Telegraph and Telephone Corp
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Publication date
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Priority to JP56137744A priority Critical patent/JPS5840637A/en
Publication of JPS5840637A publication Critical patent/JPS5840637A/en
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F1/00Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
    • G06F1/24Resetting means

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
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  • General Physics & Mathematics (AREA)
  • Direct Current Feeding And Distribution (AREA)
  • Electronic Switches (AREA)
  • Retry When Errors Occur (AREA)

Abstract

PURPOSE:To prevent malfunction due to a momentary break of power supply by supplying a voltage lower than a resetting voltage to a reset terminal when a power voltage drops below a limit voltage for the normal operation of a computer, and performing resetting operation once the computer operates abnormally. CONSTITUTION:When a power voltage Vcc drops below the operation limit voltage of a microcomputer 1, a voltage lower than the limit voltage is supplied to a reset terminal 2 by a level shifting circuit 7 composed of a diode, etc. Consequently, if the power voltage Vcc drops to a voltage at which the microcomputer 1 does not operate normally, resetting operation is started immediately.

Description

【発明の詳細な説明】 本発明はマイクロコンピュータに使用するリセット回路
に関するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a reset circuit used in a microcomputer.

従来のこの種の回路は第1図のように構成されていた。A conventional circuit of this type was constructed as shown in FIG.

1はマイクロコンピュータ、2はリセット信号(負論理
)入力端子、3は電源端子、4は抵抗、5はダイオード
、6はコンデンサを示す。
1 is a microcomputer, 2 is a reset signal (negative logic) input terminal, 3 is a power supply terminal, 4 is a resistor, 5 is a diode, and 6 is a capacitor.

この回路では、電源投入時の端子2における電圧は端子
3における電圧に比べ、立上りが遅くなり、マイクロコ
ンピータにかかる電源電圧が安定になった後リセットが
解除される構成になっている。
In this circuit, the voltage at terminal 2 rises later than the voltage at terminal 3 when the power is turned on, and the reset is canceled after the power supply voltage applied to the microcomputer becomes stable.

この遅れ時間は抵抗4ならびにコンデンサ6の値によっ
て定まる。電源が瞬断を起こした場合は、コンデンサ6
に蓄積された電荷がダイオード5を介して放電され、リ
セット端子2の電圧が低下しリセットがかかるような動
作をしている。しかし、一般のマイクロコンピュータの
リセット電圧Vmrは1.3V程度であり、がっ、ダイ
オード5.  の順方向電圧VDは0.7 V程度であ
るため、電源電圧Vccが−酊−■すなわち0.4V 
まで低下しなげればリセットがかがらない。一方、マイ
クロコンピュータは、0.4Vに比べてはるかに高い電
圧VTR(一般には4V程度)で正常な動作をしなくな
る。したがッテ、VTRカラVRESET −VD  
(7)範囲(4V〜0.4vの範囲)に電源電圧が一瞬
低下した後正常に回復した場合は、マイクロコンピュー
タはリセットされず、しかも異常動作をしたままになる
という欠点があった。
This delay time is determined by the values of resistor 4 and capacitor 6. In the event of a momentary power interruption, capacitor 6
The electric charge accumulated in the circuit is discharged through the diode 5, and the voltage at the reset terminal 2 decreases, causing a reset. However, the reset voltage Vmr of a general microcomputer is about 1.3V, and the diode 5. Since the forward voltage VD of
If the voltage does not drop to this level, the reset will not work. On the other hand, a microcomputer does not operate normally at a voltage much higher than 0.4V (generally about 4V). Gatte, VTR color VRESET-VD
(7) If the power supply voltage momentarily drops within the range (4V to 0.4V) and then recovers to normal, the microcomputer is not reset and remains in abnormal operation.

本発明はこれらの欠点を除去するため、マイクロコンピ
ュータが異常動作を開始する電圧以下に電源電圧が低下
した場合に直ちにマイクロコンピュータをリセットする
ようにしたもので以下図面について詳細に説明する。
In order to eliminate these drawbacks, the present invention is designed to immediately reset the microcomputer when the power supply voltage drops below the voltage at which the microcomputer starts to operate abnormally.The present invention will be described in detail with reference to the drawings below.

第2図は本発明の実施例であって、7はレベルシフト回
路である。70回路は、電源電圧VccがVTR以下に
なった場合にすなわち、70入力電圧がVTH−VD 
= 3.3Vになった場合にVRESET以下の電圧を
リセット端子2に供給するレベルシフト−回路である。
FIG. 2 shows an embodiment of the present invention, in which 7 is a level shift circuit. In the 70 circuit, when the power supply voltage Vcc becomes lower than the VTR, that is, the 70 input voltage becomes VTH-VD.
= 3.3V, this is a level shift circuit that supplies a voltage lower than VRESET to the reset terminal 2.

このような回路を用いることにより、マイクーロコンピ
ュータが正常な動作をしな(なる電圧VTHまで電源電
圧Vccが低下した場合には直ちにリセット動作を開始
させることができる。レベルシフト回路はダイオード等
を用いて実現できる。
By using such a circuit, if the microcomputer does not operate normally and the power supply voltage Vcc drops to the voltage VTH, the reset operation can be started immediately.The level shift circuit uses a diode, etc. This can be achieved using

第3図は、本発明の他の実施例であり、8は比較回路、
9は基準電圧発生回路、であり、基準電圧発生回路はツ
ェナーダイオード等、比較回路はコンパレータまたはト
ランジスタスイッチ等を用いて実現される。比較回路の
入力端子の一方はVccに、他方はVTRに相当する電
圧を発生する基準電圧発生回路9に接続されている。比
較回路°8は、Vccが基準電圧VTRよりも高い場合
はVRESETより十分高い出力電圧を、その反対の場
合はVRESETより十分低い出力電圧を発生させる。
FIG. 3 shows another embodiment of the present invention, in which 8 is a comparison circuit;
Reference numeral 9 denotes a reference voltage generation circuit, and the reference voltage generation circuit is realized using a Zener diode or the like, and the comparison circuit is realized using a comparator or a transistor switch or the like. One of the input terminals of the comparison circuit is connected to Vcc, and the other is connected to a reference voltage generation circuit 9 that generates a voltage corresponding to a VTR. Comparison circuit °8 generates an output voltage sufficiently higher than VRESET when Vcc is higher than reference voltage VTR, and generates an output voltage sufficiently lower than VRESET in the opposite case.

この出力電圧をリセット端子2に供給することにより、
電源電圧が基準電圧(VTH)以下になった場合に直ち
にコンピュータがリセットされる。また、4〜6の回路
は従来の回路に用いられたものと同一の回路であり、電
源投入時のリセット解除を遅らせる動作を行なう。電源
電圧VccIJ″−VTH以上となった場合には、比較
回路8の出力電圧がVRESETより十分高(なる。
By supplying this output voltage to reset terminal 2,
The computer is reset as soon as the power supply voltage drops below the reference voltage (VTH). Further, circuits 4 to 6 are the same circuits as those used in the conventional circuit, and perform an operation to delay reset cancellation when the power is turned on. When the power supply voltage is equal to or higher than VccIJ''-VTH, the output voltage of the comparator circuit 8 becomes sufficiently higher than VRESET.

したがって抵抗4を介してコンデンサ6に充電され、リ
セット端子2の電圧はある時間だけ遅れてVRESET
より高くなり、コンビーータのリセットが解除される。
Therefore, the capacitor 6 is charged via the resistor 4, and the voltage at the reset terminal 2 is delayed by a certain period of time to VRESET.
becomes higher, and the reset of the conbeater is released.

逆にVccがVTR以下となった場合は、比較回路出力
電圧はVRESETより十分小さくなり、コンデンサ6
に蓄積された電荷はダイオード5を通して短時間のうち
に放電され、リセット端子電圧はVRE8ET以下とな
りコンビーータはリセットされる。また、第4図は、比
較回路と4.5.6で構成される回路の配置を逆にした
ものであり、第3図と同様の動作が実現できる。
Conversely, when Vcc becomes lower than VTR, the comparator circuit output voltage becomes sufficiently smaller than VRESET, and capacitor 6
The accumulated charges are discharged through the diode 5 in a short time, and the reset terminal voltage becomes less than VRE8ET, and the converter is reset. Further, in FIG. 4, the arrangement of the comparator circuit and the circuits 4.5.6 is reversed, and the same operation as in FIG. 3 can be realized.

第5図は、本発明の他の実施例であり、比較回路8の出
力が図に示すようなオーブンコレクタの場合の実施例で
あり、第3図においてコンデンサ5の電荷を放電するた
めに用いたダイオード5は比較回路出力のトランジスタ
で代用して(・る。第5図のトランジスタスイッチ回路
はトランジスタを用いた比較回路の1種であ゛る。
FIG. 5 shows another embodiment of the present invention, in which the output of the comparator circuit 8 is an oven collector as shown in the figure, and is used to discharge the charge of the capacitor 5 in FIG. The diode 5 used in the circuit is replaced by a transistor for the output of the comparator circuit.The transistor switch circuit shown in FIG. 5 is a type of comparator circuit using transistors.

なお第3図及び第5図の実施例で、比較回路8及び基準
電圧発生回路9は、第2図のレベルシフト回路7又は第
6図の一抵抗分圧回路10 、11で置換することが可
能である。
In the embodiments shown in FIGS. 3 and 5, the comparison circuit 8 and the reference voltage generation circuit 9 can be replaced with the level shift circuit 7 shown in FIG. 2 or the one-resistance voltage divider circuits 10 and 11 shown in FIG. It is possible.

第6図は本発明の他の実施例であり、10ならびに11
は抵抗である。抵抗IOならびに11は、VccがVT
Hになった場合に端子2の電圧がVRESETになるよ
うに調整されている。このため、VccがVT)I以下
になった場合に直ちにコンピュータかりセットされる。
FIG. 6 shows another embodiment of the invention, 10 and 11.
is resistance. Resistors IO and 11 are connected when Vcc is VT
It is adjusted so that the voltage at terminal 2 becomes VRESET when it becomes H. Therefore, when Vcc becomes lower than VT)I, it is immediately set by the computer.

抵抗4.コンデンサ6は、第1図と同様に電源投入時の
りセント解除の遅れに用いており、ダイオード5も、同
様にVcc低下時のコンデンサ6に蓄積された電荷の急
速放電用に使用されている。
Resistance 4. As in FIG. 1, the capacitor 6 is used to delay release of low voltage when the power is turned on, and the diode 5 is also used to rapidly discharge the charge accumulated in the capacitor 6 when Vcc drops.

以上説明したように、電源電圧がコンピュータの正常動
作を行なう限界電圧VTR以下に低下した場合にリセッ
ト端子にリセット電圧VRESET以下の電圧を供給す
ることにより、コンビーータが異常動作を開始すると同
時にコンビーータをリセットすることが可能となるため
、電源瞬断による誤動作を防止することができる。
As explained above, when the power supply voltage drops below the limit voltage VTR for normal computer operation, by supplying a voltage lower than the reset voltage VRESET to the reset terminal, the converter is reset at the same time as the converter starts abnormal operation. This makes it possible to prevent malfunctions caused by instantaneous power interruptions.

第7図はリセット回路の効果を実測した例であり、(a
)は従来の回路(b)は抵抗分割を用いた第6図の1実
施例、(C)は比較回路を用いた第4図の1実施例を示
す。図から分かるように従来の回路に比べ太幅に特性が
改善できることが分かる。なお第7図(al〜(C)で
領域Aはリセットがかからず異常動作をする領域、領域
Bはリセットがかからず正常動作を継続する領域、領域
Cはリセットがかかり正常動作を開始する領域を示す。
Figure 7 is an example of actually measuring the effect of the reset circuit, (a
) shows an example of the conventional circuit (b) shown in FIG. 6 using resistance division, and (C) shows an example shown in FIG. 4 using a comparison circuit. As can be seen from the figure, the characteristics can be significantly improved compared to the conventional circuit. In Figures 7 (al to (C)), region A is a region where no reset is applied and abnormal operation occurs, region B is a region where no reset is applied and normal operation continues, and region C is a region where reset is applied and normal operation begins. Indicates the area to be used.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は従来のリセット回路、第2図は本発明によるリ
セット回路の実施例、第3図と第4図と第5図と第6図
は、各々、本発明によるリセット−−回路の別の実施例
、第7図(a)〜(C)はリセット回路の特性を示す図
である。 1・・・マイクロコンピュータ、 2・・・リセット入力端子、3・・・電源電圧端子、4
.10.11・・・抵抗、  5・・・ダイオード、6
・・・コンデンサ、    7・・・レベルシフト回路
、8・・・比較回路、   9・・・基準電圧発生回路
。 特許出願人 日本電信電話公社 特許出願代理人 弁理士 山 本 恵 −
FIG. 1 shows a conventional reset circuit, FIG. 2 shows an embodiment of the reset circuit according to the present invention, and FIGS. FIGS. 7A to 7C are diagrams showing the characteristics of the reset circuit in this embodiment. 1... Microcomputer, 2... Reset input terminal, 3... Power supply voltage terminal, 4
.. 10.11...Resistor, 5...Diode, 6
...Capacitor, 7.Level shift circuit, 8.Comparison circuit, 9.Reference voltage generation circuit. Patent applicant Nippon Telegraph and Telephone Public Corporation Patent application agent Megumi Yamamoto −

Claims (4)

【特許請求の範囲】[Claims] (1)  コンビーータに使用する電源電圧が、該コン
ピュータの正常動作を行なう限界まで低下したことを検
出する検出手段、及び該コンビーータのリセット動作を
行なわしめるために設けられた入力端子に対し、前記検
出手段の出力に従ってリセットを実行するための電圧を
送出する電圧送出回路を有することを特徴とするリセッ
ト回路。
(1) Detecting means for detecting that the power supply voltage used for the converter has fallen to the limit for normal operation of the computer, and an input terminal provided for resetting the converter; 1. A reset circuit comprising a voltage sending circuit that sends out a voltage for executing reset according to the output of the means.
(2)前記電圧送出回路がレベルシフト回路、抵抗分割
回路、トランジスタスイッチ回路及び比較回路から選択
されるひとつの回路である特許請求の範囲第1項記載の
リセット回路。
(2) The reset circuit according to claim 1, wherein the voltage sending circuit is one circuit selected from a level shift circuit, a resistance divider circuit, a transistor switch circuit, and a comparison circuit.
(3)電圧送出口路の出力に、抵抗とダイオードの並列
回路及びその出力と接地点の間に挿入されるコンデンサ
とがもうけられるごとき特許請求の範囲第1項記載のリ
セット回路。
(3) The reset circuit according to claim 1, wherein a parallel circuit of a resistor and a diode, and a capacitor inserted between the output and the ground point are provided at the output of the voltage output path.
(4)電圧送出回路の出力がコンデンサを介して接地さ
れるとともに抵抗を介して電源端子に接続されるごとき
特許請求の範囲第1項記載のリセット回路。
(4) The reset circuit according to claim 1, wherein the output of the voltage sending circuit is grounded via a capacitor and connected to a power supply terminal via a resistor.
JP56137744A 1981-09-03 1981-09-03 Resetting circuit Pending JPS5840637A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN109408285A (en) * 2018-09-12 2019-03-01 佛山市云米电器科技有限公司 A kind of capable of preventing error touch system detection control method and the steaming and baking box using it

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Publication number Priority date Publication date Assignee Title
CN109408285A (en) * 2018-09-12 2019-03-01 佛山市云米电器科技有限公司 A kind of capable of preventing error touch system detection control method and the steaming and baking box using it

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