JPS5839643U - メモリ装置 - Google Patents

メモリ装置

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Publication number
JPS5839643U
JPS5839643U JP13303381U JP13303381U JPS5839643U JP S5839643 U JPS5839643 U JP S5839643U JP 13303381 U JP13303381 U JP 13303381U JP 13303381 U JP13303381 U JP 13303381U JP S5839643 U JPS5839643 U JP S5839643U
Authority
JP
Japan
Prior art keywords
memory
memory card
memory device
selection means
card
Prior art date
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Pending
Application number
JP13303381U
Other languages
English (en)
Inventor
晃 阿部
畠沢　菊雄
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP13303381U priority Critical patent/JPS5839643U/ja
Publication of JPS5839643U publication Critical patent/JPS5839643U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は、本考案のメモリ装置の実施例のメモリ周辺部の回
路ブロック図である。 １・・・メモリカード１．２・・・アドレスレジスタ、
３・・・メモリカードアドレスバス、４・・・デコード
回路、５・・・オア回路Ａ、６・・・メモリカード内ア
ドレスバス、７・・・書込みデータバス、８・・・オア
回路Ｂ、　９・・・読出データバス、１０・・・メモリ
カードセレクトデータバス、１１・・・メモリカードセ
レクトレジスタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数個のメモリカードから構成されるメモリ装置におい
    て、アドレスデータをデコードして１個のメモリカード
    を選択する第１のメモリアドレス選択手段と、セットリ
    セット可能なフリップフロップの出力により任意のメモ
    リカードを選択できる第２のメモリカード選択手段とを
    有し、第１の手段または第１の手段と第２の選択手段と
    の重畳でメモリカードの選択を行うように構成したこと
    を特徴とするメモリ装置。
JP13303381U 1981-09-09 1981-09-09 メモリ装置 Pending JPS5839643U (ja)

Priority Applications (1)

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JP13303381U JPS5839643U (ja) 1981-09-09 1981-09-09 メモリ装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP13303381U JPS5839643U (ja) 1981-09-09 1981-09-09 メモリ装置

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JPS5839643U true JPS5839643U (ja) 1983-03-15

Family

ID=29926520

Family Applications (1)

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JP13303381U Pending JPS5839643U (ja) 1981-09-09 1981-09-09 メモリ装置

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JP (1) JPS5839643U (ja)

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