JPS5839263A - ゼロ電位制御装置 - Google Patents
ゼロ電位制御装置Info
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- JPS5839263A JPS5839263A JP13589581A JP13589581A JPS5839263A JP S5839263 A JPS5839263 A JP S5839263A JP 13589581 A JP13589581 A JP 13589581A JP 13589581 A JP13589581 A JP 13589581A JP S5839263 A JPS5839263 A JP S5839263A
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- Japan
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- transistor
- circuit
- collector
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- zero point
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- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Power Conversion In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明は交流電源に負荷と直列に接続されたスイッチン
グ素子を開閉制御する装置シこ係り、特にスイッチング
素子を交流電源のゼロ電位で点弧せしめるよう１こした
ゼロ電位制御装置に関する。 従来より交流電源に接続された負荷を開閉する場合、交
流電源のゼロ電位で開閉（特ｔこ投入）しないと高周波
雑音を生じ放送周波数に妨害を与えることはよく知られ
ている。 そこで、スイッチング素子を電源電圧波形のゼロ電位で
点弧させるものとしては、例えば】・／図ｔこ示すよう
なものがある。これは負荷がヒータでスイッチング素子
の開閉制御により温度制御を行うもので、交流電源１０
／＃こ負荷１０２とトライブック等双方向性の３端子サ
イリスタからなるスイッチング素子１０３とが直列に接
続されて主回路が形成されてお名０７Ｏ５は交流電源ｉ
ｏｉから接続された定電圧電源回路１０１１の全波整流
出力端に接続されて交流電源１０／のゼロ点を検出して
パルス信号を送出するようにしたゼロ点検出回路である
。このゼロ点検出回路１０Ｓの出力は、上記スイッチン
グ素子１０３のゲートに出力端を接続したアンド回路７
０乙の入力端の一方１こ送出し、このアンド回路１０乙
の入力端の他方ｔこけ上記負荷１０２Ｔｔこよって発生
した温度を検出する温度センサ１０りの検出値を基準値
設定回路１０ｆの基準値と比較して検出値が基準値より
低いとき″Ｈ’レベルの出力信号を送出するようにした
比較回路１０７の出力端を接続して、ゲート回路／１０
が形成されておる。そして、上記定電圧電源回路ＩＯ’
ｌは矛Ω図（こ示すようＱこ、上記各回路に動作用の定
７１丁圧電源ＶＤを供給するため、交流電源１０／を電
源トランスＴｒヲ介してダイオードブリッジｔこ形成し
た全波整流回路ＤＢｔこ入力させ、この全波整流回路の
出力をコンデンへ定電圧ダイオード、制御トランジスタ
により形成した定電圧回路により定電圧η電源■。を出
力すると共に、上記全波整流回路ＤＢの出力を、ゼロ点
検出回路１０Ｓのエミッタを接地しコレクタを負荷抵抗
ＲＬ″ｆ、介して定電圧電源■ゎに接続したトランジス
タＱのベースに、ベース抵抗ＲＢ′ｆｒ、介して入力せ
しめて、上記トランジスタＱのコレクタから入力のゼロ
点で１Ｈルベルのパルス信号を検出信号としてアンド回
路１０乙ｔこ送出する。これをうけたアンド回路７０乙
は他方の入力との論理積で１１Ｐレベルの出力信号をゲ
ート信号としてスイッチング素子１０３
グ素子を開閉制御する装置シこ係り、特にスイッチング
素子を交流電源のゼロ電位で点弧せしめるよう１こした
ゼロ電位制御装置に関する。 従来より交流電源に接続された負荷を開閉する場合、交
流電源のゼロ電位で開閉（特ｔこ投入）しないと高周波
雑音を生じ放送周波数に妨害を与えることはよく知られ
ている。 そこで、スイッチング素子を電源電圧波形のゼロ電位で
点弧させるものとしては、例えば】・／図ｔこ示すよう
なものがある。これは負荷がヒータでスイッチング素子
の開閉制御により温度制御を行うもので、交流電源１０
／＃こ負荷１０２とトライブック等双方向性の３端子サ
イリスタからなるスイッチング素子１０３とが直列に接
続されて主回路が形成されてお名０７Ｏ５は交流電源ｉ
ｏｉから接続された定電圧電源回路１０１１の全波整流
出力端に接続されて交流電源１０／のゼロ点を検出して
パルス信号を送出するようにしたゼロ点検出回路である
。このゼロ点検出回路１０Ｓの出力は、上記スイッチン
グ素子１０３のゲートに出力端を接続したアンド回路７
０乙の入力端の一方１こ送出し、このアンド回路１０乙
の入力端の他方ｔこけ上記負荷１０２Ｔｔこよって発生
した温度を検出する温度センサ１０りの検出値を基準値
設定回路１０ｆの基準値と比較して検出値が基準値より
低いとき″Ｈ’レベルの出力信号を送出するようにした
比較回路１０７の出力端を接続して、ゲート回路／１０
が形成されておる。そして、上記定電圧電源回路ＩＯ’
ｌは矛Ω図（こ示すようＱこ、上記各回路に動作用の定
７１丁圧電源ＶＤを供給するため、交流電源１０／を電
源トランスＴｒヲ介してダイオードブリッジｔこ形成し
た全波整流回路ＤＢｔこ入力させ、この全波整流回路の
出力をコンデンへ定電圧ダイオード、制御トランジスタ
により形成した定電圧回路により定電圧η電源■。を出
力すると共に、上記全波整流回路ＤＢの出力を、ゼロ点
検出回路１０Ｓのエミッタを接地しコレクタを負荷抵抗
ＲＬ″ｆ、介して定電圧電源■ゎに接続したトランジス
タＱのベースに、ベース抵抗ＲＢ′ｆｒ、介して入力せ
しめて、上記トランジスタＱのコレクタから入力のゼロ
点で１Ｈルベルのパルス信号を検出信号としてアンド回
路１０乙ｔこ送出する。これをうけたアンド回路７０乙
は他方の入力との論理積で１１Ｐレベルの出力信号をゲ
ート信号としてスイッチング素子１０３
【こ送出するこ
とになるが、このようなゼロ点でスイッチング素子の点
弧動作を行わせるためのゲート信号は、ゼロ点検出回路
のパルス信号がゼロ電位の点でパルス幅の狭いパルス（
牙３図（イ））を加えることになるため主回路の電流立
上りの点でスイッチング素子のラッチング電流ｔこ達す
ることができず、点弧失敗を生ずるおそれがある。こ′
ｔ１．全１．ヲるためｔこ、上記ゼロ点検出回路のパル
ス信号のパルス幅を広げて点弧失敗を防ぐことも考えら
れるが、このパルス幅は牙３図←）で示すように、交流
′電源のゼロ電位を中心ｔこして両方（図示ａ、：ｂ−
／：／）１こ広がって雑音の発生が増加し、ゼロ電位制
御の長所が減殺されるという問題がある。 本発明は上述した点ｔこかんがみてなされたもので、そ
の目的とするところは、簡単な構成で雑音の発生を防止
してゼロ点検出のパルス幅を広げてスイッチング素子の
点弧が的確ｔこ行えるようにしたものを提供することｔ
？−ある。 以下本発明の実施例をツノグ図及び牙Ｓ図によって説明
する。尚、）・１図は牙／図におけるゼロ点検出回路１
０３に代って形成された回路図で、他はツ・７図と同様
ｔこ構成された実施例として説明し、上述と説明が重複
する点は省略することとする。 １・り図において、Ｓはゼロ点検出回路である。これば
定電圧電源回路１０ｉｌの全波整流回路ＤＢの出力端に
】／／のトランジスタＱ工のベースをベース抵抗Ｒ１ｔ
ｌ−介して接続し、トランジスタＱ□のコレクタは定電
圧電源ＶＤ’こ負荷抵抗Ｒ２ｔｈ介して接続し、エミッ
タは順方向に挿入したダイオードＤ１を介して接地する
と共に、該エミッタを、ベースｔこカソードを接続した
ダイオードＤ２のアノードに接続し、ベースと接地間に
抵抗Ｒ３３挿入して、上記抵抗Ｒ０とＲ３で入力の分圧
回路を形成し、上記トランジスタＱ□のコレクタを、コ
レクタを負荷抵抗Ｒ４ヲ介して定電［Ｅ電源■。に接続
しエミッタが順方向ｔこ挿入したダイオードＤ３を介し
て接地した牙２のトラン（５） ジスタＱ２のベース１こ接続し、このトランジスタＱ。 のコレクタと接地間に、低抵抗Ｒ５と１／２のコンデン
サＣ２ヲ直列に挿入して、トランジスタＱ２のオンによ
りコンデンサ０２′（ｆｆＣ２→Ｒ５→Ｑ２−Ｄ３−０
２の回路で瞬時に放電させ、トランジスタＱ、のコレク
タとトランジスタＱのベース間ｔこ、低抵抗のＲ６と牙
／のコンデンサＣ１を直列に挿入して、トランジスタＱ
２のオン１こよりコンデンサＣ１はＣ１→Ｒ６−Ｃ２”
Ｄ３→Ｒ３−Ｃ工の回路でコンデンサＣ２と同時に放
′ｉｒｆ、を開始するが上記コンデンサＣ３より時定数
分だけ長い時限で放電するようをこなっており、上記ト
ランジスタＱ２のオフにより、コンデンサＣ１はｃ、Ｒ
４（ｌＲ６＜＜Ｒ４）の時定数で、また、コンデンサＣ
３はｃ ２１１４ｃ Ｉ（５＜＜Ｒ４，’）の時定数で
充電させ、上記トランジスタＱ、□のコレクタ出力を該
回路Ｓの検−小信号としてゲート回路ｌｌＯのアンド回
路１０乙に送出するようになっている。 次に、その動作ｔこついて説明する。今、坩−ｓ図の時
点ｔ。で、全波整流回路ＤＩ３の出力がゼロ点検出回路
Ｓに入力されると、この入力を抵抗Ｒ□、Ｒ３（６） （こ９］：り分圧した出力（ｍ点の出力）がトランジス
タＱ、１のベースに印加される。これによりトランジス
タｑ１、がオンし、ｑ、２がオフとなるため、コンデン
サＣ１，ｃ２ｋｌ：抵抗Ｒ４全通してそれぞれ充電され
、この充″混Ｘ−１＋：圧の」二別によりｎ点の電位は
牙Ｓ図ｎで示すよう（こ上昇する。そして、ゼロ点検出
回路Ｓ■ とダイオ−ドロ工の順方向電圧■、を加算し
た電Ｔｕ 圧（■お□； ＋ Ｖ ｆ）以下になったとき、トラン
ジスタＱ、１がオフし、トランジスタＱ、がオンするた
め、コンデンサＣ２はＣ２→Ｒ５→Ｑ、２→Ｄ３→Ｃ２
の径路で瞬時に放電して１１点の電位を急激に下げる。 一方コンデンサＣ１もＣ１→Ｒ６→Ｑ２→Ｄ３−ｈＲ３
→Ｃ□の径路で同時ｔこ放電を開始するが、時定数分だ
けコンデンサＣ２より長い時限で放゛Ｉπする。しかし
、上記ｎ点の電位ナス電位ｔこ引つげられる（矛夕図ｍ
）。このため、トランジスタｑ、□のベース・エミッタ
間をこけ逆バイアスがかかるが、この逆バイアスはダイ
オードＤ２の順方向電圧以下ｔこなるとダイオードＤ、
が梼通ずるので、トランジスタＱ□のベース・エミッタ
間の逆耐圧値以上ｔこなることはない。？２１ノら、上
記ｍ点の電位ハ、トランジスタｑ、□のオフによりダイ
オードＤ２の順方向電圧分だけマイナスに引っばられた
後、コンデンサＣ工の放電時の時定数ｔこより」二昇し
て牙Ｓ図ｍで示すよう（こゼロ点近傍でＶ字状の波形を
呈し、この上昇値がトランジスタＱ１のベース・エミッ
タ間電圧■ＢつとダイオードＤ１の順方向電圧■律加算
した電圧（”ＢＥ ” ■ｆ）以上ｔこなったとき、ト
ランジスタＱ□は再びオンし、Ｑ２がオフする。従って
、ゼロ点検出回路Ｓの出力即ちトランジスタＱのコレク
タ出力は、該トランジスタＱ工がオフしま た時点で１Ｌ′からｌＨルベルに反転し、Ｉ・ランジス
タＱ工がオンした時点でｌＨ′からｌＬルベルｔこ反転
するパルス信号をゼロ点の検出信号として検出すること
になる。そしてこのパルス信号のパルス幅ｕ ａ ＋ｂ
であるＣＡ−３図Ｓの出力）が、ｂの幅１１Ｓｌ：ａの
幅より拡げられてａ （ｂ （例えばａ：ｂ＝／：／ニ
ア）の関係で送出さ力、る。即ち、上記パルス信号のｂ
の幅はＣ□とＲ３の時定数により任意に選定できる。 そして、上記ゼロ点検出回路Ｓのパルス信号は上述した
ようｔこゲート回路／１０のアンド回路ｌＯ乙ｔこ送出
され、アンド回路１０乙のＩＨＩレベルの出力信号（ゲ
ート信号）の期間を長くすることとなるので負荷１０２
の立上りが遅れてもこれｔこ十分対応するゲート信号を
送出し点弧失敗を生ずることなくスイッチング素子１０
３がゼロ電位で点弧される。 上述した工う（こ、本発明ｅこよれば、交流電源に負荷
と直列に接続されたスイッチング素子のゲートに、上記
交流電源ｐこ接続された全波整流回路の出力を分圧回路
ｔこ印加させこの分圧回路の分圧点を、定電圧電源にエ
ミッタ接地の矛／及び牙２のトランジスタのコレクタを
負荷抵抗を介して各々接続した上記第／のトランジスタ
のベースｔこ接続すると共ｔこ、１）／のコンデンサを
介して牙２のトランジスタのコレクタに接続し、この牙
２のトランジスタのベースシこ】／／のトランジスタの
コレン（９） りを接続し、上記第２のトランジスタのコレクタと接地
間に】ノΩのコンデンサを挿入して、−に記塔／／のト
ランジスタのコレクタから出力するよつ）こしたゼロ点
検出回路を設けて、」二記交流電源のゼロ点検出のパル
ス信号のパルス幅を交流電源のゼロ点通過側のみ拡げる
よう？こしであるから、負荷の立上りが遅くても点弧失
敗を生ずることなくスイッチング素子を的確に点弧せし
めることができ、しかも、交流電源のゼロ点以降のパル
ス幅のみ拡げただけであるから、パルス信号のパルス幅
を拡げもパルス信号の立上りはゼロ点近傍であるから高
周波雑音の発生を防止することができ、放送周波数の妨
害を生じせしめることなくスイッチング素子の点弧を確
実をこ行うことができる。又、交流電源のゼロ点を電源
トランスを介して検出する場合、電源トランスの２次側
電圧の位相が進み側になってもΩ次側のゼ内点以降のパ
ルス幅が拡カルので交流電源のゼロ電位制御を不能とす
るようなことは全くなく、ゲート点弧制御の信頼性を一
段と向上せしめることができ、しかも構成は簡略化（１
０） したものであるから、装置を経済的に製することができ
ることは勿論、種々の電力制御に適用し得る等著しい効
果を有するものである。
とになるが、このようなゼロ点でスイッチング素子の点
弧動作を行わせるためのゲート信号は、ゼロ点検出回路
のパルス信号がゼロ電位の点でパルス幅の狭いパルス（
牙３図（イ））を加えることになるため主回路の電流立
上りの点でスイッチング素子のラッチング電流ｔこ達す
ることができず、点弧失敗を生ずるおそれがある。こ′
ｔ１．全１．ヲるためｔこ、上記ゼロ点検出回路のパル
ス信号のパルス幅を広げて点弧失敗を防ぐことも考えら
れるが、このパルス幅は牙３図←）で示すように、交流
′電源のゼロ電位を中心ｔこして両方（図示ａ、：ｂ−
／：／）１こ広がって雑音の発生が増加し、ゼロ電位制
御の長所が減殺されるという問題がある。 本発明は上述した点ｔこかんがみてなされたもので、そ
の目的とするところは、簡単な構成で雑音の発生を防止
してゼロ点検出のパルス幅を広げてスイッチング素子の
点弧が的確ｔこ行えるようにしたものを提供することｔ
？−ある。 以下本発明の実施例をツノグ図及び牙Ｓ図によって説明
する。尚、）・１図は牙／図におけるゼロ点検出回路１
０３に代って形成された回路図で、他はツ・７図と同様
ｔこ構成された実施例として説明し、上述と説明が重複
する点は省略することとする。 １・り図において、Ｓはゼロ点検出回路である。これば
定電圧電源回路１０ｉｌの全波整流回路ＤＢの出力端に
】／／のトランジスタＱ工のベースをベース抵抗Ｒ１ｔ
ｌ−介して接続し、トランジスタＱ□のコレクタは定電
圧電源ＶＤ’こ負荷抵抗Ｒ２ｔｈ介して接続し、エミッ
タは順方向に挿入したダイオードＤ１を介して接地する
と共に、該エミッタを、ベースｔこカソードを接続した
ダイオードＤ２のアノードに接続し、ベースと接地間に
抵抗Ｒ３３挿入して、上記抵抗Ｒ０とＲ３で入力の分圧
回路を形成し、上記トランジスタＱ□のコレクタを、コ
レクタを負荷抵抗Ｒ４ヲ介して定電［Ｅ電源■。に接続
しエミッタが順方向ｔこ挿入したダイオードＤ３を介し
て接地した牙２のトラン（５） ジスタＱ２のベース１こ接続し、このトランジスタＱ。 のコレクタと接地間に、低抵抗Ｒ５と１／２のコンデン
サＣ２ヲ直列に挿入して、トランジスタＱ２のオンによ
りコンデンサ０２′（ｆｆＣ２→Ｒ５→Ｑ２−Ｄ３−０
２の回路で瞬時に放電させ、トランジスタＱ、のコレク
タとトランジスタＱのベース間ｔこ、低抵抗のＲ６と牙
／のコンデンサＣ１を直列に挿入して、トランジスタＱ
２のオン１こよりコンデンサＣ１はＣ１→Ｒ６−Ｃ２”
Ｄ３→Ｒ３−Ｃ工の回路でコンデンサＣ２と同時に放
′ｉｒｆ、を開始するが上記コンデンサＣ３より時定数
分だけ長い時限で放電するようをこなっており、上記ト
ランジスタＱ２のオフにより、コンデンサＣ１はｃ、Ｒ
４（ｌＲ６＜＜Ｒ４）の時定数で、また、コンデンサＣ
３はｃ ２１１４ｃ Ｉ（５＜＜Ｒ４，’）の時定数で
充電させ、上記トランジスタＱ、□のコレクタ出力を該
回路Ｓの検−小信号としてゲート回路ｌｌＯのアンド回
路１０乙に送出するようになっている。 次に、その動作ｔこついて説明する。今、坩−ｓ図の時
点ｔ。で、全波整流回路ＤＩ３の出力がゼロ点検出回路
Ｓに入力されると、この入力を抵抗Ｒ□、Ｒ３（６） （こ９］：り分圧した出力（ｍ点の出力）がトランジス
タＱ、１のベースに印加される。これによりトランジス
タｑ１、がオンし、ｑ、２がオフとなるため、コンデン
サＣ１，ｃ２ｋｌ：抵抗Ｒ４全通してそれぞれ充電され
、この充″混Ｘ−１＋：圧の」二別によりｎ点の電位は
牙Ｓ図ｎで示すよう（こ上昇する。そして、ゼロ点検出
回路Ｓ■ とダイオ−ドロ工の順方向電圧■、を加算し
た電Ｔｕ 圧（■お□； ＋ Ｖ ｆ）以下になったとき、トラン
ジスタＱ、１がオフし、トランジスタＱ、がオンするた
め、コンデンサＣ２はＣ２→Ｒ５→Ｑ、２→Ｄ３→Ｃ２
の径路で瞬時に放電して１１点の電位を急激に下げる。 一方コンデンサＣ１もＣ１→Ｒ６→Ｑ２→Ｄ３−ｈＲ３
→Ｃ□の径路で同時ｔこ放電を開始するが、時定数分だ
けコンデンサＣ２より長い時限で放゛Ｉπする。しかし
、上記ｎ点の電位ナス電位ｔこ引つげられる（矛夕図ｍ
）。このため、トランジスタｑ、□のベース・エミッタ
間をこけ逆バイアスがかかるが、この逆バイアスはダイ
オードＤ２の順方向電圧以下ｔこなるとダイオードＤ、
が梼通ずるので、トランジスタＱ□のベース・エミッタ
間の逆耐圧値以上ｔこなることはない。？２１ノら、上
記ｍ点の電位ハ、トランジスタｑ、□のオフによりダイ
オードＤ２の順方向電圧分だけマイナスに引っばられた
後、コンデンサＣ工の放電時の時定数ｔこより」二昇し
て牙Ｓ図ｍで示すよう（こゼロ点近傍でＶ字状の波形を
呈し、この上昇値がトランジスタＱ１のベース・エミッ
タ間電圧■ＢつとダイオードＤ１の順方向電圧■律加算
した電圧（”ＢＥ ” ■ｆ）以上ｔこなったとき、ト
ランジスタＱ□は再びオンし、Ｑ２がオフする。従って
、ゼロ点検出回路Ｓの出力即ちトランジスタＱのコレク
タ出力は、該トランジスタＱ工がオフしま た時点で１Ｌ′からｌＨルベルに反転し、Ｉ・ランジス
タＱ工がオンした時点でｌＨ′からｌＬルベルｔこ反転
するパルス信号をゼロ点の検出信号として検出すること
になる。そしてこのパルス信号のパルス幅ｕ ａ ＋ｂ
であるＣＡ−３図Ｓの出力）が、ｂの幅１１Ｓｌ：ａの
幅より拡げられてａ （ｂ （例えばａ：ｂ＝／：／ニ
ア）の関係で送出さ力、る。即ち、上記パルス信号のｂ
の幅はＣ□とＲ３の時定数により任意に選定できる。 そして、上記ゼロ点検出回路Ｓのパルス信号は上述した
ようｔこゲート回路／１０のアンド回路ｌＯ乙ｔこ送出
され、アンド回路１０乙のＩＨＩレベルの出力信号（ゲ
ート信号）の期間を長くすることとなるので負荷１０２
の立上りが遅れてもこれｔこ十分対応するゲート信号を
送出し点弧失敗を生ずることなくスイッチング素子１０
３がゼロ電位で点弧される。 上述した工う（こ、本発明ｅこよれば、交流電源に負荷
と直列に接続されたスイッチング素子のゲートに、上記
交流電源ｐこ接続された全波整流回路の出力を分圧回路
ｔこ印加させこの分圧回路の分圧点を、定電圧電源にエ
ミッタ接地の矛／及び牙２のトランジスタのコレクタを
負荷抵抗を介して各々接続した上記第／のトランジスタ
のベースｔこ接続すると共ｔこ、１）／のコンデンサを
介して牙２のトランジスタのコレクタに接続し、この牙
２のトランジスタのベースシこ】／／のトランジスタの
コレン（９） りを接続し、上記第２のトランジスタのコレクタと接地
間に】ノΩのコンデンサを挿入して、−に記塔／／のト
ランジスタのコレクタから出力するよつ）こしたゼロ点
検出回路を設けて、」二記交流電源のゼロ点検出のパル
ス信号のパルス幅を交流電源のゼロ点通過側のみ拡げる
よう？こしであるから、負荷の立上りが遅くても点弧失
敗を生ずることなくスイッチング素子を的確に点弧せし
めることができ、しかも、交流電源のゼロ点以降のパル
ス幅のみ拡げただけであるから、パルス信号のパルス幅
を拡げもパルス信号の立上りはゼロ点近傍であるから高
周波雑音の発生を防止することができ、放送周波数の妨
害を生じせしめることなくスイッチング素子の点弧を確
実をこ行うことができる。又、交流電源のゼロ点を電源
トランスを介して検出する場合、電源トランスの２次側
電圧の位相が進み側になってもΩ次側のゼ内点以降のパ
ルス幅が拡カルので交流電源のゼロ電位制御を不能とす
るようなことは全くなく、ゲート点弧制御の信頼性を一
段と向上せしめることができ、しかも構成は簡略化（１
０） したものであるから、装置を経済的に製することができ
ることは勿論、種々の電力制御に適用し得る等著しい効
果を有するものである。
牙／図は従来のゼロ電位制御装置を例示するブロック図
、牙２図はオ／図の定電圧電源回路及びゼロ点検出回路
を例示した回路図、牙３図はゼロ点検出を説明したもの
で、同図（イ）はゼロ点検出の波形図、同図←）は同図
（イ）のゼロ点検出部の拡大波形図である。１７グ図は
本発明の実施例ｔこおけるゼロ点検出回路の回路図、牙
ｊ図は牙１図の動作を説明するタイムヅーヤート図であ
る。 １０／：交流電源 １０２＝負 荷 １０３ニスイツチング素子 １０３ 、３ ：ゼロ点検出回路 ／１０：ゲート回路 ＤＢ：全波整流回路 Ｑｌ、ニオ／のトランジスタ Ｑ２ニオＩ−のトランジスタ （１ｌ ） Ｃ１：矛／のコンデンサ Ｃ２：牙Ωのコンデンサ Ｒ２，Ｒ４：負荷抵抗 ■Ｄ＝定電圧電源 時許出願人 １：式会社愛知電機主作所 （１２）− ８３図 ぽ５μｓ ３４３
、牙２図はオ／図の定電圧電源回路及びゼロ点検出回路
を例示した回路図、牙３図はゼロ点検出を説明したもの
で、同図（イ）はゼロ点検出の波形図、同図←）は同図
（イ）のゼロ点検出部の拡大波形図である。１７グ図は
本発明の実施例ｔこおけるゼロ点検出回路の回路図、牙
ｊ図は牙１図の動作を説明するタイムヅーヤート図であ
る。 １０／：交流電源 １０２＝負 荷 １０３ニスイツチング素子 １０３ 、３ ：ゼロ点検出回路 ／１０：ゲート回路 ＤＢ：全波整流回路 Ｑｌ、ニオ／のトランジスタ Ｑ２ニオＩ−のトランジスタ （１ｌ ） Ｃ１：矛／のコンデンサ Ｃ２：牙Ωのコンデンサ Ｒ２，Ｒ４：負荷抵抗 ■Ｄ＝定電圧電源 時許出願人 １：式会社愛知電機主作所 （１２）− ８３図 ぽ５μｓ ３４３
Claims (1)
- 交流電源に負荷と直列に接続されたスイッチング素子の
ゲートに、上記交流電源から全波整流回路を介して接続
されたゼロ点検出回路の検出信号をこよりゲート回路を
介して、上記スイッチング素子を開閉するものにおいて
、上記ゼロ点検出回路は定電圧電源ｔこエミッタ接地の
オｌ及び第２のトランジスタのコレクタを負荷抵抗を介
して各々接続し、上記牙／のトランジスタのコレクタを
第２のトランジスタのベースに接続し、この牙２のトラ
ンジスタのコレクタを、牙／のトランジスタのベースｔ
こ牙／のコンデンサを介して接続すると共に、該コレク
タと接地間に牙２のコンデンサを挿入し、上記ｉ／のト
ランジスタのベースに全波整流回路の出力端を分圧回路
を介して接続して成ることを特徴とするゼロ電位制御装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13589581A JPS5839263A (ja) | 1981-08-29 | 1981-08-29 | ゼロ電位制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13589581A JPS5839263A (ja) | 1981-08-29 | 1981-08-29 | ゼロ電位制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5839263A true JPS5839263A (ja) | 1983-03-07 |
| JPH0254024B2 JPH0254024B2 (ja) | 1990-11-20 |
Family
ID=15162314
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13589581A Granted JPS5839263A (ja) | 1981-08-29 | 1981-08-29 | ゼロ電位制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5839263A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5346590A (en) * | 1976-10-04 | 1978-04-26 | Dba Sa | Electronic antiskid control apparatus |
-
1981
- 1981-08-29 JP JP13589581A patent/JPS5839263A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5346590A (en) * | 1976-10-04 | 1978-04-26 | Dba Sa | Electronic antiskid control apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0254024B2 (ja) | 1990-11-20 |
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