JPS5826855B2 - How to correct conversion accuracy of digital-to-analog converter - Google Patents

How to correct conversion accuracy of digital-to-analog converter

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JPS5826855B2
JPS5826855B2 JP584678A JP584678A JPS5826855B2 JP S5826855 B2 JPS5826855 B2 JP S5826855B2 JP 584678 A JP584678 A JP 584678A JP 584678 A JP584678 A JP 584678A JP S5826855 B2 JPS5826855 B2 JP S5826855B2
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transistor
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好仁 雨宮
浩太郎 加藤
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Nippon Telegraph and Telephone Corp
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Description

【発明の詳細な説明】 本発明は、ディジタル入力信号をアナログ出力信号に変
換するディジタル・アナログ変換器(以下DA変換器と
称する)の変換精度の修正方法に関する。
DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a method for correcting the conversion accuracy of a digital-to-analog converter (hereinafter referred to as a DA converter) that converts a digital input signal to an analog output signal.

本発明は、予め得られた電流加算形DA変換器の特性を
修正し、高い変換精度を得るための、新規にして容易な
修正方法を提供する。
The present invention provides a new and easy modification method for modifying the characteristics of a current addition type DA converter obtained in advance and obtaining high conversion accuracy.

DA変換器の変換精度は、回路内に使用されている抵抗
、トランジスタ等の素子の精度で定まり、高い変換精度
を得るためには、上記素子の精度をできるだけ向上させ
る必要がある。
The conversion accuracy of a DA converter is determined by the accuracy of elements such as resistors and transistors used in the circuit, and in order to obtain high conversion accuracy, it is necessary to improve the accuracy of the elements as much as possible.

しかし、DA変換器が使用に供される用途の多くは、従
来技術(こよる素子精度で可能となる程度以上の高い変
換精度を要求しているため、予め得られたDA変換器を
製造後に各種の方法で修正し高精度化することが一般的
に行なわれている。
However, many of the applications in which DA converters are used require higher conversion precision than is possible with conventional technology (such as element precision), so it is necessary to use pre-obtained DA converters after manufacturing. It is common practice to correct and improve accuracy using various methods.

集積化されたDA変換器を構成するlこ際しては、回路
内の素子を予め精度調整しておくことが不可能なため、
上述したDA変換器の製造後の修正は特に重要な問題と
なる。
When constructing an integrated DA converter, it is impossible to adjust the accuracy of the elements in the circuit in advance.
Modification of the above-mentioned DA converter after manufacture is a particularly important problem.

従来、この製造後修正の方法に関しては、抵抗体の一部
あるいは抵抗体を短絡している金属配線の一部をレーザ
ーにより切断する、いわゆるレーザー・トリミング法、
および回路内の種々の位置にツェナー・ダイオードを接
続しておき、必要に応じてツェナー・ダイオードを大電
流通電で短絡破壊させて回路を切換えること(こより精
度修正を行なう、いわゆるツェナー・ザラピング法が知
られている。
Conventionally, methods for this post-manufacturing modification include the so-called laser trimming method, in which a part of the resistor or a part of the metal wiring that short-circuits the resistor is cut with a laser;
Zener diodes are connected to various positions in the circuit, and if necessary, the Zener diodes are short-circuited and destroyed by applying a large current to switch the circuit (this is the so-called Zener zapping method that corrects accuracy). Are known.

しかしながら、レーザー・トリミング法においては不安
定性の要因となる熱歪と熱的融解凝固領域を抵抗体や配
線の一部上に残すことおよびトリミング装置が複雑にな
ること等の欠点を有し、ツェナー・ザラピング法におい
ては修正のための余分な回路が増加してDA変換器の集
積密度を低下させる欠点を有している。
However, the laser trimming method has drawbacks such as thermal distortion that causes instability, leaving a thermally melted solidified region on a part of the resistor or wiring, and complicating the trimming device. - The Zaraping method has the disadvantage of increasing the number of extra circuits for correction and reducing the integration density of the DA converter.

従って本発明は従来の技術の上記欠点を改善するもので
、その目的は簡単な装置で容易に実施することの出来る
DA変換器の変換精度修正方法を提供することにある。
Therefore, the present invention aims to improve the above-mentioned drawbacks of the prior art, and its object is to provide a method for correcting the conversion accuracy of a DA converter that can be easily implemented with a simple device.

本発明は、いわゆる電流加算形DA変換器の変換精度を
向上させる手段を提供するもので、ここに言う電流加算
形DA変換器とは、それぞれ大きさに重みの付いた複数
の電流を、それぞれディジタル入力信号により駆動され
る電流スイッチを通して共通の加算ライン上で加算する
ことによりディジタル入力信号をアナログ出力信号に変
換するDA変換器をいう。
The present invention provides a means for improving the conversion accuracy of a so-called current addition type DA converter. A DA converter that converts a digital input signal into an analog output signal by summing on a common summing line through current switches driven by the digital input signal.

本発明の基本思想は、上記電流スイッチを構成するトラ
ンジスタのエミッタ・ベース接合間に逆方向降伏電流を
通電して当該トランジスタの電流増幅率を低下させるこ
とにより加算ライン上に現われる電流の大きさを変化さ
せて変換精度を修正することにある。
The basic idea of the present invention is to reduce the magnitude of the current appearing on the summing line by passing a reverse breakdown current between the emitter-base junction of the transistor constituting the current switch and reducing the current amplification factor of the transistor. The purpose is to modify the conversion accuracy by changing it.

以下、図例を用いて詳細に説明する。第1図は、本発明
の詳細な説明図を示す。
A detailed explanation will be given below using diagram examples. FIG. 1 shows a detailed illustration of the invention.

図において、■は電流源の電流、QlとQ2は電流スイ
ッチを構成するトランジスタ、ABは加算ライン、I
outは電流スイッチが加算ラインABより引出す電流
、Vinはディジタル入力電圧、Vrefは基準電圧を
示す。
In the figure, ■ is the current of the current source, Ql and Q2 are transistors forming the current switch, AB is the addition line, and I
Out indicates the current drawn from the addition line AB by the current switch, Vin indicates the digital input voltage, and Vref indicates the reference voltage.

トランジスタQ、を導通状態とするディジタル入力電圧
を加えた場合、この電流スイッチが加算ラインABより
引出す電流T outは、Qlの電流増幅率をhFEと
して、次式で表現される。
When a digital input voltage that makes transistor Q conductive is applied, the current T out drawn by this current switch from addition line AB is expressed by the following equation, where hFE is the current amplification factor of Ql.

上記電流スイッチが加算ラインABから引出す電流値を
調整するために、本発明では、Qlのエミッタ・ベース
間(こ逆方向降伏電流を通電する。
In order to adjust the current value that the current switch draws from the summing line AB, in the present invention, a reverse breakdown current is passed between the emitter and the base of Ql.

トランジスタのエミッタ・ベース間に逆方向降伏電流を
通電した場合に当該トランジスタの電流増幅率が低下す
ることは周知である。
It is well known that when a reverse breakdown current is passed between the emitter and base of a transistor, the current amplification factor of the transistor decreases.

第1図においては、例えばVinをVrefよりも電位
的に負としてVref y Q2− Ql s Vin
の順路で電流を通電すればよい。
In FIG. 1, for example, Vin is set to be more negative in potential than Vref, and Vref y Q2- Ql s Vin
The current can be passed along the following path.

この操作によってQlの電流増幅率がhFE(1−δ)
に低下した場合、電流スイッチが加算ラインABより引
き出す電流I out’は、δ(1のとき、次式で表現
される。
By this operation, the current amplification factor of Ql becomes hFE(1-δ)
, the current I out' drawn by the current switch from the addition line AB is expressed by the following equation when δ(1).

I out’−I out (1−δ/hFB)すなわ
ち、加算ライン上に現われる電流の大きさを変化させる
ことができる。
I out'-I out (1-δ/hFB), ie the magnitude of the current appearing on the summing line can be varied.

この変化量は電流増幅率の変化量と比較すると微少であ
り、高精度修正が可能となる。
This amount of change is minute compared to the amount of change in the current amplification factor, allowing for highly accurate correction.

例えば、トランジスタの電流増幅率の値が修正前に10
0である場合、電流増幅率の値を10%低下させる操作
に対して出力電流値は0.1%変化する。
For example, if the value of the current amplification factor of the transistor is 10 before correction,
If it is 0, the output current value changes by 0.1% in response to an operation that reduces the value of the current amplification factor by 10%.

第2図に示す4ビツトDA変換器を一例(ことり、本発
明に基づく変換精度修正を、さらに詳細に説明する。
As an example of the 4-bit DA converter shown in FIG. 2, the conversion accuracy correction based on the present invention will be explained in more detail.

図において、I、2I、4Iおよび8Iはそれぞれ大き
さに重みを付けた電流源の電流を示す。
In the figure, I, 2I, 4I, and 8I each indicate the current of the current source with weighted magnitude.

■は最下位ビット電流、2■と4■はそれぞれ最下位ビ
ットの2倍および4倍の大きさを持つ電流、8Iは最上
位ビットの電流を示し最下位ビットの8倍の大きさを有
する。
■ is the least significant bit current, 2■ and 4■ are currents that are twice and four times as large as the least significant bit, respectively, and 8I is the current for the most significant bit that is eight times as large as the least significant bit. .

QlからQ8までは電流スイッチを構成するトランジス
タ、ABは共通の加算ライン、■outは出力電流、V
refは基準電圧、blからb4までは各ビットのディ
ジタル入力端子を示す。
From Ql to Q8 are transistors that constitute a current switch, AB is a common addition line, ■out is the output current, and V
ref indicates a reference voltage, and bl to b4 indicate digital input terminals for each bit.

第2図のDA変換器において、仮に最上位ビットの電流
源の電流が、当該DA変換器を製造する工程上のバラツ
キのために、許容される変換精度を与える太きさよりも
過大であった場合、当該ビットのディジタル入力端子b
4をVrefよりも電位的に負となし、■ref、Q8
.Q7.b4の順路を通じてQ7のエミッタ・ベース間
に逆方向降伏電流を通電し、Q7の電流増幅率を低下さ
せ当該ビットの電流スイッチが加算ラインから引き出す
電流を減少させることによって変換精度を向上させるこ
とができる。
In the DA converter shown in Figure 2, if the current of the current source for the most significant bit were larger than the width that would provide acceptable conversion accuracy due to variations in the manufacturing process of the DA converter. In this case, the digital input terminal b of the relevant bit
4 is more negative in potential than Vref, ■ref, Q8
.. Q7. Conversion accuracy can be improved by passing a reverse breakdown current between the emitter and base of Q7 through the forward path of b4, reducing the current amplification factor of Q7 and reducing the current drawn from the summing line by the current switch of the bit. can.

当該最上位ビットの電流源の電流が逆に過小であった場
合は、当該ビットを除く他の全ビットに上記の操作を施
すことによって変換精度を向上させることができる。
Conversely, if the current of the current source for the most significant bit is too small, the conversion accuracy can be improved by performing the above operation on all bits other than the most significant bit.

最上位ビット以外のビットに誤差があった場合も、上記
と同様の操作によって変換精度を修正することが可能で
ある。
Even if there is an error in bits other than the most significant bit, the conversion accuracy can be corrected by the same operation as above.

第3図は、別の構造を有する電流スイッチの一例を示す
FIG. 3 shows an example of a current switch having another structure.

図において■と■。は電流源の電流、QlからQ4まで
は電流スイッチを構成するトランジスタ、R1とR2は
抵抗、ABは加算ライン、Vrefは基準電圧、■oは
バイアス電圧、Vinはディジタル入力電圧を示す。
■ and ■ in the figure. is the current of the current source, Ql to Q4 are transistors forming a current switch, R1 and R2 are resistors, AB is an addition line, Vref is a reference voltage, ①o is a bias voltage, and Vin is a digital input voltage.

この電流スイッチが加算ラインから引出す電流値を変化
させるためには、vinを■。
To change the current value that this current switch draws from the summing line, set vin to ■.

よりも負の電位にとり、V □ y R2’Q2 +
Ql + Q3 v Vinの順路テ電流ヲ通電シテQ
1のエミッタベース間に逆方向降伏電流を流すことによ
りQlの電流増幅率を低下させればよい。
V □ y R2'Q2 +
Ql + Q3 v Direct current passing through Vin
The current amplification factor of Ql may be reduced by flowing a reverse breakdown current between the emitter and base of the transistor.

本発明にもとづ<DA変換器の変換精度修正方法は、第
1図および第3図に示す電流スイッチを用いたDA変換
器のみに限らず、他の構造の電流スイッチを有するDA
変換器にも適用し得ることは言うまでもない。
Based on the present invention, the method for correcting the conversion accuracy of a DA converter is applicable not only to DA converters using current switches shown in FIGS. 1 and 3, but also to DA converters having current switches of other structures.
Needless to say, it can also be applied to converters.

次(こ本発明の具体的な実施例を示す。Next, specific examples of the present invention are shown.

第4図は、本発明に際して構成した電流加算形モノリシ
ック8ビットDA変換器の回路図を示す。
FIG. 4 shows a circuit diagram of a current adding type monolithic 8-bit DA converter constructed in accordance with the present invention.

図において、Rと2Rは重みの付いた電流を発生するた
めの基準抵抗であり、拡散層抵抗で構成さ、?1.R=
5012R=IK、Qである。
In the figure, R and 2R are reference resistances for generating weighted current, and are composed of diffusion layer resistances. 1. R=
5012R=IK,Q.

QoからQ8までは定電流源を構成するトランジスタを
示す。
Qo to Q8 indicate transistors forming a constant current source.

最小ビットに相当するトランジスタQ1のエミッタ面積
は8μ2であり、上位ビットのトランジスタは、Qlと
同一大きさのトランジスタをビットの大きさだけ倍数並
夕1ルた構造を有し、最上位ビットのトランジスタQ8
はQlの128倍の大きさを有する。
The emitter area of the transistor Q1 corresponding to the smallest bit is 8μ2, and the transistor for the most significant bit has a structure in which a transistor of the same size as Ql is multiplied by the size of the bit. Q8
has a magnitude 128 times that of Ql.

QllからQ82までの電流スイッチトランジスタも同
様である。
The same applies to the current switch transistors from Qll to Q82.

blからb8まではディジタル入力端子、OPは電流出
力を電圧出力に変換する出力増幅器、R6は帰還抵抗、
■Eは電源電圧、VBは動作電流を定めるバイアス電圧
、■refはディジタル入力の論理レベルを定める基準
電圧、voutは出力電圧を示す。
bl to b8 are digital input terminals, OP is an output amplifier that converts current output to voltage output, R6 is a feedback resistor,
(2) E is the power supply voltage, VB is the bias voltage that determines the operating current, (2) ref is the reference voltage that determines the logic level of the digital input, and vout is the output voltage.

上記のDA変換器は、工程の均一性に留意して製造すれ
ば、チップ選択により8ビツトとしての精度を有するD
A変換器が得られるが、これと同時に、8ビツトの精度
を持たないDA変換器も得られる。
If the above-mentioned DA converter is manufactured with attention to process uniformity, the D/A converter has an accuracy of 8 bits depending on the chip selection.
An A converter is obtained, but at the same time a DA converter without 8-bit precision is also obtained.

従来の概念によるかぎり、後者の精度を改善することは
不可能である。
According to the conventional concept, it is not possible to improve the accuracy of the latter.

しかし本発明を適用することにより、この精度を改善す
ることができる。
However, by applying the present invention, this accuracy can be improved.

第1表には、8ビツトの精度を持たない上記のDA変換
器の直線誤差の一例を、ディジタル入力信号と対応させ
て示した。
Table 1 shows an example of the linear error of the above-mentioned DA converter which does not have 8-bit accuracy, in correspondence with the digital input signal.

直線誤差は、フルスケール時の出力電圧を基準とし、こ
の255分の1の値を理論的な最下位ビットの大きさく
LSB)として計算した。
The linear error was calculated using the output voltage at full scale as a reference, and taking the value of 1/255th of this as the theoretical magnitude of the least significant bit (LSB).

なお、フルスケール時の出力電流を1mAとして動作さ
せた。
Note that the operation was performed with the output current at full scale being 1 mA.

図中に示す如く、当該DA変換器は最上位ビットの大き
さが正規より過大であるため、変換精度の修正前には変
換の直線誤差が±015LSBの範囲を逸脱する場合を
生じ、8ビツトとしての精度を保有しなかった。
As shown in the figure, the size of the most significant bit of the DA converter is larger than normal, so before the conversion accuracy is corrected, the linear error of the conversion may deviate from the range of ±015LSB, resulting in an 8-bit error. did not possess the same accuracy.

次に当該DA変換器の最大ビット入力端子、第4図で示
せばb8に適切な負の電圧を印加し、電流スイッチを構
成するトランジスタQ81エミッタ・ベース間に逆方向
降伏電流を通電して本発明による変換精度修正方法を適
用したところ、直線誤差が第1表に示す如く±0.5L
SB以内に修正され、8ビツトの精度を有するDA変換
器を得ることができた。
Next, apply an appropriate negative voltage to the maximum bit input terminal of the DA converter, b8 shown in FIG. When the conversion accuracy correction method according to the invention was applied, the linear error was ±0.5L as shown in Table 1.
It was possible to obtain a DA converter that was corrected within SB and had an accuracy of 8 bits.

この場合には、逆方向降伏電流としてエミッタ・ベース
間に10〜50mAの電流を短時間通電することが適切
であった。
In this case, it was appropriate to apply a current of 10 to 50 mA between the emitter and the base for a short time as a reverse breakdown current.

以上の例では、電流スイッチが定電流回路とは分離した
構成のDA変換器に対して本発明の精度修正方法を適用
した例を示したが、本発明は電流スイッチと定電流回路
とを一部共通として構成したDA変換器にも適用される
In the above example, the accuracy correction method of the present invention is applied to a DA converter in which the current switch is separated from the constant current circuit. It is also applied to a DA converter configured as a common unit.

第5図は、後者に属するDA変換器の一例を示す。FIG. 5 shows an example of a DA converter belonging to the latter category.

図例は4ビツトとして構成され、QlからQ4までは定
電流源を構成すると同時に電流スイッチ動作をも行なう
トランジスタ、DlからD4まではダイオードを示す。
The illustrated example has a 4-bit configuration, with Ql to Q4 representing transistors that constitute a constant current source and also performing a current switching operation, and Dl to D4 representing diodes.

R,2R,4Rおよび8Rは重み付き定電流源を構成す
る抵抗、ABは加算ライン、blからb4まではディジ
タル入力端子、■Eは電源電圧、VBはバイアス電圧、
■outは出力電流を示す。
R, 2R, 4R and 8R are resistors that constitute a weighted constant current source, AB is an addition line, bl to b4 are digital input terminals, E is a power supply voltage, VB is a bias voltage,
■out indicates the output current.

当該DA変換器の動作に際して、仮fこQ4とRで構成
される最上位ビットの定電流源の電流値が過大であるた
めに変換精度が低い場合を例にとると、本発明の修正方
法を以下の如く適用すればよい。
For example, when the DA converter operates, the conversion accuracy is low because the current value of the constant current source of the most significant bit consisting of Q4 and R is excessive, and the correction method of the present invention can be applied as follows.

すなわち、ディジタル入力端子b4の電位をvBよりも
正となし、b4.D4.Q4゜vBの順路を通じてQ4
のエミッタ・ベース接合間に逆方向降伏電流を通電して
Q4の電流増幅率を低下させ、加算ラインから流れ込む
電流値を低下させることにより、変換精度を修正するこ
とができる。
That is, the potential of digital input terminal b4 is made more positive than vB, and b4. D4. Q4 through the route of Q4゜vB
The conversion accuracy can be corrected by passing a reverse breakdown current across the emitter-base junction of Q4 to lower the current amplification factor of Q4 and lowering the value of the current flowing from the summing line.

以上に示した如く、本発明は電流加算形DA変換器の変
換精度を修正する新規にして容易な修正方法を提供する
ものであり、集積化DA変換器の精度向上に犬なる寄与
をなすもので、内部にDA変換系を含む多くの集積回路
の製造歩留まり向上にも多大の貢献をなすものである。
As described above, the present invention provides a new and easy correction method for correcting the conversion accuracy of a current addition type DA converter, and makes a significant contribution to improving the accuracy of integrated DA converters. This also makes a great contribution to improving the manufacturing yield of many integrated circuits that include internal DA conversion systems.

【図面の簡単な説明】[Brief explanation of drawings]

第1図は本発明の原理説明のための電流スイッチング回
路、第2図は4ビツトDA変換器の例、第3図は別の電
流スイッチング回路の例、第4図は電流加算形モノリシ
ック8ピッ)DA変換器の例、第5図はDA変換器の別
の構造例である。 Q1〜Q8;トランジスタ、■in、b1〜b8:デイ
ジタル入力信号、AB;加算ライン。
Figure 1 is a current switching circuit for explaining the principle of the present invention, Figure 2 is an example of a 4-bit DA converter, Figure 3 is an example of another current switching circuit, and Figure 4 is a current summing type monolithic 8-pin circuit. ) Example of a DA converter, FIG. 5 shows another example of the structure of a DA converter. Q1 to Q8: transistor, ■in, b1 to b8: digital input signal, AB: addition line.

Claims (1)

【特許請求の範囲】[Claims] 1 大きさに重みのついた複数の電流をそれぞれディジ
タル入力信号により駆動される電流スイッチを介して共
通の加算ライン上で相互(こ加算すること(こよりディ
ジタル入力信号をアナログ出力信号に変換するディジタ
ル・アナログ変換器の変換精度を修正する方法において
、上記電流スイッチを構成するトランジスタのエミッタ
・ベース接合間に逆方向降伏電流を通電して当該トラン
ジスタの電流増幅率を低下させることにより上記加算ラ
イン上に現われる電流の大きさを変化させ、変換精度を
修正することを特徴とするディジタル・アナログ変換器
の変換精度修正方法。
1. Adding a plurality of magnitude-weighted currents to each other on a common summing line via current switches each driven by a digital input signal. - In a method for correcting the conversion accuracy of an analog converter, a reverse breakdown current is passed between the emitter-base junction of the transistor constituting the current switch to reduce the current amplification factor of the transistor, so that the current amplification factor of the transistor is reduced. A method for correcting conversion accuracy of a digital-to-analog converter, the method comprising changing the magnitude of a current appearing in the converter to correct the conversion accuracy.
JP584678A 1978-01-24 1978-01-24 How to correct conversion accuracy of digital-to-analog converter Expired JPS5826855B2 (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0334889B2 (en) * 1985-01-25 1991-05-24 Kumagaigumi Kk

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