JPS58204766A - Fixed frequency reset control type dc/dc converter - Google Patents

Fixed frequency reset control type dc/dc converter

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JPS58204766A
JPS58204766A JP8657882A JP8657882A JPS58204766A JP S58204766 A JPS58204766 A JP S58204766A JP 8657882 A JP8657882 A JP 8657882A JP 8657882 A JP8657882 A JP 8657882A JP S58204766 A JPS58204766 A JP S58204766A
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transformer
switching element
voltage
circuit
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隆司 山下
Ryoji Saito
斉藤 亮治
Toyokazu Kato
豊和 加藤
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    • H02M3/00Conversion of dc power input into dc power output
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Abstract

PURPOSE:To stabilize the operation of a DC/DC converter by performing the reset in two stages when dissipating energy of a transformer during OFF period of a switching element, and controlling the ON duty ration of the switching element. CONSTITUTION:When a switching element 2 is switched ON or OFF with a signal from an oscillator 3 and electric power is obtained through a transformer 6, the OFF of the element 2 is detected by a coil n6 to conduct a transistor 12, the transformer 6 is reset by reset voltage control coils n4, n5, the transistor 12 is then interrupted by a signal from a control circuit 13 depending upon the output voltage, reset by the higher reset voltage, the end of the reset is detected by the coil n3, and the element 2 is conducted. Accordingly, the reset is performed in two stages, the reset period of the former is controlled, thereby stably operating even if the ON duty ratio is not raised more than 1/2.

Description

【発明の詳細な説明】 本%明1よ、出力電圧を安建的に制−可能とする一′X
E周故数すセット制岬方式のDc−vcコンバータに関
するものである。
DETAILED DESCRIPTION OF THE INVENTION The present invention provides a method for controlling the output voltage in a safe manner.
This invention relates to a Dc-vc converter using an E-cycle factor set control method.

一般に、この糟のコンバータにおいて、該コンバータを
構成する主トランスの1次巻mには、その創作庫堆E一
方向の励磁電流しか流れない。こOため、主トランスF
i常時片励磁の状態で鮎作している。この励磁電流によ
って主トランスに蓄えられるエネルギーを、トランジス
タかオフの期間に外部へ放出しないと、トランス磁心の
磁束変化ΔBの最大値か徐々に増加し、磁気飽和を起こ
して1次巻−に過大11iMjが流れるため、トランジ
スタを破壊してしまう。よってリセット回路を付加し、
この蓄積エネルギーを放出する必要かある。この蓄積エ
ネルギーは、それまでにトランスに印加された電圧と時
間の積であられされるから、リセットのためには、同じ
電圧・時間積を逆極性でかけてやる必豊かある。
Generally, in this converter, only one direction of excitation current flows through the primary winding m of the main transformer constituting the converter. Because of this, the main transformer F
i I am always cultivating sweetfish in a state of single excitation. If the energy stored in the main transformer due to this excitation current is not released to the outside while the transistor is off, the maximum value of the magnetic flux change ΔB in the transformer core will gradually increase, causing magnetic saturation and causing excessive force in the primary winding. Since 11iMj flows, the transistor is destroyed. Therefore, a reset circuit is added,
Is there a need to release this stored energy? This stored energy is released by the product of the voltage and time applied to the transformer up to that point, so in order to reset it, it is necessary to apply the same voltage/time product with opposite polarity.

本兄明は上記1) C−D Cコンバータにおけるかか
るリセット[g回路に関係している。
The present inventor is concerned with the above-mentioned 1) such a reset [g circuit in a C-DC converter.

従来の固定周波数リセット制御方式DC−DCコンバー
タの一例を第1図に、その動作波形を第2図にそれぞれ
示す。
An example of a conventional fixed frequency reset control DC-DC converter is shown in FIG. 1, and its operating waveforms are shown in FIG. 2.

第1図において、1は直流電源、2はスイッチング素子
、3は固鼠周波数兄振器、4は駆動回路、5はリセット
検出回路、6はトランス、7,8はそれぞれダイオード
、9Vよ平滑用チョークコイル、10は平滑用コンデン
サ、11はダイオード、12をよトランジスタ、13は
出力電圧を検出してトランジスタ12を制御する制御回
路、14はコンデノサ、II+はトランス6の1次巻線
、f12は2次巻線、113はりセント検出巻解、n4
はリセット電圧制御用台勝である。
In Figure 1, 1 is a DC power supply, 2 is a switching element, 3 is a fixed frequency amplifier, 4 is a drive circuit, 5 is a reset detection circuit, 6 is a transformer, 7 and 8 are diodes, and 9V is used for smoothing. A choke coil, 10 a smoothing capacitor, 11 a diode, 12 a transistor, 13 a control circuit that detects the output voltage and controls the transistor 12, 14 a capacitor, II+ the primary winding of the transformer 6, f12 Secondary winding, 113 beam cent detection winding, n4
is the reset voltage control stand.

第2図においてaは第1図における発振器3の出力波形
、bはトランス6の巻線nlにおける電圧波形である。
In FIG. 2, a is the output waveform of the oscillator 3 in FIG. 1, and b is the voltage waveform at the winding nl of the transformer 6.

第1図の回路では、姥ずスイッチング索子2が駆動回路
4によシ時刻toにおいてオンし、トランスの1次巻m
nt、2次善#n2を通して出力側に電力を供帽する。
In the circuit of FIG. 1, the switching cable 2 is turned on by the drive circuit 4 at time to, and the primary winding of the transformer m
Power is supplied to the output side through the second best #n2.

時刻tlにおいて発振器3からの信弓IICより駆動回
路4を経由してスイッチング素子2缶オンする。すると
、出力電圧に依存して制御回路13かもトランジスタ1
2のベースへ流入するベースl!fiか増減され、それ
により決足されるトランジスタ12のコレクタ エミッ
タ間車圧により、トランス6の磁束りキットか巻蔵”4
によってイ■われる0 時刻t2になり、はぼリセットか終了すると巻線n3の
電圧からリセット終了をリセット検出回路5によって検
出し、それにより駆動回路4を1由してスイッチング素
子2を再びオンとし、前述の動作を繰り返す。
At time tl, two switching elements are turned on from the signal IIC from the oscillator 3 via the drive circuit 4. Then, depending on the output voltage, the control circuit 13 or the transistor 1
Base l flowing into the base of 2! fi is increased or decreased, and depending on the vehicle pressure between the collector and emitter of the transistor 12, which is determined by this, the magnetic flux of the transformer 6 is increased or decreased.
At time t2, when the reset is completed, the reset detection circuit 5 detects the end of the reset from the voltage of the winding n3, and thereby turns on the switching element 2 again via the drive circuit 4. , repeat the above operations.

この回路は、トランジスタ12のコレクタ・エミッタ間
車圧、すなわち巻称n4のリセット電圧を%++@+す
ることによりスイッチング索子2のメンデユーティ比を
制御する。
This circuit controls the mendutity ratio of the switching cable 2 by changing the collector-emitter voltage of the transistor 12, that is, the reset voltage of the winding number n4, to %++@+.

ところで前−己スイ゛ンチング素子2の1番目のオン期
間をTON(i)、1番目のオフ期間をTp(i)とす
ると前adの制御方法からつねに ■ON ’ TON(i)−vRHTR(i)    
 ・・・”−−・(1)但し 皿−1,2,・・・・・
・ i’−TR(i) +ToN(i +1)      
・・・四重・・ (2)が成立する。
By the way, if the first on period of the previous self-switching element 2 is TON(i) and the first off period is Tp(i), then from the control method of the previous ad, ■ON' TON(i)-vRHTR( i)
..."--(1) However, plate-1, 2,...
・i'-TR(i) +ToN(i+1)
... Quadruple... (2) holds true.

ここでVoN+jオン期[i5中、VRtj、オフ期間
中に夫々巻線(11に元止ずる電圧の絶対値であり、ま
たする。
Here, VoN+j is the absolute value of the voltage that stops at the winding (11) during the on-period [i5, VRtj, and off-period, respectively.

いま外乱に起因する何らかの原因によシミ圧が変わった
ため、出力電圧を一定に維持しようとして、n番目のオ
ン期間に変位が生じ、 ’17oN(n)= ’1’ON+Δt 01J(n)
と彦ったとすると、 Vow(Tom−’lto N(n) )”Vn(Tf
(+Δt R(n))   −−−(3)上記(1) 
* (3)式より VOR’Δt on(n) = VR・ΔtR(n)・
・・・・・・・・・・・(4)上記(2)式より ΔtB(。汁ΔjON(n−1−1) −0・・・・・
・・・・・・・(5)上記(4) 、 (5)式よシ これは(6)式の有頂に一符号があることから明らかな
ように、微小変位発生後のオン巾TON+Δton(i
)(i≧n)が振動することを示している。
Now, because the stain pressure has changed due to some reason caused by disturbance, a displacement occurs in the n-th on period in an attempt to maintain the output voltage constant, and '17oN(n) = '1'ON+Δt 01J(n)
Then, Vow(Tom−'lto N(n) )”Vn(Tf
(+Δt R(n)) ---(3) Above (1)
* From formula (3), VOR'Δt on(n) = VR・ΔtR(n)・
・・・・・・・・・・・・(4) From the above equation (2), ΔtB(.juice ΔjON(n-1-1) -0...
(5) According to equations (4) and (5) above, this is the on-width TON+Δton after the occurrence of minute displacement, as is clear from the fact that the crest of equation (6) has one sign. (i
) (i≧n) oscillates.

(1)Δ10H(n+1 ) > l−Δtom(n)
l  =・・・・・・・・(7)のとき振動は発散し、
オン幅か一つの値で決まらない。このとき である。
(1) Δ10H(n+1) > l−Δtom(n)
When l =・・・・・・・・・(7), the vibration diverges,
The ON width cannot be determined by a single value. This is the time.

(11)Δtou(n+1 ) < l−ΔjON(n
) l  ・・・・・・・・・・・・(9)のとき振動
は収束し、オン幅が一つの値で決まり安定となる。この
とき である。
(11)Δtou(n+1)<l−ΔjON(n
) l When (9) occurs, the vibration converges, the ON width is determined to one value, and it becomes stable. This is the time.

(1) 、 (2) t (1に1式より′1゛   
   ・・・・・・・・・・・・0υTON > 2 のとき安定である。
(1), (2) t ('1゛ from equation 1 in 1)
・・・・・・・・・・・・It is stable when 0υTON > 2.

これは即ち、この従来の制御方式において安定に動作を
行わせるためには、スイッチング素子20オンデユーテ
イ比を常に1/2以上としなげればならないことを表わ
してお9、そうで力い場合はオン幅が一つの値で決まら
ず、不安定動作になるという欠点かあった。
This means that in order to operate stably with this conventional control method, the on-duty ratio of the switching element 20 must always be kept at 1/2 or more. There was a drawback that the width was not determined by a single value, resulting in unstable operation.

一方、オンデユーテイ比を常Kl/2以上と高くすると
、トランスのリセット(必要なリセット電圧も上昇する
こととなり、このリセット電圧を1次巻mntt介して
受けるスイッチング素子2の耐圧上不利となり、また出
力電圧の制御可能範囲も狭くなる等の欠点があった。
On the other hand, if the on-duty ratio is made higher than Kl/2, the reset voltage of the transformer (necessary reset voltage) will also increase, which will be disadvantageous in terms of withstand voltage of the switching element 2 which receives this reset voltage via the primary winding mntt, and the output There were drawbacks such as a narrow controllable range of voltage.

本発明は、上述のような従来技術の欠点を除去するため
になされたものであり、従って本発明の目的は、スイッ
チング素子のオンデユーテイ比を従−Aてリセット電圧
もそれだけ低くてよいからスイッチング素子の耐圧上有
利であり、出力電圧の制御可能節Hも広くなるようにし
た固定周波数リセット制御方式DC−I)Cコンバータ
を提供することにおる。
The present invention has been made in order to eliminate the drawbacks of the prior art as described above, and an object of the present invention is to reduce the on-duty ratio of the switching element by lowering the reset voltage. An object of the present invention is to provide a fixed frequency reset control type DC-I)C converter which is advantageous in terms of withstand voltage and widens the controllable node H of the output voltage.

本発明の構成の要点は、DC−DCCコンマ−タにおい
て、リセット電圧を2段階に同定し、一方のリセット電
圧を採るリセット期間を制御してスイッチング素子のオ
ンデユーテイ比を制御ず乙ことにより、オンデユーディ
比をl/2以下としても安定動作を行うようにした点に
ある。以下図面につ(・で本発明の詳細な説明する。
The main point of the configuration of the present invention is to identify the reset voltage in two stages in the DC-DCC converter, and to control the on-duty ratio of the switching element by controlling the reset period during which one of the reset voltages is adopted. The point is that stable operation is achieved even when the Eudy ratio is set to 1/2 or less. The present invention will be described in detail below with reference to the drawings.

第3図は本発明の一実施例に示す回路図であり、粛4図
は七の動作波形を示す波形図である。
FIG. 3 is a circuit diagram showing one embodiment of the present invention, and FIG.

43図において、1け直流電源、2はスイッチング素子
、3は固定周波数発振器、4は駆動回路、5はリセット
検出回路、6はトランス、7,8はそれぞれダイオード
、9は平滑用チョークコイル、lOは平滑用コンデンサ
、12はトランジスタ、13は出力電圧を検出してトラ
ンジスタ12を制御する制御回路、15.16はそれぞ
れダイオード、17は定電圧ダイオード、 fllはト
ランス601次巻線、n2は2次巻線、n3はリセット
検出巻線、n4 、 n5はリセット電圧制御用巻線、
n6はスイッチング素子オフのタイミング検出用巻線で
ある。
In Figure 43, 1 DC power supply, 2 a switching element, 3 a fixed frequency oscillator, 4 a drive circuit, 5 a reset detection circuit, 6 a transformer, 7 and 8 each a diode, 9 a smoothing choke coil, and lO is a smoothing capacitor, 12 is a transistor, 13 is a control circuit that detects the output voltage and controls the transistor 12, 15 and 16 are diodes, respectively, 17 is a constant voltage diode, fl1 is the transformer 60 primary winding, and n2 is the secondary winding, n3 is a reset detection winding, n4 and n5 are reset voltage control windings,
n6 is a winding for detecting timing when the switching element is turned off.

第4図においてaは発振器3の出力波形、bはトランス
の巻&1n1の電圧波形である。
In FIG. 4, a is the output waveform of the oscillator 3, and b is the voltage waveform of the transformer winding &1n1.

これを動作するには、まずスイッチング素子2が時刻t
Oにおいて駆動回路4によってオンし、トランス6の巻
Ii!inl、n2を通して出力側に電力を供給する。
To operate this, first the switching element 2 is activated at time t.
is turned on by the drive circuit 4 at O, and the winding Ii! of the transformer 6 is turned on by the drive circuit 4. Power is supplied to the output side through inl and n2.

時刻11において発振器3からの信号によシ駆動回路4
を経由してスイッチング素子2をオフする。このときス
イッチング素子オフのタイミング検出用巻/1en6に
よシオフを検出すると制御回路13を動作させ、それに
よりトランジスタ12をオンする。
At time 11, the drive circuit 4 is activated by a signal from the oscillator 3.
The switching element 2 is turned off via the . At this time, when the switching element off timing detection winding/1en6 detects the off state, the control circuit 13 is operated, thereby turning on the transistor 12.

すると、ダイオード15が動作し、トランス60巻線(
n4+ns)はに電圧ダイオード17の電圧(VZRと
する)でクランプされ、トランス6のリセット動作が行
われる。次に出力電圧に依存した制御1gl路13から
のfj号によシ決まる時刻t1  にトランジスタ12
をオフすると、今度はダイオード15が不作動とな9、
ダイオード16の動作によシトランス6のリセットが巻
mnsと定電圧ダイオード17の電圧VZHによって行
われる。
Then, the diode 15 operates, and the transformer 60 winding (
n4+ns) is clamped by the voltage of the voltage diode 17 (assumed to be VZR), and the transformer 6 is reset. Next, at time t1 determined by the fj signal from the control 1gl path 13 which depends on the output voltage, the transistor 12
When turned off, diode 15 becomes inactive 9,
Due to the operation of the diode 16, the sitrans 6 is reset by the winding mns and the voltage VZH of the constant voltage diode 17.

時刻t2において、所定の磁束エネルギー値までリセッ
トが終了すると、巻線n3によりリセット検出回路5が
リセット終了を検出し、駆動回路4を介してスイッチン
グ素子2に駆動信号を送り、スイッチング素子2をオン
とする。以後は時刻1oからの動作を繰シ返す。
At time t2, when the reset is completed to a predetermined magnetic flux energy value, the reset detection circuit 5 detects the end of the reset via the winding n3, sends a drive signal to the switching element 2 via the drive circuit 4, and turns on the switching element 2. shall be. Thereafter, the operation from time 1o is repeated.

本発明回路においては2段階のリセット電圧■R2■r
をそれぞれ一定とし、一方の段階のリセット電圧vr元
止期間を制御して出力電圧の安定化を行うものであるが
、以上の回路においてオン@ToNに変動が発生した場
合の応答を以下に求める。
In the circuit of the present invention, there are two levels of reset voltage ■R2■r
are kept constant, and the output voltage is stabilized by controlling the reset voltage vr stop period of one stage.The response when a fluctuation occurs in ON@ToN in the above circuit is calculated below. .

とすると、電圧時間積一定の条件と、前記制御力法とか
ら次式が成立する。
Then, from the condition that the voltage time product is constant and the control force method described above, the following equation is established.

VoN゛ToN(i)=Tr(i)0Vr+Ta(i)
4’n  °−−−−−  θ優周期1゛は T−Tr
(i)+ Ta(i)+TotJ(i +1 )−αQ
また  Tc = Tr(i)  (一定とする) ・
・・・・・ OQこの′roは制御回路13で与えられ
る制御期間である。いま何らかの原因によりn番目のオ
ン期間に変位を生じ TON(11) −TON+Δl0N(++)となった
とすると、VON(’1”ON+ΔLON(n) ) 
−T’r ・V、r +VR(TR+Δ1R(n) )
・・・・・・・・・・・・αD 上記u57.αり式より ΔIR(n)十ΔtON(n+1)=0      ・
・・・・・・・・・・・ 081F配α荀、αr+ l
 (l)0式よりこれは上記(6)式と同様に微少変位
発生後のオンIM i’ON+ΔtO1J(i) (i
 4. n )が振動することを示し−CJ、;す、次
の2・ニーの状態かある。
VoN゛ToN(i)=Tr(i)0Vr+Ta(i)
4'n °---- θ dominant period 1゛ is T-Tr
(i)+Ta(i)+TotJ(i+1)−αQ
Also, Tc = Tr(i) (assumed constant) ・
. . . OQ This 'ro is a control period given by the control circuit 13. Now, if for some reason a displacement occurs in the n-th ON period and becomes TON(11) -TON+Δl0N(++), then VON('1"ON+ΔLON(n))
-T'r ・V, r +VR (TR+Δ1R(n))
・・・・・・・・・・・・αD Above u57. From the α equation, ΔIR(n) + ΔtON(n+1)=0 ・
・・・・・・・・・・・・ 081F α荀、αr+l
From equation (l)0, this is the same as equation (6) above.
4. n) indicates that it vibrates -CJ,; there is the following 2-knee state.

(1)Δ1oN(n+1 ) > l−Δton(n)
 l   −・・・・・−121のとと振111!Mま
発散し、オン幅が一つの値で決まらな(・0 (11)Δ’0N(n+1)<l−Δtori(n)l
   −−−−(21)のとき振11ft+ti収束し
、オン幅が一つの値で決まり安定である〇 となり、安定に動作するオン幅の範囲は上記04)。
(1) Δ1oN(n+1) > l−Δton(n)
l -...-121 toto 111! M diverges, and the on-width is not determined by one value (・0 (11)Δ'0N(n+1)<l−Δtori(n)l
----(21), the amplitude of 11ft+ti converges, the on-width is determined by one value and is stable, which is 0, and the range of the on-width that operates stably is 04) above.

as 、 (le 、(ハ)式よシ でしか安定に動作しなかった吐記αυ式参照)ことと比
べると安定動作範囲が拡がったことを意味する。このよ
うな作用をするから本発明は固定周波数リセット制御方
式DC−DCコンバータを安定に動作させることができ
る。
This means that the stable operation range has been expanded compared to (le, see the αυ formula, which operated stably only in formulas (C) and (C)). Because of this effect, the present invention can stably operate a fixed frequency reset control type DC-DC converter.

ま九他の実施例左しては、第3図の回路において制御期
間Toを ’ro ”” TON(i)+Tr(i)      
  ++++m+++++  Hとする場合があり、こ
の場合も以下のように第一の実施例とほぼ同様の効果が
ある。上記Q!19 、 c74)式より Δtl((nu ) =Δ’0N(n)−Δ10ti(
n+1)  −(21i)VON(’L”ON+ΔtO
N(t+)) = (Tr−Δton(n)) ・Vr
−I−(TR+JtR(n+1>)・Vu・・・・・・
・・@ hiij(14) HtMi) Htr+1式、l: 
リ)2VHのときl1loXJ十ΔtoN(i) (i
 :ff1n )は振動発散し、オン幅が一つの値で決
まらない。
9. Another embodiment: In the circuit shown in FIG.
++++m++++++H may be used, and in this case as well, substantially the same effects as in the first embodiment can be obtained as described below. Above Q! 19, c74), Δtl((nu) = Δ′0N(n)−Δ10ti(
n+1) −(21i)VON('L”ON+ΔtO
N(t+)) = (Tr-Δton(n)) ・Vr
-I-(TR+JtR(n+1>)・Vu...
...@hiij(14) HtMi) Htr+1 formula, l:
li) When 2VH, l1loXJ+ΔtoN(i) (i
:ff1n), the vibration diverges and the ON width is not determined by a single value.

(Vo1++Vr ) < 2VRのときTON+Δt
ou(i) (1≧n)は振動収束し1、オン幅が一つ
の値で決まり安定である。
(Vo1++Vr) When < 2VR, TON+Δt
When ou(i) (1≧n), the vibration converges to 1, and the ON width is determined to be one value and is stable.

Vr)のとさi”0N(o)[JtON(i) (’≧
n)は嘔調減少し、安定となる。
Vr)'s peak i"0N(o) [JtON(i) ('≧
In case of n), the symptoms of nausea decreased and became stable.

Vノ、上のように、L、8+J(1)式のように制御期
間Toを設定した場合には、−F配0旬式のように設定
した場合に比較してVBo値をやや低くすることが可能
なはか、第1の実施例と同様の効果を有する。
As shown above, when the control period To is set like the L,8+J (1) formula, the VBo value is slightly lower than when it is set like the -F zero period formula. However, it has the same effect as the first embodiment.

系5図、第6図は、それぞれ、以上の実施例とほぼ同様
の効釆奢有する他の実施例を示す回路図であ如、トラン
ス6の1次側は第3図のそれと同じなので図示を省略し
である。
System diagrams 5 and 6 are circuit diagrams showing other embodiments having almost the same effects and features as the above embodiment, and the primary side of the transformer 6 is the same as that in FIG. 3, so it is not shown. is omitted.

第5図、第6図の両実施例とも、制御回路13によって
オン、オフのタイミングを制御されたスイッチ21によ
って巻線n7のリセット電圧を2段階に設定する。
In both the embodiments shown in FIGS. 5 and 6, the reset voltage of the winding n7 is set in two stages by a switch 21 whose on/off timing is controlled by a control circuit 13.

第7図に示した実施例は、以−Fの実施例の効果の他に
、リセット電力を出力に回収することによ如電力効率の
改善を図ったものであり、スィッチ21オン時は巻11
M (n4+n5)のリセット電圧をコンバータの出力
電圧と同一とし、スィッチ21オフ時ケま会−ム】5の
リセット電圧をコンバータの出力電圧と同一とすること
によって2R階のリセット電圧を得る。
In the embodiment shown in FIG. 7, in addition to the effects of the embodiments described below, the power efficiency is improved by recovering the reset power to the output, and when the switch 21 is on, the winding 11
By making the reset voltage of M (n4+n5) the same as the output voltage of the converter, and making the reset voltage of 5 the same as the output voltage of the converter when the switch 21 is off, a reset voltage of the 2R level is obtained.

Jl&8図に示した実施例は、第7図の実施例と同様の
効果を令する他の実施例であり、スィッチ21オン時は
巻h n2’jノリセツト電圧をコンバータの出力電圧
と同一とし、スィッチ21オフ時は巻&nyのリセツ)
[圧をコンバータの出力電圧と同一とすることによって
2段階のリセット電圧を得る1、更に、リセット電力を
入力側に回収する構成としても容易に実施でき、出力側
に回収する場合と同様の効果が侮られる。
The embodiment shown in FIG. When switch 21 is off, volume & ny reset)
[By making the voltage the same as the output voltage of the converter, a two-step reset voltage is obtained1.Furthermore, it can be easily implemented as a configuration in which the reset power is recovered to the input side, and the same effect as in the case of recovering the reset power to the output side. is looked down upon.

以上説明したように、本発明によると同定周波数リセッ
ト制御方式D C−I) Cコンバータにおいて、その
オンデユーテイ比を1/2以下としても安定に動作する
ため、出力電圧の制御範囲が広くとれ、またリセット電
圧を低くしてスイッチング素子の耐圧を低くできるとい
う利点がある。
As explained above, according to the present invention, the identified frequency reset control system D C-I) C converter operates stably even when its on-duty ratio is 1/2 or less, so the output voltage control range can be widened, and There is an advantage that the breakdown voltage of the switching element can be lowered by lowering the reset voltage.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は、従来の固定周波数り、セット制御方式1) 
CD C:r 7 /(−夕の一例を不す回路図、第2
図はその動作波形を示す波形図、第3図は本発明の一実
施例を示す回路図、絽4図はその動作波形を示す波形図
、第5図〜第8図はそれぞれ本発明の他の実施例を示す
回路図、である。 符号説明 l・・・・・・直流iI源、2・・・・・・スイッチン
グ素子、3・・・・・・固定周波数発振器、4・・・・
・・駆動回路、5・・・・・・リセット検出回路、6・
・・・・・トランス、7,8・・・・・・り゛イオード
、9・・・・・・平滑用チョークコイル、10・・・・
・・平滑用コンデンサ、11・・・・・・ダイオード、
12・・・・・・トランジスタ、13・・・・・・制御
回路、14・・・・・・コンア/す、15.16・・・
・・・ダイオード、17・・・・・・定電圧ダイオード
、18・・・・・・ダイオード、19゜20・・・・・
・定電圧ダイオード、21・・・・・・制御回路により
制御されるスイッチ、22.23・・・・・・ダイオー
ド、a・・・・・・置屋周波R1I兄振器出力、b・・
・・・・トランス巻4+!n1I7J電圧 代理人 弁理士 並 木 昭 夫 代理人 弁理士 松 崎   清 It  図 す 第2 図 第71  門 第5 図 第0 図 笥7 図 哨8 図
Figure 1 shows the conventional fixed frequency set control method 1)
CD C:r7/(-Circuit diagram without an example of evening, 2nd
3 is a circuit diagram showing one embodiment of the present invention, FIG. 4 is a waveform diagram showing its operating waveforms, and FIGS. FIG. 3 is a circuit diagram showing an example. Description of symbols 1...DC iI source, 2...Switching element, 3...Fixed frequency oscillator, 4...
...Drive circuit, 5...Reset detection circuit, 6.
...Transformer, 7,8...Relied diode, 9...Smoothing choke coil, 10...
...Smoothing capacitor, 11...Diode,
12...Transistor, 13...Control circuit, 14...Connector/su, 15.16...
...Diode, 17... Constant voltage diode, 18... Diode, 19°20...
- Constant voltage diode, 21...Switch controlled by control circuit, 22.23...Diode, a...Okiya frequency R1I big oscillator output, b...
...Trans volume 4+! n1I7J Voltage Agent Patent Attorney Akio Namiki Agent Patent Attorney Kiyoshi Matsuzaki

Claims (1)

【特許請求の範囲】[Claims] 1)  1次巻−と2次巻線を備えたトランスの該1次
巻線にスイッチング素子と直流電源の直列回路を接続す
ると共に、前記トランスの励磁エネルギーを放出するた
めのリセット回路と、該トランスかりセットされたこと
を検出するリセット検出回路と、固定周波数発振器を設
け、前記リセット検出回路によりトランスかりセットさ
れたことを検出したとき前記スイッチング素子をオンに
転じ、次に前記固定周波数発振器からの(IIvにより
オフに転じることにより、前記2次巻線から出力を堆り
出し、またスイッチング素子のオフ期間に前記リセット
回路によシトランスの励磁エネルギーを放出してリセッ
トを行なうようにした固定周波数リセット得」御力式1
) C−D Cコンバータにおいて前記スイッチング素
子かオフに転じた静合を検餠するオノII*出手猷と、
−オーツ検出決方によ−り起動七キ紬配リセット回路か
ら一足期+M] (以後、第lのリセット期間という)
−1のリセット電圧を1配トランスに印加してリセット
を図る手取と、次にリセット1細からトランスに印加さ
れるリセット電圧を、AIIk#41C)電圧よりは麹
、い歯2のリセット屹庄に切り候えて残りのリセットを
行なう−t=役と、t−股は削ik;渠1のリセットル
!同のす、Tllil幅を制卸フることによりll11
jaLSスイツチング素子のオン・イノ時tuJ比Yt
+t+lI muするようにしたことを〜似とする固疋
)4Ii欧叙リセット制一方式1) C−1) Cコン
バータ
1) A series circuit of a switching element and a DC power supply is connected to the primary winding of a transformer having a primary winding and a secondary winding, and a reset circuit for releasing excitation energy of the transformer; A reset detection circuit for detecting that the transformer is set and a fixed frequency oscillator are provided, and when the reset detection circuit detects that the transformer is set, the switching element is turned on, and then the fixed frequency oscillator (IIv) to output an output from the secondary winding by turning off, and during the off period of the switching element, the excitation energy of the citrans is released to the reset circuit to perform a reset. Reset gain” Goriki ceremony 1
) Ono II * Dedeyu, who checks whether the switching element has turned off in the C-DC converter;
- One phase +M from the seven-kilometre reset circuit activated by oats detection decision (hereinafter referred to as the 1st reset period)
-1 reset voltage is applied to the 1st transformer to reset it, and then the reset voltage applied to the transformer from the reset 1st part is applied to the transformer. I cut through and reset the rest - t = role, t - crotch is deleted; resettle of culvert 1! Similarly, by controlling the Tllil width, ll11
jaLS switching element on/in tuJ ratio Yt
+t+lI Mu is similar to 4Ii European reset system method 1) C-1) C converter
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01278263A (en) * 1988-04-27 1989-11-08 Nec Corp Peak voltage removing circuit

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