JPS5817743A - Transmitter for digital signal - Google Patents
Transmitter for digital signalInfo
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- JPS5817743A JPS5817743A JP11613081A JP11613081A JPS5817743A JP S5817743 A JPS5817743 A JP S5817743A JP 11613081 A JP11613081 A JP 11613081A JP 11613081 A JP11613081 A JP 11613081A JP S5817743 A JPS5817743 A JP S5817743A
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- frequency shift
- parallel
- converter
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04J—MULTIPLEX COMMUNICATION
- H04J4/00—Combined time-division and frequency-division multiplex systems
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- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
Abstract
Description
【発明の詳細な説明】
この発明はディジタル信号の伝送装置に関【7、特に監
視制御装置等において被制御所から制御所へデータ信号
を送信し、制御所から被制御所へ制御信号を送信する場
合等に用いられる伝送装置に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a digital signal transmission device. This relates to a transmission device used in such cases.
従来この種の装置として第1図に示すものがあった。第
1図において(1)は被制御所(以下子局という)を示
し、(2)は制御所(以下親局という)を示し、(31
)、(32)はそれぞれ伝送路である、また以下に用い
る符号で10過最上位桁が1のものけ子局装量、2のも
のは親局装置とする。Qlは入力データ信号、翰は出方
データ信号で信号(ト)、翰は共にアナログ信号である
とする。出力、(ハ)はそれぞれ周波数偏移変調器(以
下MODと略記する)、(イ)、@けそれぞれ並直列変
換器(以下PAと略記する)、(至)はアナログディジ
タル賢換器(以下ん巾と略記する)、a4.鱒はそれぞ
れ復調器(以下DEMと略記する)、(至)#凶はそわ
ぞれ直並列変換器(以下φと略記する)、(ハ)はディ
ジタルアナログ変換器(以下D/Aと略記する)、■け
入力インタフェース(以下INと略記する)、(至)け
出力インタフェース(以下OUTと略記する)、翰は入
力制御信号、Qlは出力制御信号であり、信号(ト)、
(至)は共にオンオフ信号であるとする。A conventional device of this type is shown in FIG. In Fig. 1, (1) indicates a controlled station (hereinafter referred to as a slave station), (2) indicates a control station (hereinafter referred to as a master station), and (31) indicates a controlled station (hereinafter referred to as a master station).
) and (32) are transmission lines, respectively. In the codes used below, the code whose most significant digit is 1 represents the number of subordinate stations, and the number whose most significant digit is 1 represents the master station equipment. It is assumed that Ql is an input data signal, Kan is an output data signal, and both Kan is an analog signal. The output (c) is a frequency shift modulator (hereinafter abbreviated as MOD), (a) and @ are respectively parallel-to-serial converters (hereinafter abbreviated as PA), and (to) are analog-to-digital converters (hereinafter abbreviated as PA). a4. Trout is a demodulator (hereinafter abbreviated as DEM), (to) # is a serial-parallel converter (hereinafter abbreviated as φ), and (c) is a digital-to-analog converter (hereinafter abbreviated as D/A). ), ■ input interface (hereinafter abbreviated as IN), (to) output interface (hereinafter abbreviated as OUT), the line is the input control signal, Ql is the output control signal, the signal (g),
(to) are both on/off signals.
次に動作について説明する。子局(1)におけるN勺(
2)の出力はビット並列の形のディジタル信号とLPA
(ロ)によりビット直列の形の信号にしこの信号によっ
てMOD eJ力において搬送波を周波数シフト(FS
)変調し伝送路(31)に送出子る。以下の説明の便宜
のため%の出力信号は論理「0」の部′分(スペース)
と論理「1」の部分(マーク)から構成されるものとし
、MODal)はスペース入力に対しfの周波数、マー
ク人力に対しfl(f1’qf、)の周波数を出力する
ものとする。Next, the operation will be explained. Nx (
The output of 2) is a bit-parallel digital signal and LPA.
(b) converts the signal into a bit series form and uses this signal to frequency shift the carrier wave (FS) in the MOD eJ force.
) is modulated and sent to the transmission path (31). For convenience of explanation below, the output signal in % is the logic “0” part (space).
MODal) outputs a frequency of f for space input and a frequency of fl(f1'qf,) for mark input.
DEM(ハ)は伝送路(31)からの信号を入力し周波
数f、の入力に対してはスペースを周波数f1の入力に
対してはマークを出力する。S/P wはDEM(ハ)
から出力されるビット直列の形のディジタル信号を1ワ
一ド分あてビット並列の形に変換し、D/A @けこれ
をアナログ信号に変換する。The DEM (c) inputs the signal from the transmission line (31) and outputs a space for the input of frequency f, and a mark for the input of frequency f1. S/P w is DEM (ha)
The bit-serial digital signal output from the D/A is converted into a bit-parallel digital signal for one word, and the D/A signal is converted into an analog signal.
飼御信号翰を親局(2)から子局(1)へ伝送する場合
−も同様であるが、制御信号−,O呻はオン第1幇号で
あるからN巾、 D/Aを必要としない。The same is true when transmitting the control signal from the master station (2) to the slave station (1), but the control signal -, O is the first signal on, so N width and D/A are required. I don't.
従来の伝送装置社以上のように構成されているので、一
定の時間中に伝送する情報量を多くしようとしてディジ
タル信号のビット間隔を短縮しボー (baud )
Kよって表わされる信号伝送速度を上昇すると、信号の
占有周波数帯域幅が広くなね、伝送路(31)、(32
)によって伝送可卵な周波数帯域幅には制限があるので
、伝送路の本数を増加して一定時間内に伝送する情報量
を増加しなければならなくなる。また装置の2重化を行
って、事故の場合に切換るような時は、その事故は受信
側において検出され受信側φλら報告されねばならず、
情報伝送が単方向の場合切換が困難になるhどの欠点が
あった。Since the structure of the transmission equipment is more similar than that of conventional transmission equipment, the bit interval of the digital signal is shortened and the baud is
When the signal transmission speed expressed by K is increased, the occupied frequency bandwidth of the signal becomes wider.
), there is a limit to the frequency bandwidth that can be transmitted, so it is necessary to increase the number of transmission paths to increase the amount of information transmitted within a certain period of time. In addition, when duplicating equipment and switching in case of an accident, the accident must be detected on the receiving side and reported by the receiving side φλ.
When information transmission is unidirectional, there are drawbacks such as difficulty in switching.
この発明は上記のような従来のものの欠点を除去するた
めになされたもので、一つのディジタル信号を、チャネ
ル番号の互に異なる周波数偏移変調波を複数個用いて同
一伝送路上は同時に伝送し実質的な信号伝送速度を向上
した伝送装置を提供することを目的としている。。This invention was made in order to eliminate the drawbacks of the conventional ones as described above, and it is possible to simultaneously transmit one digital signal on the same transmission path using a plurality of frequency shift modulated waves with different channel numbers. It is an object of the present invention to provide a transmission device with substantially improved signal transmission speed. .
以下、この発明の実施例を図について説明する。Embodiments of the present invention will be described below with reference to the drawings.
模2回はこの発明の一実施例を示すブロック図であって
、第1図と同一符号は同−又は相当部分を示し、(12
0)、(121)はそれぞれ5名(2)に相当するP/
Sであるが、たとえばA/D(至)の出力が1乃至n番
のnビット(説明の便宜上nは偶数とする)の並列配列
であるとすると、P/S (120)はそのうちから1
.3,5.・・・n−1番の各奇数番ビットを入力しこ
わをビット直列の形で出力し、P/S (121)は2
゜4.6.・・・n番の各偶数番ビットを入力しこれを
ビット直列の形で出力する。(110)、(111)は
MODα力に相当−tルMODテアルカ、MOD (1
10)はP/S (120)の出力を入力しその入力が
スペースの時はfo、マークの時はflの周波数を出力
するとすれば、MOD(111)はP/S (121)
の出力を入力しその入力がスペースの時は26mマーク
の時Fif、(f、\f0. f2\f1)の周波数を
出力する。すなわちMOD (110)。Figure 2 is a block diagram showing one embodiment of the present invention, in which the same reference numerals as in Figure 1 indicate the same or corresponding parts, and (12
0) and (121) are P/ corresponding to 5 people (2) respectively.
For example, if the output of the A/D (to) is a parallel array of n bits numbered 1 to n (for convenience of explanation, n is an even number), then P/S (120) is
.. 3,5. ...Input each odd bit of number n-1 and output the stiffness in bit series form, P/S (121) is 2
゜4.6. . . . Inputs each n-th even numbered bit and outputs it in bit series form. (110), (111) are equivalent to MODα force
10) inputs the output of P/S (120) and outputs the frequency of fo when the input is a space and fl when it is a mark, then MOD (111) is the output of P/S (121)
When the input is a space, the frequency of Fif, (f, \f0. f2\f1) is output when the input is a space. namely MOD (110).
(111)は互に異なるチャネルの周波数偏移変調波号
を発生する。(111) generates frequency shift modulation wave signals of mutually different channels.
MOD (110)、(111)の出力は共に伝送路(
31)によシ伝送される。(240)、(241)はD
EM(ハ)に相当するDEMであるがDEM (240
)はf、とflの周波数を受信して復調し、DEM (
241)はf6とf2の周波数を受信して復調する。(
250)、(251)はS/P(ハ)に相当するS沖で
あるが、s/P(250)はDEM (240) ノ出
力ヲ並列信号に変換E7、S/P (251)はDEM
(241)ノ出力を並列信号に変換する。したがってS
/P (250’)の出力はP/!S (120)の入
力と同じ符号となり、S/P(251)の出力はp/8
(121)の入力と同じ符号となる。S/P (,2
50)、(251)の出力を重ねて配列すればAA)
(1+の出力と同じ符号となり、これをD/A(2)に
よりアナログ信号に変換する。 P/8 (120)→
MOD(110) −+DEM (240) −+ 8
/)’ (250) ノ伝送[11M(121) −+
MoI) (In ) →S/P (251) ノ伝送
装置は並列に動作するので、P/S (120)、(1
21)の出力における信号のビット間隔はそのままに保
ちながら一定時間に伝送できる情報量を2倍にすること
ができる。The outputs of MOD (110) and (111) are both transmitted through the transmission line (
31). (240) and (241) are D
DEM is equivalent to EM (c), but DEM (240
) receives and demodulates the frequencies of f, and fl, and generates DEM (
241) receives and demodulates the f6 and f2 frequencies. (
250) and (251) are S signals corresponding to S/P (c), but s/P (250) is a DEM (240). E7, S/P (251) is a DEM.
(241) Convert the output into parallel signals. Therefore S
The output of /P (250') is P/! The sign is the same as the input of S (120), and the output of S/P (251) is p/8
It has the same sign as the input of (121). S/P (,2
If the outputs of (50) and (251) are stacked and arranged, AA)
(It has the same sign as the output of 1+, which is converted to an analog signal by D/A (2). P/8 (120) →
MOD (110) −+DEM (240) −+ 8
/)' (250) ノ transmission [11M (121) −+
MoI) (In) →S/P (251) Since the transmission devices operate in parallel, P/S (120), (1
21) The amount of information that can be transmitted in a given time can be doubled while keeping the bit interval of the signal at the output as it is.
なお、第2図においてMOD@は周波数偏移変調信号と
し、てf6yfl(f3\t6+t@ S t□e f
3\f2)を発生し7、DEM(14はこれを復調する
とすわば、この信号も伝送路(31) Kよって伝送す
ることができる。In addition, in Fig. 2, MOD@ is a frequency shift modulation signal, and f6yfl(f3\t6+t@S t□e f
3\f2) is generated 7, and the DEM (14) demodulates it, so that this signal can also be transmitted via the transmission line (31)K.
以上の計明でMOD (110)けfoとf8の周波数
を゛出力し、MOD rill)けfoとf2の周波数
を出力するとし六が、MOD (110)はf0□とf
lの周波数を出力し7、MOD(111) ij f、
、とf2の周波数を出力するようにしてもよい。また通
常の信号FiPA(120)→MOD(110)→DE
M (240)→S/P (250)の系で伝送12、
特定の優先ワードだけをP/S (121) 4M0D
(111)→DEM (241)→S/P (251
)の系で伝送するようにしてもよい。With the above calculation, if MOD (110) outputs the frequencies of fo and f8, and MOD (rill) outputs the frequencies of fo and f2, then MOD (110) outputs the frequencies of fo and f2.
Output the frequency of 7, MOD (111) ij f,
, and f2 frequencies may be output. Also, the normal signal FiPA (120) → MOD (110) → DE
Transmission 12 in the system M (240) → S/P (250),
P/S only specific priority words (121) 4M0D
(111) → DEM (241) → S/P (251
) may be used for transmission.
以上のように、この発明によれば異がるチャネルの周波
数偏移変調信号を用いて同時伝送を行うので単位時間に
伝送できる情報量を増加することができる。As described above, according to the present invention, since simultaneous transmission is performed using frequency shift keying signals of different channels, the amount of information that can be transmitted per unit time can be increased.
第1図は従来の装置を示すブロック図、第2図はこの発
明の一実施例を示す説明図である。
(1)・・・子局、(2)・・・親局、(110)、(
111)屑・・・周波数偏移復調器(MOD )、(1
20)、(121)、(2)・・並直列変換器(P/S
)、α]・・・アナログディジタル変換源縛)、(+
−t) 、 (24o)、(24t)・・・周波数偏移
復調器(DEM )、Q! 、 (250)、(251
) ・・直並列変換器(S/P ’)、m・・ディジタ
ルアナログ変換器(D/A)。
なお、図中同一符号は同−又は相当部分を示す。
代理人 葛 野 信 −FIG. 1 is a block diagram showing a conventional device, and FIG. 2 is an explanatory diagram showing an embodiment of the present invention. (1)...Slave station, (2)...Master station, (110), (
111) Scrap... Frequency shift demodulator (MOD), (1
20), (121), (2)...Parallel-serial converter (P/S
), α]...Analog-digital conversion source constraint), (+
-t), (24o), (24t)...frequency shift demodulator (DEM), Q! , (250), (251
)...Serial to parallel converter (S/P'), m...Digital to analog converter (D/A). Note that the same reference numerals in the figures indicate the same or equivalent parts. Agent Shin Kuzuno −
Claims (1)
に分はこの各ビット群の並列ビットをビット直列の形に
変換して出力する各並直列変換器、この各並直列変換器
の出力によ少周波数シフトキーイングを行う各周波数偏
移変調器、この各周波数偏移変調器の出力周波数が互に
異る周波数となるようにあらかじめ各周波数偏移変調器
を設定しておく手段、上記各周波数偏移変調器の出力を
共通な伝送路により伝送する手段、上記共通外伝送路に
より伝送された信号のうち各周波数偏移変調器からの出
力信号に対応する部分を復調する各復調器、この各復調
器の出力をビット並列の形に変換する各直並列変換器、
この各直並列変換器の出力である各ビット群を再配列し
て上記ディジタル入力信号を再生する手段を備λたディ
ジタル信号の伝送装置。Each parallel-serial converter converts the parallel bits of each bit group into a bit-serial form and outputs the input digital signal in bit-parallel form into a plurality of bit groups. Each frequency shift modulator that performs small frequency shift keying, means for setting each frequency shift modulator in advance so that the output frequencies of each frequency shift modulator are different from each other, and each of the above-mentioned frequencies. means for transmitting the outputs of the shift modulators through a common transmission path; demodulators for demodulating portions of the signals transmitted through the non-common transmission path that correspond to output signals from each frequency shift modulator; each serial-to-parallel converter converting the output of each demodulator into bit-parallel form;
A digital signal transmission device comprising means for rearranging each bit group output from each serial-to-parallel converter to reproduce the digital input signal.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11613081A JPS5817743A (en) | 1981-07-23 | 1981-07-23 | Transmitter for digital signal |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11613081A JPS5817743A (en) | 1981-07-23 | 1981-07-23 | Transmitter for digital signal |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5817743A true JPS5817743A (en) | 1983-02-02 |
Family
ID=14679454
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11613081A Pending JPS5817743A (en) | 1981-07-23 | 1981-07-23 | Transmitter for digital signal |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5817743A (en) |
-
1981
- 1981-07-23 JP JP11613081A patent/JPS5817743A/en active Pending
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