JPS5814604B2 - Linearity compensator in conveyor scale - Google Patents

Linearity compensator in conveyor scale

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JPS5814604B2
JPS5814604B2 JP1074276A JP1074276A JPS5814604B2 JP S5814604 B2 JPS5814604 B2 JP S5814604B2 JP 1074276 A JP1074276 A JP 1074276A JP 1074276 A JP1074276 A JP 1074276A JP S5814604 B2 JPS5814604 B2 JP S5814604B2
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JP
Japan
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signal
analog
output
conveyor
digital converter
Prior art date
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Expired
Application number
JP1074276A
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Japanese (ja)
Other versions
JPS5293369A (en
Inventor
高浜尚敬
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kubota Corp
Original Assignee
Kubota Corp
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Publication date
Application filed by Kubota Corp filed Critical Kubota Corp
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Description

【発明の詳細な説明】 荷重を電圧に変換する荷重変換器コンベヤスケールに取
付けられた(ロードセル)の出力特性は、荷重に比例し
た完全な直線性とはならず歪みが生じるため、その出力
をデイジタルに変換した場合第2図で示すように理想の
直線aに対じ零点と負荷率100%の各点を一致さぜた
状態において、その出力は低い方向への歪特性となり、
負荷率に比例した実際のデイジタル出力を得ることが出
来ず、歪み分の誤差が生じコンベヤスケール等における
積算型式のものでは、その誤差も結果的に積算され積算
時間に比例して誤差も増大することになる。
[Detailed Description of the Invention] The output characteristics of the load cell (load cell) attached to the conveyor scale that converts the load into voltage are not perfectly linear in proportion to the load and distortion occurs. When converted to digital data, as shown in Figure 2, when the zero point and each point at 100% load factor are aligned with the ideal straight line a, the output will have distortion characteristics in the lower direction,
It is not possible to obtain an actual digital output proportional to the load factor, and an error due to distortion occurs.In the case of an integration type such as a conveyor scale, the error is also integrated as a result, and the error increases in proportion to the integration time. It turns out.

従って、本発明は以上の誤差発生を極力防ぐ目的として
、荷重に比例した積算値古なるように補正を行ない直線
性を補償するようにしコンベヤスケールの精度を向上さ
せる装置を提供するものである。
Therefore, in order to prevent the occurrence of the above-mentioned errors as much as possible, the present invention provides an apparatus that improves the accuracy of a conveyor scale by correcting the integrated value proportional to the load to compensate for linearity.

その詳細を添図で示す−実施例に付いて説明する。The details are shown in the accompanying drawings and will be explained in conjunction with examples.

1はロードセル等の荷重変換器で、この荷重変換器1は
コンベヤによって搬送される物品の瞬間重量を検出し、
その重量に比例したアナログ信号Vwを発生するもので
ある。
1 is a load converter such as a load cell, and this load converter 1 detects the instantaneous weight of an article conveyed by a conveyor,
It generates an analog signal Vw proportional to the weight.

2はアナログ・デイジタル変換器で、上記荷重変換器1
からのアナログ信号Vwをデイジタル信号aに変換させ
るものである。
2 is an analog/digital converter, which is the load converter 1 mentioned above.
This converts the analog signal Vw from the digital signal a into a digital signal a.

3は上記コンベヤの搬送速度に比例した単位時間当りに
対応するパルス数の信号Pを発生するパルス発信器で、
この発生パルスは次段のレートマルチプライア4にクロ
ツク入力されるように構成されている。
3 is a pulse transmitter that generates a signal P with a number of pulses per unit time that is proportional to the conveyance speed of the conveyor;
This generated pulse is configured to be clocked into the rate multiplier 4 at the next stage.

又、アナログ・デイジタル変換器2からの出力デイジタ
ル信号aは、次のり・−ド・オンリ・メモリ6にアドレ
ス信号として入力されると同時に、加数人力信号として
加算器7に人力される。
Further, the output digital signal a from the analog-to-digital converter 2 is inputted as an address signal to the next read-only memory 6, and simultaneously inputted to the adder 7 as an addend input signal.

尚、リード・オンリ・メモリ6への入力としては、デイ
ジタル信号aの上位必要桁(例えば上2桁)カ、アドレ
ス信号となり、そのアドレスの指定により予じめ書込み
されている補正値△aが読出しされて、加算器7へ被加
数として入力され、該加算器7において、デイシタル信
号aと補正値△aの加算、即ちa+△aが行なわれる。
As an input to the read-only memory 6, the upper required digits (for example, the first two digits) of the digital signal a serve as an address signal, and the correction value △a written in advance by specifying the address is The digital signal a is read out and input as an addend to the adder 7, where the digital signal a and the correction value Δa are added together, ie, a+Δa.

以上のa+△aの信号はレートマルチプライア4のレー
ト入力とじて与えられる構成で、そのマルチプライ出力
Poは積算計5の積算値とされている。
The above signal a+Δa is given as a rate input to the rate multiplier 4, and its multiply output Po is the integrated value of the integrator 5.

本発明は、以上の構成によるもので、その作用に付いて
述べると、コンベヤにより搬送される物品の荷重は、荷
重変換器1により測定されて、その荷重に比例した瞬間
重量のアナログ信号Vwがアナログ・デイジタル変換器
2に入力されて、デイジタル信号aに変換される。
The present invention has the above-mentioned configuration, and in terms of its operation, the load of the article conveyed by the conveyor is measured by the load converter 1, and an analog signal Vw of the instantaneous weight proportional to the load is generated. The signal is input to an analog-to-digital converter 2 and converted into a digital signal a.

従って、そのデイジタル信号aの上位2桁がアドレス指
定信号としてリード・オンリ・メモリ6に入力され、予
じめ書込みされている補正値△aの読出しが行なわれて
、次の加算器7により、デイジタル信号aと補正値△a
の加算、即ち(a+△a)が行なわれて理想曲線aの値
に略々等しい値となりレートマルチプライア4のレート
入力として与えられる。
Therefore, the upper two digits of the digital signal a are input to the read-only memory 6 as an address designation signal, and the pre-written correction value Δa is read out, and the next adder 7 reads out the correction value Δa. Digital signal a and correction value △a
, that is, (a+Δa) is performed, resulting in a value approximately equal to the value of the ideal curve a, which is given as the rate input to the rate multiplier 4.

従って、前記コンベヤの搬送速度に比例した単位時間当
りに対応してパルス発信器3より発信される信号Pをク
ロツク入力としてマルチプライされ、それの出力Poが
次の積算計5において積算され、搬送に対する総重量が
求められることになる。
Therefore, the signal P transmitted from the pulse transmitter 3 per unit time proportional to the conveyance speed of the conveyor is multiplied as a clock input, and its output Po is integrated in the next totalizer 5, and The total weight will be determined.

以上のように本発明は、アナログ・デイジタル変換器2
の出力側とレートマルチプライア4のレート入力側間に
、デイジタル信号aをアドレス信号とするリード・オン
リ・メモリ6を備えて、アドレス指定により或る値の補
正値△aを出力される構成とし、その補正値△aを、上
記デイジタル信号aに加算して、理想曲線aに対応する
値にし、レートマルチプライア4のレート入力とするよ
うにしたから、荷重変換器1の歪特性に対する誤差がリ
ード・オンリ・メモリ6の補正値△aにより補償される
結果となり高精度な測定が出来る効果がある。
As described above, the present invention provides an analog-to-digital converter 2
A read-only memory 6 which uses digital signal a as an address signal is provided between the output side of the rate multiplier 4 and the rate input side of the rate multiplier 4, and a correction value Δa of a certain value is output by address specification. , the correction value △a is added to the digital signal a to make it a value corresponding to the ideal curve a, which is used as the rate input of the rate multiplier 4, so that the error with respect to the distortion characteristics of the load converter 1 is reduced. This is compensated by the correction value Δa of the read-only memory 6, which has the effect of enabling highly accurate measurement.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図は本発明の構成を示すブロック図、第2図はアナ
ログ・テイジタル変換器の出力と負荷率の関係を示す特
性曲線図である。 1・・・・・荷重変換器、2・・・・・アナログ・テイ
ジタル変換器、3・・・・・・パルス発振器、4・・・
・・・レー1へマルチプライヤ、5・・・・・・積算計
、6・・・・・・リード・オンリ・メモリ、7・・・・
・・加算器。
FIG. 1 is a block diagram showing the configuration of the present invention, and FIG. 2 is a characteristic curve diagram showing the relationship between the output of an analog-to-digital converter and the load factor. 1...Load converter, 2...Analog/digital converter, 3...Pulse oscillator, 4...
... Multiplier to relay 1, 5... Totalizer, 6... Read-only memory, 7...
...Adder.

Claims (1)

【特許請求の範囲】[Claims] 1 コンベヤによって搬送される物品の瞬間重量に比例
したアナログ信号を発生する荷重変換器と、そのアナロ
グ信号をデイジタル信号に変換するアナログ・デイジタ
ル変換器、及び、上記コンベヤの搬送速度に比例した単
位時間当りに対応するパルス数の信号を発生するパルス
発信器を備え、上記アナログ・デイジタル変換器のディ
ジタル信号をレート入力とし、上記パルス発信器からの
パルス信号をクロツク入力としたレー1・マルチプライ
アの出力を積算するコンベヤスケールにおいて、上記ア
ナログ・デイジタル変換器の出力側とレートマルチプラ
イアのレート入力側間へ、アナログ・デイジタル変換器
の出力の上位必要桁をアドレス信号としたリード・オン
リ・メモリと、そのリード・オンリ・メモリの出力信号
を上記アナログ・デイジタル変換器の出力に加算する演
算回路を構成した事を特徴とするコンベヤスケールにお
ける直線性補償装置。
1. A load converter that generates an analog signal proportional to the instantaneous weight of the article conveyed by the conveyor, an analog-digital converter that converts the analog signal into a digital signal, and a unit time proportional to the conveyance speed of the conveyor. a pulse oscillator that generates a signal with a number of pulses corresponding to the number of pulses hit, a rate input of the digital signal from the analog-to-digital converter, and a clock input of the pulse signal from the pulse oscillator. In the conveyor scale that integrates the output, a read-only memory is connected between the output side of the analog-to-digital converter and the rate input side of the rate multiplier, using the upper required digits of the output of the analog-to-digital converter as an address signal. , a linearity compensation device for a conveyor scale, comprising an arithmetic circuit that adds the output signal of the read-only memory to the output of the analog-to-digital converter.
JP1074276A 1976-02-02 1976-02-02 Linearity compensator in conveyor scale Expired JPS5814604B2 (en)

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JPS5293369A JPS5293369A (en) 1977-08-05
JPS5814604B2 true JPS5814604B2 (en) 1983-03-19

Family

ID=11758742

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JPS56124023A (en) * 1980-03-05 1981-09-29 Toyo Baldwin:Kk Actual measurement and calibration control method based on inspection records of weighing scale
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